TW202034338A - 閘極驅動電路以及移位暫存器的控制方法 - Google Patents

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Abstract

一種閘極驅動電路，包含多級且串接的複數個移位暫存器，其中第n級移位暫存器包含驅動電路、上拉電路、第一輔助穩壓電路以及第二輔助穩壓電路。驅動電路電性耦接至輸出端以及第一節點，上拉電路電性耦接至驅動電路。第一輔助穩壓電路電性耦接至上拉電路，用以接收控制訊號，並根據控制訊號將第n級第一電壓維持在第二低電壓。第二輔助穩壓電路電性耦接至上拉電路，用以接收控制訊號，並根據控制訊號將第n級第一電壓維持在第二低電壓。

Description

閘極驅動電路以及移位暫存器的控制方 法
本揭示文件有關一種閘極驅動電路以及移位暫存器的控制方法，尤指一種用於不同更新率的閘極驅動電路以及移位暫存器的控制方法。
一般而言，顯示裝置中的閘極驅動電路是由多級且串接的移位暫存器組成，每級移位暫存器用以輸出當級的閘極驅動訊號，並透過此閘極驅動訊號開啟對應的畫素列，使得該畫素列中的每一畫素皆能寫入顯示資料。
近年來，為了滿足消費者的需求，高解析度的高階顯示面板可維持畫面品質，通常採用較高畫面更新率(Frame Rate)，例如120Hz的畫面更新率。但面板廠商為了符合不同客戶的需求，也會需要提供較低畫面更新率，例如60Hz的畫面更新率。因此，需要一種可以符合不同畫面更新率的顯示面板。
本案之第一實施態樣是在提供一種閘極驅動電路，包含多級且串接的複數個移位暫存器，其中第n級移位暫存器包含：驅動電路、上拉電路、第一輔助穩壓電路以及第二輔助穩壓電路。驅動電路電性耦接至輸出端以及第一節點，用以接收時脈訊號並且根據時脈訊號輸出閘級訊號。上拉電路電性耦接至驅動電路，用以接收時脈訊號、高電壓以及一第(n-4)級傳遞訊號，並將第一節點的第n級第一電壓抬升至高準位。第一輔助穩壓電路電性耦接至上拉電路，用以接收控制訊號，並根據控制訊號將第n級第一電壓維持在第二低電壓。第二輔助穩壓電路電性耦接至上拉電路，用以接收控制訊號，並根據控制訊號將第n級第一電壓維持在第二低電壓。
本案之第二實施態樣是在提供一種移位暫存器的控制方法，包含：當移位暫存電路操作於第一更新率時，控制訊號切換至致能位準，使得第一輔助穩壓電路以及第二輔助穩壓電路將第一節點的電壓維持在第二低電壓；以及當移位暫存電路操作於第二更新率時，控制訊號切換至禁能位準，以減少於移位暫存電路的第一節點上之漏電流。其中，第一輔助穩壓電路包含第一電晶體以及第二電晶體，第二輔助穩壓電路包含第三電晶體以及第四電晶體。
本揭閘極驅動電路以及移位暫存器的控制方法主要係提升顯示面板在較高更新率的穩壓能力，以及利用新的電路設計讓顯示面板在較低更新率時，可以減少電晶體的漏電問題，達到讓顯示面板可以操作於不同畫面更新率的功 效。
100‧‧‧閘極驅動電路
200、SR1~SRn‧‧‧移位暫存器
210‧‧‧驅動電路
220‧‧‧上拉電路
230‧‧‧下拉電路
240、260‧‧‧穩壓控制電路
250、270‧‧‧穩壓電路
251、271‧‧‧輔助穩壓電路
280‧‧‧重置電路
Q、S、P、K‧‧‧節點
G1~Gn、G(n+4)‧‧‧閘極訊號
HC1~HCn‧‧‧時脈訊號
T21、T11、T12、T31、T32、T33、T34、T35、T41、T51、T52、T53、T54、T55、T56、T61、T62、T63、T64、T65、T66、T42a、T42b、T42c、T43a、T43b、T43c、T44‧‧‧電晶體
S(n)、S(n+4)、S(n-4)‧‧‧傳遞訊號
VSS1、VSS2‧‧‧低電壓
OUT‧‧‧輸出端
LC1、LC2‧‧‧操作訊號
Q(n)、Q(n-2)、P(n)、K(n)‧‧‧電壓訊號
CTL‧‧‧控制訊號
ST‧‧‧起始訊號
V1‧‧‧第一電壓
V2‧‧‧工作電壓
VGHD‧‧‧高電壓
PH‧‧‧高準位
PL‧‧‧低準位
C‧‧‧電容
400‧‧‧移位暫存器的控制方法
S410~S420‧‧‧步驟
為讓揭示文件之上述和其他目的、特徵、優點與實施例能更明顯易懂，所附圖式之說明如下：第1圖為根據本揭示文件一實施例的閘極驅動電路的電路方塊圖；第2圖為根據本揭示文件一實施例的移位暫存器的電路圖；第3圖為根據本揭示文件一實施例的移位暫存器的運作時序圖；以及第4圖為根據本揭示文件一實施例的移位暫存器的控制方法的流程圖。
以下將配合相關圖式來說明本發明的實施例。在圖式中，相同的標號表示相同或類似的元件或方法流程。
請參閱第1圖。第1圖為根據本揭示文件一實施例的閘極驅動電路100的電路方塊圖。如第1圖所繪示，閘極驅動電路100包含多級且串接的複數個移位暫存器SR1、SR2、SR3、SR4、SR5、SR6...、SRn。每一移位暫存器SR1~SRn分別輸出對應的閘極訊號G1、G2、G3、G4、G5、G6...、Gn，並且每一移位暫存器SR1~SRn分別電性耦接至對應的時脈訊號HC1、HC2、HC3、HC4、HC5、 HC6...、HCn。
進一步參考第2圖，第2圖為根據本揭示文件一實施例的移位暫存器200的電路圖。如第2圖所繪示，移位暫存器200包含驅動電路210、上拉電路220、下拉電路230、穩壓控制電路240及260、穩壓電路250及270、輔助穩壓電路251及271以及重置電路280。驅動電路210電性耦接至輸出端OUT以及節點Q，上拉電路220電性耦接至驅動電路210、穩壓電路250及270以及輔助穩壓電路251及271。下拉電路230電性耦接至驅動電路210以及節點Q，穩壓電路250電性耦接至節點S、上拉電路220以及該輔助穩壓電路251，穩壓電路270電性耦接至節點S、上拉電路220以及輔助穩壓電路270。穩壓控制電路240電性耦接至輔助穩壓電路251，穩壓控制電路260電性耦接至輔助穩壓電路271，重置電路280電性耦接至上拉電路220。
承上述，驅動電路210用以接收時脈訊號HCn並且根據時脈訊號HCn輸出閘級訊號Gn。於此實施例中，移位暫存器以第5級移位暫存器(n=5)為例，因此驅動電路210用以根據時脈訊號HC5輸出閘級訊號G5。驅動電路210包含電晶體T21，電晶體T21的第一端用以接收時脈訊號HCn(在此情況中，電晶體T21的第一端用以接收時脈訊號HC5)，電晶體T21的第二端電性耦接至輸出端OUT，電晶體T21的控制端電性耦接至節點Q。
承上述，上拉電路220用以接收時脈訊號HCn、高電壓VGHD以及節點S的第(n-4)級傳遞訊號 S(n-4)，並將節點Q的第n級電壓訊號Q(n)抬升至高準位。上拉電路220包含電晶體T11及T12。電晶體T11的第一端用以接收高電壓VGHD，電晶體T11的第二端電性耦接至節點Q，電晶體T11的控制端用以接收第(n-4)級傳遞訊號S(n-4)。電晶體T12的第一端用以接收時脈訊號HCn，電晶體T12的第二端電性耦接至節點S，電晶體T12的控制端電性耦接至電晶體T11的第二端。於此實施例中，電晶體T11的控制端用以接收第1級傳遞訊號S1，電晶體T21的第一端用以接收時脈訊號HC5。
承上述，下拉電路230用以接收第(n+4)級傳遞訊號S(n+4)以及第(n+4)級閘極訊號G(n+4)，並將閘級訊號Gn拉低至低電壓VSS1以及節點Q的第n級電壓訊號Q(n)拉低至低電壓VSS2。下拉電路230包含電晶體T31及T41。電晶體T31的第一端電性耦接至輸出端OUT，電晶體T31的第二端電性耦接至低電壓VSS1，電晶體T31的控制端用以接收第(n+4)級閘極訊號G(n+4)。電晶體T41的第一端電性耦接至節點Q，電晶體T41的第二端性耦接至低電壓VSS2，電晶體T41的控制端用以接收第(n+4)級傳遞訊號S(n+4)。於此實施例中，電晶體T31的控制端用以接收第9級閘極訊號G9，電晶體T41的控制端用以接收第9級傳遞訊號S9。
承上述，穩壓控制電路240用以接收第一操作訊號LC1、節點Q的第n級電壓訊號Q(n)以及節點Q的第(n-2)級電壓訊號Q(n-2)，並控制輔助穩壓電路251以及穩 壓電路250。穩壓控制電路240包含電晶體T51、T52、T53、T54、T55及T56。電晶體T51的第一端電性耦接至電晶體T51的控制端，電晶體T51的控制端用以接收操作訊號LC1。電晶體T52的第一端電性耦接至電晶體T51的第一端，電晶體T52的第二端電性耦接至節點P，電晶體T52的控制端電性耦接至電晶體T51的第二端。
承上述，電晶體T53的第一端電性耦接至電晶體T52的控制端，電晶體T53的第二端電性耦接至低電壓VSS2，電晶體T53的控制端用以接收節點Q的第n級電壓訊號Q(n)。電晶體T54的第一端電性耦接至節點P，電晶體T54的第二端電性耦接至低電壓VSS2，電晶體T54的控制端用以接收節點Q的第n級電壓訊號Q(n)。電晶體T55的第一端電性耦接至電晶體T51的第二端，電晶體T55的第二端電性耦接至低電壓VSS2，電晶體T55的控制端用以接收節點Q的第(n-2)級電壓訊號Q(n-2)。電晶體T56的第一端電性耦接至節點P，電晶體T56的第二端電性耦接至低電壓VSS2，電晶體T56的控制端用以接收節點Q的第(n-2)級電壓訊號Q(n-2)。於此實施例中，電晶體T53及T54的控制端用以接收第5級電壓訊號Q(5)，電晶體T55及T56的控制端用以接收第3級電壓訊號Q(3)。
承上述，穩壓電路250用以接收節點P的電壓訊號P(n)，並將閘級訊號G(n)維持在低電壓VSS1，以及節點Q的第n級電壓訊號Q(n)以及節點S的第n級傳遞訊號S(n)維持在低電壓VSS2。穩壓電路250包含電晶體T42a、T32 及T34以及電容C。電容C的第一端電性耦接至節點Q，電容C的第二端電性耦接至輸出端OUT。電晶體T42a的第一端電性耦接至電容C的第一端，電晶體T42a的第二端電性耦接至低電壓VSS2，電晶體T42a的控制端用以接收節點P的第n級電壓訊號P(n)。電晶體T32的第一端電性耦接至電容C的第二端，電晶體T32的第二端電性耦接至低電壓VSS1，電晶體T32的控制端用以接收節點P的第n級電壓訊號P(n)。電晶體T34的第一端電性耦接至節點S，電晶體T34的第二端電性耦接至低電壓VSS2，電晶體T34的控制端用以接收節點P的第n級電壓訊號P(n)。
承上述，輔助穩壓電路251用以接收控制訊號CTL，並根據控制訊號CTL將節點Q的第n級電壓Q(n)維持在低電壓VSS2。輔助穩壓電路251包含電晶體T42b及T42c。電晶體T42b的第一端電性耦接至節點Q，電晶體T42b的控制端用以接收節點P的第n級電壓訊號P(n)。電晶體T42c的第一端電性耦接至電晶體T42b的第二端，電晶體T42c的第二端電性耦接至低電壓VSS2，電晶體T42c的控制端用以接收控制訊號CTL。
承上述，穩壓控制電路260用以接收第一操作訊號LC2、節點Q的第n級電壓訊號Q(n)以及節點Q的第(n-2)級電壓訊號Q(n-2)，並控制輔助穩壓電路271以及穩壓電路270。穩壓控制電路260包含電晶體T61、T62、T63、T64、T65及T66。電晶體T61的第一端電性耦接至電晶體T61的控制端，電晶體T61的控制端用以接收操作訊號 LC2。電晶體T62的第一端電性耦接至電晶體T61的第一端，電晶體T62的第二端電性耦接至節點K，電晶體T62的控制端電性耦接至電晶體T61的第二端。
承上述，電晶體T63的第一端電性耦接至電晶體T62的控制端，電晶體T63的第二端電性耦接至低電壓VSS2，電晶體T63的控制端用以接收節點Q的第n級電壓訊號Q(n)。電晶體T64的第一端電性耦接至節點K，電晶體T64的第二端電性耦接至低電壓VSS2，電晶體T64的控制端用以接收節點Q的第n級電壓訊號Q(n)。電晶體T65的第一端電性耦接至電晶體T61的第二端，電晶體T65的第二端電性耦接至低電壓VSS2，電晶體T65的控制端用以接收節點Q的第(n-2)級電壓訊號Q(n-2)。電晶體T66的第一端電性耦接至節點K，電晶體T66的第二端電性耦接至低電壓VSS2，電晶體T66的控制端用以接收節點Q的第(n-2)級電壓訊號Q(n-2)。於此實施例中，電晶體T63及T64的控制端用以接收第5級電壓訊號Q(5)，電晶體T65及T66的控制端用以接收第3級電壓訊號Q(3)。
承上述，穩壓電路270用以接收節點K的電壓訊號K(n)，並將閘級訊號G(n)維持在低電壓VSS1，以及節點Q的第n級電壓訊號Q(n)以及節點S的第n級傳遞訊號S(n)維持在低電壓VSS2。穩壓電路270包含電晶體T43a、T33及T33。電晶體T43a的第一端電性耦接至電晶體T11的第二端，電晶體T43a的第二端電性耦接至低電壓VSS2，電晶體T43a的控制端用以接收節點K的第n級電壓訊號K(n)。電晶 體T33的第一端電性耦接至輸出端OUT，電晶體T33的第二端電性耦接至低電壓VSS1，電晶體T33的控制端用以接收節點K的第n級電壓訊號K(n)。電晶體T35的第一端電性耦接至節點S，電晶體T35的第二端電性耦接至低電壓VSS2，電晶體T35的控制端用以接收節點K的第n級電壓訊號K(n)。
承上述，輔助穩壓電路271用以接收控制訊號CTL，並根據控制訊號CTL將節點Q的第n級電壓訊號Q(n)維持在低電壓VSS2。輔助穩壓電路271包含電晶體T43b及T43c。電晶體T43b的第一端電性耦接至節點Q，電晶體T43b的控制端用以接收節點K的第n級電壓訊號K(n)。電晶體T43c的第一端電性耦接至電晶體T43b的第二端，電晶體T42c的第二端電性耦接至低電壓VSS2，電晶體T43c的控制端用以接收控制訊號CTL。
承上述，重置電路280用以接收起始訊號ST，並根據起始訊號ST重置節點Q的第n級電壓訊號Q(n)。重置電路280包含電晶體T44。電晶體T44的第一端電性耦接至節點Q，電晶體T44的第二端電性耦接至低電壓VSS2，電晶體T44的控制端用以接收起始訊號ST。
實作上，本揭露所述之電晶體可以用P型的低溫多晶矽薄膜電晶體來實現，但本實施例並不以此為限。例如，電晶體也可以用P型的非晶矽(amorphous silicon)薄膜電晶體或其他型式的薄膜電晶體來實現。
以下將配合第1圖~第3圖來進一步說明移位暫 存器200的運作方式，第3圖為根據本揭示文件一實施例的移位暫存器200的運作時序圖。如第3圖所示，在階段TP1中，起始訊號ST為高準位PH以及節點Q的第(n-2)級電壓訊號Q(n-2)為工作電壓V2，使得電晶體T44、T55、T56、T65及T66為導通狀態，將節點Q、P及K的電壓位準重置到低電壓VSS2。
接著，在階段TP2中，節點S的第(n-4)級傳遞訊號S(n-4)為高準位PH使得電晶體T11為導通狀態，將節點Q的電壓位準耦合至第一電壓V1。此時，節點Q的第n級電壓訊號Q(n)為第一電壓V1，使得電晶體T53、T54、T63及T64為導通狀態，將電晶體T52、T62、T42a、T42b、T32、T34、T43a、T43b、T33及T35的控制端維持在低電壓VSS2。
接著，在階段TP3中，由於電晶體T11及T44為關斷狀態，電晶體T12及T21因為節點Q的第n級電壓訊號Q(n)為第一電壓V1而處於導通狀態以及時脈訊號HCn為高準位PH，使得電晶體T12傳輸時脈訊號HCn作為傳遞訊號S(n)，以及電晶體T21傳輸時脈訊號HCn作為閘極訊號G(n)。此時，節點Q的第n級電壓訊號Q(n)再被時脈訊號HCn耦合至工作電壓V2。接著，在階段TP4中，由於時脈訊號HCn為低準位PL，使得節點Q的第n級電壓訊號Q(n)為第一電壓V1。
接著，在階段TP5中，由於第(n+4)級傳遞訊號S(n+4)以及第(n+4)級閘極訊號G(n+4)為高準位PH，使得 電晶體T31及T41為導通狀態，電晶體T31會將閘極訊號G(n)拉低至低電壓VSS1，電晶體T41會將節點Q的第n級電壓訊號Q(n)拉低至低電壓VSS2。此時，由於節點Q的第n級電壓訊號Q(n)以及節點Q的第(n-2)級電壓訊號Q(n-2)為低電壓VSS2，因此電晶體T51、T52、T61及T62會因為操作訊號LC1及LC2導通，使得電晶體T32、T33、T34、T35、T42a、T42b、T43a以及T43b導通，電晶體T34及T35用以將節點S的電壓維持在低位準VSS2，電晶體T32及T33用以將閘極訊號G(n)維持在低位準VSS1，電晶體T42a及T43a用以將節點Q的電壓維持在低位準VSS2。
於一實施例中，如果控制訊號CTL為高位準PH，使得電晶體T42c及T43c為導通狀態，因此在階段TP5中可以幫助電晶體T42a及T43a將節點Q的電壓維持在低位準VSS2。在此情況中，控制訊號CTL可以實施為高電壓VGHD。
於另一實施例中，如果控制訊號CTL為低位準PL，使得電晶體T42c及T43c為關斷狀態，因此在階段TP5中由於電晶體T42c及T43c為關斷狀態，並且電晶體T42b及T43b為關斷狀態，因此可以降低節點Q的漏電流。在此情況中，控制訊號CTL可以實施為起始訊號ST。
請參考第4圖，第4圖為根據本揭示文件一實施例的移位暫存器的控制方法400的流程圖。如第4圖所繪示，移位暫存器的控制方法400首先執行步驟S410當移位暫存電路200操作於第一更新率時，控制訊號CTL切換至致 能位準，使得輔助穩壓電路251及271將節點Q的電壓維持在低電壓。於此實施例中，第一更新率可以實施為較高的畫面更新率(例如，120Hz)。如果顯示面板採用較高的畫面更新率可以利用致能控制訊號CTL，讓電晶體T42b、T43b、T42c及T43c幫助電晶體T42a及T43a將節點Q的電壓維持在低位準VSS2，以增加移位暫存器的穩壓能力。
接著，移位暫存器的控制方法400執行步驟S420當移位暫存電路200操作於第二更新率時，控制訊號CTL切換至禁能位準，以減少於移位暫存電路200的節點Q上之漏電流。於此實施例中，第二更新率可以實施為較低的畫面更新率(例如，60Hz)。如果顯示面板採用較低的畫面更新率可以利用禁能控制訊號CTL，以及電晶體T42b及T43b於禁能狀態時，可以減少節點Q的漏電流，以減少移位暫存器的漏電路徑。
綜上所述，本揭露之閘極驅動電路以及移位暫存器的控制方法主要係提升顯示面板在較高更新率的穩壓能力，以及利用新的電路設計讓顯示面板在較低更新率時，可以減少電晶體的漏電問題，達到讓顯示面板可以操作於不同畫面更新率的功效。
在說明書及申請專利範圍中使用了某些詞彙來指稱特定的元件。然而，所屬技術領域中具有通常知識者應可理解，同樣的元件可能會用不同的名詞來稱呼。說明書及申請專利範圍並不以名稱的差異做為區分元件的方式，而是以元件在功能上的差異來做為區分的基準。在說明書及申請 專利範圍所提及的「包含」為開放式的用語，故應解釋成「包含但不限定於」。另外，「耦接」在此包含任何直接及間接的連接手段。因此，若文中描述第一元件耦接於第二元件，則代表第一元件可通過電性連接或無線傳輸、光學傳輸等信號連接方式而直接地連接於第二元件，或者通過其他元件或連接手段間接地電性或信號連接至該第二元件。
另外，除非說明書中特別指明，否則任何單數格的用語都同時包含複數格的涵義。
以上僅為本發明的較佳實施例，凡依本發明請求項所做的均等變化與修飾，皆應屬本發明的涵蓋範圍。
100‧‧‧閘極驅動電路
SR1~SRn‧‧‧移位暫存器
G1~Gn‧‧‧閘極訊號
HC1~HCn‧‧‧時脈訊號
VSS1、VSS2‧‧‧低電壓
LC1、LC2‧‧‧操作訊號
CTL‧‧‧控制訊號

Claims (20)

  1. 一種閘極驅動電路，包含多級且串接的複數個移位暫存器，其中第n級移位暫存器包含：一驅動電路，電性耦接至一輸出端以及一第一節點，用以接收一時脈訊號並且根據該時脈訊號輸出一閘級訊號；一上拉電路，電性耦接至該驅動電路，用以接收該時脈訊號、一高電壓以及一第(n-4)級傳遞訊號，並將該第一節點的一第n級第一電壓抬升至一工作電壓；一第一輔助穩壓電路，電性耦接至該上拉電路，用以接收一控制訊號，並根據該控制訊號將該第n級第一電壓維持在一第二低電壓；以及一第二輔助穩壓電路，電性耦接至該上拉電路，用以接收該控制訊號，並根據該控制訊號將該第n級第一電壓維持在該第二低電壓。
  2. 如請求項1所述的閘極驅動電路，更包含：一下拉電路，電性耦接至該驅動電路以及該第一節點，用以接收一第(n+4)級傳遞訊號以及一第(n+4)級閘極訊號，並將該閘級訊號拉低至一第一低電壓以及該第n級第一電壓拉低至該第二低電壓。
  3. 如請求項1所述的閘極驅動電路，更包含：一第一穩壓電路，電性耦接至一第二節點、該上拉電 路以及該第一輔助穩壓電路，用以接收一第三節點的一第三電壓，並將該閘級訊號維持在一第一低電壓，以及該第n級第一電壓以及一第n級傳遞訊號維持在該第二低電壓；以及一第二穩壓電路，電性耦接至該第二節點、該上拉電路以及該第二輔助穩壓電路，用以接收一第四節點的一第四電壓，並將該閘級訊號維持在該第一低電壓，以及該第n級第一電壓以及該第n級傳遞訊號維持在該第二低電壓。
  4. 如請求項3所述的閘極驅動電路，更包含：一第一穩壓控制電路，電性耦接至該第一輔助穩壓電路，用以接收一第一操作訊號、該第n級第一電壓以及一第(n-2)級第一電壓，並控制該第一輔助穩壓電路以及該第一穩壓電路；以及一第二穩壓控制電路，電性耦接至該第二輔助穩壓電路，用以接收一第二操作訊號、該第n級第一電壓以及該第(n-2)級第一電壓，並控制該第二輔助穩壓電路以及該第二穩壓電路。
  5. 如請求項1所述的閘極驅動電路，更包含：一重置電路，電性耦接至該上拉電路，用以接收一起始訊號，並根據該起始訊號重置該第n級第一電壓。
  6. 如請求項1所述的閘極驅動電路，其中該 驅動電路，更包含：一電晶體，具有一第一端、一第二端以及一控制端，該第一端用以接收該時脈訊號，該第二端電性耦接至該輸出端，該控制端電性耦接至該第一節點。
  7. 如請求項1所述的閘極驅動電路，其中該上拉電路，更包含：一第一電晶體，具有一第一端、一第二端以及一第一控制端，該第一端用以接收該高電壓，該第二端電性耦接至該第一節點，該第一控制端用以接收該第(n-4)級傳遞訊號；以及一第二電晶體，具有一第三端、一第四端以及一第二控制端，該第三端用以接收該時脈訊號，該第四端電性耦接至一第二節點，該第二控制端電性耦接至該第二端。
  8. 如請求項1所述的閘極驅動電路，其中該第一輔助穩壓電路，更包含：一第一電晶體，具有一第一端、一第二端以及一第一控制端，該第一端電性耦接至該第一節點，該第一控制端電性耦接至一第三節點；以及一第二電晶體，具有一第三端、一第四端以及一第二控制端，該第三端電性耦接至該第二端，該第四端電性耦接至該第二低電壓，該第二控制端用以接收該控制訊號。
  9. 如請求項8所述的閘極驅動電路，其中，當該控制訊號於一致能位準時，使得該第二電晶體導通，該第一電晶體以及該第二電晶體將該第n級第一電壓維持在該第二低電壓。
  10. 如請求項1所述的閘極驅動電路，其中該第二輔助穩壓電路，更包含：一第一電晶體，具有一第一端、一第二端以及一第一控制端，該第一端電性耦接至該第一節點，該第一控制端電性耦接至一第四節點；以及一第二電晶體，具有一第三端、一第四端以及一第二控制端，該第三端電性耦接至該第二端，該第四端電性耦接至該第二低電壓，該第二控制端用以接收該控制訊號。
  11. 如請求項10所述的閘極驅動電路，其中，當該控制訊號於一致能位準時，使得該第二電晶體導通，該第一電晶體以及該第二電晶體將該第n級第一電壓維持在該第二低電壓。
  12. 如請求項2所述的閘極驅動電路，其中該下拉電路，更包含：一第一電晶體，具有一第一端、一第二端以及一第一控制端，該第一端電性耦接至該輸出端，該第二端電性耦接至該第一低電壓，該第一控制端用以接收該第(n+4)級 閘極訊號；以及一第二電晶體，具有一第三端、一第四端以及一第二控制端，該第三端電性耦接至該第一節點，該第四端電性耦接至該第二低電壓，該第二控制端用以接收該第(n+4)級傳遞訊號。
  13. 如請求項3所述的閘極驅動電路，其中該第一穩壓電路，更包含：一第一電晶體，具有一第一端、一第二端以及一第一控制端，該第一端電性耦接至該第二節點，該第二端電性耦接至該第二低電壓，該第一控制端電性耦接至該第三節點；一第二電晶體，具有一第三端、一第四端以及一第二控制端，該第三端電性耦接至該輸出端，該第四端電性耦接至該第一低電壓，該第二控制端電性耦接至該第三節點；以及一第三電晶體，具有一第五端、一第六端以及一第三控制端，該第五端電性耦接至該第一節點，該第六端電性耦接至該第二低電壓，該第二控制端電性耦接至該第三節點。
  14. 如請求項3所述的閘極驅動電路，其中該第二穩壓電路，更包含：一第一電晶體，具有一第一端、一第二端以及一第一 控制端，該第一端電性耦接至該第二節點，該第二端電性耦接至該第二低電壓，該第一控制端電性耦接至該第四節點；一第二電晶體，具有一第三端、一第四端以及一第二控制端，該第三端電性耦接至該輸出端，該第四端電性耦接至該第一低電壓，該第二控制端電性耦接至該第四節點；以及一第三電晶體，具有一第五端、一第六端以及一第三控制端，該第五端電性耦接至該第一節點，該第六端電性耦接至該第二低電壓，該第三控制端電性耦接至該第四節點。
  15. 如請求項4所述的閘極驅動電路，其中該第一穩壓控制電路，更包含：一第一電晶體，具有一第一端、一第二端以及一第一控制端，該第一端電性耦接至該第一控制端，該第一控制端用以接收該第一操作訊號；一第二電晶體，具有一第三端、一第四端以及一第二控制端，該第三端電性耦接至該第一端，該第四端電性耦接至該第三節點，該第二控制端電性耦接至該第二端；一第三電晶體，具有一第五端、一第六端以及一第三控制端，該第五端電性耦接至該第二控制端，該第六端電性耦接至該第二低電壓，該第三控制端用以接收該第n級第一電壓； 一第四電晶體，具有一第七端、一第八端以及一第四控制端，該第七端電性耦接至該第三節點，該第八端電性耦接至該第二低電壓，該第四控制端用以接收該第n級第一電壓；一第五電晶體，具有一第九端、一第十端以及一第五控制端，該第九端電性耦接至該第二端，該第十端電性耦接至該第二低電壓，該第五控制端用以接收該第(n-2)級第一電壓；以及一第六電晶體，具有一第十一端、一第十二端以及一第六控制端，該第十一端電性耦接至該第三節點，該第十二端電性耦接至該第二低電壓，該第六控制端用以接收該第(n-2)級第一電壓。
  16. 如請求項4所述的閘極驅動電路，其中該第二穩壓控制電路，更包含：一第一電晶體，具有一第一端、一第二端以及一第一控制端，該第一端電性耦接至該第一控制端，該第一控制端用以接收該第二操作訊號；一第二電晶體，具有一第三端、一第四端以及一第二控制端，該第三端電性耦接至該第一端，該第四端電性耦接至該第四節點，該第二控制端電性耦接至該第二端；一第三電晶體，具有一第五端、一第六端以及一第三控制端，該第五端電性耦接至該第二控制端，該第六端電性耦接至該第二低電壓，該第三控制端用以接收該第n級 第一電壓；一第四電晶體，具有一第七端、一第八端以及一第四控制端，該第七端電性耦接至該第四節點，該第八端電性耦接至該第二低電壓，該第四控制端用以接收該第n級第一電壓；一第五電晶體，具有一第九端、一第十端以及一第五控制端，該第九端電性耦接至該第二端，該第十端電性耦接至該第二低電壓，該第五控制端用以接收該第(n-2)級第一電壓；以及一第六電晶體，具有一第十一端、一第十二端以及一第六控制端，該第十一端電性耦接至該第四節點，該第十二端電性耦接至該第二低電壓，該第六控制端用以接收該第(n-2)級第一電壓。
  17. 如請求項5所述的閘極驅動電路，其中該重置電路，更包含：一電晶體，具有一第一端、一第二端以及一控制端，該第一端電性耦接至該第一節點，該第二端電性耦接至該第二低電壓，該控制端用以接收該起始訊號。
  18. 一種移位暫存器的控制方法，包含：當一移位暫存電路操作於一第一更新率時，一控制訊號切換至一致能位準，使得一第一輔助穩壓電路以及一第二輔助穩壓電路將一第一節點的電壓維持在一第二低電 壓；以及當該移位暫存電路操作於一第二更新率時，該控制訊號切換至一禁能位準，以減少於該移位暫存電路的該第一節點上之一漏電流；其中，該第一輔助穩壓電路包含一第一電晶體以及一第二電晶體，該第二輔助穩壓電路包含一第三電晶體以及一第四電晶體。
  19. 如請求項18所述的移位暫存器的控制方法，其中當該控制訊號以及一第一操作訊號於該致能位準時，該第一電晶體以及該第二電晶體導通，當該控制訊號以及一第二操作訊號於該致能位準時，該第三電晶體以及該第四電晶體導通，該第一電晶體、該第二電晶體、該第三電晶體以及該第四電晶體用以將該第一節點的電壓維持在該第二低電壓。
  20. 如請求項18所述的移位暫存器的控制方法，其中當該控制訊號於該禁能位準時，該第二電晶體以及該第四電晶體關斷。
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