SU543958A1 - Симмирующее устройство дл цифрового дифференциального анализатора - Google Patents
Симмирующее устройство дл цифрового дифференциального анализатораInfo
- Publication number
- SU543958A1 SU543958A1 SU1897993A SU1897993A SU543958A1 SU 543958 A1 SU543958 A1 SU 543958A1 SU 1897993 A SU1897993 A SU 1897993A SU 1897993 A SU1897993 A SU 1897993A SU 543958 A1 SU543958 A1 SU 543958A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- simulator
- digital differential
- differential analyzer
- elements
- inputs
- Prior art date
Links
Landscapes
- Complex Calculations (AREA)
Description
1
Изобретение относитс к вычиспитепь (ной технике и предназначено дл суммирощани приращений в цифровых дифференци )апьных анализаторах.
Известно суммирующее усгройстЕьо, содержащее регистры, элементы И l.
Это устройство имеет низкое быстродей ствие.
Известно также устройство, содержащее блок пам ти и блок синхронизации.
Известное устройство обладает сложной структурой, так как дл его реализации необходим реверсивный счетчик, сдвигающий регистр, однозар дный сумматор.
Целью изобретени вл етс упрощение устройства.
Поставленна цель достигаетс тем, 4Tq устройство содержит блок управлени , два элемента ИЛИ, два элемента И, счетчик, первый и второй вь1ходы которого соединен р первыми входами соответственно первого и второго элемента ИЛИ, первый выход блока синхронизации соединен со вторым уходом первого элемеита ИЛИ, первыми элементов И и счетчика, второй БЫхор
блока синхронизаци соеднпен через блок управлени со вторыми входами элементов И и блока naufiTit, выходы первого и второго
элементов ИЛИ соединены соответственно
I
с третьими входами первого и второго эл:е- ,ментов И, выходы которых соединены cooT-f ветственно со вторым н третьим входами счетчика, третий выход которого соеди le icj третьим входом блока пам ти, первый ьыхо(ц (Которого соединен с четвертым входом счетчика , а второй выход вл етс выходом устройства , третий и второй входы соответственно первого и второго элементов ИЛИ в лаютс входами устройства.
На чертеже приведена схема устройства; Она содержит первый элемент ИЛИ 1, второй элемент ИЛИ 2, первый элемент И 3, второй эпеме гг И 4, блок пам ти 5, счетчик 6, блок управлени 7 и блок синхронизации 8.
Счетчик 6 построен на основе фазо-импульсного многоустойчивого элемента и предназначен дл поразр дного суммирова- ни чисел, представленных в фазо-импульс .ном и число-импульсном кодах. Блок управу
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU1897993A SU543958A1 (ru) | 1973-03-27 | 1973-03-27 | Симмирующее устройство дл цифрового дифференциального анализатора |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU1897993A SU543958A1 (ru) | 1973-03-27 | 1973-03-27 | Симмирующее устройство дл цифрового дифференциального анализатора |
Publications (1)
Publication Number | Publication Date |
---|---|
SU543958A1 true SU543958A1 (ru) | 1977-01-25 |
Family
ID=20546736
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU1897993A SU543958A1 (ru) | 1973-03-27 | 1973-03-27 | Симмирующее устройство дл цифрового дифференциального анализатора |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU543958A1 (ru) |
-
1973
- 1973-03-27 SU SU1897993A patent/SU543958A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU543958A1 (ru) | Симмирующее устройство дл цифрового дифференциального анализатора | |
GB1330700A (en) | Real time fast fourier transform processor with sequential access memory | |
SU556500A1 (ru) | Ячейка пам ти дл сдвигового регистра | |
SU450198A1 (ru) | Цифрова интегрирующа система дл решени линейных дифференциальных уравнений | |
SU648978A1 (ru) | Устройство дл сравнени двоичных чисел | |
SU864340A1 (ru) | Устройство дл сдвига информации | |
SU397906A1 (ru) | Цифровое точечное квазиобрати/иое интегрирующее устройство | |
SU932484A1 (ru) | Устройство дл сравнени чисел | |
SU1444760A1 (ru) | Устройство дл возведени в квадрат последовательного р да чисел | |
SU729587A1 (ru) | Устройство дл умножени | |
SU864275A1 (ru) | Устройство дл ввода информации | |
SU521570A1 (ru) | Устройство дл определени функции | |
SU744590A1 (ru) | Цифровой функциональный преобразователь | |
SU392494A1 (ru) | I ВСЕСОЮЗНАЯ|j;rn-:-fVi|O.TF)inHMFnMMАвторыЗа вительКиевска экспедици Украинского научно-исследовательскогогеологоразведоуного институтаSHSJiHOTEKA | |
SU435523A1 (ru) | Устройство вычитания | |
SU913367A1 (ru) | Устройство для сравнения двоичных чисел 1 | |
SU525116A1 (ru) | Частотный интегратор | |
SU875462A1 (ru) | Регистр сдвига | |
SU1129610A1 (ru) | Устройство дл извлечени квадратного корн из суммы квадратов двух чисел | |
SU427388A1 (ru) | Устройство сдвига | |
SU568051A1 (ru) | Устройство дл возведени в квадрат | |
SU798856A1 (ru) | Устройство дл функциональногопРЕОбРАзОВАНи МАССиВА чиСЕл | |
SU409386A1 (ru) | Десятичный счетчик | |
SU676985A1 (ru) | Устройство дл ввода информации | |
SU556436A1 (ru) | Устройство дл делени |