KR980006348A - 반도체소자의 캐패시터 제조방법 - Google Patents
반도체소자의 캐패시터 제조방법 Download PDFInfo
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- 239000003990 capacitor Substances 0.000 title claims abstract 7
- 238000004519 manufacturing process Methods 0.000 title claims abstract 7
- 239000004065 semiconductor Substances 0.000 title claims abstract 6
- 238000000034 method Methods 0.000 title claims 3
- 238000003860 storage Methods 0.000 claims abstract description 6
- 229920002120 photoresistant polymer Polymers 0.000 claims abstract 5
- 239000000758 substrate Substances 0.000 claims 4
- 150000004767 nitrides Chemical class 0.000 claims 3
- 238000000151 deposition Methods 0.000 claims 2
- 238000005530 etching Methods 0.000 claims 2
- 238000002955 isolation Methods 0.000 claims 2
- VYZAMTAEIAYCRO-UHFFFAOYSA-N Chromium Chemical compound [Cr] VYZAMTAEIAYCRO-UHFFFAOYSA-N 0.000 claims 1
- 230000001590 oxidative effect Effects 0.000 claims 1
- 239000010453 quartz Substances 0.000 claims 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims 1
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- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
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Abstract
본 발명은 반도체 소자의 캐패시터 제조방법에 관한 것으로,캐패시터 저장전극을제조할 때 다크 필드 마스크(dark field mask)와 네가티브 레지스트(negative resist)을 이용하여 광의 근접효과(proximity)를 작게함으로써 캐패시터 저장전극의 면적을 최대화 할 수 잇는 캐패시터 제조방법에 관한 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 의해 다크 필드 마스크로서, 저장전극 패턴이 구비된 것을 도시한 도면.
Claims (4)
- 캐패시터 저장전극 제조방법에 있어서, 반도체기판 상부에 콘택홀이 구비된 절연막이 형성되고, 그 상부에 도전층을 증착하는 단계와, 상기 도전층 상부에 네가티브 레지스트를 도포하고, 다크 필드 마스크를 이용하여 광을 상기 레지스트로 노광하는 단계와, 현상공정을 진행하여 노광되지 않은 네가티브 레지스트를 제거하여 레지스트 패턴을 형성하는 단계와, 상기 레지스트 패턴을 마스크로 이용하여 하부의 도전층을 식각하여 저장전극용 도전층 패턴을 형성한 다음, 상기 레지스트 패턴을 제거하는 단계를 포함하는 캐패시터 저장전극 제조방법.
- 제1항에 있어서, 상기 다크 필드 마스크에 저장전극 패턴으로 되는 쿼츠 기판 패턴의 장축 길이를 브리이트 필드 마스크에 형성되는 저장전극용 크롬 패턴의 크기 보다 조금 크게 구비하는 것을 캐패시터 저장전극 제조방법.
- 제1항에 있어서, 상기 노광 공정에 사용되는 광은 G선,I선,KrF,ArF 또는 F 등의 모든 파장을 이용하는 것을 특징으로 하는 캐패시터 저장전극 제조방법.
- 반도체 소자 제조방법에 있어서, 반도체기판 상부에 산화막 질화막을 적층하고, 그 상부에 네가티브 레지스트를 도포하는 단계와, 소자분리용 다크 필드 마스크를 이용하여 광을 상기 레지스트로 노광하는 단계와, 현상공정을 진행하여 노광되지 않은 네가티브 레지스트를 제거하여 레지스트 패턴을 형성하는 단계와, 상기 레지스트 패턴을 마스크로 이용하여 하부의 질화막을 식각하여 질화막 패턴을 형성하는 단계와, 상기 레지스트 패턴을 제거하고, 산화공정으로 반도체 기판을 산화시켜 소자분리 산화막을 제조하는 단계를 포함하는 반도체소자 제조방법.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019960024277A KR100231596B1 (ko) | 1996-06-27 | 1996-06-27 | 반도체 소자의 캐패시터 제조방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019960024277A KR100231596B1 (ko) | 1996-06-27 | 1996-06-27 | 반도체 소자의 캐패시터 제조방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR980006348A true KR980006348A (ko) | 1998-03-30 |
KR100231596B1 KR100231596B1 (ko) | 1999-11-15 |
Family
ID=19463737
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019960024277A KR100231596B1 (ko) | 1996-06-27 | 1996-06-27 | 반도체 소자의 캐패시터 제조방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100231596B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100712995B1 (ko) * | 2005-09-20 | 2007-05-02 | 주식회사 하이닉스반도체 | 반도체소자의 스토리지노드콘택홀 형성 방법 |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0410568A (ja) * | 1990-04-27 | 1992-01-14 | Fujitsu Ltd | 半導体装置の製造方法 |
-
1996
- 1996-06-27 KR KR1019960024277A patent/KR100231596B1/ko not_active IP Right Cessation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100712995B1 (ko) * | 2005-09-20 | 2007-05-02 | 주식회사 하이닉스반도체 | 반도체소자의 스토리지노드콘택홀 형성 방법 |
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Publication number | Publication date |
---|---|
KR100231596B1 (ko) | 1999-11-15 |
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