KR970049425A - 시프트 레지스터 - Google Patents
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Abstract
본 발명은 시프트 레지스터에 관한 것으로, 더욱 상세하게는 라인(line)에 의한 딜레이(delay)를 최소화 할 수 있는 시프트 레지스터에 관한 것이다. 이 시프트 레지스터는 두 개의 D 플립플롭을 한쌍으로 해서 8쌍의 D 플립플롭이 직렬 접속해서, 최종단의 제 1 D 플립플롭 출력단자에 직렬 데이타 출력단을 접속하고, 각 단의 제 2 D 플립플롭 출력단자에 병렬데이타 출력단을 접속한 시프트 레지스터에 있어서; 클럭신호 입력시 데이타가 이동되는 각단의 제 1 D 플립플롭 출력단자와 다음단의 제 1 D 플립플롭 입력단자 사이에 버퍼를 접속시킨 것을 특징으로 한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 시프트 레지스터의 구조도.
Claims (1)
- 두 개의 D 플립플롭을 한쌍으로 해서 8쌍의 D 플립플롭이 직렬 접속해서, 최종단의 제 1 D 플립플롭 출력단자에 직력 데이타 출력단을 접속하고, 각 단의 제 2 D 플립플롭 출력단자에 병렬 데이타 출력단을 접속한 시프트 레지스터에 있어서; 클럭신호 입력시 데이타가 이동되는 각 단의 제1D플립플롭 출력단자와 다음단의 제1D플립플롭 입력단자 사이에 버퍼를 접속시킨 것을 특징으로 하는 시프트 레지스터.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019950055026A KR0169606B1 (ko) | 1995-12-22 | 1995-12-22 | 시프트 레지스터 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019950055026A KR0169606B1 (ko) | 1995-12-22 | 1995-12-22 | 시프트 레지스터 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR970049425A true KR970049425A (ko) | 1997-07-29 |
| KR0169606B1 KR0169606B1 (ko) | 1999-01-15 |
Family
ID=19443509
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019950055026A KR0169606B1 (ko) | 1995-12-22 | 1995-12-22 | 시프트 레지스터 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR0169606B1 (ko) |
-
1995
- 1995-12-22 KR KR1019950055026A patent/KR0169606B1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR0169606B1 (ko) | 1999-01-15 |
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