KR970024601A - 배타적 논리합 회로 - Google Patents

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KR970024601A
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pmos transistor
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KR1019950037735A
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김재형
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김주용
현대전자산업 주식회사
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Abstract

본 발명은 제1 및 제2입력(A, B)을 각각의 게이트 신호로 하며, 출력단(Q)과 접지단 사이에 직렬 연결된 제1 및 제2 NMOS 트랜지스터(10, 20); 상기 제2입력(B)을 게이트 신호로 하여 상기 제1입력(A)이 인가되는 제1입력단과 상기 출력단(Q)사이를 절체하는 제1 PMOS 트랜지스터(30); 및 상기 제1입력을 게이트 신호로 하여 상기 제2입력이 인가되는 제2입력단과 상기 출력단 사이를 절체하는 제2 PMOS 트랜지스터(40)를 구비하는 것을 특징으로 하는 고 효율 2 입력 배타적 논리합 회로에 관한 것으로, 구성 요소의 수가 적고, 따라서, 적은 전력 소모를 유도할 수 있으며, 입력에 따르는 XOR 동작을 안정적으로 수행할 수 있으며, 또한, 구성 요소의 수가 적기 때문에 소자의 크기를 줄일 수 있으며, 데이타 처리 속도를 향상시킬 수 있도록 한 것이다.

Description

배타적 논리합 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 일실시예에 의한 XOR회로의 회로도.

Claims (3)

  1. 2 입력 배타적 논리합 회로에 있어서, 제1 및 제2입력을 각각의 게이트 신호로 하며, 출력단과 접지단 사이에 직렬 연결된 제1 및 제2 NMOS 트랜지스터; 상기 제2입력을 게이트 신호로 하여 상기 제1입력이 인가되는 제1입력단과 상기 출력단 사이를 절체하는 제1 PMOS 트랜지스터; 및 상기 제1입력을 게이트 신호로 하여 상기 제2입력이 인가되는 제2입력단과 상기 출력단 사이를 절체하는 제2 PMOS 트랜지스터를 구비하는 것을 특징으로 하는 고 효율 2 입력 배타적 논리합 회로.
  2. 제1항에 있어서, 상기 출력단에 인가되는 신호를 입력받아 풀 스윙시켜 출력하는 버퍼를 더 구비하는 것을 특징으로 하는 고 효율 2 입력 배타적 논리합 회로.
  3. 제2항에 있어서, 상기 버퍼는 직렬 연결된 다수의 인버터를 구비하는 것을 특징으로 하는 고 효율 2 입력 배타적 논리합 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950037735A 1995-10-27 1995-10-27 배타적 논리합 회로 KR970024601A (ko)

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* Cited by examiner, † Cited by third party
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