KR950015584A - 반도체 장치의 제조방법 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract 6
- 238000004519 manufacturing process Methods 0.000 title claims abstract 5
- 238000000034 method Methods 0.000 claims abstract description 4
- 229920002120 photoresistant polymer Polymers 0.000 claims abstract 8
- 238000005530 etching Methods 0.000 claims abstract 3
- 239000000758 substrate Substances 0.000 claims abstract 2
- 230000000903 blocking effect Effects 0.000 claims 1
- 239000007788 liquid Substances 0.000 claims 1
- 238000001020 plasma etching Methods 0.000 claims 1
- 230000010354 integration Effects 0.000 abstract 1
- 230000003287 optical effect Effects 0.000 abstract 1
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Abstract
본 발명은 반도체 장치의 제조 방법에 관한 것으로서, 삼층 레지스트가 형성되어 있는 기판의 노광에 선폭은 동일하고, 간격이 넓은 광차단막 패턴이 형성되어 있는 제 1 노광 마스크로 노광하여 삼층 감광막 패턴을 형성한 후, 이를 마스크로 중간층을 절반 두께로 식각하고, 식각된 중간층상에 별도의 감광막을 형성한다. 그다음 상기 별도의 감광막을 상기 제 1 노광 마스크의 광차단막 패턴과는 엇갈리게 위치하여 중복되지않는 광차단막 패턴들이 형성되어 있는 제 2 노광 마스크로 노광하여 감광막 패턴을 형성하고, 노출된 중간층을 식각하여 중간층 패턴을 형성한다. 따라서 상기 중간층 패턴은 두차례의 노광 및 이방성 식각에 의해 절반의 두께로 형성되지만, 하나의 노광 마스크로 형성되는 경우 보다 광분해능을 두배 이상의 향상시켰으므로, 기존의 스테퍼로도 매우 큰 공정 마진을 갖고 미세패턴을 형성할 수 있어, 소자의 설계상 유리할 뿐만 아니라 반도체 장치의 고집적화, 예를들어 64M 또는 256M 디램 이상에 사용할 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 2 도(a)∼(f)는 본 발명에 따른 감광막 패턴 제조 공정도.
Claims (3)
- 소정의 기판 상에 감광막으로 하부층을 형성하는 공정과, 상기 하부층상에 중간층을 형성하는 공정과, 상기 중간층 상에 감광막으로 상부층을 형성하는 공정과, 상기 상부층을 소정의 광차단막 패턴이 형성되어있는 제 1 노광 마스크를 사용하여 선택적으로 노광하여 상부층 패턴을 형성하는 공정과, 상기 상부층 패턴에 의해 노출되어 있는 상기 중간층을 소정 두께 제거한 후, 상기 상부층 패턴을 제거하는 공정과, 상기 남아 있는 중간층 상에 감광막을 도포하는 공정과, 상기 감광막을 소정의 광차단막 패턴이 상기 제 1 노광 마스크의 광차단막 패턴들의 사이에 중첩되지 않도록 번갈아 형성되어 있는 제 2노광 마스크를 사용하여 선택적으로 노광하여 감광막 패턴을 형성하는 공정과, 상기 감광막 패턴에 의해 노출되어 있는 중간층을 상기 하부층이 노출될 때까지 제거하여 중간층 패턴을 형성하고, 상기 감광막 패턴을 제거하는 공정과, 상기 중간층 패턴에 의해 노출되어 있는 하부층을 제거하여 하부층 패턴을 형성하는 공정을 구비하여 노광 장치의 광분해능 이하의 미세패턴을 형성하는 반도체 장치의 제조 방법.
- 제1항에 있어서, 상기 감광막들을 포지티브형 또는 네가티브형 감광액으로 형성하는 것을 특징으로 하는 반도체 장치의 제조 방법.
- 제1항에 있어서, 상기 중간층 식각 공정을 반응성 이온 에칭에 의한 이방성 식각방법으로 실시하는 것을 특징으로 하는 반도체 장치의 제조 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019930023822A KR0126656B1 (ko) | 1993-11-10 | 1993-11-10 | 반도체 장치의 제조 방법 |
DE4440230A DE4440230C2 (de) | 1993-11-10 | 1994-11-10 | Verfahren zur Bildung feiner Strukturen eines Halbleiterbauelements |
JP27667194A JP2803999B2 (ja) | 1993-11-10 | 1994-11-10 | 半導体装置の微細パターン製造法 |
GB9422666A GB2284300B (en) | 1993-11-10 | 1994-11-10 | Process for forming fine pattern of semiconductor device |
US08/656,972 US5705319A (en) | 1993-11-10 | 1996-06-06 | Process for forming fine patterns for a semiconductor device utilizing three photosensitive layers |
US08/659,741 US5741625A (en) | 1993-11-10 | 1996-06-06 | Process for forming fine patterns in a semiconductor device utilizing multiple photosensitive film patterns and organic metal-coupled material |
US08/883,289 US5716758A (en) | 1993-11-10 | 1997-06-26 | Process for forming fine pattern for semiconductor device utilizing multiple interlaced exposure masks |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019930023822A KR0126656B1 (ko) | 1993-11-10 | 1993-11-10 | 반도체 장치의 제조 방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR950015584A true KR950015584A (ko) | 1995-06-17 |
KR0126656B1 KR0126656B1 (ko) | 1998-04-02 |
Family
ID=19367743
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019930023822A KR0126656B1 (ko) | 1993-11-10 | 1993-11-10 | 반도체 장치의 제조 방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR0126656B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100802229B1 (ko) * | 2006-05-12 | 2008-02-11 | 주식회사 하이닉스반도체 | 반도체 소자의 패턴 형성 방법 |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100358413B1 (ko) * | 2000-07-06 | 2002-10-25 | 주식회사 파루 | 펄스정전분무장치 |
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1993
- 1993-11-10 KR KR1019930023822A patent/KR0126656B1/ko not_active IP Right Cessation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100802229B1 (ko) * | 2006-05-12 | 2008-02-11 | 주식회사 하이닉스반도체 | 반도체 소자의 패턴 형성 방법 |
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Publication number | Publication date |
---|---|
KR0126656B1 (ko) | 1998-04-02 |
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