KR940012390A - 어드레스 디코딩회로 - Google Patents
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Abstract
본 발명은 반도체 메모리장치, 특히 다수개의 어드레스를 입력하여 디코딩신호를 출력하는 어드레스 디코딩회로에 관한 것으로, 외부에서 인가되는 어드레스를 받아들이는 어드레스 버퍼에서 직접 프리디코딩 신호를 출력하도록 하기 위하여, 입력 어드레스를 씨모오스 레벨로 정형하는 어드레스 입력단과, 상기 입력단의 출력을 래치하는 래치수단과, 상기 래치수단의 출력 및 그 반전출력을 논리곱으로 조합하여 출력하는 출력단을 구비하여, 별도의 프리디코딩 회로를 사용하지 않고 디코딩함으로써, 동작 스피드의 저하가 방지되고, 소자의 감소를 칩의 면적이 감소되고 소비전력이 줄어든 어드레스 디코딩회로를 제고한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 따른 어드레스 디코딩회로.
Claims (3)
- 다수개의 어드레스 신호를 입력하여 디코딩신호를 출력하는 어드레스 디코딩 회로에 있어서, 외부에서 인가되는 어드레스 신호를 씨모오스 레벨로 정형하여 출력하는 다수개의 어드레스 입력단(31)과, 상기 입력단 각각의 출력이 래치되는 다수개의 레치수단(32)과, 상기 각 래치수단(32)의 출력 및 그 반전출력을 논리곱으로 조합하여 출력하는 출력단(34)을 구비함을 특징으로 하는 어드레스 디코딩회로.
- 제1항에 있어서, 상기 입력단(31)과 래치수단(32)이 래치제어신호에 따라 동작하는 전달게이트(33)를 더 구비함을 특징으로 하는 어드레스 디코딩 회로.
- 제1항에 있어서, 상기 출력단(34)이 각각의 조합된 신호를 입력하며 출력 제어신호에 의해 제어되는 다수개의 난드게이트와, 상기 각 난드게이트의 출력을 반전하는 다수개의 인버터로 이루러짐을 특징으로 하는 어드레스 디코딩 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019920021137A KR940012390A (ko) | 1992-11-11 | 1992-11-11 | 어드레스 디코딩회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019920021137A KR940012390A (ko) | 1992-11-11 | 1992-11-11 | 어드레스 디코딩회로 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| KR940012390A true KR940012390A (ko) | 1994-06-23 |
Family
ID=67210944
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019920021137A KR940012390A (ko) | 1992-11-11 | 1992-11-11 | 어드레스 디코딩회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR940012390A (ko) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100569713B1 (ko) * | 1998-10-21 | 2006-09-18 | 삼성전자주식회사 | 듀얼 스캔 방식에서 소비 전력을 감소시키는 회로 |
| US7349287B2 (en) | 2005-12-28 | 2008-03-25 | Fujitsu Limited | Address decoder, storage device, processor device, and address decoding method for the storage device |
-
1992
- 1992-11-11 KR KR1019920021137A patent/KR940012390A/ko not_active IP Right Cessation
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100569713B1 (ko) * | 1998-10-21 | 2006-09-18 | 삼성전자주식회사 | 듀얼 스캔 방식에서 소비 전력을 감소시키는 회로 |
| US7349287B2 (en) | 2005-12-28 | 2008-03-25 | Fujitsu Limited | Address decoder, storage device, processor device, and address decoding method for the storage device |
| KR100887220B1 (ko) * | 2005-12-28 | 2009-03-06 | 후지쯔 가부시끼가이샤 | 어드레스 디코더, 기억 장치, 처리 장치 및 기억장치에서의 어드레스 디코딩 방법 |
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