KR940010084A - 독립적인 입력단을 가지는 컨트롤 신호 인에이블 회로 - Google Patents

독립적인 입력단을 가지는 컨트롤 신호 인에이블 회로 Download PDF

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KR940010084A
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Abstract

본 발명은 반도체 메모리 장치에서 특히 소정의 외부입력신호에 대하여 독립적인 입력단을 가지도록 하는 컨트롤 신호 인에이블 신호에 관한 것으로, 종래 기술에 의한 컨트롤 신호 인에이블 신호의 구성방식은 칩내에 필수적으로 구비되어야하는 2개이상의 컨트롤 신호를 단지 하나의 입력단(2)을 통해서 인에이블시키게 되어, 칩의 고집적화에 따라 칩의 사이즈가 커지게 되고 이로부터 버퍼회로(즉, 노아게이트(2))의 출력신호의 로딩이 커지게 되어 출력신호의 고속성의 저하가 유발되는 바, 본 발명에 의한 컨트롤 신호 인에이블 회로는 다수개의 컨트롤 신호의 갯수에 상응하는 버퍼 회로를 각각 독립적으로 패드에 입력단이 연결되게 각각 구비하여 상기 다수개의 컨트롤 신호가 상기 각각의 버퍼회로에 의해서 독립적으로 인에이블되게 하므로서, 칩내에 사용되는 컨트롤 신호의 인에이블동작을 고속화하여 고집적 반도체 메모리 장치의 고속동작을 향상시키며, 예를들어 스테틱 램의 경우에는 교류특성중의 하나인 TCS나 TWR 특성을 개선하는 효과가 있다.

Description

독립적인 입력단을 가지는 컨트롤 신호 인에이블 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 컨틀롤신호인에이블 회로.

Claims (3)

  1. 칩의 패드로부터 소정의 외부신호를 인가받아 칩의 다수개의 컨트롤 신호를 인에이블시키는 반도체 메모리장치에 있어서, 상기 다수개의 컨트롤 신호의 갯수에 상응하는 버퍼회로를 각각 독립적으로 상기 패드에 입력단이 연결되게 각각 구비하여, 상기 다수개의 컨트롤 신호가 상기 각각의 버퍼회로에 의해서 독립적으로 인에이블되게 함을 특징으로 하는 컨트롤 신호 인에이블 회로.
  2. 제1항에 있어서, 상기 다수개의 버퍼회로가 각각 노아게이트로 이루어짐을 특징으로 하는 컨트롤 신호 인에이블 회로.
  3. 칩의 패드로부터 소정의 외부신호를 인가받아 칩의 제1 또는 제2컨트롤 신호를 인에이블시키는 반도체 메모리 장치에 있어서, 상기 제1컨트롤 신호가 상기 패드에 일입력이 연결되는 제1노아회로부에 의해 인에이블됨과, 상기 제2컨트롤 신호가 상기 패드에 상기 제1노아회로부와 독립적으로 일입력이 연결되는 제2노아회로부에 의해 인에이블되게 함을 특징으로 하는 컨트롤 신호 인에이블 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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