KR930009245A - 리셋기능을 가지는 고속 임계치(문턱값) 교차 검출기 - Google Patents

리셋기능을 가지는 고속 임계치(문턱값) 교차 검출기 Download PDF

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Abstract

본 발명은 양의 귀환과 DC 전압 클램핑을 하는 고속 전-CMOS를 제공한다. 이 회로는 그들의 소오스들이 전류원이나 공급전압에 접속된 두 개의 소오스-결합된 PMOS 트랜지스터들을 구비한다. 제3PMOS 트랜지스터는 제1PMOS 트랜지스터의 소오스와 전류 미러의 단자 사이에 접속된다. 이 제3PMOS 트랜지스터의 게이트는 회로에 양의 귀환을 제공하기 위해 출력 노드에 접속된다. 음의 입력 전압이 양의 입력전압보다 낮아질 때, 제2PMOS를 통과하는 전류는 증가되며 제1PMOS 트랜지스터를 통과하는 전류는 감소한다. 출력노드의 전압에 증가함에 따라 제3PMOS 트랜지스터의 동등한 저항값이 증가하여, 제1PMOS 트랜지스터를 통과하는 전류를 감소시킨다. 이것을 출력 노드에 제공되는 전류를 증가시키고 회로의 구동 특성을 증가시키는 작용을 한다. 이 회로에 대한 더 나은 개선으로서, 전압-클램핑 장치가 설계에 포함된다.

Description

리셋기능을 가지는 고속 임계치(문턱값) 교차 검출기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제6도는 본 발명의 귀환 수단을 포함하는 비교기를 보여주는 회로도
제7도는 본 발명의 한 가능한 실시예를 보여주는 회로도
제8도는 제5도 내지 제7도의 회로들의 출력 특성의 그래프
제9도는 본 발명의 바람직한 실시예의 회로도

Claims (29)

  1. 제1전압 입력 신호를 받아들이며 제1노드에 접속된 제1입력 수단과; 제2전압 입력을 받아들이며 제1노드와 출력 노드에 접속된 제2입력 수단; 제1전압 공급단에 접속되고 상기 출력 노드에서 상기 제2입력 수단에 접속되어, 제1전류를 받아들이며 상기 제1전류와 동등한 제2전류를 출력하는 전류 미러 수단; 및 상기 제1입력 수단 및 상기 전류 미러 수단에 접속되며 상기 출력 노드에서 출력 전압에 의해 제어되는 양의 귀환 수단을 적어도 구비함을 특징으로 하는 회로.
  2. 제1항에 있어서, 상기 출력 노드와 상기 전류 미러 수단사이에 접속되며, 최소 출력 전압 레벨을 증가시키는 DC 클램핑 수단이 더 구비됨을 특징으로 하는 회로.
  3. 제1항에 있어서, 상기 출력 노드에 접속된 리셋수단이 더 구비됨을 특징으로 하는 회로.
  4. 제1항에 있어서, 상기 전류 미러 수단과 상기 제1전압 공급사이에 접속되며 최소 출력 전압 레벨을 증가시키는 DC 클램핑 수단이 더 구비됨을 특징으로 하는 회로.
  5. 제1항에 있어서, 상기 제1노드에 접속된 제2전압 공급단이 더 구비됨을 특징으로 하는 회로.
  6. 제1항에 있어서, 상기 제1노드에 접속된 전류원이 더 구비됨을 특징으로 하는 회로.
  7. 제1항에 있어서, 상기 제1입력수단, 제2입력 수단 및 상기 양의 귀환 수단이 제1형의 트랜지스터들을 포함하며, 상기 전류 미러 수단이 제2형의 트랜지스터들을 포함함을 특징으로 하는 회로.
  8. 제1전압 입력 신호를 받아들이며 제1노드에 접속된 제1입력 수단; 제2전압 입력을 받아들이며, 상기 제1노드와 출력 노드에 접속된 제2입력 수단; 제1전압 공급단, 상기 제1입력수단 및 상기 제2입력 수단에 접속되어, 제1전류를 받아들이며 상기 제1전류와 동등한 제2전류를 발생하는 전류 미러 수단; 및 최소 출력 전압 레벨을 정가시키는 DC 클램핑 수단이 더 구비됨을 특징으로 하는 회로.
  9. 제8항에 있어서, 상기 제1입력 수단과 상기 전류 미러 수단에 접속되며, 상기 출력 노드에서 출력 전압에 의해 제어되는 양의 귀환 수단을 적어도 구비함을 특징으로 하는 회로.
  10. 제8항에 있어서, 상기 DC 클램핑 수단이 상기 출력 노드와 상기 전류 미러 수단사이에 접속됨을 특징으로 하는 회로.
  11. 제8항에 있어서, 상기 출력 노드에 접속된 리셋수단이 더 구비됨을 특징으로 하는 회로.
  12. 제8항에 있어서, 상기 DC 클램핑 수단이 상기 전류 미러 수단과 상기 제1전압 공급사이에 접속됨을 특징으로 하는 회로.
  13. 제8항에 있어서, 상기 제1노드에 접속된 제2전압 공급단이 더 구비됨을 특징으로 하는 회로.
  14. 제8항에 있어서, 상기 제1노드에 접속된 전류원이 더 구비됨을 특징으로 하는 회로.
  15. 제8항에 있어서, 상기 제1입력수단과 상기 제2입력 수단은 제1형의 트랜지스터들을 포함하며, 상기 전류 미러 수단과 상기 DC 클램핑 수단은 제2형의 트랜지스터들을 포함함을 특징으로 하는 회로.
  16. 제1전압 입력 신호를 받아들이며 제1노드에 접속된 제1입력 수단; 제2전압 입력을 받아들이며, 상기 제1노드와 출력 노드에 접속되는 제2입력 수단; 제1전압 공급단에 접속되고 상기 출력 노드에서 상기 제2입력 수단에 접속되며, 제1전류원을 받아들여 상기 제1전류와 동등한 제2전류를 발생하는 전류 미러 수단; 상기 제1입력 수단과 상기 전류 미러 수단에 접속되며, 상기 출력 노드에서 출력 전압에 의해 제어되는 양의 귀환 수단; 및 최소 출력 전압 레벨을 증가시키는 DC 클램핑 수단을 구비함을 특징으로 하는 회로.
  17. 제16항에 있어서, 상기 DC 클램핑 수단이 상기 출력 노드와 상기 전류 미러 수단사이에 접속됨을 특징으로 하는 회로.
  18. 제16항에 있어서, 상기 출력 노드에 접속되는 리셋수단이 더 구비됨을 특징으로 하는 회로.
  19. 제16항에 있어서, 상기 DC 클램핑 수단이 상기 전류 미러 수단과 상기 제1전압 공급사이에 접속됨을 특징으로 하는 회로.
  20. 제16항에 있어서, 상기 제1노드에 접속된 제2전압 공급단이 더 구비됨을 특징으로 하는 회로.
  21. 제16항에 있어서, 상기 제1노드에 접속된 전류원이 더 구비됨을 특징으로 하는 회로.
  22. 제16항에 있어서, 상기 제1입력수단, 상기 제2입력 수단 및 상기 양의 귀환 수단은 제1형의 트랜지스터들을 포함하며, 상기 전류 미러 수단과 상기 DC 클램핑 수단은 제2형의 트랜지스터들을 포함함을 특징으로 하는 회로.
  23. 전압공급단에 소오스-접속된 제1트랜지스터와 일정한 전류원에 소오스가 접속된 제2트랜지스터로 구성된, 전압 입력을 받아들이는 서로 다른 채널 형의 제1 및 제2의 드레인-접속된 MOS 트랜지스터들; 상기 제1 및 제2트랜지스터의 드레인들과 상기 전압공급단에 접속되는 캐패시터; 문턱 전압에 접속되는 제1입력 수단과 상기 커패시터에 접속되는 제2입력 수단을 가지며, 지연된 출력을 발생하는 문턱치 교차 검출기를 적어도 구비하고, 그리고 상기 한계 교차 검출기는; 제1전압 입력 신호를 받아들이며 제1노드에 접속되는 제1입력수단; 제2전압 입력을 받아들이며, 상기 제1노드 및 출력 노드에 접속되는 제2입력수단; 상기 출력 노드에서 상기 제2입력 수단에 접속되며 제1전류를 받아들여 상기 제1전류와 동등한 제2전류를 발생하는 전류미러수단; 상기 제1입력 수단과 상기 전류 미러 수단에 접속되며, 상기 출력 노드에서 출력 전압에 의해 제어되는 양의 귀환 수단; 및 최소 출력 전압 레벨을 증가시키는 DC 클램핑 수단을 적어도 구비하여 이루어지는 가변 타이머 지연회로.
  24. 제23항에 있어서, 상기 DC 클램핑 수단이 상기 출력 노드와 상기 전류 미러 수단사이에 접속됨을 특징으로 하는 회로.
  25. 제23항에 있어서, 상기 출력 노드에 접속되는 리셋수단이 더 구비됨을 특징으로 하는 회로.
  26. 제23항에 있어서, 상기 DC 클램핑 수단이 상기 전류 미러 수단과 제2전압 공급사이에 접속됨을 특징으로 하는 회로.
  27. 제23항에 있어서, 상기 제1노드가 전압 공급 노드를 구비함을 특징으로 하는 회로.
  28. 제23항에 있어서, 상기 제1노드에 접속되는 전류원이 더 구비됨을 특징으로 하는 회로.
  29. 제23항에 있어서, 상기 제1입력수단, 상기 제2입력 수단 및 상기 양의 귀환 수단은 제1형의 트랜지스터들을 포함하며, 상기 전류 미러 수단과 상기 DC 클램핑 수단은 제2형의 트랜지스터들을 포함함을 특징으로 하는 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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