KR920013940A - 상태 평가량 기억장치 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 제1도에 따른 바이터비 복호기에 채용된 가산비교 선택부와 상태 평가량 기억부의 상세 구성도, 제3도는 제1도에 따른 부호비 R=1/2, 구속장 K=3인 경우의 격자 상태도.
Claims (4)
- 입력버퍼(100)와 지로평가량 계산부(200)와, 가산비교선택부(300)와, 상태평가량 기억부(400)와, 경로추적 논리부(500)와 경로기억부(600) 및 주클럭발생부(700)를 구비한 바이터비 복호기에 있어서, 상기 상태평가량 기억부 (400)와 상기 가산비교선택부(300)에서 전송되는 현상태 평가량의 이전상태를 기억시키는 제1,2지연기(SR0, SR1)와, 상기 가산비교선택부(300)에서 전송되는 현상태 평가량을 기억시키는 제3,4지연기(SR2, SR3)와, 다음 데이타가 입력되는 다음 시점에서 상기 제1,2지연기(SR0, SR1)가 현상태 평가량을 기억하도록 절체시키는 제1,2절체기(SW1, SW2)와, 다음 데이타가 입력되는 다음 시점에서 상기 제3,4지연기 (SR2, SR3)가 이전상태의 상태평가량을 기억하도록 절체시키는 제3,4절체기 (SW3, SW4)와, 시점변화에 따라 이전 상태평가량으로 사용되는 제1, 2, 3, 4지연기 (SR0, SR1, SR2, SR3)의 출력신호를 상기 가산비교선택부(300)의 입력단으로 전송하는 제5,6절체기(SW5, SW6)와, 상기 제1,2,3,4지연기(SR0, SR1, SR2, SR3)의 각 상태를 계산하는 기본주기의 클럭신호를 순차적으로 공급하는 제7, 8, 9, 10절체기 (SW7, SW8, SW9, SW10)를 포함함을 특징으로 하는 상태평가량 기억장치.
- 제1항에 있어서, 상태 평가량 기억수단인 지연기의 길이를 어는 한 시점에서 계산해야 되는 총 상태수(S=2k-1)를 한 상태로 도달되는 지로의 갯수(B=2n-1)로 나눈값(S/B)으로 설정함을 특징으로 하는 상태평가량 기억장치.
- 제1항에 있어서, 상태평가량 기억수단이 지연기의 총 갯수를 어느 한 시점에서 현 상태에 도달하는 지로의 갯수(B)의 두배로 설정하여 각각 이전상태 평가량 기억수단과 현상태 평가량 기억수단으로 사용함을 특징으로 하는 상태평가량 기억장치.
- 제1항에 있어서, 상태평가량 기억수단의 각지연기에 공급되는 이동 동작클럭 (M/2 CLOCK, M/2 CLOCK)은 주상태 평가계산 기본클럭(INPUT CLOCK)을 지로 갯수(B)로 나눈후 주클럭(MAINCLOCK)의 주기에 따라 순차적으로 공급하여 각 지연기에 계산된 평가량이 분할 기억됨을 특징으로 하는 상태평가량 기억장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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