KR910700566A - 고속 프리스케일러 - Google Patents
고속 프리스케일러Info
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 프리스케일러 회로의 배선도,
제2도는 제1도 회로의 각 인버트 스테이지의 모듈라스 4 및 모듈라스 5출력을 나타내는 진리치표.
Claims (14)
- 고속 프리스케일러 회로로써, 각기 제1 및 제2입력 및 출력을 가진 캐스케이드된 다수의 기수 인버터회로를 포함하며, 상기 제1입력은 입력신호를 수신하고, 상기 입력 신호를 수신하기 위한 제1입력, 상기 캐스케이드된 다수의 인버터 회로중 마지막 회로의 출력에 연결된 제2 입력 및 출력을 가진 중간 인버터 회로를포함하며, 제1, 제2, 및 제3입력 및 출력을 가진 출력 인버터 회로를 포함하며, 상기 출력인버터 회로의 상기 제1입력은 상기 입력신호를 수신하고, 상기 출력 인버터 회로의 제2입력은 상기 중간 인버터 회로의 출력에연결되며, 상기 출력 인버터 회로의 출력은 상기 캐스케이드된 인버터 회로중 첫 번째 회로의 제2입력에 연결되며, 상기 프리스케일러 회로의 출력을 형성하고, 상기 캐스케이드된 다수의 인버터 회로중 앞서 선택된 첫 번째회로의 출력에 연결된 제1입력 및 상기 출력 인버터 회로의 출력이 예정된 스테이트를 유지하도록 상기 출력인버터 회로의 제3입력에 연결된 출력을 가진 피드 포워드 회로수단을 포함하는 고속 프리스케일러 회로.
- 제1항에 있어서, 상기 피드 포워드 회로 수단이 제어신호를 수신하도록 연결된 최소한 하나의 제2 입력을 가지며, 상기 제어신호는 제1 및 제2스테이트를 나타내고, 상기 제어신호가 상기 제1스테이트에 존재할 때 상기 출력 인버터 회로의 출력이 상기 예정된 스테이트에 존재하게 되는 고속 프리스케일러 회로.
- 제2항에 있어서, 상기 제어신호에 연결된 제1 입력, 상기 캐스케이드된 다수의 인버터 회로중 마지막 회로의 출력에 연결된 제2입력, 및 상기 제어신호가 상기 제1스테이트에 존재하고 상기 캐스케이드된 다수의 인버터 회로중 마지막 회로의 출력이 예정된 스테이트에 존재할 때 상기 중간 인버터 회로의 출력이 예정된 스테이트에 존재하도록 상기 중간 인버터 회로에 연결된 출력을 가진 제1회로 수단을 포함하는 고속 프리스케일러 회로.
- 제3항에 있어서, 상기 입력 신호가 주파수 f를 가진 클럭 신호이며, 상기 제어신호가 상기 제1스테이트에 존재할 때는 상기 출력 인버터 회로의 출력이 모듈라스 X 출력이고 상기 제어신호가 상기 제2스테이트에 존재할 때는 모듈라스 Y 출력이며, 이때 X 및 Y가 정수인 고속 프리스케일러 회로.
- 제4항에 있어서, 상기 캐시케이드된 다수의 인버터 회로가 캐스케이드된 세 개의 인버터회로를 포함하며 이때 X는 4이고, Y는 5인 고속 프리스케일러 회로.
- 각각 클럭 신호를 수신하도록 연결된 제1 입력 및 출력을 가진 제1, 제2, 제3, 제4 및 제5인버터 회로를 포함하는 4/5 프리스케일러 회로에 의한 고속 분할로서, 상기 제2, 제3, 제4 및 제5반전 회로가 각각 선행 인버터 회로의 출력에 연결된 제2입력을 가지며, 상기 제1인버터 회로가 상기 제5인버터 회로의 출력에 연결된 제2입력을 가지는 4/5고속 분할 프리스케일러 회로로서, 제1 및 제2스테이트를 나타낼 수 있는 모듈라스 제어 신호를 수신하기 위한 수단, 및 상기 제5인버터 회로에 연결되고 상기 제5인버터 회로의 출력에 나타나는 출력 신호의 모듈라스를 변화시키기 위해 상기 모듈라스 제어신호에 응답하는 피드 포워드 회로수단을 포함하는 4/5고속 분할 프리스케일러 회로.
- 제6항에 있어서, 상기 피드 포워드 회로 수단이 입력으로써 상기 제2인버터 회로의 출력을 갖는 4/5 고속분할 프리스케일러 회로.
- 제7항에 있어서, 상기 각각의 제1, 제2, 제3, 제4 및 제5인버터 회로가, 제1공급 전압을 수신하도록 연결된 소스. 입력 신호를 수신하도록 연결된 게이트, 및 드레인을 가진 제1P-채널 전계 효과 트랜지스터, 상기 제1P-채널 전계 효과 트랜지스터의 드레인에 연결된 소스, 클럭신호를 수신하기 위한 게이트, 및 인버터 회로의 출력을 형성하는 드레인을 가진 제2P-채널 전계효과 트랜지스터, 상기 제2P-채널 전계 효과 트랜지스터의 드레인에 연결된 드레인, 상기 클럭 신호를 수신하도록 연결된 게이트 및 소스를 가진 제1N-채널 효과 트랜지스터, 및 상기 제1N-채널 전계 효과 트랜지스터의 소스에 연결된 드레인, 상기 입력 신호를 수신하도록 연결된 게이트, 및 제2공급 전압원을 수신하도록 연결된 게이트, 및 소스를 가진 제2N-채널 전계 효과 트랜지스터를 포함하는 4/5고속 분할 프리스케일로 회로.
- 제8항에 있어서, 상기 모듈라스 제어신호가 상기 제1스테이트에 존재할 때 상기 제5인버터회로의 출력이 모듈라스 4출력이 되는 4/5 고속 분할 프레스케일러 회로.
- 제8항에 있어서, 상기 모듈라스 제어 신호가 상기 제2스테이트에존재할 때 상기 제5인버터 회로의 출력이 모듈라스 5출력이 되는 4/5 고속분할 프리스케일러 회로.
- 제8항에 있어서, 상기 피드 포워드 회로가, 상기 제5인버터 회로안의 제1N-채널 전계 효과 트랜지스터의소스에 연결된 드레인, 상기 제2인버터 회로의 출력에 연결된 게이트, 및 소스를 가진 제3N-채널 전계 효과 트랜지스터 및 상기 제3N-채널 전계 효과 트랜지스트의 소스에 연결된 드레인, 상기 제어신호를 수신하도록 연결된 게이트, 및 상기 제2공급 전압원을 수신하도록 연결된 소스를 가진 제4N-채널 전계 효과 트랜지스터를 포함하는 4/5고속 분할 프리스케일러 회로.
- 제11항에 있어서, 상기 피드 포워드 회로수단이, 상기 제4인버터 회로안의 제1P-채널 전계 효과 트랜지스트의 소스에 연결된 소스, 상기 제어신호를 수신하도록 연결된 게이트 및 드레인을 가진 제3P-채널 전계 효과 트랜지스터, 상기 제3P-채널 전계 효과 프랜지스터의 드레인에 연결된 소스, 상기 제3인버터 회로의 출력에 연결된 게이트, 및 상기 제4인버터 회로의 출력에 연결된 드레인을 가진 제4P-채널 전계 효과 트랜지스터, 상기 제5인버터 회로의 출력에 연결된 드레인, 상기 제4인버터 회로의 출력에 연결된 게이트, 및 소스를 가진 제5N-채널 전계 효과 트랜지스터, 및 상기 제5N-채널 전계 효과 트랜지스터의 소스에 연결된 드레인, 상기 제어신호를 수신하도록 연결된 게이트, 및 상기 제2공급 전압원에 연결된 소스를 가진 제6N-채널 전계 효과 트랜지스터를 포함하는 4/5고속 분할 프리스케일러 회로.
- 고속 프리스케일러 회로로써, 각기 제1 및 제2입력 및 출력을 가진 캐스케이드된 다수의 기수 인버터 회로를 포함하며, 상기 제1입력은 입력 신호를 수신하고, 상기 입력 신호를 수신하기 위한 제1입력, 상기 캐스케이드된 다수의 인버터 회로중 마지막 회로의 출력에 연결된 제2입력, 및 출력을 가진 중간 인버터 회로를 포함하며, 제1, 제2 및 제3입력 및 출력을 가진 출력 인버터 회로의 포함하며, 상기 출력 인버터회로의 상기 제1입력은 상기 입력신호를 수신하고, 상기 출력 인버터 회로의 제2입력은 상기 중간 인버터 회로의 출력에 연결되며, 상기 출력인버터 회로의 출력은 상기 캐스케이드된 다수의 인버터 회로중 첫 번째 회로의 상기 제2입력에 연결되며 상기 프리스케일러 회로의 출력을 형성하고, 모듈라스 제어 신호를 수신하도록 연결된 제1입력, 상기 캐스케이드된 다수의 인버터 회로중 두 번째 회로의 출력에 연결된 제2입력, 및 상기 모듈라스 제어신호의 스테이트에 응답하여 상기 출력 인버터 회로의 출력에 나타나는 출력신호의 모듈라스를 변화시키기 위해 상기 출력 인버터 회로에 연결된 출력을 가진 피드 포워드 회로를 포함하는 고속 프리스케일로 회로.
- 제13항에 있어서, 상기 캐스케이드된 다수의 인버터 회로가 세 개의 캐스케이드된 인버터 회로로 구성되며, 상기 출력 인버터 회로의 출력에 나타나는 출력이 상기 제어신호가 제1 스테이트에 존재할 때는 모듈라스 4출력이고 상기 제어신호가 제2스테이트에 존재할 때는 모듈라스 5출력인 고속 프리스케일로 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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