KR910005155A - 마이크로 프로세서 - Google Patents
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- G06—COMPUTING; CALCULATING OR COUNTING
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline, look ahead
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- G06F9/3802—Instruction prefetching
- G06F9/3804—Instruction prefetching for branches, e.g. hedging, branch folding
Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 실시예를 표시한 블럭 선도.
제2도는 제1도의 도시된 PFU를 표시한 내부 블럭 선도.
제3도는 제2도에 도시된 회로 동작을 설명하기 위한 동작 선도.
Claims (3)
- 조건부 브랜치 명령의 브랜치 조건이 설정되기 전에 다수의 바이트의 명령 데이타를 프릿 팻치하기 위해 브랜치 어드레스에서의 명령에 대해 명령 프리팻치 동작을 수행하는 수단과, 다수의 바이트중 프리 팻치된 명령 데이타를 일시적으로 기억하는 버퍼 수단과, 더 작은 비트 데이타에 응답하여 상기 버퍼 수단에서 출력될 바이트 데이타를 선택하는 수단과, 브랜치가 이루어질 때 선택된 바이트 명령 디코더에 전달하는 수단을 구비하는 마이크로 프로세서.
- 조건부 브랜치 명령을 프리 팻칭한 후 프리팻치되는 최소한 하나의 명령을 일시적으로 기억시키는 제1기억수단과, 상기 조건부 브랜치 명령의 브랜치 조건이 설정되기 전에 프리 팻치되는 브랜치 어드레스에서 명령을 일시적으로 기억시키는 제2기억수단과, 상기 제1기억 수단에 기억되는 명령의 오퍼랜드 필드와 동작 코드를 정렬시키는 상기 제1기억 수단에 접속된 제1정렬기와, 상기 제2기억 수단에 기억되는 명령의 오퍼랜드 필드와 동작코드 필드를 정렬시키는 상기 제2기억 수단에 접속된 제2정렬기와 브랜치가 이루어지지 않을 때 상기 제1정렬기의 출력을 명령 디코더에 전달하며, 상기 브랜치가 이루어질 때 상기 제2정렬기의 출력은 상기 명령 디코더에 전달하는 상기 제1 및 제2정렬기에 접속되는 선택 수단을 구비하는 마이크로 프로세서.
- 제2항에 있어서, 상기 브랜치가 이루어질 때 상기 제2기억 수단으로부터의 명령을 상기 제1기억 수단에 기록 하는 수단을 구비하는 마이크로 프로세서.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (3)
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