KR910003380B1 - 인덱스 신호 발생타이밍 조정 시스템 - Google Patents

인덱스 신호 발생타이밍 조정 시스템 Download PDF

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Abstract

내용 없음.

Description

인덱스 신호 발생타이밍 조정 시스템
제 1 도는 본 발명의 일실시예에 따른 인덱스 신호 발생 타이밍 조정 시스템의 블럭선도.
제 2 도는 제 1 도중 카운터부의 상세 구성을 도시한 블럭선도.
제 3 도는 제 1 도중 어드레스 발생기 및 기입회로의 상세 구성을 도시한 블럭선도.
제 4 도는 제 1 도중 인덱스 펄스 발생기의 상세 구성을 도시한 블럭선도.
제 5a 도 내지 f는 제 1 도의 실시예의 동작을 설명하기 위한 타이밍도.
* 도면의 주요 부분에 대한 부호의 설명
10 : FDD 유니트 12 : CE 디스크
14 : 자기헤드 16 : 증폭기
18 : 스핀들 20 : 마그네트
22 : 검출기 24 : 인덱스 검출기
26 : 인덱스 펄스 발생기 28 : 클릭 발생기
30 : 어드레스 발생기 32 : 메모리
50 : 조정유니트 52 : 클럭 발생기
54 : 카운터부 56 : CPU
57 : 지시계 58 : ROM
60 : 기입회로
본 발명은 플로피 디스크 드라이브 유니트의 인덱스 신호 발생 타이밍을 자동적으로 조정하는 시스템에 관한 것이다.
통상, 플로피 디스크 드라이브(FDD)에는, 자기 기록 매체(이하, 디스크라 함)가 1회전일 때마다 하나의 인덱스 펄스를 출력하는 인덱스 펄스 검출부가 설치되어 있다. 그리고, 이 인덱스 펄스를 이용하여, 콘트롤러(FDC)가 트랙의 개시와 종료를 검출할 수 있도록 하고 있다.
예를들어, 5인치의 FDD에서는, 디스크에 인덱스 호올이 미리 형성되어 있어서, 이 인덱스 호올이 광전센서에 연결된 인덱스 검출기에 의해 검출될 때, 인덱스펄스가 출력되도록 하고 있다. 또, 3.5인치의 FDD에서는, 인덱스호올은 없고, 디스크와 스핀들모터가 일정한 각도로 첵킹되도록 스핀들에 신호발생부, 예를들면 마그네트를 설치하고 있다.
그런데, FDD간의 호환성을 유지하기 위해서는 트랙의 선두에서부터 정상적으로 데이타가 판독 기입되도록, 지연 인덱스 펄스의 입상위치(즉, '로우'상태에서 '하이'상태로의 천이위치)가 조정되어야 한다. 이 경우, 인덱스펄스와 지연 인덱스 펄스와의 위치오차를 인덱스 위치 정밀도라고 한다. 종래에는, 적절한 인덱스 위치 정밀도를 얻기 위하여, 예를들면, 5인치 FDD에서는 센서의 부착위치를 조정하고, 또 3.5인치 FDD에서는 전기적으로 지연 인덱스 펄스의 입상을 지연시키는 방식이 있었다. 이상의 조정방식에서는, 통상 CE(custormer engineer) 디스크가 사용되었고, 저항과 커패시터를 가변 함으로써 지연시간이 조정되도록 하였다.
그러나, 어떠한 방식에서도 인덱스 조정의 자동화 및 고정밀도화는 곤란하였다.
본 발명은 상기한 사정을 감안하여 이루어진 것으로서, 그 목적은 플로피 디스크 드라이브 유니트의 인덱스 신호 발생 타이밍을 자동적으로 조정할 수 있는 시스템을 제공하기 위한 것이다.
본 발명의 시스템은 스핀들에 세트된 CE디스크의 회전상태를 나타내는 회전신호를 발생하기 위한 회전신호 발생수단과, 상기 CE 디스크에 기록된 버스트 데이타에서 버스트 신호를 발생하기 위한 버스트 신호발생수단과, 지연시간 데이타를 기억하기 위한 기억수단과, 상기 회전신호 발생수단에 의해 회전신호가 발생되었을 때, 상기 기억수단에 기억되어 있던 지연시간 데이타에 의한 시간이 경과한 후, 인덱스 신호를 발생하기 위한 인덱스 신호발생수단과, 상기 인덱스 신호 발생수단에 의해 발생된 인덱스 신호가 유효상태로 될 때로부터 상기 버스트 신호 발생수단에 의해 버스트 신호가 발생될 때까지의 시간을 계측하기 위한 계측수단과, 상기 계측수단에 의하여 계측된 시간으로부터 미리 결정된 시간을 감산하고, 감산 결과에 대응하는 지연시간 데이타를 결정하기 위한 연산제어 수단과, 상기 연산제어 수단으로부터의 기입제어신호에 따라서, 어드레스를 발생하기 위한 어드레스 발생수단 및 기입 제어신호에 따라서, 상기 어드레스 발생수단에 의해 발생되어 상기 기억수단의 어드레스로 결정된 지연시간 데이타를 상기 기억수단에 기입하기 위한 기입수단을 구비하는 것이다.
이상, 상세히 설명한 바와같이, 본 발명에 의하면, 플로피 디스크 드라이브 유니트의 호환성을 얻기 위한 인덱스 신호 발생 타이밍의 조정을 자동적으로, 또 고정밀도로 행할 수 있게 된다. 따라서, 결과적으로 플로피 디스크 드라이브 유니트의 제조공정의 효율화를 도모할 수 있게 되고, 또 제조 코스트의 절감을 실현할 수 있다.
이하에, 첨부도면을 참조하여, 본 발명에 따른 인덱스 신호 발생 타이밍 조정 시스템의 일실시예에 대하여 설명한다.
우선, 제 1 도 내지 제 4 도를 참조하여, 본 발명의 일실시예의 구성을 설명한다. 제 1 도를 참조로 하면 스핀들(18)에는 마그네트(20)가 부착되어 있다. 또, 스핀들(18)에는 CE디스크(12)가 세트되어 있다. 검출기(22)는, 예를들면, 호올소자로 구성되어, 스핀들(18)이 모터(도시생략)에 의해 회전 구동될 때, 마그네트(20)의 자계를 검출하는 것이다. 검출된 회전신호 RS는, 인덱스 검출기(24)로 출력된다. 회전신호 RS는, 검출기(24)에 의해, 회전신호 RS의 피크에서 입상하는 회전 펄스신호 RP로 변환된다. 검출기(24)는 당해 기술분야의 숙련자에게는 잘 알려져 있는 회로이다. 변환된 회전펄스 신호 RP는 인덱스 펄스 발생기(26)에 공급된다. 발생기(26)에는, 클럭 발생기(28)로부터의 클럭 CLK1과 메모리(32)로부터의 지연시간 데이타가 공급되고 있다. 발생기(26)에 의해 발생된 인덱스 펄스 IP는 카운터부(54)로 출력된다.
인덱스 펄스 발생기(26)의 상세구성이 제 4 도에 도시되어 있다. 제 4 도를 참조로 하면 RS플립플롭(82)의 입력단자에 회전펄스 신호 RP가 공급된다. 이에따라 회전 펄스신호 RP가 유효상태로 되는 타이밍에서 플립플롭(82)이 세트된다. AND 게이트(84)는 플립플롭(82)의 Q 출력과, 클럭발생기(28)로부터의 클럭 CLK1을 입력으로서 수신하고 그들의 논리적을 카운터(86)로 출력한다. 카운터(86)에는, 메모리(32)에 기억되어 있는 지연시간 데이타가 프리세트된다. 카운터(86)은 AND게이트(84)로부터 출력되는 클럭에 따라서 카운트다운되고, 카운트가 "0"로 되었을 때 바로우(borrow) 신호가 인덱스 펄스 IP로서 출력된다. 인덱스 IP는, 인버터(88)에 의하여 반전된 후, 카운터(86)과 플립플롭(82)의 R단자에 공급된다. 반전된 인덱스 펄스 IP의 입상에 의하여 카운터(86)은 클리어 되고, 플립플롭(82)는 리세트 된다. 이것에 의하여 그 Q출력은 "0"이 된다.
스핀들(18)에 세트된 CE디스크(12)로부터 자기 헤드(14)에 의해 버스트 데이타가 판독되고, 증폭기(16)에 의해 증폭되어서 버스트 신호 BS가 발생된다. 버스트 신호 BS는 카운터부(54)에 공급된다.
메모리(32)는 불휘발성 메모리이고,예를들면 ROM, 혹은 P-ROM으로 구성된다. 메모리(32)에는, 어드레스 발생기(30)로부터의 어드레스 A와 고전압 기입회로(60)로부터의 지연시간 데이타 D가 공급되고 데이타 D는 어드레스 A에 기입된다. 메모리(32)의 어드레스 A에는, 제조시에는 아무 것도 기입되어 있지 않고, 이 조정처리에 의해 비로소 데이타가 기입된다. 어드레스 발생기(30)는 입력되는 지시에 따라서 어드레스 A를 발생하고 메모리(32)에 기록된 지연시간 데이타가 판독되어 인덱스 펄스 발생기(26)에 공급된다.
이상과 같이, 자기헤드(14), 증폭기(16), 스핀들(18), 마그네트(20), 검출기(22), 인덱스 검출기(24), 인덱스 펄스발생기(26), 클럭발생기(28), 어드레스 발생기(30) 및 메모리(32)가 플로피 디스크 드라이브 유니트(10)에 포함된다. 다음에, 조정유니트(50)의 구성을 설명한다.
카운터(54)는, 증폭기(16)로부터의 버스트 신호 BS를 또 인덱스 펄스 발생기(26)로부터의 인덱스 펄스 IP를 입력으로서 수신한다. 카운터(54)에 입력되는 버스트 신호 BS는 펄스형성회로(62)에 의해 그 피크에서 입상하는 버스트 펄스 BP로 변환된다. 이회로(62)는 당해 기술분야의 숙련자에는 잘 알려져 있는 회로이다.
카운터(67)은 인덱스 펄스 IP가 유효상태로 될 때부터, 버스트 펄스가 유효상태로 될 때까지의 시간을 클럭발생기(52)로부터의 클럭 CLK2에 의해 계측한다. 카운터부(54)의 상세구성이 제 2 도에 도시되어 있다.
제 2 도를 참조로 하면 RS플립플롭(65)의 S단자에는, 인덱스 펄스 발생기(26)로부터의 인덱스 펄스 IP가 공급되고 있다. 이에따라 플립플롭(65)는, 인덱스 펄스 IP에 의해 세트된다. 플립플롭(65)의 R단자에는 버스트 펄스 BP가 형성회로(65)로부터 공급되고 있다. 플립플롭(65)의 Q출력은 CPU(56)에 공급되고 계측의 개시와 종료를 알기 위하여 사용된다. 플립플롭(65)의 Q출력은 또, AND게이트(66)으로 출력된다. AND게이트(66)의 다른 입력단자에는 클럭발생기(52)로부터의 클럭 CLK2가 공급되고 있다. AND게이트(66)의 출력은, 카운터(67)에 공급되어 카운트된다. 카운트 결과는 CPU(56)에 의해 판독되고, 그후 CPU(56)로부터 신호에 의해 카운터(67)는 리세트된다.
스타트 명령이 입력되었을 때 CPU(56)은 ROM(58)에 기입된 프로그램에 따라서, 인덱스 펄스를 발생하는 타이밍을 결정하기 위한 처리를 개시한다. 카운터(54)로부터 카운트가 입력되면 그 카운트 값으로부터 시간 T2(후에 설명함)를 감산하고, 그 결과를 지연시간 데이타로서 결정한다. 지연시간 데이타가 결정되면 CPU(56)는 기입회로(60)에 지연시간 데이타를 유지시킨다. 그후 기입 제어신호 OE를 어드레스 발생기(30)와 기입회로(60)에 출력하고, 지연시간 데이타를 메모리(32)에 기입토록 한다.
기입회로(60)와 어드레스 발생기(30)의 상세구성이 제 3 도에 도시되어 있다. 제 3 도를 참조로 하면, 저항군(71)의 일단은 메모리(32)의 기입 어드레스에 따라서 전원전압 혹은 그라운드에 접속되어 있다. 타단은 드라이버군(72)에 각각 접속되어 있다. 드라이버군(72)의 각 3상태 드라이버는, CPU(56)로 부터의 기입 제어 신호 OE에 의해 제어되고 있다. 제어신호 OE가 입력되었을 때, 어드레스 A 가 메모리(32)에 공급된다. 또 레지스터(74)는 데이타를 유지하고, 드라이버군(72)에 공급되는 제어신호 OE에 따라서, 어드레스 A와 동시에 지연시간 데이타가 메모리(32)로 출력된다. 이때, 도시하지 않은 고전압도 동시에 메모리(32)에 공급된다.
그후, 인덱스 펄스의 위치조정이 정확히 되었는지의 여부를 조사히기 위하여 상술한 바와같은 동작이 반복되고, 정확히 지연시간 데이타가 메모리(32)에 기입되었을 때 CPU(56)는 지시계(57)를 구동한다.
다음에, 제 5a 도 내지 f를 참조로 하여 본 실시예의 동작을 설명한다.
플로피 디스크 드라이브 유니트(10)의 전원이 턴온되고, CE디스크(12)가 세트된 상태에서 CE디스크(12)가 회전되고 있다고 하자, 이때, CPU(56)에 조정개시 명령이 입력되면, CPU(56)는 카운터부(54)에서 계측된 지연시간을 입력으로서 수신한다.
마그네트(20)가 스핀들(18)과 함께 회전하고, 검출기(22)에 의해 제 5a 도에 표시하는 바와같은 회전신호 RS가 검출된다. 검출된 회전신호 RS는 인덱스 검출기(24)에 의해 제 5b 도에 표시되는 회전펄스 RP로 변환되고, 인덱스 펄스발생기(26)에 공급된다. 발생기(26)에는 메모리(32)의 어드레스 발생기(30)에서 출력된 어드레스에 저장되어 있던 지연시간 데이타가 미리 공급되고 있다. 그러나, 이 어드레스에는 아무 것도 기입되어 있지 않기 때문에, 데이타는 "0"이다. 여기서 카운터(86)는 지연시간없이 인덱스 펄스 IP를 카운터부(54)로 출력한다.
카운터부(54)에 입력된 인덱스 펄스 IP는 RS플립플롭(65)의 S단자에 공급된다. 이것에 의하여, 플립플롭(65)의 Q츨력은 "1"이 되고, 클럭 발생기(52)로부터의 클럭 CLK2는, 제 5e 도에 표시하는 바와같이 AND게이트(66)를 거쳐 카운터(67)에 공급되어, 카운트된다.
CE 디스크(12)가 회전될 때 제 5c 도에 표시되는 바와같이 헤드(14)에 의해 버스트 신호 BS가 판독되고, 증폭기(16)에 의해 증폭된 후, 제 5d 도에 표시되는 바와같이 형성회로(62)에 의해 대응 버스트 펄스 BP가 발생되어, 플립플롭(65)로 출력된다. 플립플롭(65)은 버스트 펄스 BP에 의하여 리세트되고, 그 Q 출력은 "0"이 된다. 따라서 클릭 CLK2는 카운터(67)에 공급되지 못하게 되고, 카운트는 정지한다. CPU(56)은 플립플롭(65)의 출력을 모니터하고 있고, 그 Q 출력이 "0"이 되면 카운터(67)의 값 T1을 판독하고 카운터(67)을 리세트한다.
CPU(56)는 카운트값 T1을 판독한 후 클럭 CLK1에 의해(T1-T2)를 계산한다. 시간 T2는 미리 결정되어 있기 때문에, (T1-T2)가 지연시켜야 할 시간, 즉 지연시간 데이타가 된다. 지연시간 데이타가 구해지면, CPU(56)는 기입회로(60)에 지연시간 데이타를 유지시킨다. 그후 기입제어신호를 발생하고, 어드레스 발생기(30)와 기입회로(60)로 하여금 지연시간 데이타를 메모리(32)에 기입시키도록 한다.
지연시간 데이타의 기입이 종료하면, 플로피 디스크 드라이브 유니트(10)는 리세트되어, 메모리(32)의 어드레스 발생기(30)로부터의 어드레스에서 판독된 지연시간 데이타가, 인덱스 펄스 발생기(28)의 카운터(86)에 프리세트 된다. 그후, 인덱스 검출기(24)에서, 상술한 바와같이 하여 회전펄스 RP가 출력되고, 인덱스펄스 발생기(26)에 공급된다. 회전펄스 RP는 RS플립플롭(82)의 S단자에 공급되고, 플립플롭(82)는 세트된다. 플립플롭(82)의 Q출력은 AND게이트(84)의 한쪽 입력단자에 공급된다. 게이트(84)의 다른쪽 단자에는 클럭 발생기(28)로부터의 클럭CLK1에 공급되고 있고, AND게이트(84)의 입력은 카운터(86)에 출력된다. 카운터(86)은, 메모리(32)에서 공급된 지연시간 데이타를 프리세트값으로 하고, 클럭 CLK1이 AND게이트(84)를 거쳐 입력될때마다, 카운트다운한다. 카운트가 "0"이 되었을 때 바로우 펄스를 인덱스 펄스 IP로서 출력한다. 인덱스 펄스 IP는 카운터(54)로 출력된다. 카운터(86)과 플립플롭(82)은 인버터(88)에서 반전된 펄스 IP에 의해 리세트된다.
RS플립플롭(65)은 인덱스 펄스 발생기(26)로부터의 인덱스 펄스 IP에 의해 세트되고, 상술한 바와같이 하여 시간 T2를 계측한다. 계측이 종료하면, CPU(56)는 그 계측치가 미리 정해진 값의 허용오차 범위인 것을 확인한 후, 지시계(57)로 하여금 조정처리의 종료를 나타내도록 한다.
기입회로(60)는 조정유니트(50)의 내부에 있다고 설명하였으나, 플로피 디스크 드라이브 유니트 10의 내부에 있도록 하여도 좋다.
또, 상기 실시예에서는, 마그네트 호올소자를 사용할 경우에 대하여 설명하였으나, 마그네트(20)와 검출기(22) 대신에 발광유니트와 수광유니트를 사용할 수도 있다. 또, 5인치 디스크와 같이 인덱스 호올을 갖는 경우에는, 제 1 도에서 점선으로 표시한 바와 같이 발광소자(40)와 수광소자(42)를 설치할 수도 있다.

Claims (10)

  1. 플로피 디스크 드라이브 유니트와 조정 유니트로 구성되는 인덱스 신호발생 타이밍 조정시스템에 있어서. 스핀들에 세트된 CE디스크의 회전 상태를 표시하는 회전 신호를 발생하기 위한 회전신호 발생수단과, 상기 CE디스크에 기입된 버스트 데이타에서 버스트 신호를 발생하기 위한 버스트 신호 발생수단과, 지연시간 데이타를 기억하기 위한 기억수단과, 상기 회전신호 발생수단에 의하여 회전신호가 발생되었을 때 상기 기억수단에 기억되어 있던 지연시간 데이타에 의한 시간이 경과한 후 인덱스 신호를 발생하기 위한 인덱스 신호 발생수단과, 상기 인덱스 신호 발생수단에 의해 발생되는 인덱스 신호가 유효상태로 될 때부터 상기 버스트신호 발생수단에 의하여 버스트 신호가 발생될 때까지의 시간을 계측하기 위한 계측수단과, 상기 계측수단에 의하여 계측된 시간으로부터 미리 결정된 시간을 감산하고, 그 감산결과에 대응하는 지연시간 데이타를 결정하기 위한 연산 제어수단과, 상기 연산 제어수단으로부터의 기입제어 신호에 따라서 어드레스를 발생하기 위한 어드레스 발생수단 및 기입제어 신호에 따라서, 상기 어드레스 발생수단에 의해 발생되어 상기 기억수단의 어드레스로 결정된 지연시간 데이타를 상기 기억수단에 기입하기 위한 기입수단을 구비하는 것을 특징으로 하는 시스템.
  2. 제 1 항에 있어서, 상기 회전 신호 발생수단, 상기 버스트 신호 발생수단, 상기 기억수단, 상기 어드레스 발생수단 및 상기 인덱스 신호 발생수단은 상기 플로피 디스크 드라이브 유니트에 포함되고, 상기 계측수단, 상기 연산 제어수단 및 상기 기입수단은 상기 조정유니트에 포함되는 것을 특징으로 하는 시스템.
  3. 제 1 항에 있어서, 상기 회전신호 발생수단, 상기 버스트 신호 발생수단, 상기 기억수단, 상기 인덱스 신호 발생수단, 상기 어드레스 발생수단 및 상기 기입수단은 상기 플로피 드라이브 유니트에 포함되고, 상기 계측수단과 상기 연산 제어수단은 상기 조정 유니트에 포함되는 것을 특징으로 하는 시스템.
  4. 제 1 항에 있어서, 상기 기억수단은 불휘발성이고, 또 기입가능한 메모리인 것을 특징으로 하는 시스템.
  5. 제 1 항에 있어서, 상기 회전신호 발생수단은 스핀들에 부착된 마그네트와, 상기 마그네트로부터 자계를 검출하기 위한 호올소자를 추가로 구비하는 것을 특징으로 하는 시스템.
  6. 제 1 항에 있어서, 상기 회전신호 발생수단은 스핀들에 부착된 발광수단과, 상기 발광수단으로부터 빛을 검출하기 위한 수광수단을 포함하는 것을 특징으로 하는 시스템.
  7. 제 1 항에 있어서, 상기 회전신호 발생수단은 CE디스크상에 그것으로부터 격리되어 설치된 발광수단과, 상기 CE디스크에 대해 상기 발광수단과, 반대측으로 격리되어 설치되고, 또 상기 CE디스크의 인덱스 호올을 개재하여 상기 발광수단에서 입사되는 빛을 검출하기 위한 수광수단을 포함하는 것을 특징으로 하는 시스템.
  8. 제 1 항에 있어서, 상기 연산제어수단은 인덱스 신호에 의해 계측된 시간이 미리결정된 시간의 허용오차 이내에 있는지의 여부를 결정하기 위한 수단을 추가로 구비하는 것을 특징으로 하는 시스템.
  9. 제 8 항에 있어서, 상기 연산 제어수단은 인덱스 신호에 의해 계측된 시간이 미리 결정된 시간의 허용오차 이내에 있지 않을 때, 지연시간 데이타를 결정하기 위하여 선택된 신호를 회전신호로 하기 위한 수단을 추가로 구비하는 것을 특징으로 하는 시스템.
  10. 제 8 항에 있어서, 인덱스 신호에 의해 계측된 시간이 미리 결정된 시간의 허용오차 이내에 있을 때, 조정처리의 종료를 알리기 위한 지지수단을 추가로 구비하는것을 특징으로 하는 시스템.
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