KR880002255A - 집적회로 분리방법 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 하부에 제1패드 산화물 층을 갖고 있는 제1질화물 층이 포토레지스트로 패턴화되고 질화물, 산화물, 및 실리콘의 노출부가 리세스-에칭된 본 발명의 제1단계를 도시한 횡단면도.
제2도는 제2열 산화물 층이 성장되고, 포토레지스트 층이 제거된 본 발명의 제2단계를 도시한 횡단면도.
제3도는 제2질화물 층 및 두꺼운 측벽 산화물 층의 증착후의, 본 발명 방법의 제3단계를 도시한 횡단면도.
Claims (32)
- 좁은 리세스와 넓은 리세스들에 의해 분리된 반도체 기판내의 영역을 분리하기 위한 방법에 있어서, 넓은 리세스내에서만 제 1 필드 산화물을 성장시키는 수단, 및 좁은 리세스 및 넓은 리세스의 소정의 나머지 비-충전 부분을 채우기 위해 기판상에 제2필드 산화물을 증착시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제1항에 있어서, 기판이 패드 산화물 층 및 질화 실리콘층으로 덮혀진 다음, 제1필드 산화물을 성장시키기 전에 넓은 리세스의 저부에 갭을 제공하기 위해 에칭되는 것을 특징으로 하는 방법.
- 제1항에 있어서, 기판이 패드 산화물 층, 폴리실리콘 층 및 질화 실리콘 층으로 덮혀지고, 제1필드 산화물을 성장시키기 전에 넓은 리세스 내의 기판에 갭을 제공하기 위해 이 층들을 에칭시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제2항에 있어서, 에칭이 비등방성인 것을 특징으로 하는 방법.
- 제3항에 있어서, 에칭이 비등방성인 것을 특징으로 하는 방법.
- 실리콘 기판내에 집적 회로용 분리 영역을 제조하기 위한 방법에 있어서, 제1산화물 층으로 기판의 선정된 부분을 덮는 수단, 제1질화 실리콘 층으로 제1산화물 층을 덮는 수단. 리세스에 인접한 모우트를 형성하기 위해 제 1산화물 및 제 1질화물 층들을 통해 기판에 넓은 좁은 리세스들을 에칭시키는 수단, 기판상에 제2질화 실리콘 층을 증착시키는 수단, 넓은 리세스의 저부에서 제2질화물 층을 통해 갭을 제거하기위해 넓은 리세스를 에칭시키는 수단, 갭에 의해 노출된 영역상의 넓은 리세스 내에 제1필드 산화물을 성장시키는 수단, 좁은 리세스 및 넓은 리세스의 나머지 부분을 채우기 위해 제2필드 산화물 층을 증착시키는 수단, 및 모우트들 사이에 분리 영역을 형성하기 위해 리세스의 상연부에 근사한 레벨로 제2필드 산화물층을 프레너화시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제6항에 있어서, 제1산화물 층과 제1질화 실리콘 층 사이에 폴리실리콘 층을 형성하는 수단을 포함하는 것을 특징으로 하는 방법.
- 제6항에 있어서, 제2질화물 층을 증착시키기 전에 리세스의 측벽을 덮기위해 제2산화물 층을 성장시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제6항에 있어서, 좁은 리세스가 채워지고 넓은 리세스가 최소한 부분적으로 채워지도록 제2질화 실리콘 층상에 제2산화물 층을 증착시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제9항에 있어서, 제2산화물 층의 나머지 부분이 넓은 리세스 내에 제1필드 산화물을 성장시키기전에 제거되는 것을 특징으로 하는 방법.
- 제6항에 있어서, 제2필드 산화물 층을 증착시키기 전에 제1및 제2질화 실리콘 층을 제거시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제6항에 있어서, 리세스가 약 5,000Å의 길이로 에칭되는 것을 특징으로 하는 방법.
- 제6항에 있어서, 제2필드 산화물 층이 약 10,000Å의 두께를 갖고 있는 것을 특징으로 하는 방법.
- 제6항에 있어서, 제1필드 산화물 층이 약 10,000Å의 두께를 갖고 있는 것을 특징으로 하는 방법.
- 단결정성 실리콘 기판내에 집적 회로용 분리 영역을 제조하는 방법에 있어서, 패드 산화물 층으로 기판의 선정된 부분을 덮는 수단, 패드 산화물 층 상에 제1질환 실리콘층을 형성하는 수단, 리세스에 인접한 모우트를 형성하기 위해 패드 산화물 및 제1질화물 층을 통해 기판에 넓고 좁은 리세스들을 에칭시키는 수단, 리세스의 측벽을 덮기위해 제1측벽 산화물 층을 성장시키는 수단, 제1측벽 산화물 층을 덮기위해 제2질화 실리콘 층을 증착시키는 수단, 좁은 리세스가 채워지도록 제1및 제2질화물 층상에 제2측벽 산화물 층을 증착시키는 수단, 넓은 리세스의 저부에서 제2질화 실리콘 층을 통해 갭을 제거하기 위해 넓은 리세스를 에칭시키는 수단, 갭에 의해 노출된 영역상에 제1필드 산화물을 성장시키는 수단, 제1및 제2질화 실리콘층을 제거시키는 수단, 좁은 리세스를 채우기 위해 제2필드 산화물 층을 증착시키는 수단, 및 모우트들 사이에 분리 영역을 형성하기 위해 리세스의 상연부에 근사한 레벨로 제2필드 산화물을 프래너화시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제15항에 있어서, 프래너화 스텝후에 패드 산화물 층을 제거 시키는 수단, 실리콘 기판의 노출부상에 게이트 산화물 층을 성장시키는 수단, 및 트랜지스터 게이트용으로 사용되도록 게이트 산화물 층상에 물질을 증착시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제15항에 있어서, 제2측벽 산화물 층의 나머지 부분이 제1필드 산화물을 성장시키기 전에 제거되는 것을 특징으로 하는 방법.
- 제15항에 있어서, 패드 산화물 층과 질화 실리콘 층 사이에 폴리실리콘 층을 형성하는 수단을 포함하는 것을 특징으로 하는 방법.
- 제15항에 있어서, 리세스가 약 5,000Å의 깊이로 애칭되는 것을 특징으로 하는 방법.
- 제15항에 있어서, 제2필드 산화물 층이 약 10,000Å의 두께를 갖고 있는 것을 특징으로 하는 방법.
- 제15항에 있어서, 제1필드 산화물 층이 약 10,000Å의 두께로 성장되는 것을 특징으로 하는 방법.
- 좁은 리세스와 넓은 리세스들에 의해 분리된 실리콘 기판내의 활성 영역을 분리하는 방법에 있어서, 측벽 산화물로 모든 리세스를 채우는 수단, 넓은 영역내의 영역을 노출시키기 위해 측벽 산화물을 통해 측벽 에칭을 실행하는 수단, 실리콘 기판의 노출된 영역상에서 제1필드 산화물을 성장시키는 수단, 및 좁은 리세스와 넓은 리세스의 소정의 나머지 비-충전 부분을 채우기 위해 나머지 기판상에 제2필드 산화물 층을 증착시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제22항에 있어서, 측벽 산화물의 나머지 부분이 제1필드 산화물을 성장시키기 전에 제거되는 것을 특징으로 하는 방법.
- 제22항에 있어서, 기판이 측벽 산화물로 리세스를 채우기 전에 패드 산화물 층 및 질화 실리콘 층으로 덮혀지는 것을 특징으로 하는 방법.
- 제24항에 있어서, 폴리실리콘 층이 패드 산화물 층과 질화 실리콘 층사이에 형성되는 것을 특징으로 하는 방법.
- 제16항에 있어서, 제2필드 산화물이 플래너 표면을 형성하기 위해 애칭되는 것을 특징으로 하는 방법.
- 제22항에 있어서, 제2필드 산화물을 증착시키기 전에 질화실리콘을 제거시키는 수단, 제2필드 산화물을 증착시킨 후, 패드 산화물층을 제거시키는 수단, 실리콘 기판의 노출 부분상에 게이트 산화물을 형성하는 수단, 및 트랜지스터 게이트 용으로 사용되도록 게이트 산화물 층상에 물질을 증착시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 제22항에 있어서, 실리콘 기판의 활성 영역상에 게이트 산화물 층을 형성하는 수단, 및 트랜지스터 게이트용으로 사용되도록 게이트 산화물 층에 물질을 증착시키는 수단을 포함하는 것을 특징으로 하는 방법.
- 활성 영역이 제1항에 기술한 방법에 의해 형성된 분리 영역에 의해 분리된 것을 특징으로 하는 반도체 장치.
- 제6항에 기술한 방법에 의해 형성된 분리 영역에 의해 분리된 영역을 갖고있는 것을 특징으로 하는 반도체 장치.
- 제15항에 기술한 방법에 의해 형성된 분리 영역에 의해 분리된 활성 영역을 갖고 있는 것을 특징으로 하는 반도체 장치.
- 제22항에 기술한 방법에 의해 형성된 분리영역에 의해 분리된 활성 영역을 갖고 있는 것을 특징으로 하는 반도체 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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