KR850002914A - 멀티 프로세서 시스템용 메세지 배향식 인터럽트 장치 - Google Patents

멀티 프로세서 시스템용 메세지 배향식 인터럽트 장치 Download PDF

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Abstract

내용 없음

Description

멀티 프로세서 시스템용 메세지 배향식 인터럽트 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 상호 접속 장치의 신호 구조를 도시한 도면. 제3A도 내지 제3b도는 국부 타이밍(local timing)신호가 발생되고 상호 접속 장치에 접속된 장치들 사이의 처리를 하도록 상호 접속 장치의 특정한 실시예에 사용된 여러 가지의 타이밍 신호를 도시한 도면.

Claims (9)

  1. 데이타 프로세싱 시스템내의 통신로 상에서 다른 장치들과 통신하고, 장치 요구시에 1개이상의 상기 다른 장치들의 동작을 인터럽트하고 1개이상의 상기 장치로부터의 인터럽트 요구에 응답하기 위한 장치를 포함하는 장치에 있어서, 데이타 및 명령을 상기 통신로를 거쳐서 개별적으로 통신하기 위해 최소한 1개의 데이타 이송통로 및 1개의 단독 명령 이송통로를 정하는 장치, 인터럽트 명령을 확인하는 정보를 상기 명령 확인 장치, 인터럽트될 1개 이상의 장치를 지정하는 정보를 상기 데이타 이송 통로를 거쳐서 통신하기 위한 장치, 상기 장치가 인터럽트 요구의 영향을 받기 쉬운지의 여부를 결정하도록 장치들로부터의 인터럽트 명령 정보 및 장치 지정정보의 수신에 응답하는 장치, 및 어떤 응답 장치들이 인터럽트 요구를 써비스할 수 있는 장치들인지의 여부를 결정하도록 인터럽트 명령에 응답하는 정보 확인 장치들의 상기 데이타 통로상의 송신에 응답하는 장치로 구성된 것을 특징으로 하는 멀티프로세서 시스템용 메세지 배향식 인터럽트 장치.
  2. 제1항에 있어서, 인터럽트가 요구되는 레벨을 표시하는 정보를 상기 데이타 이송통로상에 송신하기 위한 장치를 포함하는 것을 특징으로 하는 장치.
  3. 제1항에 있어서, 이터럽트가 요구되는 다수의 레벨을 확인하는 정보를 상기 데이타 이송 통로상에 송신하기 위한 장치를 포함하는 것을 특징으로 하는 장치.
  4. 제1항에 있어서, 인터럽트가 요구하는 장치의 미리 할당된 확인 번호를 포함하는 신호를 상기 데이타 이송통로상에 송신하기 위한 장치를 포함하는 것을 특징으로 하는 장치.
  5. 제4항에 있어서, 인터럽트 요구에 연속적으로 응답하여 사용하기 위해 상기 확인 번호를 기억시키기 위한 장치를 포함하는 것을 특징으로 하는 장치.
  6. 제1항에 있어서, 인터럽트될 장치들을 확인하는 디지탈 신호 패턴을 기억시키기 위한 장치를 포함하는 것을 특징으로 하는 장치.
  7. 제6항에 있어서, 상기 장치의 동작의 인터럽트를 요구하기 위해 최소한 1개의 장치에 지시된 제1 처리를 정하는 장치, 및 기억장치내의 인터럽트 루우틴의 위치를 확인하는 정보를 인터럽트 요구 장치로부터 유도해내기 위해 최소한 1개의 장치로부터 인터럽트에 대한 요구를 수신하는 것에 응답하여 발생된 제2처리를 정하는 장치를 포함하는 것을 특징으로 하는 장치.
  8. 제7항에 있어서, 상기 제2 처리 동안에 인터럽트 벡터의 송신을 기다리는 이 장치들 중에서 만조정을 제공하는 장치를 포함하는 것을 특징으로 하는 장치.
  9. 데이타 프로세싱 시스템 내의 통신로 상에서 다른 장치들과 통신하고, 장치 요구시에 1개 이상의 상기 다른 장치들의 동작을 인터럽트하고 1개 이상의 상기 장치로부터의 인터럽트요구에 응답하기 위한 장치를 포함하는 장치에 있어서, 상기 명령 이송 통로상의 인터럽트 명령 및 상기 데이타 이송통로 상의 장치 지정을 상기 장치들에 통신시키기 위해 제1 처리순차를 정하는 장치, 및 상기 장치로부터 인터럽트 벡터를 유도해 내기 위해 상기 명령 이송통로 상의 확인 명령을 상기 장치에 통신시키고 상기 벡터를 구하는 장치를 확인하는 정보를 상기 데이타 통로상에 통신시키기 위해 인터럽트를 내보내고 제2 처리 순차를 정하는 장치로부터의 인터럽트명령 수신에 선택적으로 응답하는 장치로 구성된 것을 특징으로 하는 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019840005835A 1983-09-22 1984-09-22 다중 프로세서 시스템용 메세지 전송 인터럽팅 장치 및 이의 실행방법 KR910001788B1 (ko)

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Families Citing this family (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4831518A (en) * 1986-08-26 1989-05-16 Bull Hn Information Systems Inc. Multiprocessor interrupt rerouting mechanism
US5062040A (en) * 1986-12-22 1991-10-29 At&T Bell Laboratories Handling of notification of asynchronous events by user and stub processes of a distributed process executing on a plurality of processors of a multi-processor system
EP0272837A3 (en) * 1986-12-22 1988-09-07 AT&T Corp. Inter-process signal handling in a multi-processor system
AU604345B2 (en) * 1987-05-01 1990-12-13 Digital Equipment Corporation Interrupting node for providing interrupt requests to a pended bus
US4953072A (en) * 1987-05-01 1990-08-28 Digital Equipment Corporation Node for servicing interrupt request messages on a pended bus
AU604959B2 (en) * 1987-05-01 1991-01-03 Digital Equipment Corporation Servicing interrupts using a pended bus
JPH04128795U (ja) * 1991-05-17 1992-11-25 株式会社タカラ 動作玩具
EP0576764A1 (en) * 1992-06-30 1994-01-05 International Business Machines Corporation Method and apparatus for managing the access to a resource by several users in a data processing system
JP2005316951A (ja) * 2004-03-30 2005-11-10 Seiko Epson Corp 情報端末、情報処理システム、及び、これらの制御方法
US11635915B2 (en) * 2021-03-17 2023-04-25 Macronix International Co., Ltd. Managing memory reliability in memory systems

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50156336A (ko) * 1974-06-05 1975-12-17
JPS5925258B2 (ja) * 1976-09-28 1984-06-15 日本電気株式会社 プロセツサ制御システム
IT1100916B (it) * 1978-11-06 1985-09-28 Honeywell Inf Systems Apparato per gestione di richieste di trasferimento dati in sistemi di elaborazione dati
US4376982A (en) * 1980-06-30 1983-03-15 International Business Machines Corporation Protocol for inter-processor dialog over a communication network
US4381542A (en) * 1980-10-20 1983-04-26 Digital Equipment Corporation System for interrupt arbitration
US4420806A (en) * 1981-01-15 1983-12-13 Harris Corporation Interrupt coupling and monitoring system

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EP0139568A2 (en) 1985-05-02

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