KR20100017296A - 파워 서플라이 - Google Patents

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KR20100017296A KR1020097024420A KR20097024420A KR20100017296A KR 20100017296 A KR20100017296 A KR 20100017296A KR 1020097024420 A KR1020097024420 A KR 1020097024420A KR 20097024420 A KR20097024420 A KR 20097024420A KR 20100017296 A KR20100017296 A KR 20100017296A
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Abstract

스위칭된 모드 파워 서플라이 및 스위칭된 모드 파워 서플라이를 동작하기 위한 방법에 따라서, 파워 출력 스위치의 동작동안 전류 흐름의 각각의 발생의 크기가 네거티브 피드백 제어를 위해 감지된다. 감지 전압은 1차 서플라이 전압에 비례하여 발생된다. 감지 전압이 문턱값을 초과할 때마다, 파워 서플라이의 출력 파워는 감지 전압에 비례하는 전압을 각각의 감지된 크기에 더함으로써 흐르는 전류의 각각의 발생의 감지된 크기를 증가시킴으로써 제한된다. 문턱값 전압은 상이한 절연파괴 전압을 갖는 제너 다이오드를 이용하여 선택될 수 있다. 따라서 보조적인 파워 제한이 발생하고 발생하지 않는 1차 서플라이 전압의 전반적인 범위내 각각의 범위는 제어될 수 있다.
1 : 파워 서플라이 2 : FB 핀 3 : CS 핀

Description

파워 서플라이{POWER SUPPLY}
본 발명의 장치에 따른 전류 모드 제어 스위칭된 모드 파워 서플라이(current mode controlled switched mode power supply)는 문턱값, 예를 들어, 파워 제한이 시작되는 전압 문턱값(voltage threshold)의 선택을 인에이블하는 방식으로 넓은 입력 AC 전압 범위에 걸쳐서 파워 서플라이의 파워 출력(power output)을 제한한다.
전류 모드 제어를 활용하는 스위칭 파워 서플라이는 입력 전압에 비례하는 최대 파워 출력을 제공한다. 넓은 전압 입력 범위에 걸쳐서 사용하기 위한 파워 서플라이에 있어서, 과부하동안 과도한 파워가 입력 AC 전압의 높은 범위에서 전달될 수 있으며, 이것은 파워 서플라이내 트랜스포머, 다이오드 및 트랜지스터에 대해 높은 동작 온도를 야기할 수 있다.
이러한 파워 서플라이에서 파워 제한이 사용되지 않는다면, 파워 서플라이내 부품들이 가장 높은 입력 전압에서 과열 또는 실패없이 과부하동안 최대 출력 파워를 다루도록 설계되어야 한다. 보다 견고한 부품들을 활용함으로써 불필요한 비용을 더하게 되고 부품이 입력 AC 전압의 보다 좁은 범위내 의도되거나 고정된 파워 출력을 위해서만 설계된다면 파워 서플라이가 물리적으로 보다 커지도록 한다.
기존의 전류 모드 제어 스위칭된 모드 파워 서플라이는 파워 서플라이의 출력 스위칭 트랜지스터의 동작 전류를 나타내는 전압에 더해질 수 있는 오프셋 전압을 발생하는 회로를 부분적으로 다룬다. 오프셋 전압은 전압 피드백의 크기를 증가시킨다. 따라서, 파워 제한은 오프셋 부재시 발생할 수 있는 것 보다 낮은 입력 AC 전압에서 시작된다.
기존의 파워 서플라이는 다수의 문제를 해결하지만, 기존의 파워 서플라이의 동작은 보다 나은 개선을 위한 기회를 제공한다. 이처럼 발생된 하나의 이러한 문제는 입력 AC 전압의 크기에 정비례한 DC 전압에 정비례한 오프셋 전압의 크기라는 점이다. 따라서, 파워 제한이 개시된 입력 AC 전압 레벨에 걸쳐서 제어가 존재하지 않는다. 파워 제한은 항상 파워 제한이 필요하지 않을 수도 있을 때 보다 낮은 파워 레벨에서 조차 발생하는데, 이는 파워 제한을 개시하기 위해 입력 AC 전압 범위내에서 문턱값을 설정하는 것이 불가능하기 때문이다. 파워 제한을 개시하기 위한 문턱값을 설정함으로써, 예를 들어, 적절한 성능 기준에 기초한 설계 및 파워 서플라이의 동작을 개선할 수 있도록 하는 것이 유리하다. 이러한 성능 기준은, 예를 들어, 파워 서플라이의 입력 전압 범위를 최적화하는 단계, 파워 서플라이의 최대 부하 능력을 최적화하는 단계, 파워 서플라이의 비용을 최적화하는 단계; 파워 서플라이의 사이즈를 최적화하는 단계, 그리고 파워 서플라이의 동작의 효율성을 최적화하는 단계를 포함할 수 있다.
이러한 문제와 기타 문제들은 파워 제한을 개시하기 위해 입력 AC 전압 범위내에 선택가능한 문턱값을 제공함으로써 본 명세서에 고안된 발명의 장치에 따라서 해결된다. 선택가능한 문턱값은, 예를 들어, 전술한 하나 이상의 성능 기준과 연관된 설계 기준을 충족시키기 위해 보다 많은 비용, 보다 견고한 부품 및 적은 비용, 보다 덜 견고한 부품을 조합함으로써 선택들이 이루어질 수 있도록 한다.
더욱이, 기존에 활용된 포지티브 전압에 비해 문턱값을 설정하기 위한 네거티브 전압을 활용함으로써 본 명세서에서 고안된 발명의 장치에 따라서 설계시 보다 나은 유연성이 제공될 수 있다.
스위칭된 모드 파워 서플라이를 작동하기 위한 발명의 장치에 따른 방법은 1차 서플라이 전압을 수신하는 단계, 반복적으로 상기 1차 서플라이 전압을 부하에 결합하고 상기 1차 서플라이 전압을 상기 부하로부터 결합해제하는 단계, 상기 결합 및 결합 해제 단계에 응답하여 2차 전압 서플라이를 활성화하는 단계, 상기 결합 및 결합해제 단계동안 각각의 전류 흐름의 발생의 크기를 감지하는 단계, 상기 감지 단계에 응답하여 적어도 부분적으로 상기 결합 및 결합해제 단계를 제어하는 단계, 상기 1차 서플라이 전압에 비례하는 감지 전압을 발생하는 단계, 그리고 감지 전압이 문턱값을 초과할 때는 언제나 각각의 흐르는 전류의 발생의 감지된 크기를 증가시킴으로써 상기 파워 서플라이의 출력 파워를 제한하는 단계를 포함한다.
본 발명의 방법은 상기 감지 전압에 비례하는 팩터(a factor)에 의해 상기 흐르는 전류의 각각의 발생의 상기 감지된 크기를 증가시키는 단계, 또는 상기 감지 단계 및 상기 활성화 단계에 응답하여 상기 결합 및 결합해제 단계를 제어하는 단계를 하나 이상 포함한다.
본 발명의 방법은 1차 교류(AC) 서플라이 전압을 수신하는 단계, 상기 흐르는 전류의 각각의 감지된 크기에 관련된 전압 신호를 발생하는 단계, 상기 AC 서플라이 전압의 네거티브 부분에 응답하여 상기 감지 전압을 발생하는 단계, 및 상기 감지 전압이 상기 문턱값을 초과할 때, 상기 감지 전압에 비례하는 팩터에 의해 크기에 있어 각각의 상기 전압 신호를 증가시키는 단계, 및 상기 증가된 크기 전압 신호 및 상기 활성화 단계에 응답하여 상기 결합 및 결합해제 단계를 제어하는 단계를 더 포함한다.
발명의 장치에 따른 스위칭된 모드 파워 서플라이는 1차 서플라이 전압의 소스, 반복적으로 상기 1차 서플라이 전압을 트랜스포머에 결합하고 상기 트랜스포머로부터 상기 1차 서플라이 전압을 결합해제하기 위한 스위치, 상기 트랜스포머에 결합되고 상기 스위치의 동작에 의해 활성화되는 2차 전압 서플라이, 스위치의 상기 동작동안 각각의 전류 흐름의 발생의 크기를 감지하기 위한 저항, 네거티브 피드백 루프의 부분을 형성하고 상기 감지된 크기에 적어도 부분적으로 응답하는 상기 스위치를 위한 컨트롤러, 상기 1차 서플라이 전압에 비례하는 감지 전압 소스, 및 상기 감지 전압이 상기 파워 서플라이의 출력 파워를 제한하기 위해 상기 흐르는 전류의 각각의 상기 발생의 상기 감지된 크기와 상기 감지 전압에 비례하는 보조 전압을 결합하기 위한 문턱값을 초과할 때 동작할 수 있는 회로를 포함한다.
스위칭된 모드 파워 서플라이는 상기 감지된 크기에 응답하고 상기 2차 전압 서플라이의 동작에 응답하는 상기 스위치를 위한 상기 컨트롤러를 더 포함할 수 있다.
1차 서플라이 전압이 교류(AC) 서플라이 전압인 경우에 있어서, 감지 전압은 AC 서플라이 전압의 네거티브 부분에 응답하여 발생될 수 있다.
스위칭된 모드 파워 서플라이는 AC 서플라이 전압의 네거티브 부분을 정류하기 위한 제 1 다이오드, 상기 감지 전압을 개발하기 위해 상기 정류된 전압에 응답하는 커패시터, 및 상기 문턱값을 설정하는 절연파괴 전압(breakdown voltage)을 가지는 제너 다이오드(Zener diode)를 더 포함한다.
도 1은 발명의 장치에 따른 전류 모드 제어 스위칭된 모드 파워 서플라이의 제 1 섹션을 도시하는 도면,
도 1a는 파워 서플라이내 2개의 접지(Z 및 M1)간의 관계를 예시하는 도면,
도 1b는 접지(M1)와 2개의 전압 서플라이(+12V 스탠바이(SB) 및 +12V)간의 관계를 예시하는 도면,
도 2는 파워 서플라이의 제 2 섹션인 도면,
도 3은 파워 서플라이의 제 3 섹션인 도면,
도 2 및 도 3은 각각 도 2와 도 3간의 연속성을 설정하기 위해 트랜스포머(LP102) 및 광-커플러(DP302)를 포함하는 도면.
일반적으로, 전류 모드 제어 스위칭된 모드 파워 서플라이내 전류 스위칭된의 크기는 전류 감지 레지스터를 가로질러 전개된 전압을 측정함으로써 모니터된다. 감지된 전압이 제어 회로 또는 파워 서플라이에 의해 문턱값 설정에 도달할 때, 파워 스위칭 디바이스는 다음 사이클의 개시 때까지 턴오프된다.
AC 입력 전압에 비례하는 오프셋 전압은 감지된 전압에 더해질 수 있으며, 이것은 AC 입력 전압이 상승함에 따라서 스위칭 디바이스를 제어 회로가 턴오프하는 문턱값을 효과적으로 낮게한다.
발명의 장치에 따라서, 감지된 전압 및 오프셋 전압의 조합에 응답하여 제어 회로의 정상적인 피드백 동작을 제외하고 제어 및 디자인 유연성은 파워 제한이 개시되는 문턱값이 선택되고 설정되도록 인에이블함으로써 제공된다. 파워 서플라이의 성분 값 및 성분 파워 용량이 선택될 수 있으며, 예를 들어, 상수 과부하 파워가 AC 입력 전압에 독립적으로 유지될 수 있다.
파워 서플라이(1)는 도 1, 도 1a, 도 1b, 도 2 및 도 3에 도시된다. 파워 서플라이의 다양한 섹션이 도면들간에 나누어지는 방법이 예시의 편의에 기초한다.
도 1은 발명의 장치에 따라서 전류 모드 제어 스위칭된 모드 파워 서플라이(1)의 제 1 섹션(10)을 도시한다. 파워 서플라이의 섹션(10)은 AC 전압 입력 메인 서플라이(RAW B+ 및 LO B+)에 응답하여 2개의 출력 전압을 발생한다. 파워 서플라이내에 Z, M, M1 및 M2로 지정된 4개의 접지가 존재한다. 도 1a에서 회로(10A)는 접지(Z 및 M1)간의 관계를 예시한다. 도 1b에서 회로(10B)는 접지(M1)와 도 3의 제 3 섹션에서 전개된 2개의 전압 서플라이(+12V 스탠드바이(SB) 및 +12V)간의 관계를 예시한다.
도 2는 파워 서플라이(1)의 제 2 부분(20)을 도시한다. 제 2 부분(20)은 제 1 부분(10)에서 발생된 (LO B+ 및 RAW B+) 전압을 수신한다.
도 3은 복수의 2차 전압이 발생되는 파워 서플라이(1)의 제 3 부분(30)을 도시한다. 트랜스포머(LP102)와 광-커플러(DP302) 모두는 파워 서플라이의 설명을 용이하게 하도록 부분(20 및 30)으로 도시한다.
부분(30)은 광-커플러(DP302)를 통해 부분(20)내 제어 회로(IP101)를 집적하기 위해 제 1 피드백 제어 신호를 공급한다. 부분(20)내 제 2 광-커플러(DP106)는 제어 회로(IP101)에 제 2 피드백 제어 신호를 공급한다.
격리 장벽은 트랜스포머(LP102), 광-커플러(DP302) 및 광-커플러(DP106)에 의해 생성된다. 부분(20)내 회로(22)는 부분(20)내 회로의 나머지로부터 절연되고 부분(10 및 20)내 회로로부터 절연된다. 회로의 부분(22)을 위한 접지는 M2로 지정된다.
도 2 및 전류 모드 제어 스위칭 파워 서플라이(1)의 부분(20)을 참조하면, 부분(10)에서 발생된 입력 전압 RAW B+는 파워 서플라이를 위한 에너지의 메인 소스를 제공한다. 트랜스포머(LP102)는 복수의 저전압 출력을 발생하기 위해 부분(30)에서 정류되고 필터되는 출력 전압을 제공한다. 집적 회로(IP101)는 파워 디바이스(TP102)를 스위치하기 위해 사용된 펄스-폭 변조 출력 신호를 제공하는 제어 IC이다. 현재의 바람직한 실시예에서, IP101는 Semiconductor Components Industries, LLC에 의해 제조된 ON Semiconductor® NCP1207B 전류 모드 변조기이다. 데이터 시트는 Publication Order Number: NCP1207A/D, October, 2006-Rev.3.로 이용가능하다.
NCP1207B 전류 모드 변조기의 핀은 다음의 기능과 연관된다. DMG 핀(1)은 불연속적인 동작을 보장하고 7.2V의 고정 오버-전압 검출 레벨을 제공하는 보조 플라이백 신호(flyback signal)를 수신한다. FB 핀(2)이 광-커플러에 접속될 때, 피크 전류 설정 포인트는 출력 파워 요구에 따라서 조절된다. 내부 스킵 레벨 아래의 브링잉 핀(2)은 디바이스를 셧오프 한다. CS 핀(3)은 1차 전류를 감지하고 감지된 전류를 내부 비교기로 라우트한다. 핀(3)과 직렬로 저항을 삽입함으로써 스킵 동작이 발생하는 레벨의 제어를 가능하게 한다. GND 핀(4)은 접지이다. DRV 핀(5)은 외부 MOSFET으로의 드라이버의 출력이다. Vcc 핀(6)은 외부 벌크 커패시터에 접속된다. NC 핀(7)은 접속되지 않는다. HV 핀(8)은 고전압 레일에 접속되어 일정한 전류를 Vcc 벌크 커패시터내로 주입한다.
저항(RP108)은 트랜스포머(LP102)와 트랜지스터(TP102)를 통해 흐르는 전류에 비례하는 전압(Vsense)을 제공하는 전류 감지 저항이다. 감지된 전압(Vsense)은 제어 IC(IP101)의 핀(3)(CS)에 결합된다. 정상적인 동작동안, 이러한 전압이 제어 IC에 대해 입력에서 소정의 문턱값에 도달할 때, 핀(5)(DRV)상의 IP101의 출력은 낮아지며 다음 사이클이 시작될 때까지 트랜지스터(TP102)를 턴오프한다. 시스템이 보다 많은 파워를 필요로 하면, IP101에서 문턱값 전압 레벨은 보다 많은 에너지가 LP102내에 저장되고(보다 높은 피크 전류) 보다 많은 파워가 출력 와인딩(output winding)으로 전달되도록 증가된다. 문턱값 전압은 이용가능한 최대 출력 파워를 제한하는 최대값을 갖는다. 구성요소(LP103)는 페라이트 비드(ferrite bead)이다.
발명의 장치의 바람직한 실시예에 따라서 파워 제한을 개시하기 위한 선택가능한 문턱값은 도 2의 부분(20)을 참조하여 설명된다. 트랜스포머(LP102)의 핀(6)은 다수의 목적지에 저항(RP118)을 통해 결합되는 AC 전압을 제공한다. 다이오드(DP109)는 커패시터(CP108 및 CP110)에 전압을 결합하고, 이 커패시터는 충전되고 IC(IP101)의 Vcc 입력 핀(6)에 결합된 서플라이 전압을 형성한다. 이러한 전압은 저항(RP102, RP122, RP123 및 RP124)에 더 결합되어 트랜지스터(TP101)의 동작을 바이어스시킨다. 트랜스포머(LP102)의 핀(6)으로부터 전압의 포지티브 부분은 IC(IP101)의 DMG 입력 핀(1)에 결합된 것으로서 조절된 전압이 된다. 트랜스포머(LP102)의 핀(6)으로부터 AC 전압의 네거티브 부분은 다이오드(DP103)의 캐소드에 결합된다. AC 전압의 이러한 네거티브 부분은 조절되지 않고 입력 전압 RAW B+에 비례한다. 다이오드(DP103)의 애노드는 제너 다이오드(DP104)의 애노드 및 커패시터(CP118)에 결합되며, 이의 다른 단부는 접지에 결합된다. 다이오드(DP103)는 트랜스포머(LP102)의 핀(6)으로부터 전압의 네거티브 부분을 정류하여 네거티브 서플라이 전압(VTH)을 생성하며, 이것은 커패시터(CP118)에 의해 필터링되고 RAW B+ 전압에 따라 변한다. 네거티브 서플라이 전압(VTH)이 제너 다이오드(DP104)로 하여금 전도되도록 하는 값에 도달할 때, 전압은 전류가 콜렉터내에서 흐르도록 하는 트랜지스터(TP101)의 베이스에서 전개된다. 이어 이러한 콜렉터 전류는 전류 감지 전압을 인공적으로 증가시키는 저항(RP103)에 걸쳐서 전개될 전압 VOFFSET을 야기하는 저항(RP125 및 RP103)을 통해 흐른다. 즉, 보다 적은 전류가 IP101내 소정의 문턱 전압 설정을 위한 감지 저항(RP108)을 통해 흐르도록 한다. 저항(RP122)은 회로의 이득을 제어하고 저항(RP125)은 가능한 전류의 최대 감소를 결정한다. 제너 다이오드(DP104)의 절연파괴 전압은 전압 레벨, 즉, 전압 문턱값을 결정하며, 파워 제한이 시작된다. 도면에 예시된 바람직한 실시예에 있어서, 파워 서플라이는 충분한 부하 용량, 감소된 비용, 감소된 사이즈 및 동작의 효율성의 조합을 제공하기에 최적화된다. 바람직한 실시예는 특히 디지털 셋탑 박스를 위해 적합하며, 여기서 제너 다이오드 절연파괴 전압은 24볼트이다. 전압 문턱값은 제너 다이오드를 상이한 절연파괴 전압으로 대체함으로써 쉽게 조절될 수 있다. 결론적으로, 파워 서플라이는 전술한 바와 같이 부하 용량, 감소된 비용, 감소된 크기 및 동작의 효율성과 같은 성능 인자의 균형에 있어서 재설계하기가 용이하다.
도 3의 부분(30)에 도시된 대부분의 회로는 +5V, +6.5V, +12V, +12V SB(스탠드바이) 및 +5V Ref(Reference)의 2차 저전압 파워 서플라이를 발생한다. +5V, +6.5V 및 +12V 서플라이는 커넥터(BP201)를 통해 파워 서플라이로부터 라우트된다. 부분(30)의 한 섹션은 광-커플러(DP302)에 입력을 공급하며, 이의 동작은 이하 설명된다.
IC(IP101)에 공급된 추가적인 피드백 및 제어 신호가 존재한다. 피드백 신호(FBLOAD)는 광-커플러(DP106)의 출력으로서 발생된다. 제어 신호(RSCONTROL)는 광-커플러(DP106)의 출력으로서 발생된다. 2개의 광-커플러의 출력은 광-커플러(DP302)의 핀(4), 광-커플러(DP106)의 핀(4), 커패시터(CP113) 및 제어 IC(IP101)의 FB 핀(2)의 접합(J1)에서 어느 하나에 결합된다.
피드백 신호(FBLOAD)는 파워 서플라이 부하의 출력 파워 요구에 관련된다. 회로(22)는 +6.5V 전압 서플라이를 모니터한다. 회로(22)내 디바이스(IP102)는 파워 서플라이의 출력 전압을 제어하기 위해 사용된 기준 증폭기이다. 기준 증폭기(IP102)는 고정 2.5V 기준 및 증가된 전류가 기준 전압을 초과하여 증가하는 입력 전압으로서 디바이스의 캐소드에서 흐르도록 하는 증폭기를 포함한다. 전류가 디바이스의 캐소드를 통해 흐를 때, 전류는 또한 광-커플러(DP106)의 다이오드 부분과 직렬로 흐른다. 광-커플러(DP106)의 다이오드 부분에서 흐르는 전류는 전류가 광-커플러(DP106)의 트랜지스터 측에서 흐르도록 하여, 제어 IC(IP101)가 트랜스포머에 공급된 파워를 감소시키도록 한다.
제어 IC(IP101)내 피크 전류 설정 포인트는 피드백 신호(FBLOAD)에 응답하고 따라서 피크 전류는 출력 파워 요구에 따라서 제어된다. 정상적인 동작동안, 제어 IC(IP101)는 DMG 핀(1) 및 CS 핀(3)상의 신호에 응답한다. CS 핀(3)상의 신호가 오프셋 전압(VOFFSET)에 의해 증가되는 동안, 문턱 전압(VTH)이 초과될 때에만 IC(IP101)의 제어 외부에서 출력 파워가 제한된다.
제어 신호(CCONTROL)는 리셋 기능의 부분으로서 파워 서플라이를 셧다운하기 위해 사용된다. 제어 신호(CCONTROL)는 온/오프 신호로서 사용되며, 피드백 신호(FBLOAD)에 비해, 이것은 조절 목적을 위해 사용된 전압 피드백이다. 광-커플 러(DP302)내 다이오드가 전도성일 때, 제어 신호(RSCONTROL)는 공통 접합(J1)을 접지에 또는 접지를 향해 풀다운하여, 피드백 신호(FBLOAD)를 인터럽트한다. 제어 IC(IP101)의 FB 핀(2)에서 전압이 제어 IC(IP101)내 내부 스킵 레벨 미만으로 떨어질 때, 스위칭 디바이스 트랜지스터(TP102)는 광-커플러(DP302)가 턴오프 되고 접합(J1)에서 전압이 다시 피드백 신호(FBLOAD)에 응답할 때까지 턴오프 된다.
제어 IC내에 내장된 정상적인 동작 및 안전한 프로토콜은 발명의 장치에 따를 문턱값 개시형 파워 제한에 의해 역으로 영향을 받지 않는다는 것을 알 수 있다.

Claims (10)

  1. 스위칭된 모드 파워 서플라이를 동작하기 위한 방법에 있어서,
    1차 서플라이 전압(a primary supply voltage)를 수신하는 단계;
    반복적으로 상기 1차 서플라이 전압을 임피던스(an impedence)에 결합하고 상기 임피던스로부터 상기 1차 서플라이 전압을 결합해제하는 단계;
    상기 결합 및 결합해제 단계에 응답하여 2차 서플라이 전압을 활성화하는 단계;
    상기 결합 및 결합해제 단계동안 전류 흐름의 반복적인 발생의 크기를 감지하는 단계;
    상기 감지 단계에 응답하여 적어도 부분적으로 상기 결합 및 결합해제 단계를 제어하는 단계;
    상기 1차 서플라이 전압에 관련된 감지 전압(a sense voltage)을 발생하는 단계; 및
    상기 감지 전압이 문턱값을 초과할 때마다 상기 감지 전압에 비례하는 팩터(a factor)에 의해 상기 흐르는 전류의 상기 발생의 상기 감지된 크기를 증가시킴으로써 상기 파워 서플라이의 출력 파워를 제한하는 단계를 포함하는, 스위칭된 모드 파워 서플라이를 동작하기 위한 방법.
  2. 제 1 항에 있어서,
    상기 감지 단계는 상기 흐르는 전류의 상기 발생의 상기 감지된 크기에 응답하여 전압 신호를 발생하는 단계를 포함하는, 스위칭된 모드 파워 서플라이를 동작하기 위한 방법.
  3. 제 2 항에 있어서,
    상기 감지 단계에 응답하고 상기 활성화 단계에 응답하여 상기 결합 및 결합해제 단계를 제어하는 단계를 더 포함하는, 스위칭된 모드 파워 서플라이를 동작하기 위한 방법.
  4. 제 1 항에 있어서,
    상기 감지 단계에 응답하고 상기 활성화 단계에 응답하여 상기 결합 및 결합해제 단계를 제어하는 단계를 더 포함하는, 스위칭된 모드 파워 서플라이를 동작하기 위한 방법.
  5. 제 1 항에 있어서,
    1차 교류(AC) 서플라이 전압을 수신하는 단계;
    상기 흐르는 전류의 각각의 감지된 크기에 관련된 전압 신호를 발생하는 단계; 및
    상기 AC 서플라이 전압의 네거티브 부분에 응답하여 상기 감지 전압을 발생하는 단계를 포함하는, 스위칭된 모드 파워 서플라이를 동작하기 위한 방법.
  6. 스위칭된 모드 파워 서플라이에 있어서,
    반복적으로 1차 서플라이 전압을 트랜스포머(a transformer)에 결합하고 상기 트랜스포머로부터 상기 1차 서플라이 전압을 결합해제하기 위한 스위치;
    상기 트랜스포머에 결합되고 상기 스위치의 동작에 의해 활성화되는 2차 전압;
    상기 스위치의 상기 동작동안 전류 흐름의 반복적인 발생의 크기를 감지하기 위한 저항;
    네거티브 피드백 루프의 상기 스위치 형성 부분을 위해 그리고 상기 감지된 크기에 적어도 부분적으로 반응하는 컨트롤러;
    상기 1차 서플라이에 관련된 감지 전압의 소스; 및
    상기 감지 전압이 상기 흐르는 전류의 상기 발생의 상기 감지된 크기와 상기 파워 서플라이의 출력 파워를 제한하기 위해 상기 감지 전압에 비례하는 보조 전압을 조합하기 위한 문턱값을 초과할 때 동작할 수 있는 회로를 포함하는, 스위칭된 모드 파워 서플라이.
  7. 제 6 항에 있어서,
    상기 스위치를 위한 상기 컨트롤러는 상기 감지된 크기에 응답하고 상기 2차 서플라이의 동작에 응답하는, 스위칭된 모드 파워 서플라이.
  8. 제 7 항에 있어서,
    상기 감지 전압은 상기 AC 서플라이 전압의 네거티브 부분에 응답하여 발생되는, 스위칭된 모드 파워 서플라이.
  9. 제 6 항에 있어서,
    상기 회로는,
    상기 AC 서플라이 전압의 상기 네거티브 부분을 정류하기 위한 제 1 다이오드;
    상기 감지 전압을 전개하기 위해 상기 정류된 전압에 응답하는 커패시터; 및
    상기 문턱값을 설정하는 절연파괴 전압(breakdown voltage)을 갖는 제너 다이오드(a Zener diode)를 포함하는, 스위칭된 모드 파워 서플라이.
  10. 제 6 항에 있어서,
    상기 회로는,
    상기 1차 서플라이의 부분을 정류하기 위한 제 1 다이오드;
    상기 감지 전압을 전개하기 위한 상기 정류된 부분에 응답하는 커패시터; 및
    상기 문턱값을 설정하기 위한 절연파괴 전압을 갖는 제너 다이오드를 포함하는, 스위칭된 모드 파워 서플라이.
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