KR20060098901A - 플라즈마 디스플레이 패널의 에너지 회수장치 - Google Patents

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Abstract

본 발명은 신뢰성을 향상시킴과 아울러 비용을 저감시킬 수 있는 플라즈마 디스플레이 패널의 에너지 회수장치에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 패널의 에너지 회수장치는 플라즈마 디스플레이 패널의 스캔전극에 서스테인전압을 공급하기 위한 서스테인전압원; 상기 플라즈마 디스플레이 패널에 저장된 에너지를 회수함과 아울러 회수된 에너지를 상기 플라즈마 디스플레이 패널에 재공급하기 위한 소스 커패시터; 및 상기 소스 커패시터에 공급되는 전압을 1/2 서스테인전압으로 일정하게 유지하기 위해 상기 서스테인전압원과 상기 소스 커패시터 사이에 접속된 전압 안정화부를 포함한다.

Description

플라즈마 디스플레이 패널의 에너지 회수장치{ENERGY RECOVERY APPARATUS OF PLASMA DISPLAY PANEL}
도 1은 종래의 플라즈마 디스플레이 패널의 에너지 회수장치를 나타내는 회로도이다.
도 2는 도 1에 도시된 스위치들의 온/오프 타이밍과 패널 커패시터의 출력 파형을 나타내는 타이밍도 및 파형도이다.
도 3은 본 발명의 제 1 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치를 나타내는 도면이다.
도 4는 본 발명의 제 2 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치를 나타내는 도면이다.
<도면의 주요부분에 대한 부호의 설명>
30, 32, 80, 82, 130, 132 : 에너지 회수장치
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 신뢰성을 향상시킴과 아울러 비용을 저감시킬 수 있는 플라즈마 디스플레이 패널의 에너지 회수장치에 관한 것이다.
최근, 음극선관(Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 각종 평판표시장치들이 개발되고 있다. 이러한, 평판표시장치는 액정표시장치(Liquid Crystal Display : LCD), 전계방출 표시장치(Field Emission Display : FED), 플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함) 및 일렉트로 루미네센스(Electro-Luminescence : EL) 표시장치 등이 있다. 이중 PDP는 기체방전을 이용한 표시소자로서 대형패널의 제작이 용이하다는 장점이 있다. 현재 대부분의 PDP는 상부기판에 스캔전극 및 서스테인전극이 형성되고, 하부기판에 어드레스전극이 형성된 3전극 교류 면방전형 PDP가 주로 사용된다.
이러한, 3전극 교류 면방전형 PDP는 다수개의 서브필드로 분리되어 구동되고, 각 서브필드기간에는 비디오 데이터의 가중치에 비례시킨 횟수의 발광이 진행됨으로써 계조표시가 행해지게 된다. 서브필드는 다시 초기화기간, 어드레스기간 및 서스테인기간으로 분할되어 구동된다.
여기서, 초기화기간은 방전셀에 균일한 벽전하를 형성하는 기간이고, 어드레스기간은 비디오데이터의 논리값에 따라 선택적인 어드레스방전이 발생하게 하는 기간이며, 서스테인기간은 어드레스방전이 발생된 방전셀에서 방전이 유지되게 하는 기간이다.
이와 같이 구동되는 3전극 교류 면방전형 PDP의 어드레스 방전 및 서스테인 방전에는 수백 볼트 이상의 고압이 필요하게 된다. 따라서, 어드레스 방전 및 서스테인 방전에 필요한 구동전력을 최소화하기 위하여 에너지 회수장치가 이용된다.
도 1은 종래의 플라즈마 디스플레이 패널의 에너지 회수장치를 나타내는 회로도이다.
도 1을 참조하면, 'Weber(USP-5081400)'에 의해 제안된 플라즈마 디스플레이 패널의 에너지 회수장치(30, 32)는 패널 커패시터(Cp)를 사이에 두고 서로 대칭적으로 설치된다. 여기서, 패널 커패시터(Cp)는 스캔전극(Y)과 서스테인전극(Z) 사이에 형성되는 정전용량을 등가적으로 나타낸 것이다. 이러한, 에너지 회수장치에서 제 1 에너지 회수장치(30)는 스캔전극(Y)에 서스테인펄스를 공급하고, 제 2 에너지 회수장치(32)는 제 1 에너지 회수장치(30)와 교번되게 동작하면서 서스테인전극(Z)에 서스테인펄스를 공급한다.
종래의 플라즈마 디스플레이 패널의 에너지 회수장치(30, 32)의 구성을 제 1 에너지 회수장치(30)를 참조하여 설명하기로 한다. 제 1 에너지 회수장치(30)는 패널 커패시터(Cp)와 소스 커패시터(Cs) 사이에 접속된 인덕터(L)와, 소스 커패시터(Cs)와 인덕터(L) 사이에 병렬로 접속된 제 1 및 제 2 스위치(SW1, SW2)와, 패널 커패시터(Cp)의 스캔전극(Y)과 서스테인전압원(Vs) 사이에 접속된 제 3 스위치(SW3)와, 패널 커패시터(Cp)의 스캔전극(Y)과 기저전압원(GND) 사이에 접속된 제 4 스위치(SW4)를 포함한다.
소스 커패시터(Cs)는 서스테인 방전시 패널 커패시터(Cp)에 충전되는 전압을 회수하여 충전함과 아울러 충전된 전압을 패널 커패시터(Cp)에 재공급한다. 이와 같은 소스 커패시터(Cs)에는 서스테인전압원(Vs)의 절반값에 해당하는 Vs/2의 전압이 충전된다. 인덕터(L)는 패널 커패시터(Cp)와 함께 공진회로를 형성한다. 이를 위해, 제 1 내지 제 4 스위치(SW1 내지 SW4)는 전류의 흐름을 제어한다. 이때, 제 1 내지 제 4 스위치(SW1 내지 SW4)에는 내부 다이오드(D1 내지 D4)가 형성된다. 한편, 제 1 및 제 2 스위치(SW1, SW2)와 인덕터(L)의 사이에 각각 설치된 제 5 및 제 6 다이오드(D5, D6)는 전류가 역방향으로 흐르는 것을 방지한다.
도 2는 도 1에 도시된 스위치들의 온/오프 타이밍과 패널 커패시터의 출력 파형을 나타내는 타이밍도 및 파형도이다.
도 2를 참조하면, t1 기간 이전에 패널 커패시터(Cp)에는 0V의 전압이 충전됨과 아울러 소스 커패시터(Cs)에는 Vs/2의 전압이 충전되어 있다고 가정하여 동작과정을 상세히 설명하기로 한다.
t1 기간에는 제 1 스위치(SW1)가 턴-온(Turn-on) 되어 소스 커패시터(Cs), 제 1 스위치(SW1), 제 5 다이오드(D5), 인덕터(L) 및 패널 커패시터(Cp)로 이어지는 전류 패스가 형성된다. 이에 따라, 소스 커패시터(Cs)에 충전된 Vs/2의 전압은 패널 커패시터(Cp)에 공급된다. 이때, 인덕터(L)와 패널 커패시터(Cp)는 직렬 공진회로를 형성하기 때문에 패널 커패시터(Cp)에는 소스 커패시터(Cs) 전압의 2배인 서스테인전압(Vs)이 충전된다.
t2 기간에는 제 1 스위치(SW1)는 턴-오프 되고, 제 3 스위치(SW3)가 턴-온 된다. 이에 따라, 서스테인전압원(Vs)으로부터 서스테인전압(Vs)이 스캔전극(Y)에 공급된다. 이때, 패널 커패시터(Cp)는 t2 기간동안 서스테인전압(Vs)을 유지한다. 한편, 패널 커패시터(Cp)의 전압은 t1기간에 서스테인전압(Vs)까지 상승하였기 때문에 서스테인 방전을 일으키기 위해 외부에서 공급해 주는 구동전력은 최소화된다.
t3 기간에는 제 3 스위치(SW3)는 턴-오프 되고, 제 2 스위치(SW2)가 턴-온 된다. 이에 따라, 패널 커패시터(Cp), 인덕터(L), 제 6 다이오드(D6) 및 소스 커패시터(Cs)로 이어지는 전류패스가 형성되어 패널 커패시터(Cp)에 충전된 전압이 소스 커패시터(Cs)로 회수된다. 이때, 소스 커패시터(Cs)에는 Vs/2의 전압이 충전된다.
t3 기간 이후에는 제 2 스위치(SW3)는 턴-오프 되고, 제 4 스위치(SW4)가 턴-온 된다. 이에 따라, 패널 커패시터(Cp)의 스캔전극(Y)에는 기저전압(GND)이 공급된다. 이때, 패널 커패시터(Cp)는 서스테인전극(Z)에 서스테인펄스가 공급되는 동안 기저전압(GND)을 유지한다.
한편, 제 2 에너지 회수장치(32)는 제 1 에너지 회수장치(30)와 교번적으로 동작하면서 패널 커패시터(Cp)에 서스테인펄스를 공급한다. 따라서, 패널 커패시터(Cp)에는 서로 반대 극성을 가지는 서스테인전압(Vs)이 공급된다. 이와 같이 패널 커패시터(Cp)에 서로 반대 극성을 가지는 서스테인전압(Vs)이 공급됨으로써 방전셀들에서 서스테인 방전이 일어난다.
그러나, 이와 같은 종래의 에너지 회수장치는 소스 커패시터(Cs)에 공급되는 전압이 없기 때문에 패널 커패시터(Cp)에 서스테인전압(Vs)을 충/방전시킬 때 스캔 전극(Y) 쪽의 임피던스에 따라 전압강하가 발생하게 된다. 이로 인해, 소스 커패시터(Cs)에는 1/2 서스테인전압(Vs/2) 보다 작은 전압이 충전되게 되므로 패널 커패시터(Cp)에는 서스테인전압(Vs) 보다 작은 전압이 충전되므로 신뢰성이 저하되게 된다. 또한, 서스테인전압(Vs)과 소스 커패시터(Cs)에 충전된 전압간의 전압차가 제 1 및 제 2 스위치(SW1, SW2)에 그대로 걸리기 때문에 제 1 및 제 2 스위치(SW1, SW2)의 정격을 높여야 하므로 플라즈마 디스플레이 패널의 비용이 증가하는 문제점이 있다.
따라서, 본 발명의 목적은 신뢰성을 향상시킴과 아울러 비용을 저감시킬 수 있는 플라즈마 디스플레이 패널의 에너지 회수장치를 제공하는데 있다.
상기 목적을 달성하기 위하여, 본 발명에 따른 플라즈마 디스플레이 패널의 에너지 회수장치는 플라즈마 디스플레이 패널의 스캔전극에 서스테인전압을 공급하기 위한 서스테인전압원; 상기 플라즈마 디스플레이 패널에 저장된 에너지를 회수함과 아울러 회수된 에너지를 상기 플라즈마 디스플레이 패널에 재공급하기 위한 소스 커패시터; 및 상기 소스 커패시터에 공급되는 전압을 1/2 서스테인전압으로 일정하게 유지하기 위해 상기 서스테인전압원과 상기 소스 커패시터 사이에 접속된 전압 안정화부를 포함한다.
상기 전압 안정화부는 상기 서스테인전압원과 상기 소스 커패시터 사이에 접속되어 상기 서스테인전압원으로부터의 서스테인전압을 1/2 서스테인전압으로 일정하게 유지하는 제너 다이오드; 및 상기 제너 다이오드와 상기 서스테인전압원 사이에 접속되어 상기 제너 다이오드에 공급되는 전류를 제어하는 저항을 포함한다.
상기 전압 안정화부는 상기 서스테인전압원과 상기 소스 커패시터 사이에 접속되어 상기 서스테인전압원으로부터의 서스테인전압을 1/2 서스테인전압으로 일정하게 유지하는 제 1 제너 다이오드; 상기 소스 커패시터와 기저전압원 사이에 접속되어 상기 소스 커패시터의 양단에 공급되는 전압을 1/2 서스테인전압으로 일정하게 유지하는 제 2 제너 다이오드; 및 상기 서스테인전압원과 상기 제 1 제너 다이오드 사이에 접속되어 상기 제 1 제너 다이오드에 공급되는 전류를 제어하는 제 1 저항을 포함한다.
상기 전압 안정화부는 상기 소스 커패시터와 상기 제 2 제너 다이오드 사이에 접속되어 상기 제 2 제너 다이오드에 흐르는 전류를 제어하는 제 2 저항을 더 포함한다.
본 발명에 따른 플라즈마 디스플레이 패널의 에너지 회수장치는 플라즈마 디스플레이 패널의 스캔전극에 서스테인전압을 공급하기 위한 서스테인전압원; 상기 플라즈마 디스플레이 패널에서 방전에 기여하지 않은 무효전력의 에너지를 회수함과 아울러 회수된 에너지를 상기 플라즈마 디스플레이 패널의 스캔전극에 재공급하기 위한 소스 커패시터; 및 상기 소스 커패시터에 공급되는 전압을 1/2 서스테인전압으로 일정하게 유지하기 위해 상기 서스테인전압원과 상기 소스 커패시터 사이에 접속된 제 1 제너 다이오드를 포함한다.
본 발명에 따른 플라즈마 디스플레이 패널의 에너지 회수장치는 상기 소스 커패시터의 양단에 1/2 서스테인전압을 일정하게 유지하기 위해 상기 소스 커패시터와 상기 제 1 제너 다이오드 사이의 공통노드와 기저전압원 사이에 접속된 제 2 제너 다이오드를 더 포함한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부 도면을 참조한 실시 예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 3 및 도 4를 참조하여 본 발명의 바람직한 실시 예에 대하여 설명하기로 한다.
도 3은 본 발명의 제 1 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치를 나타내는 도면이다.
도 3을 참조하면, 본 발명의 제 1 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치(80, 82)는 패널 커패시터(Cp)를 사이에 두고 서로 대칭적으로 설치된다. 여기서, 패널 커패시터(Cp)는 스캔전극(Y)과 서스테인전극(Z) 사이에 형성되는 정전용량을 등가적으로 나타낸 것이다. 이러한, 에너지 회수장치에서 제 1 에너지 회수장치(80)는 스캔전극(Y)에 서스테인펄스를 공급하고, 제 2 에너지 회수장치(82)는 제 1 에너지 회수장치(80)와 교번되게 동작하면서 서스테인전극(Z)에 서스테인펄스를 공급한다.
본 발명의 제 1 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치(80, 82)의 구성을 제 1 에너지 회수장치(80)를 참조하여 설명하기로 한다. 제 1 에너지 회수장치(80)는 패널 커패시터(Cp)의 스캔전극(Y)에 서스테인전압(Vs)을 공급하기 위한 서스테인전압원(Vs), 패널 커패시터(Cp)의 스캔전극(Y)에 기저전압(GND)을 공급하기 위한 기저전압원(GND), 패널 커패시터(Cp)에 충전된 에너지를 회수함과 아울러 회수된 에너지를 패널 커패시터(Cp)에 재공급하기 위한 소스 커패시터(Cs), 패널 커패시터(Cp)와 소스 커패시터(Cs) 사이에 접속된 인덕터(L), 인덕터(L)와 소스 커패시터(Cs) 사이에 병렬로 접속된 제 1 및 제 2 스위치(SW1, SW2), 제 1 스위치(SW1)와 인덕터(L) 사이에 접속된 제 1 다이오드(D1), 인덕터(L)와 제 2 스위치(SW2) 사이에 접속된 제 2 다이오드(D2), 서스테인전압원(Vs)과 패널 커패시터(Cp)의 스캔전극(Y) 사이에 접속된 제 3 스위치(SW3), 패널 커패시터(Cp)의 스캔전극(Y)과 기저전압원(GND) 사이에 접속된 제 4 스위치(SW4), 서스테인전압원(Vs)과 소스 커패시터(Cs) 사이에 접속된 전압 안정화부(70)를 포함한다.
패널 커패시터(Cp)는 PDP의 스캔전극(Y)과 서스테인전극(Z) 사이에 형성되는 정전용량을 등가적으로 나타낸 것이다. 이러한, 패널 커패시터(Cp)는 서로 반대 극성을 가지는 서스테인전압(Vs)에 의해 서스테인 방전을 발생한다.
소스 커패시터(Cs)는 패널 커패시터(Cp)에 충전된 에너지를 회수함과 아울러 회수된 에너지를 패널 커패시터(Cp)의 스캔전극(Y)에 재공급한다.
인덕터(L)는 제 1 내지 제 4 스위치(SW1 내지 SW4)의 스위칭 제어신호에 의해 패널 커패시터(Cp)로부터 공급되는 에너지를 저장함과 아울러 패널 커패시터(Cp)와의 LC 공진에 의해 저장된 에너지를 패널 커패시터(Cp)에 공급한다.
제 1 스위치(SW1)는 소스 커패시터(Cs)와 제 1 다이오드(D1) 사이에 접속되 어 타이밍 콘트롤러(도시하지 않음)로부터 공급되는 제 1 스위칭 제어신호에 의해 소스 커패시터(Cs)에 저장된 에너지가 패널 커패시터(Cp)에 공급되도록 전류패스를 형성한다.
제 2 스위치(SW2)는 소스 커패시터(Cs)와 제 2 다이오드(D2) 사이에 접속되어 타이밍 콘트롤러(도시하지 않음)로부터 공급되는 제 2 스위칭 제어신호에 의해 패널 커패시터(Cp)에서 방전에 기여하지 않는 무효전력의 에너지가 소스 커패시터(Cs)에 공급되도록 전류패스를 형성한다.
제 3 스위치(SW3)는 서스테인전압원(Vs)과 패널 커패시터(Cp)의 스캔전극(Y) 사이에 접속되어 타이밍 콘트롤러(도시하지 않음)로부터 공급되는 제 3 스위칭 제어신호에 의해 서스테인전압원(Vs)으로부터의 서스테인전압(Vs)이 패널 커패시터(Cp)의 스캔전극(Y)에 공급되도록 전류패스를 형성한다.
제 4 스위치(SW4)는 패널 커패시터(Cp)의 스캔전극(Y)과 기저전압원(GND) 사이에 접속되어 타이밍 콘트롤러(도시하지 않음)로부터 공급되는 제 4 스위칭 제어신호에 의해 기저전압원(GND)으로부터의 기저전압(GND)이 패널 커패시터(Cp)의 스캔전극(Y)에 공급되도록 전류패스를 형성한다.
이러한, 제 1 내지 제 4 스위치(SW1 내지 SW4) 각각은 반도체 스위치 소자 예를 들면, MOSFET, IGBT, SCR, BJT 중 어느 하나로 구성된다.
제 1 다이오드(D1)는 제 1 스위치(SW1)와 인덕터(L) 사이에 접속되어 패널 커패시터(Cp)의 충전 시 패널 커패시터(Cp)로부터의 역전류를 방지한다.
제 2 다이오드(D2)는 인덕터(L)와 제 2 스위치(SW2) 사이에 접속되어 패널 커패시터(Cp)의 방전 시 소스 커패시터(Cs)로부터의 역전류를 방지한다.
전압 안정화부(70)는 서스테인전압원(Vs)과 소스 커패시터(Cs) 사이에 접속되어 제 1 에너지 회수장치(80)에서 부하의 변동에 의해 전류가 변화되더라도 소스 커패시터(Cs)에 공급되는 전압이 1/2 서스테인전압(Vs)을 일정하게 유지하도록 서스테인전압원(Vs)으로부터 공급되는 전압을 안정화시킨다. 이러한, 전압 안정화부(70)는 서스테인전압원(Vs)과 소스 커패시터(Cs) 사이에 직렬로 접속된 저항(R) 및 제너 다이오드(ZD)를 포함한다.
저항(R)은 서스테인전압원(Vs)과 제너 다이오드(ZD) 사이에 접속되어 제너 다이오드(ZD)에 흐르는 전류를 제어한다.
제너 다이오드(ZD)는 저항(R)과 소스 커패시터(Cs) 사이에 접속되어 서스테인전압원(Vs)으로부터 공급되는 서스테인전압(Vs) 중 1/2 서스테인전압(Vs/2)이 소스 커패시터(Cs)에 안정적으로 공급되도록 1/2 서스테인전압(Vs/2)을 갖는 정전압원으로 사용된다. 이를 위해, 제너 다이오드(ZD)는 1/2 서스테인전압(Vs/2)을 일정하게 유지할 수 있는 소자가 사용된다. 이에 따라, 소스 커패시터(Cs)에는 항상 1/2 서스테인전압(Vs)이 안정적으로 충전된다.
한편, 제 2 에너지 회수장치(82)는 제 1 에너지 회수장치(80)와 교번적으로 동작하면서 패널 커패시터(Cp)의 서스테인전극(Z)에 구동전압을 공급한다. 따라서, 패널 커패시터(Cp)에는 서로 반대 극성을 가지는 서스테인전압(Vs)이 공급 된다. 이와 같이 패널 커패시터(Cp)에 서로 반대 극성을 가지는 서스테인전압(Vs)이 공급됨으로써 방전셀들에서 서스테인 방전이 일어나게 된다. 이때, 제 2 에너지 회수장 치(82)에 설치된 전압 안정화부(90)는 제 1 에너지 회수장치(80)에 설치된 전압 안정화부(70)와 동일한 역할을 하므로 자세한 설명은 상술한 내용으로 대치하기로 한다.
이와 같이 본 발명의 제 1 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치에서는 서스테인전압원(Vs)과 소스 커패시터(Cs) 사이에 전압 안정화부(70)를 설치하여 소스 커패시터(Cs)에 공급되는 전압을 1/2 서스테인전압(Vs/2)으로 일정하게 유지함으로써 소스 커패시터(Cs)에 1/2 서스테인전압(Vs/2)을 항상 안정적으로 충전할 수 있다. 이로 인해, 패널 커패시터(Cp)에 충전되는 서스테인전압(Vs)의 라이징 타임(Rising Time)을 일정하게 유지할 수 있게 되므로 신뢰성을 향상시킬 수 있다. 또한, 소스 커패시터(Cs)는 항상 1/2 서스테인전압(Vs/2)을 안정적으로 충전하게 되어 패널 커패시터(Cp)의 충/방전 전류패스를 형성하는 제 1 및 제 2 스위치(SW1, SW2)에는 1/2 서스테인전압(Vs/2)이 일정하게 걸리게 되므로 내압이 낮은 스위치 소자를 사용할 수 있다. 이로 인해, 플라즈마 디스플레이 패널의 비용을 저감시킬 수 있다.
도 4는 본 발명의 제 2 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치를 나타내는 도면이다.
도 4를 참조하면, 본 발명의 제 2 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치(130, 132)는 패널 커패시터(Cp)를 사이에 두고 서로 대칭적으로 설치된다. 여기서, 패널 커패시터(Cp)는 스캔전극(Y)과 서스테인전극(Z) 사이에 형성되는 정전용량을 등가적으로 나타낸 것이다. 이러한, 에너지 회수장치에서 제 1 에너지 회수장치(130)는 스캔전극(Y)에 서스테인펄스를 공급하고, 제 2 에너지 회수장치(132)는 제 1 에너지 회수장치(130)와 교번되게 동작하면서 서스테인전극(Z)에 서스테인펄스를 공급한다.
본 발명의 제 2 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치(130, 132)의 구성을 제 1 에너지 회수장치(130)를 참조하여 설명하기로 한다. 제 1 에너지 회수장치(130)는 패널 커패시터(Cp)의 스캔전극(Y)에 서스테인전압(Vs)을 공급하기 위한 서스테인전압원(Vs), 패널 커패시터(Cp)의 스캔전극(Y)에 기저전압(GND)을 공급하기 위한 기저전압원(GND), 패널 커패시터(Cp)에 충전된 에너지를 회수함과 아울러 회수된 에너지를 패널 커패시터(Cp)에 재공급하기 위한 소스 커패시터(Cs), 패널 커패시터(Cp)와 소스 커패시터(Cs) 사이에 접속된 인덕터(L), 인덕터(L)와 소스 커패시터(Cs) 사이에 병렬로 접속된 제 1 및 제 2 스위치(SW1, SW2), 제 1 스위치(SW1)와 인덕터(L) 사이에 접속된 제 1 다이오드(D1), 인덕터(L)와 제 2 스위치(SW2) 사이에 접속된 제 2 다이오드(D2), 서스테인전압원(Vs)과 패널 커패시터(Cp)의 스캔전극(Y) 사이에 접속된 제 3 스위치(SW3), 패널 커패시터(Cp)의 스캔전극(Y)과 기저전압원(GND) 사이에 접속된 제 4 스위치(SW4), 서스테인전압원(Vs)과 소스 커패시터(Cs) 사이에 접속된 제 1 전압 안정화부(122) 및 소스 커패시터(Cs)와 기저전압원(GND) 사이에 접속된 제 2 전압 안정화부(124)를 포함한다.
이와 같은 본 발명의 제 2 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치는 상술한 본 발명의 제 1 실시 예예 따른 플라즈마 디스플레이 패널의 에너지 회수장치와 대비하여 제 2 전압 안정화부(124)를 제외한 나머지 구성 요소는 본 발명의 제 1 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치와 동일하므로 제 2 전압 안정화부(124)를 제외한 나머지 구성요소에 대한 자세한 설명은 상술한 내용으로 대치하기로 한다.
제 2 전압 안정화부(124)는 소스 커패시터(Cs)와 기저전압원(GND) 사이에 접속되어 제 1 에너지 회수장치(130)에서 부하의 변동에 의해 전류가 변화되더라도 소스 커패시터(Cs)에 공급되는 전압이 1/2 서스테인전압(Vs)을 일정하게 유지하도록 제 1 전압 안정화부(122)에 의해 분압 된 전압을 안정화시킨다. 즉, 제 2 전압 안정화부(124)는 소스 커패시터(Cp)의 양단에 제 1 전압 안정화부(122)에 의해 안정화된 전압 즉, 1/2 서스테인전압(Vs/2)이 안정적으로 공급되도록 제 1 전압 안정화부(122)에 의해 분압 된 전압을 안정화시킨다. 이를 위해, 제 2 전압 안정화부(124)는 소스 커패시터(Cs)와 기저전압원(GND) 사이에 직렬로 접속된 제 2 저항(R2) 및 제 2 제너 다이오드(ZD2)를 포함한다.
제 2 저항(R2)은 소스 커패시터(Cs)와 기저전압원(GND) 사이에 접속되어 제 2 제너 다이오드(ZD2)에 흐르는 전류를 제어한다. 이러한, 제 2 저항(R2)은 제거될 수 있다.
제 2 제너 다이오드(ZD2)는 제 2 저항(R2)과 기저전압원(GND) 사이에 접속되어 제 1 전압 안정화부(122)에 의해 분압 된 1/2 서스테인전압(Vs/2)이 소스 커패시터(Cs)의 양단에 안정적으로 공급되도록 1/2 서스테인전압(Vs/2)을 갖는 정전압원으로 사용된다. 이를 위해, 제 2 제너 다이오드(ZD)는 제 1 제너 다이오드(ZD1) 과 동일한 소자가 사용된다. 다시 말해, 제 2 제너 다이오드(ZD2)는 1/2 서스테인전압(Vs/2)을 일정하게 유지할 수 있는 소자가 사용된다. 이에 따라, 소스 커패시터(Cs)에는 항상 1/2 서스테인전압(Vs)이 안정적으로 충전된다.
이와 같이 본 발명의 제 2 실시 예에 따른 플라즈마 디스플레이 패널의 에너지 회수장치에서는 서스테인전압원(Vs)와 소스 커패시터(Cs) 및 기저전압원(GND) 사이에 전압 안정화부(120)를 설치하여 소스 커패시터(Cs)에 공급되는 전압을 1/2 서스테인전압(Vs/2)으로 일정하게 유지함으로써 소스 커패시터(Cs)에 1/2 서스테인전압(Vs/2)을 항상 안정적으로 충전할 수 있다. 이로 인해, 패널 커패시터(Cp)에 충전되는 서스테인전압(Vs)의 라이징 타임을 일정하게 유지할 수 있게 되므로 신뢰성을 향상시킬 수 있다. 또한, 소스 커패시터(Cs)는 항상 1/2 서스테인전압(Vs/2)을 안정적으로 충전하게 되어 패널 커패시터(Cp)의 충/방전 전류패스를 형성하는 제 1 및 제 2 스위치(SW1, SW2)에는 1/2 서스테인전압(Vs/2)이 일정하게 걸리게 되므로 내압이 낮은 스위치 소자를 사용할 수 있다. 이로 인해, 플라즈마 디스플레이 패널의 비용을 저감시킬 수 있다.
상술한 바와 같이, 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 에너제 회수장치는 1/2 서스테인전압을 안정적으로 유지할 수 있는 전압 안정화부를 이용하여 소스 커패시터에 1/2 서스테인전압을 항상 안정적으로 충전함으로써 패널 커패시터에 충전되는 서스테인전압의 라이징 타임을 일정하게 유지하여 신뢰 성을 향상시킬 수 있다. 또한, 소스 커패시터에는 1/2 서스테인전압이 항상 안정적으로 충전되므로 패널 커패시터(Cp)의 충/방전 전류패스를 형성하는 스위치 소자에서는 1/2 서스테인전압이 일정하게 걸리게 되어 내압이 낮은 스위치 소자를 사용할 수 있다. 이로 인해, 플라즈마 디스플레이 패널의 비용을 저감시킬 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (6)

  1. 플라즈마 디스플레이 패널의 스캔전극에 서스테인전압을 공급하기 위한 서스테인전압원;
    상기 플라즈마 디스플레이 패널에 저장된 에너지를 회수함과 아울러 회수된 에너지를 상기 플라즈마 디스플레이 패널에 재공급하기 위한 소스 커패시터; 및
    상기 소스 커패시터에 공급되는 전압을 1/2 서스테인전압으로 일정하게 유지하기 위해 상기 서스테인전압원과 상기 소스 커패시터 사이에 접속된 전압 안정화부를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 에너지 회수장치.
  2. 제 1 항에 있어서,
    상기 전압 안정화부는
    상기 서스테인전압원과 상기 소스 커패시터 사이에 접속되어 상기 서스테인전압원으로부터의 서스테인전압을 1/2 서스테인전압으로 일정하게 유지하는 제너 다이오드; 및
    상기 제너 다이오드와 상기 서스테인전압원 사이에 접속되어 상기 제너 다이오드에 공급되는 전류를 제어하는 저항을 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 에너지 회수장치.
  3. 제 1 항에 있어서,
    상기 전압 안정화부는
    상기 서스테인전압원과 상기 소스 커패시터 사이에 접속되어 상기 서스테인전압원으로부터의 서스테인전압을 1/2 서스테인전압으로 일정하게 유지하는 제 1 제너 다이오드;
    상기 소스 커패시터와 기저전압원 사이에 접속되어 상기 소스 커패시터의 양단에 공급되는 전압을 1/2 서스테인전압으로 일정하게 유지하는 제 2 제너 다이오드; 및
    상기 서스테인전압원과 상기 제 1 제너 다이오드 사이에 접속되어 상기 제 1 제너 다이오드에 공급되는 전류를 제어하는 제 1 저항을 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  4. 제 3 항에 있어서,
    상기 전압 안정화부는
    상기 소스 커패시터와 상기 제 2 제너 다이오드 사이에 접속되어 상기 제 2 제너 다이오드에 흐르는 전류를 제어하는 제 2 저항을 더 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 에너지 회수장치.
  5. 플라즈마 디스플레이 패널의 스캔전극에 서스테인전압을 공급하기 위한 서스테인전압원;
    상기 플라즈마 디스플레이 패널에서 방전에 기여하지 않은 무효전력의 에너 지를 회수함과 아울러 회수된 에너지를 상기 플라즈마 디스플레이 패널의 스캔전극에 재공급하기 위한 소스 커패시터; 및
    상기 소스 커패시터에 공급되는 전압을 1/2 서스테인전압으로 일정하게 유지하기 위해 상기 서스테인전압원과 상기 소스 커패시터 사이에 접속된 제 1 제너 다이오드를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 에너지 회수장치.
  6. 제 5 항에 있어서,
    상기 소스 커패시터의 양단에 1/2 서스테인전압을 일정하게 유지하기 위해 상기 소스 커패시터와 상기 제 1 제너 다이오드 사이의 공통노드와 기저전압원 사이에 접속된 제 2 제너 다이오드를 더 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 에너지 회수장치.
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