KR20030065360A - 구동 회로 - Google Patents

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Abstract

스위칭용 트랜지스터에 접속된 기본 소자의 누설 전류를 저감시킨다. 다이오드(12)를 구동하는 구동용의 제3 트랜지스터 Tr3의 게이트 전극 및 데이터선(16) 사이에 설치된 상호 직렬로 접속된 스위칭용의 제1 트랜지스터 Tr1 및 제2 트랜지스터 Tr2의 전류 구동 능력에 관련된 특성을 서로 다르게 한다. 제1 트랜지스터 Tr1 및 제2 트랜지스터 Tr2 중의 한쪽의 보존 특성을 높임과 함께, 다른 쪽의 전류 구동 능력을 높이고, 직렬로 접속된 2개의 트랜지스터에 의해 누설 전류를 저감시킨다.

Description

구동 회로{DRIVING CIRCUIT}
본 발명은 구동 회로에 관한 것으로, 특히 누설 전류를 감소시키는 기술에 관한 것이다.
최근, 반도체 디바이스를 탑재하는 장치의 소형 경량화가 진행되고, 그러한 장치에 실장되는 스위칭용 트랜지스터도 반도체 기판 상에 실장되는 경우가 많다. 예를 들면, LCD 등의 유닛 기기에는 박막 트랜지스터(TFT)가 다용되고 있다. 이러한 경우, TFT의 특성은 향상되어 있다고 해도, 누설 전류의 문제는 영원한 과제이다. 예를 들면, 데이터를 어느 정도 장기간 보존하기 위해서는 보존 특성을 향상시키는 기술이 필요하다.
예를 들면, 트랜지스터의 게이트 길이를 길게 함으로써, 보존 특성을 향상시킬 수 있지만, 이것은 상술한 소형화의 요구에 반하는 것이다. 또한, 트랜지스터의 게이트 길이를 길게 함으로써, 게이트 용량이 증가하고, 그 때문에 트랜지스터의 소비 전력이 증대한다는 문제도 생긴다.
본 발명은 그러한 과제에 감안하여 이루어진 것으로, 그 목적은 기본 소자로부터 트랜지스터를 통하여 발생하는 누설 전류의 저감에 있다. 본 발명의 다른 목적은, 목적으로 하는 기본 소자에 데이터를 설정 및 보존하기 위한 스위칭용 트랜지스터의 보존 특성을 높이는 데 있다. 본 발명의 또 다른 목적은, 스위칭용 트랜지스터의 전류 구동 능력을 높이는 데 있다. 본 발명의 또 다른 목적은, 스위칭용 트랜지스터의 소형화 및 저소비 전력화를 도모하는 것에 있다.
도 1은 본 발명의 제1 실시예에 따른 구동 회로를 도시하는 도면.
도 2는 본 발명의 제2 실시예에 따른 구동 회로를 도시하는 도면.
도 3은 본 발명의 제3 실시예에 따른 구동 회로를 도시하는 도면.
도 4는 본 발명의 제4 실시예에 따른 구동 회로를 도시하는 도면.
〈도면의 주요 부분에 대한 부호의 설명〉
10, 20, 30, 40 : 구동 회로
12 : 다이오드
22 : 액정
32 : 용량 검출부
42 : 메모리
Tr1 : 제1 트랜지스터
Tr2 : 제2 트랜지스터
Tr3 : 제3 트랜지스터
Tr4 : 제4 트랜지스터
본 발명의 하나의 형태는, 구동 회로에 관한 것이다. 이 회로는 목적으로 하는 소자에 데이터를 설정 및 보존하기 위한 트랜지스터를 복수개 직렬로 접속하고, 또한 이들 트랜지스터 중 적어도 1개의 트랜지스터의 전류 구동 능력에 관련된 특성을 다른 트랜지스터와 다르게 한 것이다. 여기서, 전류 구동 능력에 관련된 특성은, 예를 들면 전류 증폭율이나 온 저항 등이어도 된다.
트랜지스터는 MOSFET이어도 되고, 적어도 1개의 트랜지스터의 게이트 길이 또는 게이트 폭을 다른 트랜지스터와는 다른 값으로 형성해도 된다.
복수의 트랜지스터는 데이터 공급원과 소자 사이에 설치되어도 되고, 데이터 공급원측에 설치된 트랜지스터는 소자측에 설치된 트랜지스터보다 전류 구동 능력이 커도 된다.
본 발명의 다른 형태는, 구동 회로에 관한 것이다. 이 회로는 목적으로 하는 소자에 데이터를 설정 및 보존하기 위한 제1 트랜지스터 및 제2 트랜지스터를 직렬로 접속하고, 제1 트랜지스터의 게이트 폭을 제2 트랜지스터의 게이트 폭보다 좁게 함과 함께, 제2 트랜지스터의 게이트 길이를 제1 트랜지스터의 게이트 길이보다 짧게 한다.
또, 이상의 구성 요소의 임의의 조합, 본 발명의 표현을 방법, 장치, 시스템 등의 사이에서 변환한 것도, 또한 본 발명의 형태로서 유효하다.
〈제1 실시예〉
도 1은 본 발명의 제1 실시예에 따른 구동 회로를 도시하는 도면이다. 본실시예에서, 구동 회로(10)는 제1 트랜지스터 Tr1, 제2 트랜지스터 Tr2, 제3 트랜지스터 Tr3, 컨덴서 C 및 다이오드(12)를 포함한다. 다이오드(12)는, 예를 들면 발광 소자로서 기능하는 유기 EL(OLED: Organic Light Emitting Diode)인 광학 소자이다.
제3 트랜지스터 Tr3은 TFT이고, 다이오드(12)에 흐르는 구동 전류를 제어하는 구동용이다. 제1 트랜지스터 Tr1 및 제2 트랜지스터 Tr2도 TFT이고, 제3 트랜지스터 Tr3에 데이터를 설정 및 보존하기 위한 스위칭용이다. 또한, 제1 트랜지스터 Tr1 및 제2 트랜지스터 Tr2는 직렬로 접속된다. 이러한 구성으로 함으로써, 트랜지스터의 보존 특성이 향상되어, 누설 전류를 저감시킬 수 있다. 또, 이와 같이 2개의 스위칭용 트랜지스터가 직렬로 접속된 회로 자체는, 예를 들면 일본 특개2000-221903호 공보에 개시되어 있지만, 그 특성이나 목적에 관한 기재는 없다.
본 실시예에서는, 제1 트랜지스터 Tr1 및 제2 트랜지스터 Tr2는 전류 구동 능력에 관련된 특성이 다르게 설계된다. 전류 구동 능력에 관련된 특성은, 예를 들면 전류 증폭율 β이다. 전류 증폭율은 β=μ(C0x/2)×(W/L)로 표시된다. μ는 캐리어의 실효 모빌리티, C0x는 단위 면적당 게이트 산화막 용량, W는 게이트 폭, L은 게이트 길이이다. 본 실시예에서는 트랜지스터 Tr1 및 제2 트랜지스터 Tr2의 게이트 길이 또는 게이트 폭을 상호 다르게 형성한다. 이에 의해, 트랜지스터 Tr1 및 제2 트랜지스터 Tr2의 전류 증폭율이 달라진다.
여기서, 제1 트랜지스터 Tr1, 제2 트랜지스터 Tr2 및 제3 트랜지스터 Tr3은n 채널형으로서 나타내고 있지만, p 채널형이어도 된다.
제1 트랜지스터 Tr1에서, 게이트 전극은 게이트선(14)에 접속되고, 드레인 전극(또는 소스 전극)은 데이터선(16)에 접속되고, 소스 전극(또는 드레인 전극)은 제2 트랜지스터 Tr2의 드레인 전극(또는 소스 전극)에 접속된다. 제2 트랜지스터 Tr2에서, 게이트 전극은 게이트선(14)에 접속되고, 소스 전극(또는 드레인 전극)은 제3 트랜지스터 Tr3의 게이트 전극 및 컨덴서 C의 한쪽의 전극에 접속된다. 컨덴서 C의 다른 쪽의 전극은 소정의 전위로 설정된다. 데이터선(16)은 정전류원에 접속되고, 다이오드(12)에 흐르는 전류를 결정하는 휘도 데이터가 공급된다.
제3 트랜지스터 Tr3에서, 드레인 전극은 전원선(18)에 접속되고, 소스 전극은 다이오드(12)의 애노드에 접속된다. 다이오드(12)의 캐소드는 접지된다. 전원선(18)은 전원(도시 생략)에 접속되고, 소정의 전압이 인가된다.
본 실시예에서, 제1 트랜지스터 Tr1 및 제2 트랜지스터 Tr2의 전류 증폭율을 다르게 하게 하기 위한 구성은, (1) 제1 트랜지스터 Tr1의 게이트 길이를 제2 트랜지스터 Tr2의 게이트 길이보다 짧게 하고, (2) 제2 트랜지스터 Tr2의 게이트 길이를 제1 트랜지스터 Tr1의 게이트 길이보다 짧게 하고, (3) 제1 트랜지스터 Trl의 게이트 폭을 제2 트랜지스터 Tr2의 게이트 폭보다 좁게 하고, (4) 제2 트랜지스터 Tr2의 게이트 폭을 제1 트랜지스터 Tr1의 게이트 폭보다 좁게 하는 네 가지를 들 수 있다.
이하에, 각 경우의 장점을 설명한다.
(1) 제1 트랜지스터 Tr1의 게이트 길이를 제2 트랜지스터 Tr2의 게이트 길이보다 짧게 함으로써, 제2 트랜지스터 Tr2의 보존 특성을 유지한 채, 제1 트랜지스터 Tr1의 전류 증폭율의 증가, 소형화, 저소비 전력화라는 장점이 얻어진다. 또한, 제3 트랜지스터 Tr3에 직접 접속된 제2 트랜지스터 Tr2의 보존 특성을 높게 유지함으로써, 제3 트랜지스터 Tr3으로부터의 누설 전류를 경감시킬 수 있어, 제3 트랜지스터 Tr3의 게이트 전위를 보다 양호한 정밀도로 유지할 수 있다.
(2) 제2 트랜지스터 Tr2의 게이트 길이를 제1 트랜지스터 Tr1의 게이트 길이보다 짧게 함으로써, 제1 트랜지스터 Tr1의 보존 특성을 유지한 채, 제2 트랜지스터 Tr2의 게이트 용량을 감소할 수 있다고 하는 장점이 얻어진다. 이에 의해, 제2 트랜지스터 Tr2의 게이트 용량이 제3 트랜지스터 Tr3의 게이트 전위에 미치게 하는 영향을 경감시킬 수 있어, 제3 트랜지스터 Tr3의 게이트 전위를 보다 양호한 정밀도로 유지할 수 있다.
(3) 제2 트랜지스터 Tr2의 게이트 폭을 제1 트랜지스터 Tr1의 게이트 폭보다 좁게 함으로써, 제1 트랜지스터 Tr1의 전류 증폭율을 유지한 채, 제2 트랜지스터 Tr2의 보존 특성을 더욱 향상시킬 수 있다. 제3 트랜지스터 Tr3에 직접 접속된 제2 트랜지스터 Tr2의 보존 특성을 높게 유지함으로써, 제3 트랜지스터 Tr3으로부터의 누설 전류를 경감시킬 수 있어, 제3 트랜지스터 Tr3의 게이트 전위를 보다 양호한 정밀도로 유지할 수 있다.
(4) 제1 트랜지스터 Tr1의 게이트 폭을 제2 트랜지스터 Tr2의 게이트 폭보다 좁게 함으로써, 제2 트랜지스터 Tr2의 전류 구동 능력을 유지한 채로, 제2 트랜지스터 Tr2의 보존 특성을 더욱 향상시킬 수 있다.
본 실시예에서는 이상의 각 경우의 효과를 고려하여, 최적의 장점이 얻어지는 경우의 설계를 행한다.
또한, 이상의 구성의 조합도 가능하고, 예를 들면 (1)의 구성과 (4)의 구성을 조합해도 되고, (2)의 구성과 (3)의 구성을 조합해도 된다. 이에 의해, 양방의 트랜지스터를 소형화할 수 있어, 게이트 용량의 감소에 의해 저소비 전력화도 도모할 수 있다. 또한, 한쪽의 트랜지스터의 전류 증폭율을 크게 할 수 있음과 함께, 다른 쪽의 트랜지스터의 보존 특성을 향상시킬 수 있다고 하는 장점이 생긴다. 또한, 2개의 스위칭용 트랜지스터는 직렬로 접속되어 있기 때문에, 보존 특성을 더욱 높일 수 있다.
〈제2 실시예〉
도 2는 본 발명의 제2 실시예에 따른 구동 회로를 도시하는 도면이다. 본 실시예에서, 구동 회로(20)는 상술한 제1 실시예에서의 구동 회로(10)의 제3 트랜지스터 Tr3 및 다이오드(12) 대신에 액정(22)을 포함하는 점에서 제1 실시예와 다르다. 이하, 제1 실시예에서의 구성 요소와 마찬가지의 것에는 마찬가지의 부호를 붙이고, 적절하게 설명을 생략한다. 액정(22)은 제2 트랜지스터 Tr2의 드레인 전극(또는 소스 전극)에 접속된다.
본 실시예에서도, 제1 실시예에서와 마찬가지로 제1 트랜지스터 Tr1 및 제2 트랜지스터 Tr2의 전류 구동 능력을 다르게 하도록 각각의 트랜지스터를 설계해도 된다. 이 경우도 각 구성의 효과를 고려하여, 최적의 장점이 얻어지도록 설계한다.
〈제3 실시예〉
도 3은 본 발명의 제3 실시예에 따른 구동 회로를 도시하는 도면이다. 본 실시예에서, 구동 회로(30)는 제1 실시예에서의 제3 트랜지스터 Tr3 및 다이오드(12) 대신에, 용량 검출부(32)를 포함하는 점에서 제1 실시예와 다르다.
용량 검출부(32)는 제2 트랜지스터 Tr2의 드레인 전극(또는 소스 전극)에 접속된다. 용량 검출부(32)는, 예를 들면 각종 센서이다.
본 실시예에서도, 트랜지스터의 전류 구동 능력에 관련된 특성의 고려는 마찬가지이다.
〈제4 실시예〉
도 4는 본 발명의 제4 실시예에 따른 구동 회로를 도시하는 도면이다. 본 실시예에서, 구동 회로(40)는 제1 실시예에서의 제3 트랜지스터 Tr3 및 다이오드(12) 대신에, 메모리(42)를 포함한다하는 점에서 제1 실시예와 다르다. 또한, 구동 회로(40)는 스위칭용 TFT인 제4 트랜지스터 Tr4를 더 포함한다.
메모리(42)의 한쪽의 전극은, 제2 트랜지스터 Tr2의 드레인 전극(또는 소스 전극)에 접속되고, 다른 쪽의 전극은 소정의 전위로 설정된다.
본 실시예에서는, 제1 트랜지스터 Tr1, 제2 트랜지스터 Tr2 및 제3 트랜지스터 Tr3 중 적어도 1개의 트랜지스터의 전류 구동 능력에 관련된 특성을 다르게 하도록 이들 트랜지스터를 설계해도 된다. 이 경우도 각 구성의 효과를 고려하여, 최적의 장점이 얻어지도록 설계한다.
이상, 본 발명을 실시예에 기초하여 설명하였다. 이들 실시예는 예시이고,이들 각 구성 요소나 각 처리 공정의 조합에 다양한 변형예가 가능한 것, 또한 그러한 변형예도 본 발명의 범위에 있는 것은 당업자에게 이해될 것이다. 이하, 그러한 예를 설명한다.
제1 실시예, 제2 실시예 및 제3 실시예의 구동 회로에서도, 제4 실시예에서 설명한 것과 마찬가지로 3개의 스위칭용 트랜지스터를 포함해도 된다. 또한, 모든 형태에서, 복수의 스위칭용 트랜지스터를 더 많이 포함해도 된다.
이상의 실시예에서는, 스위칭용 트랜지스터의 게이트 길이 또는 게이트 폭의 설계를 바꿈으로써, 복수의 트랜지스터의 전류 구동 능력에 관련된 특성을 다르게 하였지만, 게이트 절연막의 두께를 바꾸거나, 게이트 전극에의 이온 주입량을 변화시키거나 함으로써 복수의 트랜지스터의 전류 구동 능력에 관련된 특성을 다르게 해도 된다.
전류 구동 능력을 다르게 한 복수의 스위칭용 트랜지스터를 직렬로 접속함으로써, 적어도 하나의 트랜지스터에 의해 보존 특성을 높임과 함께, 다른 트랜지스터에 의해 전류 구동 능력의 증가, 저소비 전력화 또는 소형화를 도모할 수 있다.

Claims (4)

  1. 목적으로 하는 소자에 데이터를 설정 및 보존하기 위한 트랜지스터를 복수개 직렬로 접속하고, 또한 이들 트랜지스터 중 적어도 1개의 트랜지스터의 전류 구동 능력에 관련된 특성을 다른 트랜지스터와 다르게 한 것을 특징으로 하는 구동 회로.
  2. 제1항에 있어서,
    상기 트랜지스터는 MOSFET이고, 상기 적어도 1개의 트랜지스터의 게이트 길이 또는 게이트 폭을 다른 트랜지스터와는 다른 값으로 형성한 구동 회로.
  3. 제1항 또는 제2항에 있어서,
    복수의 상기 트랜지스터는 데이터 공급원과 상기 소자 사이에 설치되고, 상기 데이터 공급원측에 설치된 트랜지스터는 상기 소자측에 설치된 트랜지스터보다 상기 전류 구동 능력이 큰 것을 특징으로 하는 구동 회로.
  4. 목적으로 하는 소자에 데이터를 설정 및 보존하기 위한 제1 트랜지스터 및 제2 트랜지스터를 직렬로 접속하고, 상기 제1 트랜지스터의 게이트 폭을 상기 제2 트랜지스터의 게이트 폭보다 좁게 함과 함께, 상기 제2 트랜지스터의 게이트 길이를 상기 제1 트랜지스터의 게이트 길이보다 짧게 하는 것을 특징으로 하는 구동 회로.
KR1020030005437A 2002-01-29 2003-01-28 구동 회로 KR100584060B1 (ko)

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