KR101130986B1 - 적층 콘덴서 및 적층 콘덴서의 등가 직렬 저항 조정 방법 - Google Patents
적층 콘덴서 및 적층 콘덴서의 등가 직렬 저항 조정 방법 Download PDFInfo
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- 239000003990 capacitor Substances 0.000 title claims abstract description 273
- 238000000034 method Methods 0.000 title claims description 29
- 239000004020 conductor Substances 0.000 claims abstract description 366
- 238000003475 lamination Methods 0.000 claims description 12
- 238000010586 diagram Methods 0.000 description 21
- 230000012447 hatching Effects 0.000 description 12
- 239000002131 composite material Substances 0.000 description 7
- 230000004048 modification Effects 0.000 description 5
- 238000012986 modification Methods 0.000 description 5
- 150000001875 compounds Chemical class 0.000 description 2
- 230000006866 deterioration Effects 0.000 description 2
- 238000010030 laminating Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 230000002250 progressing effect Effects 0.000 description 1
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- G06F13/4063—Device-to-bus coupling
- G06F13/4068—Electrical coupling
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-
- H—ELECTRICITY
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- H01G—CAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
- H01G4/00—Fixed capacitors; Processes of their manufacture
- H01G4/002—Details
- H01G4/005—Electrodes
- H01G4/012—Form of non-self-supporting electrodes
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01G—CAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
- H01G4/00—Fixed capacitors; Processes of their manufacture
- H01G4/002—Details
- H01G4/228—Terminals
- H01G4/232—Terminals electrically connecting two or more layers of a stacked or rolled capacitor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01G—CAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
- H01G4/00—Fixed capacitors; Processes of their manufacture
- H01G4/30—Stacked capacitors
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- Y10T29/00—Metal working
- Y10T29/43—Electric condenser making
- Y10T29/435—Solid dielectric type
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Manufacturing & Machinery (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Theoretical Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Fixed Capacitors And Capacitor Manufacturing Machines (AREA)
- Ceramic Capacitors (AREA)
Abstract
Description
Claims (12)
- 복수의 유전체층과 복수의 내부 전극이 교대로 적층된 적층체와, 상기 적층체에 형성된 복수의 단자 전극을 구비한 적층 콘덴서에 있어서,상기 복수의 내부 전극은 교대로 배치되는 복수의 제 1 내부 전극과 복수의 제2 내부 전극을 포함하고,상기 복수의 단자 전극은 서로 전기적으로 절연된 제 1 및 제 2 단자 전극을 포함하고,상기 복수의 제 1 내부 전극은 스루홀 도체를 통하여 서로 전기적으로 접속되고,상기 복수의 제 2 내부 전극은 스루홀 도체를 통하여 서로 전기적으로 접속되고,상기 복수의 제 1 내부 전극 중 1개 이상에서 상기 제 1 내부 전극의 총수보다도 1개 적은 수 이하의 제 1 내부 전극은 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되고,상기 복수의 제 2 내부 전극 중 1개 이상에서 상기 제 2 내부 전극의 총수보다도 1개 적은 수 이하의 제 2 내부 전극은 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되고,상기 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되는 상기 제 1 내부 전극의 수와 상기 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되는 상기 제 2 내부 전극의 수를 각각 조정함으로써, 등가 직렬 저항이 미리 정해진 값으로 설정되어 있는 적층 콘덴서.
- 복수의 유전체층과 복수의 내부 전극이 교대로 적층된 적층체와, 상기 적층체에 형성된 복수의 단자 전극을 구비한 적층 콘덴서에 있어서,상기 복수의 내부 전극은 교대로 배치되는 복수의 제 1 내부 전극과 복수의 제 2 내부 전극을 포함하고,상기 복수의 단자 전극은 서로 전기적으로 절연된 제 1 및 제 2 단자 전극을 포함하고,상기 복수의 제 1 내부 전극은 스루홀 도체를 통하여 서로 전기적으로 접속되고,상기 복수의 제 2 내부 전극은 스루홀 도체를 통하여 서로 전기적으로 접속되고,상기 복수의 제 1 내부 전극 중 1개 이상에서 상기 제 1 내부 전극의 총수보다도 1개 적은 수 이하의 제 1 내부 전극은 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되고,상기 복수의 제 2 내부 전극 중 1개 이상에서 상기 제 2 내부 전극의 총수보다도 1개 적은 수 이하의 제 2 내부 전극은 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되고,상기 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되는 상기 제 1 내부 전극의 상기 적층체의 적층 방향에서의 위치와 상기 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되는 상기 제 2 내부 전극의 상기 적층체의 적층 방향에서의 위치를 각각 조정함으로써, 등가 직렬 저항이 미리 정해진 값으로 설정되어 있는 적층 콘덴서.
- 제 1 항 또는 제 2 항에 있어서,상기 복수의 제 1 내부 전극끼리를 전기적으로 접속하는 상기 스루홀 도체의 수와 상기 복수의 제 2 내부 전극끼리를 전기적으로 접속하는 상기 스루홀 도체의 수를 각각 더욱 조정함으로써, 등가 직렬 저항이 미리 정해진 값으로 설정되어 있는 적층 콘덴서.
- 제 1 항 또는 제 2 항에 있어서,상기 복수의 제 1 내부 전극끼리는 병렬 접속되어 있고,상기 복수의 제 2 내부 전극끼리는 병렬 접속되어 있는 적층 콘덴서.
- 복수의 유전체층과 복수의 내부 전극이 교대로 적층된 적층체와, 상기 적층체에 형성된 복수의 단자 전극을 구비한 적층 콘덴서에 있어서,교대로 배치되는 제 1 수의 제 1 내부 전극과 제 2 수의 제 2 내부 전극을 상기 복수의 내부 전극으로서 포함하는 콘덴서부를 가지고,상기 복수의 단자 전극은 서로 전기적으로 절연된 제 1 및 제 2 단자 전극을 포함하고,상기 제 1 수의 제 1 내부 전극은 스루홀 도체를 통하여 서로 전기적으로 접속되고,상기 제 2 수의 제 2 내부 전극은 스루홀 도체를 통하여 서로 전기적으로 접속되고,상기 제 1 수의 제 1 내부 전극 중 1개 이상에서 상기 제 1 수보다도 1개 적은 수 이하의 제 1 내부 전극은 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되고,상기 제 2 수의 제 2 내부 전극 중 1개 이상에서 상기 제 2 수보다도 1개 적은 수 이하의 제 2 내부 전극은 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되고,상기 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되는 상기 제 1 내부 전극의 수와 상기 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되는 상기 제 2 내부 전극의 수를 각각 조정함으로써, 등가 직렬 저항이 미리 정해진 값으로 설정되어 있는 적층 콘덴서.
- 복수의 유전체층과 복수의 내부 전극이 교대로 적층된 적층체와, 상기 적층체에 형성된 복수의 단자 전극을 구비한 적층 콘덴서에 있어서,교대로 배치되는 제 1 수의 제 1 내부 전극과 제 2 수의 제 2 내부 전극을 상기 복수의 내부 전극으로서 포함하는 콘덴서부를 가지고,상기 복수의 단자 전극은 서로 전기적으로 절연된 제 1 및 제 2 단자 전극을 포함하고,상기 제 1 수의 제 1 내부 전극은 스루홀 도체를 통하여 서로 전기적으로 접속되고,상기 제 2 수의 제 2 내부 전극은 스루홀 도체를 통하여 서로 전기적으로 접속되고,상기 제 1 수의 제 1 내부 전극 중 1개 이상에서 상기 제 1 수보다도 1개 적은 수 이하의 제 1 내부 전극은 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되고,상기 제 2 수의 제 2 내부 전극 중 1개 이상에서 상기 제 2 수보다도 1개 적은 수 이하의 제 2 내부 전극은 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되고,상기 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되는 상기 제 1 내부 전극의 상기 적층체의 적층 방향에서의 위치와 상기 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되는 상기 제 2 내부 전극의 상기 적층체의 적층 방향에서의 위치를 각각 조정함으로써, 등가 직렬 저항이 미리 정해진 값으로 설정되어 있는 적층 콘덴서.
- 제 5 항 또는 제 6 항에 있어서,상기 제 1 수의 제 1 내부 전극끼리를 전기적으로 접속하는 상기 스루홀 도체의 수와 상기 제 2 수의 제 2 내부 전극끼리를 전기적으로 접속하는 상기 스루홀 도체의 수를 각각 더욱 조정함으로써, 등가 직렬 저항이 미리 정해진 값으로 설정되어 있는 적층 콘덴서.
- 제 5 항 또는 제 6 항에 있어서,상기 제 1 수의 제 1 내부 전극끼리는 병렬 접속되어 있고,상기 제 2 수의 제 2 내부 전극끼리는 병렬 접속되어 있는 적층 콘덴서.
- 복수의 유전체층과 복수의 내부 전극이 교대로 적층된 적층체와, 상기 적층체에 형성된 복수의 단자 전극을 구비한 적층 콘덴서의 등가 직렬 저항 조정 방법에 있어서,상기 복수의 내부 전극은 교대로 배치되는 복수의 제 1 내부 전극과 복수의 제 2 내부 전극을 포함하고,상기 복수의 단자 전극은 서로 전기적으로 절연된 제 1 및 제 2 단자 전극을 포함하고,상기 복수의 제 1 내부 전극을 스루홀 도체를 통하여 서로 전기적으로 접속하고,상기 복수의 제 2 내부 전극을 스루홀 도체를 통하여 서로 전기적으로 접속하고,상기 복수의 제 1 내부 전극 중 1개 이상에서 상기 제 1 내부 전극의 총수보다도 1개 적은 수 이하의 제 1 내부 전극을 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속하고,상기 복수의 제 2 내부 전극 중 1개 이상에서 상기 제 2 내부 전극의 총수보다도 1개 적은 수 이하의 제 2 내부 전극을 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속하고,상기 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되는 상기 제 1 내부 전극의 수와 상기 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되는 상기 제 2 내부 전극의 수를 각각 조정함으로써, 등가 직렬 저항을 미리 정해진 값으로 설정하는 적층 콘덴서의 등가 직렬 저항 조정 방법.
- 복수의 유전체층과 복수의 내부 전극이 교대로 적층된 적층체와, 상기 적층체에 형성된 복수의 단자 전극을 구비한 적층 콘덴서의 등가 직렬 저항 조정 방법에 있어서,상기 복수의 내부 전극은 교대로 배치되는 복수의 제 1 내부 전극과 복수의 제 2 내부 전극을 포함하고,상기 복수의 단자 전극은 서로 전기적으로 절연된 제 1 및 제 2 단자 전극을 포함하고,상기 복수의 제 1 내부 전극을 스루홀 도체를 통하여 서로 전기적으로 접속하고,상기 복수의 제 2 내부 전극을 스루홀 도체를 통하여 서로 전기적으로 접속하고,상기 복수의 제 1 내부 전극 중 1개 이상에서 상기 제 1 내부 전극의 총수보다도 1개 적은 수 이하의 제 1 내부 전극을 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속하고,상기 복수의 제 2 내부 전극 중 1개 이상에서 상기 제 2 내부 전극의 총수보다도 1개 적은 수 이하의 제 2 내부 전극을 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속하고,상기 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되는 상기 제 1 내부 전극의 상기 적층체의 적층 방향에서의 위치와 상기 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되는 상기 제 2 내부 전극의 상기 적층체의 적층 방향에서의 위치를 각각 조정함으로써, 등가 직렬 저항을 미리 정해진 값으로 설정하는 적층 콘덴서의 등가 직렬 저항 조정 방법.
- 복수의 유전체층과 복수의 내부 전극이 교대로 적층된 적층체와, 상기 적층체에 형성된 복수의 단자 전극을 구비한 적층 콘덴서의 등가 직렬 저항 조정 방법에 있어서,교대로 배치되는 제 1 수의 제 1 내부 전극과 제 2 수의 제 2 내부 전극을 상기 복수의 내부 전극으로서 포함하는 콘덴서부를 갖고,상기 복수의 단자 전극은 서로 전기적으로 절연된 제 1 및 제 2 단자 전극을 포함하고,상기 제 1 수의 제 1 내부 전극을 스루홀 도체를 통하여 서로 전기적으로 접속하고,상기 제 2 수의 제 2 내부 전극을 스루홀 도체를 통하여 서로 전기적으로 접속하고,상기 제 1 수의 제 1 내부 전극 중 1개 이상에서 상기 제 1 수보다도 1개 적은 수 이하의 제 1 내부 전극을 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속하고,상기 제 2 수의 제 2 내부 전극 중 1개 이상에서 상기 제 2 수보다도 1개 적은 수 이하의 제 2 내부 전극을 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속하고,상기 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되는 상기 제 1 내부 전극의 수와 상기 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되는 상기 제 2 내부 전극의 수를 각각 조정함으로써, 등가 직렬 저항을 미리 정해진 값으로 설정하는 적층 콘덴서의 등가 직렬 저항 조정 방법.
- 복수의 유전체층과 복수의 내부 전극이 교대로 적층된 적층체와, 상기 적층체에 형성된 복수의 단자 전극을 구비한 적층 콘덴서의 등가 직렬 저항 조정 방법에 있어서,교대로 배치되는 제 1 수의 제 1 내부 전극과 제 2 수의 제 2 내부 전극을 상기 복수의 내부 전극으로서 포함하는 콘덴서부를 갖고,상기 복수의 단자 전극은 서로 전기적으로 절연된 제 1 및 제 2 단자 전극을 포함하고,상기 제 1 수의 제 1 내부 전극을 스루홀 도체를 통하여 서로 전기적으로 접속하고,상기 제 2 수의 제 2 내부 전극을 스루홀 도체를 통하여 서로 전기적으로 접속하고,상기 제 1 수의 제 1 내부 전극 중 1개 이상에서 상기 제 1 수보다도 1개 적은 수 이하의 제 1 내부 전극을 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속하고,상기 제 2 수의 제 2 내부 전극 중 1개 이상에서 상기 제 2 수보다도 1개 적은 수 이하의 제 2 내부 전극을 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속하고,상기 인출 도체를 통하여 상기 제 1 단자 전극에 전기적으로 접속되는 상기 제 1 내부 전극의 상기 적층체의 적층 방향에서의 위치와 상기 인출 도체를 통하여 상기 제 2 단자 전극에 전기적으로 접속되는 상기 제 2 내부 전극의 상기 적층체의 적층 방향에서의 위치를 각각 조정함으로써, 등가 직렬 저항을 미리 정해진 값으로 설정하는 적층 콘덴서의 등가 직렬 저항 조정 방법.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JPJP-P-2005-00006644 | 2005-01-13 | ||
JP2005006644A JP4167231B2 (ja) | 2005-01-13 | 2005-01-13 | 積層コンデンサ、及び、積層コンデンサの等価直列抵抗調整方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20060082795A KR20060082795A (ko) | 2006-07-19 |
KR101130986B1 true KR101130986B1 (ko) | 2012-03-28 |
Family
ID=36653009
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020060000056A KR101130986B1 (ko) | 2005-01-13 | 2006-01-02 | 적층 콘덴서 및 적층 콘덴서의 등가 직렬 저항 조정 방법 |
Country Status (5)
Country | Link |
---|---|
US (1) | US7388737B2 (ko) |
JP (1) | JP4167231B2 (ko) |
KR (1) | KR101130986B1 (ko) |
CN (1) | CN100587866C (ko) |
TW (1) | TW200634870A (ko) |
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JP4475298B2 (ja) | 2007-07-09 | 2010-06-09 | Tdk株式会社 | 積層コンデンサ |
KR100925603B1 (ko) | 2007-09-28 | 2009-11-06 | 삼성전기주식회사 | 적층형 캐패시터 |
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-
2005
- 2005-01-13 JP JP2005006644A patent/JP4167231B2/ja not_active Expired - Lifetime
- 2005-12-12 US US11/298,761 patent/US7388737B2/en active Active
- 2005-12-13 TW TW094144102A patent/TW200634870A/zh unknown
-
2006
- 2006-01-02 KR KR1020060000056A patent/KR101130986B1/ko active IP Right Grant
- 2006-01-13 CN CN200610001185A patent/CN100587866C/zh active Active
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Publication number | Priority date | Publication date | Assignee | Title |
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Also Published As
Publication number | Publication date |
---|---|
KR20060082795A (ko) | 2006-07-19 |
CN1805087A (zh) | 2006-07-19 |
US20060152886A1 (en) | 2006-07-13 |
TW200634870A (en) | 2006-10-01 |
JP4167231B2 (ja) | 2008-10-15 |
CN100587866C (zh) | 2010-02-03 |
JP2006196685A (ja) | 2006-07-27 |
US7388737B2 (en) | 2008-06-17 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
PA0109 | Patent application |
Patent event code: PA01091R01D Comment text: Patent Application Patent event date: 20060102 |
|
PG1501 | Laying open of application | ||
A201 | Request for examination | ||
PA0201 | Request for examination |
Patent event code: PA02012R01D Patent event date: 20100803 Comment text: Request for Examination of Application Patent event code: PA02011R01I Patent event date: 20060102 Comment text: Patent Application |
|
E902 | Notification of reason for refusal | ||
PE0902 | Notice of grounds for rejection |
Comment text: Notification of reason for refusal Patent event date: 20110905 Patent event code: PE09021S01D |
|
E701 | Decision to grant or registration of patent right | ||
PE0701 | Decision of registration |
Patent event code: PE07011S01D Comment text: Decision to Grant Registration Patent event date: 20120222 |
|
GRNT | Written decision to grant | ||
PR0701 | Registration of establishment |
Comment text: Registration of Establishment Patent event date: 20120321 Patent event code: PR07011E01D |
|
PR1002 | Payment of registration fee |
Payment date: 20120322 End annual number: 3 Start annual number: 1 |
|
PG1601 | Publication of registration | ||
FPAY | Annual fee payment |
Payment date: 20150224 Year of fee payment: 4 |
|
PR1001 | Payment of annual fee |
Payment date: 20150224 Start annual number: 4 End annual number: 4 |
|
FPAY | Annual fee payment |
Payment date: 20160219 Year of fee payment: 5 |
|
PR1001 | Payment of annual fee |
Payment date: 20160219 Start annual number: 5 End annual number: 5 |
|
FPAY | Annual fee payment |
Payment date: 20170221 Year of fee payment: 6 |
|
PR1001 | Payment of annual fee |
Payment date: 20170221 Start annual number: 6 End annual number: 6 |
|
FPAY | Annual fee payment |
Payment date: 20180302 Year of fee payment: 7 |
|
PR1001 | Payment of annual fee |
Payment date: 20180302 Start annual number: 7 End annual number: 7 |
|
FPAY | Annual fee payment |
Payment date: 20190305 Year of fee payment: 8 |
|
PR1001 | Payment of annual fee |
Payment date: 20190305 Start annual number: 8 End annual number: 8 |
|
FPAY | Annual fee payment |
Payment date: 20200302 Year of fee payment: 9 |
|
PR1001 | Payment of annual fee |
Payment date: 20200302 Start annual number: 9 End annual number: 9 |
|
PR1001 | Payment of annual fee |
Payment date: 20220216 Start annual number: 11 End annual number: 11 |
|
PR1001 | Payment of annual fee |
Payment date: 20230220 Start annual number: 12 End annual number: 12 |
|
PR1001 | Payment of annual fee |
Payment date: 20240219 Start annual number: 13 End annual number: 13 |