KR100256013B1 - 디지탈 신호 처리 장치 - Google Patents

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Abstract

본 발명은 디지탈 비디오 테이프 레코더 등에 적용하기 가장 적합한 디지탈 신호 처리 장치에 관해서, 입력되는 디지탈 정보 신호와 디지탈 파이롯트 신호를 시간축 상에서 합성한 합성 신호를 출력하는 디지탈 멀티플렉서와, 이 디지탈 멀티플렉서에서 출력되는 합성 신호가 공급됨과 함께, 합성 신호를 형성하는 디지탈 정보 신호 혹은 디지탈 파이롯트 신호를 각각 다른 레벨로 증폭하여 출력하는 가변 증폭 회로를 구비함으로써, 회로 구성이 간소화되고, 또한 조정이 용이해져, 그 신뢰성을 향상하도록 한 것이다.

Description

디지탈 신호 처리 장치
제1도는 본 발명의 디지탈 신호 처리 장치의 실시예에 따르는 구성을 도시하는 블럭도.
제2(a)도 내지 제2(e)도는 제1도의 실시예의 동작 설명에 제공되는 신호 처리 파형도.
제3도는 제1도에 도시하는 실시예에 있어서 기록 증폭 회로를 상세히 도시하는 제1의 구체적인 예에 따르는 배선도.
제4도는 제1도에 도시하는 실시예에 있어서 기록 증폭 회로를 상세히 도시하는 제2의 구체적인 예에 따르는 배선도.
제5도는 종래의 기술에 따르는 신호 처리 장치의 구성을 도시하는 블럭도.
제6(a)도 내지 제6(d)도는 제5도에 도시하는 신호 처리 장치의 동작 설명에 제공되는 신호 처리 파형도.
* 도면의 주요부분에 대한 부호의 설명
20 : 디지탈 멀티플렉서 22 : 기록 증폭 회로
30 : 에미터 결합 논리 회로 32 : 반도체 스위치
Se : 디지탈 서보 파이롯트 신호 Sd : 디지탈 기록 정보 신호
Ss : 스윗칭 신호 Sr : 합성 기록 신호
Sm : 증폭 기록 신호
본 발명은 디지탈 비디오 테이프 레코더 등에 적용하기 가장 적합한 디지탈 신호 처리 장치에 관한 것이다.
본 발명은 디지탈 비디오 테이프 레코더 등에 적용하기 가장 적합한 디지탈 신호 처리 장치에 관한 것으로써, 디지탈 정보 신호 및 디지탈 파이롯트 신호를 기록 매체상에 기록하며, 디지탈 정보 신호 및 디지탈 파이롯트 신호와 스윗칭 신호를 수신하여 디지탈 정보 신호 및 디지탈 파이롯트 신호를 스윗칭 신호에 의해서 결정된 시간축 상에서 정보 및 파이롯트 신호 부분을 가진 합성 디지탈 기록 신호로 시간축 합성하기 위한 디지탈 멀티플렉서 수단과, 증폭된 디지탈 기록 신호를 제공하기 위해 합성 디지탈 기록 신호의 전류를 가변 증폭하기 위한 가변 이득 증폭 수단과, 증폭된 디지탈 기록 신호에 의해서 전류 구동되며 기록 매체상에 증폭된 디지탈 기록 신호를 기록하기 위한 변환 수단과, 변환 수단을 전류 구동하는 상기 증폭된 디지탈 기록 신호에서 파이롯트 신호 부분이 정보 신호 부분의 전류 레벨 보다 실제적으로 큰 전류 레벨을 갖도록 스윗칭 신호에 응답해서 가변이득 증폭 수단의 이득을 제어하기 위한 수단을 구비함으로써, 회로 구성이 간소화되고, 또한 조정이 용이해져, 그 신뢰성이 향상되도록 한 것이다.
종래, 소위, 8mm VTR에 있어서는, 기록/재생에 있어서 오토트랙킹용의 서보 파이롯트 신호가 기록 정보 신호에 시간축 상에서 합성되어서 자기 기록매체(자기 테이프)에 기록되어 있다.
이와 같은 기록을 하는 디지탈 신호 처리 장치 및 신호 처리 파형의 한 예를 제5도, 제6(a)도 내지 제6(d)도에 도시한다.
이 예에서는 아나로그 멀티플렉서(2)와, 기록 증폭기(4)가 설치되어 있으며, 제6(a)도, 제6(b)도에 도시하는 아나로그 기록 정보 신호 Sa와 아나로그 서보 파이롯트 신호 Sb가 도시되지 아니한 증폭기로 소정의 레벨로 조정이 행해진후, 아나로그 멀티플렉서(2)에 입력된다. 그래서, 아나로그 기록 정보 신호 Sa와 아나로그 서보 파이롯트 신호 Sb가 제6(c)도에 도시하는 아나로그 스윗칭 신호 Sc에 의해 소정의 시간축 상에서 합성된다. 이 합성 신호 Sd는 기록 증폭 회로(4)에서 전류 증폭이 행해져, 로터리 트랜스(RT)(6)를 거쳐서, 자기 헤드(8)에 공급되어, 자기테이프 Tp에 자기 기록된다.
이와 같이 하여, 기록 정보 신호 Sa에 비교해서 고레벨의 아나로그 파이롯트 신호 Sb가 자기 테이프 Tp에 기록되어, 이후에 판독 출력될 때의 아나로그 파이롯트 신호 Sb는 고 C/N비가 얻어지게 된다.
여기에서, 상술한 종래의 기술에 따르는 신호 처리 장치에 있어서는, 아나로그 멀티플렉서(2)에 공급되는 아나로그 기록 정보 신호 Sa는, 예를 들면 주파수 대역이 20MHz 내지 30MHz를 갖고 있으며, 또한 아나로그 서보 파이롯트 신호 Sb의 주파수 대역은 수 MHz이다. 이와 같은 광대역 신호를 원하는 평탄한 레벨로 증폭하는 경우, 비교적 복잡한 구성의 고주파 증폭 회로가 필요해져서, 근래에 요청되는 장치 규모, 신호 처리 현상의 축소에 대응하지 아니함과 더불어, 온도 변화등에 의한 특성의 변동을 일으키기 쉽고, 보다 고도의 신뢰성이 얻어지지 않는 결점이 있다.
상기한 과제를 감안하여 본 발명의 목적은, 회로 구성이 간소화됨과 함께 조정이 용이해져, 신뢰성이 뛰어나는 디지탈 신호 처리 장치를 제공하는데 있다.
본 발명의 디지탈 신호 처리 장치는 예를 들면 제1도 내지 제4도에 도시되는 바와같이, 입력되는 디지탈 정보 신호와 디지탈 파이롯트 신호를 시간축 상에서 합성한 합성 신호를 출력하는 디지탈 멀티플렉서(20), 이 디지탈 멀티플렉서에서 출력되는 합성 신호가 공급됨과 동시에, 합성 신호를 형성하는 디지탈 정보 신호 혹은 디지탈 파이롯트 신호를 각각 다른 레벨로 증폭하여 출력하는 가변 증폭 회로(22)를 구비하는 것을 특징으로 한다.
본 발명의 디지탈 신호 처리 장치에서는 입력되는 디지탈 데이타 신호와 디지탈 파이롯트 신호가 디지탈 신호 처리에 의해 소정의 시간축 상에서 합성하여 도출되고, 이후 출력 신호에 있어서 데이타 신호와 파이롯트 신호가 구별되어 전류 증폭이 행해진다. 이에 의해, 디지탈 데이타 신호와 디지탈 파이롯트 신호가 각각 구별되어 적절한 전류 증폭이 가능해지고, 또한, 그 회로 구성이 간소화되며, 또한 조정이 용이해져, 신호성이 뛰어나는 디지탈 신호 처리 장치가 얻어진다.
다음에, 본 발명의 디지탈 신호 처리 장치의 실시예를 제1도 내지 제4도를 참조하여 상세히 설명한다.
제1도에 있어서, (10)은 제1의 입력단자를 도시하고, 이 제1의 입력 단자(10)에는 디지탈 기록 정보 신호 Sd, 예를 들면, 고화질 비디오 카메라로 피사체를 촬상하여 촬상 신호가 영상 신호 처리부 등에 입력되어, 여기에서 얻어지는 주파수 대역 20MHz 내지 30MHz의 아나로그의 합성 신호를 양자화하여, 또다시 디지탈화한 신호이다. 또한, (12)는 제2의 입력 단자를 도시하고, (12)에는 제2의 입력 단자 영상 신호 처리 회로등에서 생성된 주파수 대역이 수 MHz의 아나로그의 서보 파이롯트 신호를 양자화하여, 또다시 디지탈화한 디지탈 서보 파이롯트 신호 Se가 공급된다.
또한, (14)는 제3의 입력 단자를 도시하며, (14)에는 제3의 입력 단자 영상 신호 처리 회로의 타이밍 발생기 등에서 생성되고, 디지탈 기록 정보 신호 Sd의 소정의 시간축 상에서 디지탈 서보 파이롯트 신호 Se를 가중하기 위한 스윗칭 신호 Ss가 공급되어 있다.
그래서, 공급되는 스윗칭 신호 Ss, 디지탈 기록 정보 신호 Sd, 디지탈 서보 파이롯트 신호 Se는 디지탈 멀티플렉서(20)에 입력된다. 이 디지탈 멀티플렉서(20)에서는 공급되는 스윗칭 신호 Ss에 의거한 스윗칭 동작으로 디지탈 기록 정보 신호 Sd와 디지탈 서보 파이롯트 신호 Se를 시간축상에서 합성한 합성 기록 신호 Sr가 출력되도록 되어 있다.
이 합성 기록 신호 Sr는 기록 증폭 회로(22)에 공급된다. (22)에서는 공급되는 합성 기록 신호 Sr에 형성되는 디지탈 기록 정보 신호 Sd와 디지탈 서보 파이롯트 신호 Se를 스윗칭 신호 Ss에 의거해서 전류 증폭을 실시하여, 디지탈 기록 정보 신호 Sd에 대해서 레벨이 커지는 디지탈 서보 파이롯트 신호 Se가 형성된 증폭기록 신호 Sm가 출력 단자(16, 17)와의 사이에서 얻어진다.
그래서, 증폭 기록 신호 Sm는 출력 단자(16, 17)에 접속되는 로터리 트랜스(24)에 공급됨과 함께, 자기 헤드(26)에 입력되어서, 자기 테이프 Tp에 자기 기록이 행해지도록 되어 있다.
다음에, 상기한 동작을 설명한다. 디지탈 멀티플렉서(20)에는 제2(a)도, 제2(b)도, 제2(c)도에 도시하는 디지탈 기록 정보 신호 Sd와 디지탈 서보 파이롯트 신호 Se와 디지탈 스윗칭 신호 Ss가 입력된다. 이 디지탈 멀티플렉서에서는, 디지탈 기록 정보 신호 Sd와 디지탈 서보 파이롯트 신호 Se가 스윗칭 신호 Ss에 대응한 시간축 상에서 합성되어, 제2(d)도에 도시하는 합성 기록 신호 Sr에 형성되어 도출된다.
이 합성 기록 신호 Sr는 스윗칭 신호 Ss와 함께 기록 증폭 회로(22)에 입력된다. 기록 증폭 회로(22)에서는 합성 기록 신호 Sr를 형성하는 디지탈 기록 정보 신호 Sd와 디지탈 서보 파이롯트 신호 Se가 구별되어 전류 증폭되어져 제2(e)도에 도시하는 증폭 기록 신호 Sm가 출력된다. 이 증폭 기록 신호 Sm는 디지탈 서보 파이롯트 신호 Se와 디지탈 기록 정보 신호 Sd가 스윗칭 신호 Ss에 동기해서, 또한, 시간축상에서 구별되어서 디지탈 기록 정보 신호 Sd에 대해서 디지탈 서보 파이롯트 신호 Se가 큰 전류가 증폭되어 있으며, 이후, 로터리 트랜스(24), 자기 헤드(26)를 개재해서 자기 테이프 Tp에 자기 기록된다.
이 경우, 디지탈 기록 정보 신호 Sd와 디지탈 파이롯트 신호 Se가 각각 구별하여 적절한 전류 증폭이 가능해져, 예를 들면 비교적 복잡한 광대역신호를 원하는 평탄한 레벨로 증폭하기 위한 고주파 증폭 회로가 불필요해져, 그 회로 구성이 간소화되고, 또한 조정이 용이해진다.
또한, 제1도에 도시하는 기록 증폭 회로(22)의 제1 및 제2의 구체적인 예를 설명한다.
제3도에 도시되는 기록 증폭 회로(22)의 제1의 구체적인 예는, 제2(d)도에 도시하는 합성 기록 신호 Sd가 공급되는 에미터 결합 논리 회로(ECL회로)(30)와, 저항기 Rv군의 정합 브릿지 회로는, 커플링 콘덴서 C1, C2등을 개재해서 에미터 결합 논리 회로(30)의 출력단에 접속되는 트랜지스터 Tr1, Tr2로 형성되는 차동 증폭 회로가 설치되어 있다.
그래서, 차동 증폭 회로의 콜렉터에는 부하 저항기 R1, R2가 Vcc와의 사이에 접속되어 있으며, 여기에서 작동 증폭될 때의 콜렉터에 도출되는 증폭 기록 신호 Sm가 로터리 트랜스(24)에 공급되도록 되어 있다. 또한, 차동 증폭 회로의 동작시의 에미터 전류 IE3을 동등하게 하기 위한 주지의 전류 밀러 접속된 트랜지스터 Tr3, Tr4가 설치되어 있다. 또한, 전류 제어용의 트랜지스터 Tr3와, 베이스 구동 전류 안정화용의 트랜지스터 Tr4에는 소정의 에미터 전류 IE3을 설정하기 위한 저항기군 R과, 여기에서의 정귀환 저지용의 콘덴서 C가 설치되어 있다. 또한 스윗칭 신호 Ss, 여기에서는 디지탈 기록 정보 신호 Sd와 디지탈 서보 파이롯트 신호 Se의 레벨에 의해 전환되는 반도체 스위치(32)가 설치되어 있으며, 또한 반도체 스위치(32)의 고정 접점과 Vcc단자와의 사이에 가변 저항기 Vr1, Vr2가 접속되어 잇다.
이 기록 증폭 회로(22)에서는 합성 기록 신호 Sd가 에미터 결합 논리 회로(30)에 입력되어서, 위상을 반전한 소정의 신호로 형성된 후, 커플링 콘덴서 C1, C2등을 개재해서 차동 증폭 회로를 구성하는 트랜지스터 Tr1, Tr2에 입력된다. 이 트랜지스터 Tr1, Tr2의 작동 증폭시의 각각의 에미터 전류 IE3은 전류 밀러에 접속된 트랜지스터 Tr3, Tr4의 동작에 의해, 그 값은 동등해지도록 동작한다. 그래서, 제2(c)도에 도시하는 스윗칭 신호 Ss가 하이(H)레벨의 겨우, 트랜지스터 Tr2가 온(ON)으로 되어, 트랜지스터 Tr1이 오프(OFF)된다. 이 경우, 전류가 부하 저항 R2, 로터리 트랜스(24)와, 트랜지스터 Tr3을 흐른다. 이때의 전류의 값은 스윗칭 신호 Ss에 의해 동기해서 전환되는 반도체 스위치(32)에 접속된 가변 저항기 Vr2의 값에 의한 트랜지스터 Tr3의 구동 전류가 설정되게 된다. 또한 제2(c)도에 도시하는 스윗칭 신호 Ss가 로우(L) 레벨의 경우, 트랜지스터 Tr1이 온(ON)으로 되어 트랜지스터 Tr2가 오프(OFF)로 된다. 이경우, 전류가 부하 저항 R1, 로터리 트랜스(24), 트랜지스터 Tr3을 통한다. 이때의 전류의 값은 스윗칭 신호 Ss에 의해 동기해서 전환되는 스위치(32)에 접속된 가변 저항기 Vr2의 값에 의한 트랜지스터 Tr3의 베이스 구동 전류로 설정되게 된다. 그래서, 스윗칭 신호 Ss가 하이(H) 레벨인 때에 트랜지스터 Tr3의 전류는 스윗칭 신호 Ss가 로우(L) 레벨의 경우에 비교해서 증대하도록 가변 저항기 Vr2의 값이 설정되어 있으며, 그 출력인 증폭 기록 신호 Sm는 제2(e)도에 도시되는 파형, 즉, 디지탈 기록 정보 신호 Sd에 대해서 디지탈 서보 파이롯트 신호 Se의 전류값이 증대한 원하는 출력으로 형성된다.
다음에, 제4도에 도시되는 기록 증폭 회로(22)의 제2의 구체적인 예를 설명한다. 이 예는 제1의 구체적인 예에 대해서, 트랜지스터 Tr3에 저항기 R5군과 에미터에 직렬 접속된 VR이 접속되는 트랜지스터 Tr5로 형성되는 증폭기가 접속되어, 여기에서는 공급되는 스윗칭 신호 Ss가 증폭된다. 여기에서 증폭된 스윗칭 신호 Ss의 하이(H) 레벨부분, 즉, 디지탈 증폭 기록 신호 Sm가 하이(H)레벨의 경우, 트랜지스터 Tr2가 온(ON)으로 되어, 트랜지스터 Tr1이 오프(OFF)로 된다. 이 경우에 부하 저항기 R2, 로타리 트랜지스터(24), 트랜지스터 Tr3을 통하는 전류의 값은 상기한 제1의 예와 비교해서, 그 전류의 값이 증대하게 된다. 또한, 이 전류의 최대의 값은 에미터에 직렬 접속된 가변 저항기 VR의 값으로 설정된다. 또한, 스윗칭 신호 Ss의 로우(L) 레벨 부분에서는 상기한 하이(H) 레벨 부분과 역으로 동작한다. 또 다른 동작은 제1의 예와 동일하므로, 그것의 중복된 설명은 생략한다.
이와 같이 하여, 입력되는 디지탈 기록 정보 신호 Sd와 디지탈 파이롯트 신호Se가 디지탈 신호 처리로 합성 기록 신호 Sr에 형성된 후에, 이 합성 기록 신호 Sr에 형성된 디지탈 기록 정보 신호 Sd와 디지탈 파이롯트 신호 Se가 구별되어, 원하는 전류 증폭, 즉, 디지탈 파이롯트 신호 Se가 디지탈 기록 정보 신호 Sd에 대해서 대전류에 형성된 증폭 기록 신호 Sm가 로터리 트랜스(24)에 공급된다. 이후, 자기 헤드(26)를 개재해서 디지탈 파이롯트 신호 Se만이 원하는 대전류로 자기 테이프 Tp에 자기 기록된다.
이 경우, 특히, 디지탈 멀티플렉서(20)에 있어서 신호 처리는 디지탈 신호 처리가 행해지기 때문에 안정된 합성 기록 신호 Sd가 얻어진다. 또다시, 디지탈 파이롯트 신호 Se를, 희망하는 대전류로 형성한 증폭 기록 신호 Sm가 용이하게 얻어진다. 여기에서의 회로 구성은 비교적 간소하며, 또한 조정이 용이하며, 그 신뢰성을 향상할 수가 있다.
본 발명은 상기한 실시예에 한정되지 않고, 본 발명의 요지를 이탈하지 않는 범위에서 각각 변경할 수 잇는 것은 명백하다.
이상의 설명에서 이해되는 바와 같이, 본 발명의 디지탈 신호 처리 장치에 의하면, 회로 구성이 간소화되어, 또한 조정이 용이하며, 그 신뢰성이 향상되는효과가 있다.

Claims (1)

  1. 디지탈 정보 신호 및 디지탈 파이롯트 신호를 기록 매체상에 기록하기 위한 디지탈 기록 장치로서, 상기 디지탈 정보 신호 및 디지탈 파이롯트 신호와 스윗칭 신호를 수신하여 상기 디지탈 정보 신호 및 상기 디지탈 파이롯트 신호를 상기 스윗칭 신호에 의해서 결정된 시간축 상에서 정보 및 파이롯트 신호 부분을 가진 합성 디지탈 기록 신호로 시간축 합성하기 위한 디지탈 멀티플렉서 수단과, 증폭된 디지탈 기록 신호를 제공하기 위해 상기 합성 디지탈 기록 신호의 전류를 가변 증폭하기 위한 가변 이득 증폭 수단과, 상기 증폭된 디지탈 기록 신호에 의해서 전류 구동되며 상기 기록 매체상에 상기 증폭된 디지탈 기록 신호를 기록하기 위한 변환 수단과, 상기 변환 수단을 전류 구동하는 상기 증폭된 디지탈 기록 신호에서 상기 파이롯트 신호 부분이 상기 정보 신호 부분의 전류 레벨 보다 실제적으로 큰 전류 레벨을 갖도록 상기 스윗칭 신호에 응답해서 상기 가변 이득 증폭 수단의 이득을 제어하기 위한 수단을 포함하는 디지탈 기록 장치.
KR1019910007072A 1990-05-07 1991-05-02 디지탈 신호 처리 장치 KR100256013B1 (ko)

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