JPWO2020053693A5 - - Google Patents
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- 第1のトランジスタ乃至第5のトランジスタ、容量素子、及び表示素子が設けられた画素を有し、
前記第1のトランジスタでは、ソースまたはドレインの一方が前記容量素子の一方の電極と電気的に接続され、ソースまたはドレインの他方が第1の配線と電気的に接続され、
前記第2のトランジスタでは、ソースまたはドレインの一方が前記第3のトランジスタのゲートと電気的に接続され、ソースまたはドレインの他方が第2の配線と電気的に接続され、
前記第3のトランジスタでは、ソースまたはドレインの一方が前記表示素子と電気的に接続され、ソースまたはドレインの他方が第3の配線と電気的に接続され、
前記第4のトランジスタでは、ソースまたはドレインの一方が前記表示素子と電気的に接続され、ソースまたはドレインの他方が第4の配線と電気的に接続され、
前記第5のトランジスタでは、ソースまたはドレインの一方が前記第3のトランジスタのバックゲートと電気的に接続され、ソースまたはドレインの他方が第5の配線と電気的に接続され、
前記第1のトランジスタのゲートと前記第4のトランジスタのゲートとは、電気的に接続される表示装置。 - 第1のトランジスタ乃至第5のトランジスタ、容量素子、及び表示素子が設けられた画素と、補正データ生成回路と、を有し、
前記第1のトランジスタでは、ソースまたはドレインの一方が前記容量素子の一方の電極と電気的に接続され、ソースまたはドレインの他方が第1の配線と電気的に接続され、
前記第2のトランジスタでは、ソースまたはドレインの一方が前記第3のトランジスタのゲートと電気的に接続され、ソースまたはドレインの他方が第2の配線と電気的に接続され、
前記第3のトランジスタでは、ソースまたはドレインの一方が前記表示素子と電気的に接続され、ソースまたはドレインの他方が第3の配線と電気的に接続され、
前記第4のトランジスタでは、ソースまたはドレインの一方が前記表示素子と電気的に接続され、ソースまたはドレインの他方が第4の配線と電気的に接続され、
前記第5のトランジスタでは、ソースまたはドレインの一方が前記第3のトランジスタのバックゲートと電気的に接続され、ソースまたはドレインの他方が第5の配線と電気的に接続され、
前記第1のトランジスタのゲートと前記第4のトランジスタのゲートとは、電気的に接続され、
第1の期間において、前記補正データ生成回路が、前記第3のトランジスタのしきい値電圧を補正するためのデータである補正データを生成し、
第2の期間において、第1の電位が、前記容量素子の他方の電極に供給され、
第3の期間において、第2の電位が前記容量素子の一方の電極に供給されることにより、前記容量素子の他方の電極の電位が第3の電位となり、
第4の期間において、前記第3の電位に対応する電流が、前記表示素子に流れる表示装置。 - 請求項2において、
前記第1の期間において、前記補正データ生成回路が前記補正データを生成した後、前記補正データに対応する電位が、前記第3のトランジスタのバックゲートに供給される表示装置。 - 請求項2において、
前記第1の期間において、前記第4のトランジスタをオン状態とすることにより、前記第3のトランジスタ及び前記第4のトランジスタに電流を流し、当該電流に対応した前記補正データを前記補正データ生成回路が生成する表示装置。 - 請求項4において、
前記第1の期間において、前記第3のトランジスタに流れる電流が一定値以下となるように、前記補正データ生成回路が前記補正データを生成する表示装置。
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