JPWO2016143382A1 - 内部電源回路および半導体装置 - Google Patents
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Abstract
Description
本発明の上記および他の目的、特徴および利点は本発明の例として好ましい実施の形態を表す添付の図面と関連した以下の説明により明らかになるであろう。
時間帯taでは、経路L1による内部電源が生成されて上昇している。一方、ノイズ等によって負荷2に接続される伝送ラインに異常電流が生じたような場合、時間帯tbに示すように、内部電源が上昇しなくなる期間が維持されてしまう。
内部電源回路10は、PチャネルMOSFET(Metal Oxide Semiconductor Field Effect Transistor)であるPMOSトランジスタM1〜M3、NチャネルMOSFETであるNMOSトランジスタM4、デプレッション型MOSFETであるデプレッションMOSトランジスタMdおよびツェナーダイオードDzおよび抵抗R1を備える。
また、内部電源出力端子VDDoutは、内部電源回路10が外部電源VCCから生成した内部電源VDDを出力する端子である。内部電源VDDおよびGND1は、周辺回路の動作電源として供給される。
経路L2では、電源電圧VCCからNMOSトランジスタM4の閾値電圧分低い電圧値が、内部電源VDDとして生成される。これにより、初期運用時に高電圧の電源電圧VCCが周辺回路に直接印加されないようにしている。
グラフg1は、入力信号Sinの波形を示しており、縦軸は入力信号Sinの電圧(V)、横軸は時間T(μs)である。
〔0≦T<T1〕入力信号Sinは、Hレベルである。したがって、PMOSトランジスタM1はオフになる。よって、内部電源回路10は、非駆動なので内部電源VDDは0Vである。
したがって、図3に示す経路L1を通じて、PMOSトランジスタM1から出力される電流が流れて、内部電源VDDが生成され、内部電源VDDは、内部電源出力端子VDDoutから出力されることになる。
このとき、ノードn1の電圧Vn1と、ノードn2の電圧Vn2とに電位差が生じ、電圧Vn1の方が電圧Vn2よりも高くなる(Vn2<Vn1)。したがって、PMOSトランジスタM2のゲート電位は、PMOSトランジスタM2のソース電位よりも低くなるから、PMOSトランジスタM2はオンになる。
一方、NMOSトランジスタM4のゲート電位は、電圧Vn2が印加されるが、NMOSトランジスタM4のソース電位よりも高いので、NMOSトランジスタM4はオンする。
内部電源VDDは、チャージポンプ101の動作電源になっているから、チャージポンプ101が現時点で動作する。チャージポンプ101が動作すると、負荷2を駆動するためのメインスイッチをオン、オフさせるスイッチ制御信号を出力する。
すなわち、ツェナーダイオードDzのブレークダウンが解消すると、デプレッションMOSトランジスタMdは非通電になるから、ノードn1の電圧Vn1と、ノードn2の電圧Vn2とは等しくなる。
〔T4≦T〕入力信号Sinは、Lレベルになり、PMOSトランジスタM1はフルオンし、内部電源VDDは、電源電圧VCCと同じ電圧値となる。
次に解決すべき課題について説明する。図7は内部電源回路に異常電流が発生した場合を示す図である。内部電源回路10は、出力端子OUTを介して負荷2に直接接続しているため、出力端子OUTおよび出力端子OUTに接続する伝送ラインは、外部ノイズを受けやすい。
グラフg11は、入力信号Sinの波形を示しており、縦軸は入力信号Sinの電圧(V)、横軸は時間T(μs)である。
〔0≦T<T1〕入力信号Sinは、Hレベルである。したがって、PMOSトランジスタM1はオフとなり、内部電源VDDは0Vになる。
〔T2≦T<Tres〕期間Tdは、出力端子OUTに外部ノイズを受け、ツェナーダイオードDzに接続している抵抗R1に逆電圧Vaが発生した状態である。
なお、図1との対応関係を示すと、制御スイッチs0は、PMOSトランジスタM1に対応し、スイッチs1は、PMOSトランジスタM2に対応し、スイッチs2は、PMOSトランジスタM3に対応し、スイッチs3は、NMOSトランジスタM4に対応する。
さらに、グラフg23は、内部電源出力端子VDDoutから出力される内部電源VDDの波形を示しており、縦軸は内部電源VDDの電圧(V)、横軸は時間T(μs)である。
すると、ノードn1の電圧Vn1と、ノードn2の電圧Vn2とは等しくなるから、期間Taと同様なトランジスタのスイッチング動作となって、図3に示す経路L1によって、内部電源VDDが生成されることになる。これにより、内部電源VDDが、電源電圧VCCに達することができる。
IPS30は、負荷2、マイコン4、バッテリ5に接続している。また、IPS30は、ロジック回路31、レベルシフトドライバ32、内部電源回路33、ST(status)回路34、低電圧検出回路35、短絡検出回路36、負荷開放検出回路37、過電流検出回路38および過熱検出回路39を備える。
スイッチ素子M0がオフになる瞬間では、モータ等の誘導性の負荷2からは、逆起電力が発生する。このため、スイッチ素子M0に対して、ダイオードD0を逆並列に接続して、このときの負荷電流を還流させる構成としている。
低電圧検出回路35は、VCC電圧が定格電圧より低いとき、異常信号をロジック回路31に送信する。低電圧検出回路35から送信された異常信号を受信したロジック回路31は、スイッチ素子M0を制御するONBH信号をオフ信号にして出力する。
上記については単に本発明の原理を示すものである。さらに、多数の変形、変更が当業者にとって可能であり、本発明は上記に示し、説明した正確な構成および応用例に限定されるものではなく、対応するすべての変形例および均等物は、添付の請求項およびその均等物による本発明の範囲とみなされる。
1a クランプ回路
1b 電流制御素子
1c 切替えスイッチ群
1d スイッチ回路
2 負荷
s0 制御スイッチ
s1 第1スイッチ
s2 第2スイッチ
s3 第3スイッチ
Sin 制御信号
L1 第1経路
L2 第2経路
IN 入力端子
OUT 出力端子
VDDout 内部電源出力端子
GND0 外部グランド
GND1 内部グランド
ga 内部電源の波形
ta 第1経路による内部電源の生成期間
tb 内部電源が上昇しなくなる期間
t1 制御信号のオン開始時刻
t2 所定時間経過したときの時刻
Claims (5)
- 電源電圧から内部電源を生成する内部電源回路において、
前記電源電圧に接続し、制御信号にもとづきオンして電流を出力する制御スイッチと、
負荷に接続し、前記制御スイッチの出力電圧のクランプ制御を行うクランプ回路と、
クランプ制御される前記出力電圧により、前記電流を導通または非導通にする電流制御素子と、
前記電流の導通または非導通に応じて変化する電圧の印加にもとづいて、前記内部電源を生成するための経路の切替えを行う切替えスイッチ群と、
前記クランプ回路と、前記切替えスイッチ群との結合を断続するスイッチ回路と、
を有することを特徴とする内部電源回路。 - 前記切替えスイッチ群は、前記電源電圧から所定レベルの電圧ドロップがない前記内部電源を生成する第1経路と、前記電源電圧から前記所定レベルを電圧ドロップさせた前記内部電源を生成する第2経路との切替えを行い、
前記スイッチ回路は、前記制御スイッチのオン開始から所定時間経過した後に前記結合を切断することで前記第1経路への切替えを行う、
ことを特徴とする請求項1記載の内部電源回路。 - 前記切替えスイッチ群は、三端子スイッチである、第1スイッチ、第2スイッチおよび第3スイッチを含み、
前記制御信号が入力する入力端子は、前記制御スイッチの入力端と、前記スイッチ回路の一方の入力端と接続し、
前記制御スイッチの電流出力端は、前記第1、第2、第3スイッチの一方の入力端と、前記電流制御素子の入力端と接続し、
前記電流制御素子の出力端は、前記第1、第3スイッチの他方の入力端と、前記スイッチ回路の他方の入力端と接続し、
前記第1スイッチの出力端は、前記第2スイッチの他方の入力端と、内部グランドに接続し、
前記第2、第3スイッチの出力端は、内部電源出力端子に接続し、
前記スイッチ回路の出力端は、前記クランプ回路の入力端に接続し、
前記クランプ回路の出力端は、前記負荷の一端に接続し、前記負荷の他端は、外部グランド接続する、
ことを特徴とする請求項2記載の内部電源回路。 - 前記出力電圧が所定電圧未満の場合には、前記クランプ回路により、前記出力電圧がクランプされて前記電流制御素子が非導通になり、前記第1スイッチがオフ、前記第2スイッチがオンおよび前記第3スイッチがオフして、前記制御スイッチから、前記第2スイッチを介して、前記内部電源出力端子へ向かう前記第1経路が生成されて前記内部電源を出力し、
前記出力電圧が所定電圧以上の場合には、前記クランプ回路により、前記出力電圧のクランプが解除されて前記電流制御素子が導通し、前記第1スイッチがオン、前記第2スイッチがオフおよび前記第3スイッチがオンして、前記制御スイッチから、前記第3スイッチを介して、前記内部電源出力端子へ向かう前記第2経路が生成されて前記内部電源を出力し、
前記制御スイッチのオン開始から所定時間経過後には、前記スイッチ回路により、前記結合が切断されることで、前記電流制御素子が非導通になって、前記第1経路が生成されて前記内部電源を出力する、
ことを特徴とする請求項3記載の内部電源回路。 - 電源電圧から生成された内部電源を動作電源にして、負荷を駆動するための昇圧動作を行うチャージポンプと、
前記電源電圧に接続し、制御信号にもとづきオンして電流を出力する制御スイッチと、前記負荷に接続し、前記制御スイッチの出力電圧のクランプ制御を行うクランプ回路と、クランプ制御される前記出力電圧により、前記電流を導通または非導通にする電流制御素子と、前記電流の導通または非導通に応じて変化する電圧の印加にもとづいて、前記内部電源を生成するための経路の切替えを行う切替えスイッチ群と、前記クランプ回路と、前記切替えスイッチ群との結合を断続するスイッチ回路とを含む内部電源回路と、
を有することを特徴とする半導体装置。
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