JPS6396931A - 半導体装置 - Google Patents
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は半導体装置に関し、特に半導体チップを塔載す
る絶縁性基板における配線及び半田付は用ランドに関す
る。
る絶縁性基板における配線及び半田付は用ランドに関す
る。
従来の技術
第2図は従来例における外部端子が絶縁性基板の側壁に
設けられたL OO(Leadless Chip(3
arrier )形の半導体装置の断面図であり、1は
絶縁性基板、2は絶縁性基板1に塔載された半導体チッ
プ、3は絶縁性基板1のボンディングパッド4と半導体
チップ2の電極を結線するポンディングワイヤ、6は外
部端子、6はボンディングパッド4と外部端子5を結線
する金属配線である。
設けられたL OO(Leadless Chip(3
arrier )形の半導体装置の断面図であり、1は
絶縁性基板、2は絶縁性基板1に塔載された半導体チッ
プ、3は絶縁性基板1のボンディングパッド4と半導体
チップ2の電極を結線するポンディングワイヤ、6は外
部端子、6はボンディングパッド4と外部端子5を結線
する金属配線である。
高周波信号を扱う電気回路の場合、信号の流れる伝送路
の特性インピーダンスと同じ値の抵抗で伝送路の最後が
終端されていないと正常な信号の伝送は行われない。そ
こで半導体装置をプリント基板に塔載して使用する場合
、信号が入力する半導体装置の外部端子5近傍で信号伝
送路を抵抗で終端することが行われている。しかしなが
ら外部端子5の間隔がo、smlや0.25111ff
のように狭くなってくると抵抗の大きさがそれらに比較
して大きいため、複数の入力用の外部端子6同士が接近
している場合、抵抗の位置を半導体装置からかなり離さ
ないと抵抗を接続できない。したがってこのような場合
、抵抗で終端された位置から外部端子5までの配線部分
と、半導体装置内部における外部端子5とボンディング
パッド4及びその間の金属配線6の部分は特性インピー
ダンス不整合の状態で信号が伝送することになり正常な
伝送は行われなくなる。
の特性インピーダンスと同じ値の抵抗で伝送路の最後が
終端されていないと正常な信号の伝送は行われない。そ
こで半導体装置をプリント基板に塔載して使用する場合
、信号が入力する半導体装置の外部端子5近傍で信号伝
送路を抵抗で終端することが行われている。しかしなが
ら外部端子5の間隔がo、smlや0.25111ff
のように狭くなってくると抵抗の大きさがそれらに比較
して大きいため、複数の入力用の外部端子6同士が接近
している場合、抵抗の位置を半導体装置からかなり離さ
ないと抵抗を接続できない。したがってこのような場合
、抵抗で終端された位置から外部端子5までの配線部分
と、半導体装置内部における外部端子5とボンディング
パッド4及びその間の金属配線6の部分は特性インピー
ダンス不整合の状態で信号が伝送することになり正常な
伝送は行われなくなる。
また、電源用バイパスコンデンサを接続する場合も上記
と同様にコンデンサの位置から半導体装置内部のボンデ
ィングパッド4までが長くなり、そのインピーダンスの
影響で電源用バイパスコンデンサの電源の安定化の効果
が弱くなる。
と同様にコンデンサの位置から半導体装置内部のボンデ
ィングパッド4までが長くなり、そのインピーダンスの
影響で電源用バイパスコンデンサの電源の安定化の効果
が弱くなる。
発明が解決しようとする問題点
上記のように半導体装置をプリント基板に塔載してプリ
ント基板上において抵抗で信号の終端を行う場合、終端
位置から半導体装置内部のボンディングパッドまでの距
離が長くなり正常な信号伝送が行われなくなる。また、
電源用バイパスコンデンサの場合も同様にその効果が弱
くなる。
ント基板上において抵抗で信号の終端を行う場合、終端
位置から半導体装置内部のボンディングパッドまでの距
離が長くなり正常な信号伝送が行われなくなる。また、
電源用バイパスコンデンサの場合も同様にその効果が弱
くなる。
本発明は上記欠点に鑑みなされたものであり、ボンディ
ングパッドの近くで終端用抵抗や電源用バイパスコンデ
ンサの接点が可能な半導体装置を提供することを目的と
する。
ングパッドの近くで終端用抵抗や電源用バイパスコンデ
ンサの接点が可能な半導体装置を提供することを目的と
する。
問題点を解決するための手段
本発明は上記問題点を解決するためになされたものであ
り、半導体装置裏面で終端用抵抗及び電源用バイパスコ
ンデンサ等を接続するために半田付は用ランドを設け、
それらに対応するボンディングパッドにスルーホールを
介して結線するものである。
り、半導体装置裏面で終端用抵抗及び電源用バイパスコ
ンデンサ等を接続するために半田付は用ランドを設け、
それらに対応するボンディングパッドにスルーホールを
介して結線するものである。
作用
ボンディングパッドをスルーホールを介して半導体装置
裏面の半田付は用ランドに結線し、半導体装置裏面にお
いてバイアス電源用の半田付は用ランドとの間に終端用
抵抗または電源用バイパスコンデンサを接続することに
より、上記部品接続位置とボンディングパッドとの距離
を短かくすることができる。また抵抗終端の場合、ボン
ディングパッドまで特性インピーダンスを保つことがで
きる。
裏面の半田付は用ランドに結線し、半導体装置裏面にお
いてバイアス電源用の半田付は用ランドとの間に終端用
抵抗または電源用バイパスコンデンサを接続することに
より、上記部品接続位置とボンディングパッドとの距離
を短かくすることができる。また抵抗終端の場合、ボン
ディングパッドまで特性インピーダンスを保つことがで
きる。
実施例
以下図面を参照して本発明の詳細な説明する。
第1図は本発明の一実施例におけるLCC形半導体装置
の図面であり、同図aは断面図、同すは裏面から見た平
面図である。但し、実装された部品を含む。従来例と同
一番号のものは同じものを示す。
の図面であり、同図aは断面図、同すは裏面から見た平
面図である。但し、実装された部品を含む。従来例と同
一番号のものは同じものを示す。
7.71.72は終端抵抗及びバイパスコンデンサを半
田付けするための部品用ランド、8は部品用ランド7.
71.72との間に上記部品を半田付けするための電源
用ランド、9はスルーホール、10.11は終端用抵抗
、12はバイパスコンデンサである。
田付けするための部品用ランド、8は部品用ランド7.
71.72との間に上記部品を半田付けするための電源
用ランド、9はスルーホール、10.11は終端用抵抗
、12はバイパスコンデンサである。
本例においては部品用ランド7、及び71は信号入力の
端子に対応し、部品用ランド72は電源の端子に対応す
る。その他の出力端子等には必ずしもこれらのスルーホ
ール9や部品用ランド7゜71.72を設ける必要はな
く、終端を必要とする入力端子及び電源端子にのみ設け
ればよい。電源用ランド8には外部から電源を供給する
。本例の場合、同一のランドとなっているが複数の電源
を必要とする場合はそれに対応して複数個の電源用ラン
ドを設ければよい。
端子に対応し、部品用ランド72は電源の端子に対応す
る。その他の出力端子等には必ずしもこれらのスルーホ
ール9や部品用ランド7゜71.72を設ける必要はな
く、終端を必要とする入力端子及び電源端子にのみ設け
ればよい。電源用ランド8には外部から電源を供給する
。本例の場合、同一のランドとなっているが複数の電源
を必要とする場合はそれに対応して複数個の電源用ラン
ドを設ければよい。
たとえばICCLレベルの入力の場合、入力端はバイア
ス電圧−2V、終端抵抗6oΩが接続されるが、このよ
うな場合、電源用ランド8には外部から一2vを供給し
、終端用抵抗10.11を50Ωの抵抗にすればよい。
ス電圧−2V、終端抵抗6oΩが接続されるが、このよ
うな場合、電源用ランド8には外部から一2vを供給し
、終端用抵抗10.11を50Ωの抵抗にすればよい。
また、外部端子6.金属配線6.スルーホール9を所望
の特性インピーダンスを持つようにしておけば、はぼボ
ンディングパッド4まで正常な信号伝送ができる。終端
抵抗10.11は裏面にあるので、半導体装置の外側の
プリント基板上で終端する場合よりはるかにボンディン
グパッド4の近くで終端できることになる。
の特性インピーダンスを持つようにしておけば、はぼボ
ンディングパッド4まで正常な信号伝送ができる。終端
抵抗10.11は裏面にあるので、半導体装置の外側の
プリント基板上で終端する場合よりはるかにボンディン
グパッド4の近くで終端できることになる。
終端の場合と同様にバイパスコンデンサ12を接続する
場合、できるだけボンディングパッド4に近いほうがよ
い。近ければ近いほど電源の安定化に効果がある。した
がってプリント基板上で接続するよりも本例のように半
導体装置裏面で接続するほうが効果が大きくなる。
場合、できるだけボンディングパッド4に近いほうがよ
い。近ければ近いほど電源の安定化に効果がある。した
がってプリント基板上で接続するよりも本例のように半
導体装置裏面で接続するほうが効果が大きくなる。
発明の効果
以上述べてきたように、本発明によれば、ボンディング
パッドまで正常な高周波の信号が伝送でき、また電源の
バイパスによる安定化の効果を大きくでき、その実用的
効果は大なるものがある。
パッドまで正常な高周波の信号が伝送でき、また電源の
バイパスによる安定化の効果を大きくでき、その実用的
効果は大なるものがある。
第1図aは本発明の一実施例におけるLOG形半導体装
置の断面図、第1図すは同装置を裏面からみた平面図、
第2図は従来におけるLCC形半導体装置の断面図であ
る。 1・・・・・・絶縁性基板、2・・・・・・半導体チッ
プ、3・・・・・・ポンディングワイヤ、4・・・・・
・ボンディングパッド、6・・・・・・外部端子、6・
・・・・・金属配線、7・・・・・・部品用ランド、8
・・・・・・電源用ランド、9・・・・・・スルーホー
ル、10・・・・・・終端用抵抗、12・・・・・・バ
イパスコンデンサ。
置の断面図、第1図すは同装置を裏面からみた平面図、
第2図は従来におけるLCC形半導体装置の断面図であ
る。 1・・・・・・絶縁性基板、2・・・・・・半導体チッ
プ、3・・・・・・ポンディングワイヤ、4・・・・・
・ボンディングパッド、6・・・・・・外部端子、6・
・・・・・金属配線、7・・・・・・部品用ランド、8
・・・・・・電源用ランド、9・・・・・・スルーホー
ル、10・・・・・・終端用抵抗、12・・・・・・バ
イパスコンデンサ。
Claims (2)
- (1)絶縁性基板及びこの基板に塔載された半導体チッ
プからなり、それぞれのボンディングパッドと対応する
電極とが金属線により結線されており、前記ボンディン
グパッドは前記絶縁性基板の側面の外部端子へ金属配線
で結線され、かつ前記ボンディングパッドの近傍に設け
られたスルーホールを介して前記絶縁性基板裏面の半田
付け用ランドに結線されており、前記絶縁性基板の裏面
には前記半田付け用ランドとの間に個別部品が半田付け
でき、また外部からの電源線が半田付けできる別の半田
付け用ランドが設けられている半導体装置。 - (2)金属配線及びスルーホールが同一の特性インピー
ダンスを有する特許請求の範囲第1項記載の半導体装置
。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24249786A JPH088268B2 (ja) | 1986-10-13 | 1986-10-13 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24249786A JPH088268B2 (ja) | 1986-10-13 | 1986-10-13 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6396931A true JPS6396931A (ja) | 1988-04-27 |
JPH088268B2 JPH088268B2 (ja) | 1996-01-29 |
Family
ID=17089968
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP24249786A Expired - Lifetime JPH088268B2 (ja) | 1986-10-13 | 1986-10-13 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH088268B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5543659A (en) * | 1993-10-28 | 1996-08-06 | Fuli Electric Co., Ltd. | Package for power semiconductor device with snubber circuit |
US5600175A (en) * | 1994-07-27 | 1997-02-04 | Texas Instruments Incorporated | Apparatus and method for flat circuit assembly |
US5608261A (en) * | 1994-12-28 | 1997-03-04 | Intel Corporation | High performance and high capacitance package with improved thermal dissipation |
-
1986
- 1986-10-13 JP JP24249786A patent/JPH088268B2/ja not_active Expired - Lifetime
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5543659A (en) * | 1993-10-28 | 1996-08-06 | Fuli Electric Co., Ltd. | Package for power semiconductor device with snubber circuit |
US5600175A (en) * | 1994-07-27 | 1997-02-04 | Texas Instruments Incorporated | Apparatus and method for flat circuit assembly |
US5608261A (en) * | 1994-12-28 | 1997-03-04 | Intel Corporation | High performance and high capacitance package with improved thermal dissipation |
Also Published As
Publication number | Publication date |
---|---|
JPH088268B2 (ja) | 1996-01-29 |
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