JPS6351301B2 - - Google Patents

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JPS6351301B2
JPS6351301B2 JP61130166A JP13016686A JPS6351301B2 JP S6351301 B2 JPS6351301 B2 JP S6351301B2 JP 61130166 A JP61130166 A JP 61130166A JP 13016686 A JP13016686 A JP 13016686A JP S6351301 B2 JPS6351301 B2 JP S6351301B2
Authority
JP
Japan
Prior art keywords
disk device
ipl
program
floppy disk
storage device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP61130166A
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English (en)
Other versions
JPS61281346A (ja
Inventor
Yasuhito Wakasugi
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
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Publication of JPS61281346A publication Critical patent/JPS61281346A/ja
Publication of JPS6351301B2 publication Critical patent/JPS6351301B2/ja
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Description

【発明の詳細な説明】 本発明は電子計算機システムにおけるイニシヤ
ル・プログラム・ロード方式に関するものであ
る。
周知のように、電子計算機システムにおいて
は、電源投入時あるいはシステムリセツト等をき
つかけとして、デイスク装置、フロツピデイスク
装置等の外部記憶装置より主記憶装置へプログラ
ム(管理プログラムの常駐部等)をロードする必
要がある。これがイニシヤル・プログラム・ロー
ド(以下、IPLと略す)である。(前記外部記憶
装置を以下IPL用装置と呼ぶ)ところで複数台の
IPL用装置が接続される構成の電子計算機システ
ムにおいては、電源投入時等のIPLに先立つて
IPL用装置を指定する必要があるが、従来はオペ
レータがスイツチ等で一々IPL用装置を指定して
おり、操作が煩わしいこと、あるいはスイツチの
設定ミスを起し易いなどの問題があつた。
本発明の目的は、IPL時のオペレータの操作性
の良さを残したまま、特別な場合にIPL装置の変
更を可能としたIPL方式を提供することにある。
しかして、本発明の特徴とするところは、イニ
シヤル・プログラム・ロードによりプログラムが
読出される記憶装置を複数台接続できる構成の電
子計算機システムにおいて、該記憶装置の各々に
あらかじめ優先順位を設定しておき、接続されて
いる該記憶装置のうち最優先順位のものからプロ
グラムのロードを行なうイニシヤル・プログラ
ム・ロード方式において、電源投入あるいはシス
テムリセツト後所定期間内にプログラムを読出す
べき記憶装置の変更が指示された場合、該指示さ
れた記憶装置よりプログラムのロードを行なうこ
とにある。
以下、本発明の一実施例につき図面を用いて詳
細に説明する。
第1図及び第2図は本発明で対象とする電子計
算機システムのブロツク図である。第1図におい
て、演算処理装置1にはインタフエース・バスラ
イン4を通してタイマ機構2、主記憶装置3、シ
ステムコンソール用のキーボード装置5、フロツ
ピデイスク装置6およびデイスク装置7が接続さ
れている。主記憶装置3はIPL動作を実行するの
に必要なIPLプログラムがあらかじめ格納されて
いる領域9(一般にROMで構成される)、及び
IPLによりプログラムが格納される領域10(一般
にRAMで構成される)より成る。第2図は、第
1図のデイスク装置7の替りに2台目のフロツピ
デイスク装置8が接続されていること以外は第1
図と同じである。いわゆる第1図はデイスク装置
ベースのシステムであり、第2図はフロツピデイ
スク装置ベースのシステムである。
ここで、第1図の構成においては、イニシヤ
ル・プログラムはデイスク装置7に格納されてお
り、第2図の構成においては、フロツピデイスク
装置6にイニシヤル・フロツピ媒体がセツトされ
る様に決めてあるとする。又、IPL用装置の優先
順位としては、デイスク装置、フロツピデイスク
装置の順、さらに同種の装置においては装置番号
の若い順に優先順位をもたせてあるとする。本発
明は、この両システム構成のIPLを主記憶装置3
の領域9に格納されている同じIPLプログラムに
より、電源投入時あるいはシステムリセツト等を
きつかけとして自動的に行うものである。第3図
はそのフローチヤートを示したもので、以下、こ
れにもとづいて動作を説明する。
電源投入等によりIPLプログラムに制御が渡さ
れると、該IPLプログラムは一定時間、タイマ機
構2を用いて時間監視を行い、その時間内(例え
ば3秒)にオペレータが何らキー操作をしなかつ
た場合(ステツプ11)、まずIPL用装置として優
先順位の最も高いデイスク装置7の接続をチエツ
クする(ステツプ12)。即ち、デイスク装置7に
入出力命令を発行し、応答があれば接続されてお
り、応答がなければ接続されていないものとす
る。第1図の場合にはデイスク装置7の接続が確
認されるので、該デイスク装置7を起動し(ステ
ツプ13)、それに格納されているイニシヤル・プ
ログラムを主記憶信号3の領域10にロードする
(ステツプ14)。一方、第2図の場合はデイスク装
置の未接続が確認されるので、次に優先順位の高
い1台目のフロツピデイスク装置6の接続を同様
にしてチエツクする(ステツプ15)。そして、フ
ロツピデイスク装置6が接続されている場合は、
それにフロツピ媒体がセツトされているか否かチ
エツクし(ステツプ16)、セツトされていない場
合はセツトされるのを待ち、フロツピ媒体のセツ
トが確認されると、該フロツピデイスク装置6を
起動し(ステツプ17)、フロツピ媒体のイニシヤ
ル・プログラムを主記憶装置3の領域10にロード
する(ステツプ18)。
なお、IPLプログラムに制御が移り、前記一定
時間内にオペレータのキー操作があれば、キー入
力によりどのIPL用装置が指定されたかチエツク
し(ステツプ19)、もしデイスク装置7が指定さ
れたのであれば、該デイスク装置7よりIPL動作
を行い(ステツプ13、14)、又、例えばフロツピ
デイスク装置8が指定された場合は、それより
IPL動作を行う(ステツプ16、17、18)。即ち、
システムがあらかじめ決められた優先順位に従つ
てIPL用装置を決定する以外に、従来と同様に、
オペレータのキー操作により任意にIPL用装置を
決定することもできる。
第3図ではIPL用装置の優先順位としてデイス
ク装置、フロツピデイスク装置の順とし、デイス
ク装置7が接続されていない場合は直ちにフロツ
ピデイスク装置6の接続を確認するフローを示し
たが、複数台のデイスク装置が接続できる構成の
場合は、各デイスク装置の接続を例えば若い順に
チエツクし、いずれのデイスク装置も接続されて
いない場合、フロツピデイスク装置のチエツクに
移るようにすればよい。これはフロツピデイスク
装置についても同様であり、フロツピデイスク装
置6が接続されていない場合は次のフロツピデイ
スク装置8の接続をチエツクし、該フロツピデイ
スク装置8が接続されている場合はそれよりIPL
動作を行うようにすればよい。
本発明によれば、IPL時の操作性の良さを残し
たまま、特別な場合にIPL装置の変更が可能とな
る。
【図面の簡単な説明】
第1図及び第2図は本発明で対象とする電子計
算機システム例のブロツク図、第3図は第1図及
び第2図を対象とした本発明のIPL方式を説明す
るための流れ図である。 1……演算処理装置、2……タイマ機構、3…
…主記憶装置、4……バスライン、5……キーボ
ード装置、6,8……フロツピデイスク装置、7
……デイスク装置。

Claims (1)

    【特許請求の範囲】
  1. 1 イニシヤル・プログラム・ロードによりプロ
    グラムが読出される記憶装置を複数台接続できる
    構成の電子計算機システムにおいて、該記憶装置
    の各々にあらかじめ優先順位を設定しておき、接
    続されている該記憶装置のうち最優先順位のもの
    からプログラムのロードを行なうイニシヤル・プ
    ログラム・ロード方式において、電源投入あるい
    はシステムリセツト後所定期間内にプログラムを
    読出すべき記憶装置の変更が指示された場合、該
    指示された記憶装置よりプログラムのロードを行
    なうことを特徴とするイニシヤル・プログラム・
    ロード方式。
JP13016686A 1986-06-06 1986-06-06 イニシヤル・プログラム・ロ−ド方式 Granted JPS61281346A (ja)

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JP13016686A JPS61281346A (ja) 1986-06-06 1986-06-06 イニシヤル・プログラム・ロ−ド方式

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JPS61281346A JPS61281346A (ja) 1986-12-11
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JPS61281346A (ja) 1986-12-11

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