JPS6331311A - 可変インピ−ダンス駆動回路 - Google Patents

可変インピ−ダンス駆動回路

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JPS6331311A
JPS6331311A JP62178149A JP17814987A JPS6331311A JP S6331311 A JPS6331311 A JP S6331311A JP 62178149 A JP62178149 A JP 62178149A JP 17814987 A JP17814987 A JP 17814987A JP S6331311 A JPS6331311 A JP S6331311A
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variable impedance
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    • H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
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    • H03K—PULSE TECHNIQUE
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、被試験装置に自動試験装置からの試験信号を
供給する可変インピーダンス駆動回路に関するものであ
る。
〔従来の技術〕
自動試験装置に用いられる型式の駆動回路では、被試験
装置（ＤＯＴ）を刺激する試験信号パルスを供給するた
めの駆動回路を作るのに、ＣＭＯＳ（Ｃｏｍｐｌｅｍｅ
ｎｔａｒｙ　Ｍｅｔａｌ　０ｘｉｄｅ　Ｓｅｍ１ｃｏｎ
ｄｕｃｔｏｒ　）簗積回路（ＩＣ）チップ技術を使用す
ると有利であることが多い。それは、このＣＭＯＳ　Ｉ
Ｃが比較的安価かつ小形のためである。通常、ＤＵＴは
インピーダンスが一定の伝送線により上記駆動回路の出
力端に接続するので、試験パルスの所望形状を維持する
ためには、駆動回路の出力インピーダンスを伝送線のイ
ンピーダンスに整合させる必要がある。
〔発明が解決しようとする問題点〕
上述の駆動回路の問題点の１つは、ＣＭＯＳチップの性
能の変動により、かかる駆動回路のインピーダンスが大
幅に変化することである。同じ製造工程で製造した１似
のＣＭＯＳ素子のインピーダンスが、１００％程度も異
なることは珍しくない。よって、ＣＭＯＳ伝送ゲートを
出力駆動回路として用いる試験装置においては、各駆動
回路のインピーダンスをＤＯＴに接続する伝送線のイン
ピーダンスに整合させる方法が必要となる。
したがって、本発明の目的は、小形で安価な可変インピ
ーダンス駆動回路の提供にある。
〔問題点を解決するための手段及び作用〕本発明の可変
インピーダンス駆動回路は、そのインピーダンスを試験
装置及びＤＵＴ間の伝送線又はその他の接続線のインピ
ーダンスに整合させることができる。この駆動回路は、
それぞれ所定の公称インピーダンスをもつ複数のゲート
手段を具えており、これらのゲート手段を並列接続し、
制御手段からの制御信号により選択的に動作させる。こ
の制御信号は、予め選択したゲート手段の１つをオフ（
非動作状態）又はオン（動作状態）として、駆動回路に
所望の総合的インピーダンスをもたせる。
このゲート手段は、並列接続されたＮチャンネル素子及
びＰチャンネル素子から成るＣＭＯ３ＦＥＴ対を用いた
伝送ゲートでもよい。各伝送ゲートは所定の公称インピ
ーダンスを有し、並列接続された任意所定数の伝送ゲー
トのインピーダンスには、例えば、それぞれＲ，２Ｒ，
・・・・、２°Ｒのような２進的関係をもたせる。制御
手段（論理回路）は、これに接続された制御線を介して
各伝送ゲートを制御し、１つ以上の伝送ゲートを選択的
に動作させる。伝送ゲートの成るものをオンさせると共
に他の伝送ゲートをオフさせることにより、電圧源を伝
送線に接続する駆動回路のインピーダンスを制御するこ
とができる。
本発明の上述及び他の目的、特徴、利点は、添付図を参
照した以下の説明より一層容易に理解できるであろう。
〔実施例〕
第１図は本発明の好適な実施例を示すブロック図、第２
図はその伝送ゲートの１つを示す略図である。
駆動回路（１０）は、複数のＣＭＯ５伝送ゲート（１２
）　。
（１４）　、　　（１６）　、　　（１８）　、　　（
２０）及び（２２）を具えている。伝送ゲート（１２）
を示す第２図より、ゲート（１２）〜（２２）の各々が
、Ｎチャンネル・トランジスタと並列接続されたＰチヤ
ンネル・トランジスタより成ることが判るであろう。よ
って、両方のトランジスタは、共通のソース（２４）及
び共通のドレイン（２６）を有する。Ｐチャンネル・ト
ランジスタのゲート（２８）は、反転増幅器（３２）を
介して制御線（３０）に接続する。各伝送ゲート（１２
）〜（２２）は、制御線（３０）　、　　（３４）　、
　　（３６）（３８）　、　　（４０）及び（４２）に
よりそれぞれ制御される。各制御線（３０）〜（４２）
の状態は、符号化入力線０１〜Ｃ６の論理状態と共に制
御線Ａ１及びＡ２の論理状態を図示の如くアンド・ゲー
トで組合せて制御する。これらの制御線Ａ１及びＡ２ば
、駆動回路（１０）の状態、すなわち、駆動回路（１０
）が高電圧レベル論理状態となるべきか又は低電圧レベ
ル論理状態となるべきかを制御する。
駆動回路（１０）の出力端を伝送線（４４）に接続し、
この伝送線（４４）をＤＵＴ（４６）に接続する。
例えば高（電圧）レベル論理状態にある伝送ゲート（１
２）　、　　（１４）及び（１６）のいくつかを制御す
ることにより、駆動回路（１０）の出力インピーダンス
を選択できる。これは、各伝送ゲート（１２）〜（１６
）は、それぞれオンのときには所定の公称インピーダン
スとなり、オフのときはほぼ無限大のインピーダンスと
なるからである。よって、伝−送ゲートのいくつかを選
択的にオン・オフすることにより、オームの法則により
計算できる総合イ、ンピーダンスを調整できる。
オン状態の伝送ゲートの個々のインピーダンス値が２進
的関係にあれば、微調整が可能である。
すなわち、例えばゲート（１２）の抵抗値がＲならば、
ゲート（１４）の抵抗値は２Ｒとし、ゲート（１６）の
抵抗値は４Ｒとするのである。高及び低論理レベル用に
それぞれ３つより多くのゲートを設けてもよく、この場
合、抵抗値はそれぞれＲ１２Ｒ，・・・・、２°Ｒとな
る。よって、高レベル制御線ＡＩ又は低レベル制御線Ａ
２は、駆動回路が高又は低論理状態となるように制御す
る。また、高電圧（論理）レベル用制御線Ｃ１〜０３及
び低電圧（論理）レベル用制御線Ｃ４〜Ｃ６は、伝送ケ
ート（１２）〜（２２）のいくつかを選択的に動作させ
る（イネーブルする）デジタル・コードに応じて駆動回
路（ｌＯ）の出力インピーダンスを制御する。
（発明の効果〕 上述の如く本発明によれば、複数のゲート手段の内、所
望のものを選択的に動作させることにより出力インピー
ダンスを制御できる簡単かつ安価な可変インピーダンス
駆動回路が得られる。
【図面の簡単な説明】
第１図は本発明の好適な一実施例を示すブロック図、第
２図は第１図の伝送ゲートの１つを示す略図である。 図において、（１２〜２２）はゲート手段、（３０〜４
２、ＡＩ、Ａ２．Ｃ１〜Ｃ６）は制御手段を示す。

Claims (1)

  1. 【特許請求の範囲】 共通の電圧源及び出力端間に並列接続され、それぞれ動
    作状態において所定の公称インピーダンスを有する複数
    のゲート手段と、 該複数のゲート手段を選択的に動作させる制御手段とを
    具え、 上記出力端における出力インピーダンスを可変としうる
    ことを特徴とする可変インピーダンス駆動回路。
JP62178149A 1986-07-22 1987-07-16 可変インピ−ダンス駆動回路 Granted JPS6331311A (ja)

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US06/887,314 US4707620A (en) 1986-07-22 1986-07-22 Adjustable impedance driver network
US887314 1992-05-22

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JPS6331311A true JPS6331311A (ja) 1988-02-10
JPH0573290B2 JPH0573290B2 (ja) 1993-10-14

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DE (1) DE3783963T2 (ja)

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