JPS63257258A - 低抵抗付回路基板およびその製造法 - Google Patents
低抵抗付回路基板およびその製造法Info
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- JPS63257258A JPS63257258A JP62090883A JP9088387A JPS63257258A JP S63257258 A JPS63257258 A JP S63257258A JP 62090883 A JP62090883 A JP 62090883A JP 9088387 A JP9088387 A JP 9088387A JP S63257258 A JPS63257258 A JP S63257258A
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Landscapes
- Parts Printed On Printed Circuit Boards (AREA)
- Apparatuses And Processes For Manufacturing Resistors (AREA)
- Non-Adjustable Resistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はオーディオアンプ、VTR電源回路などに用い
られる低抵抗付回路基板およびその製造法に関する。
られる低抵抗付回路基板およびその製造法に関する。
従来、オーディオパワー回路ではトランジスタのエミッ
タ回路で0.2Ω前後の低抵抗で、かつ消費電力の大き
い抵抗が用いられている。また、VTR電源回路におい
て電流検出抵抗としても0.3Ω前後の低抵抗体が用い
られている(文献:風見F!A:アデイテイブ法による
ニッケル抵抗「電子材料」1982年5月号、71−7
4頁)。
タ回路で0.2Ω前後の低抵抗で、かつ消費電力の大き
い抵抗が用いられている。また、VTR電源回路におい
て電流検出抵抗としても0.3Ω前後の低抵抗体が用い
られている(文献:風見F!A:アデイテイブ法による
ニッケル抵抗「電子材料」1982年5月号、71−7
4頁)。
一般にこのような低抵抗を回路基徹上に印刷の手法によ
り形成させることは困難であり、外付は抵抗部品が使用
されていた。これに対し、近年アディティブ法によるニ
ッケル抵抗として低抵抗体を形成する試みがなされてい
る(前記文献参照)。
り形成させることは困難であり、外付は抵抗部品が使用
されていた。これに対し、近年アディティブ法によるニ
ッケル抵抗として低抵抗体を形成する試みがなされてい
る(前記文献参照)。
しかしながら、この方法はメッキによる方法であるので
量産性には優れているが、メッキ条件のわずかの変化に
より得られるニッケル抵抗体の厚さが変り、正確な抵抗
値を得ることが困難である。
量産性には優れているが、メッキ条件のわずかの変化に
より得られるニッケル抵抗体の厚さが変り、正確な抵抗
値を得ることが困難である。
この様なメッキによる方法に対して、回路形成に用いら
れる導体金属箔のエツチングによる抵抗体の形成が出来
れば回路形成時に抵抗が形成でき便利である。ところが
一般に回路に用いられる銅箔は導体として用いられるた
め、電気抵抗の小さいものとして通常厚さが35μmま
たは18μmの銅箔が用いられており、この銅箔厚で抵
抗を形成することは事実上器しい。
れる導体金属箔のエツチングによる抵抗体の形成が出来
れば回路形成時に抵抗が形成でき便利である。ところが
一般に回路に用いられる銅箔は導体として用いられるた
め、電気抵抗の小さいものとして通常厚さが35μmま
たは18μmの銅箔が用いられており、この銅箔厚で抵
抗を形成することは事実上器しい。
従って最も簡単にエツチングにより抵抗を形成するには
、一般に用いられている厚さ65μmまたは18μmの
銅箔をエツチングして回路パターンを形成し、その後、
抵抗としたい回路部位のみを再度エツチングして、銅箔
を薄くし、希望する厚みとすることにまり銅箔抵抗を形
成せざるを得ない。
、一般に用いられている厚さ65μmまたは18μmの
銅箔をエツチングして回路パターンを形成し、その後、
抵抗としたい回路部位のみを再度エツチングして、銅箔
を薄くし、希望する厚みとすることにまり銅箔抵抗を形
成せざるを得ない。
しかしながら、この様な銅箔のエツチングで厚みを薄く
して抵抗を形成する方法では銅箔厚みのコントロールが
難しく、抵抗値にバラツキが大きく、実用化が困難であ
る。
して抵抗を形成する方法では銅箔厚みのコントロールが
難しく、抵抗値にバラツキが大きく、実用化が困難であ
る。
この欠点を解決する方法として複合金属箔を用いる方法
が考え出された。
が考え出された。
たとえば、銅箔にメッキ法によりスズ・ニッケル合金膜
を被着させて複合膜とし、つぎにこの複合膜をスズ・ニ
ッケル合金膜を内側にして絶縁板に張り付け、ついでエ
ツチングにより銅およびスズ・ニッケル合金の不要部分
を取除くことによってスズ・ニッケル合金膜からなる抵
抗付回路基板とする方法が知られている(°特公昭55
−42510号公報)。しかし、このようなスズ・ニッ
ケル合金膜は比較的電気抵抗が大きいので、1Ω未満の
ような低抵抗値を得るにはスズ・ニッケル合金膜抵抗の
幅を広くするか、または厚さを厚くしなければならない
。幅を広くする方法は回路基板のスペース確保上問題が
あり、厚さを厚くする方法はメッキに時間がかかり能土
的でない。さらに、このような銅箔と抵抗体との複合膜
から回路基板上に抵抗を形成する場合、抵抗以外の回路
部はすべて電気抵抗の小さい銅にせざるを得ない。しか
しながら、このような銅の回路を主体とする回路基板で
はトランジスタ・チップ、工Cチップなどの半導体チッ
プを搭載する場合にワイヤーボンディング部に金、銀な
ど高価な貴金属メッキが必要となる欠点があった。
を被着させて複合膜とし、つぎにこの複合膜をスズ・ニ
ッケル合金膜を内側にして絶縁板に張り付け、ついでエ
ツチングにより銅およびスズ・ニッケル合金の不要部分
を取除くことによってスズ・ニッケル合金膜からなる抵
抗付回路基板とする方法が知られている(°特公昭55
−42510号公報)。しかし、このようなスズ・ニッ
ケル合金膜は比較的電気抵抗が大きいので、1Ω未満の
ような低抵抗値を得るにはスズ・ニッケル合金膜抵抗の
幅を広くするか、または厚さを厚くしなければならない
。幅を広くする方法は回路基板のスペース確保上問題が
あり、厚さを厚くする方法はメッキに時間がかかり能土
的でない。さらに、このような銅箔と抵抗体との複合膜
から回路基板上に抵抗を形成する場合、抵抗以外の回路
部はすべて電気抵抗の小さい銅にせざるを得ない。しか
しながら、このような銅の回路を主体とする回路基板で
はトランジスタ・チップ、工Cチップなどの半導体チッ
プを搭載する場合にワイヤーボンディング部に金、銀な
ど高価な貴金属メッキが必要となる欠点があった。
この発明は上記のような欠点がなく、かつ抵抗値が正確
な低抵抗付回路基板を提供することを目的とする。
な低抵抗付回路基板を提供することを目的とする。
本発明者ら戸先にアルミニウム箔と銅箔とから成る複合
箔を用い、エツチングによりアルミニウムと銅の両方の
金属が露出した回路基板を作成し、この回路基板に半導
体チップを配置して、この半導体チップと該アルミニウ
ム回路をアルミニウム線で接続する混成集積回路の製法
を提案した(特開昭58−48432号公報)。本発明
はこの混成集積回路の製法を更に発展させて、低抵抗付
回路基板としたものである。
箔を用い、エツチングによりアルミニウムと銅の両方の
金属が露出した回路基板を作成し、この回路基板に半導
体チップを配置して、この半導体チップと該アルミニウ
ム回路をアルミニウム線で接続する混成集積回路の製法
を提案した(特開昭58−48432号公報)。本発明
はこの混成集積回路の製法を更に発展させて、低抵抗付
回路基板としたものである。
本発明者らはこのアルミニウム箔と銅箔のそれぞれの箔
の厚みが異なった種々の複合箔が容易に入手可能である
ことに着目し、種々検討の結果、本発明を完成させるに
到った。
の厚みが異なった種々の複合箔が容易に入手可能である
ことに着目し、種々検討の結果、本発明を完成させるに
到った。
すなわち、本発明の第1は絶縁体上に銅箔からなる抵抗
体を設け、該抵抗体の少なくとも一端にアルミニウム箔
片を積層させて端子とした低抵抗付回路基板である。
体を設け、該抵抗体の少なくとも一端にアルミニウム箔
片を積層させて端子とした低抵抗付回路基板である。
また、本発明の第2は絶縁体上にアルミニウム箔と銅箔
との複合箔をアルミニウム箔を表側にして張り付け、 ついで前記アルミニウム箔と銅箔とをエツチングするこ
とにより、前記抵抗体を形成させるとともに、その少な
くとも一端にアルミニウムの積層箔を残存させて端子と
することを特徴とする低抵抗付回路基板の製造法である
。
との複合箔をアルミニウム箔を表側にして張り付け、 ついで前記アルミニウム箔と銅箔とをエツチングするこ
とにより、前記抵抗体を形成させるとともに、その少な
くとも一端にアルミニウムの積層箔を残存させて端子と
することを特徴とする低抵抗付回路基板の製造法である
。
以下、本発明について詳しく説明する。本発明において
絶縁体とはベークライト、エポキシ樹脂、ポリイミダ樹
脂、ポリエステル樹脂などの合成樹脂に必要に応じて、
シリカ、アルミナなどの無機光てん剤(繊維または粉末
)を配合したものである。
絶縁体とはベークライト、エポキシ樹脂、ポリイミダ樹
脂、ポリエステル樹脂などの合成樹脂に必要に応じて、
シリカ、アルミナなどの無機光てん剤(繊維または粉末
)を配合したものである。
アルミニウム箔と銅箔との複合箔におけるアルミニウム
箔の厚さは10〜80μmの厚さが好ましい。銅の厚さ
は得られる抵抗体の抵抗値にもよるが一般には3〜15
μmが好ましい。このような複合箔はアルミニウム箔の
片面にメッキにより銅を被着させることにより得られる
。アルミニウムに銅を直接メッキすることが困難なとき
には、アルミニウムと銅との間に亜鉛等の第6の金属を
介在させてもよい。
箔の厚さは10〜80μmの厚さが好ましい。銅の厚さ
は得られる抵抗体の抵抗値にもよるが一般には3〜15
μmが好ましい。このような複合箔はアルミニウム箔の
片面にメッキにより銅を被着させることにより得られる
。アルミニウムに銅を直接メッキすることが困難なとき
には、アルミニウムと銅との間に亜鉛等の第6の金属を
介在させてもよい。
銅の表面は絶縁体との接着性を向上させるため多少、粗
面にすることが好ましい。銅の厚さが比較的厚い場合に
はアルミニウムと銅を圧延により張り合わせたクラツド
箔を用いることもできる。
面にすることが好ましい。銅の厚さが比較的厚い場合に
はアルミニウムと銅を圧延により張り合わせたクラツド
箔を用いることもできる。
複合箔を絶縁体に張り付けるには、絶縁体、たとえばエ
ビキシ樹脂を含浸させたガラス繊維のプリン0レグ(半
硬化状態体のもの)上に複合箔を置き、加熱・加圧する
方法や、絶縁体がポリエステル、ポリイミドなどの樹脂
の様にブチラール樹脂などの耐熱性の接着剤を用いて接
着する方法がある。
ビキシ樹脂を含浸させたガラス繊維のプリン0レグ(半
硬化状態体のもの)上に複合箔を置き、加熱・加圧する
方法や、絶縁体がポリエステル、ポリイミドなどの樹脂
の様にブチラール樹脂などの耐熱性の接着剤を用いて接
着する方法がある。
アルミニウムと銅とのエツチングには3通りの方法が可
能である。第1の方法はまず、アルミニウムのみをエツ
チングさせるエツチング剤により、′アルミニウムの不
要部分を取除き、つぎに銅をエツチングさせるエツチン
グ剤により銅の不要部分を取除く方法である。第2の方
法はまず、アルミニウムと銅をエツチングさせるエツチ
ング剤により、アルミニウムと銅の両方とも不要な部分
を取除き、つぎにアルミニウムのみエツチングさせるエ
ツチング剤によりアルミニウムの不要部分を取除く方法
である。第6の方法はまず、アルミニウムのみをエツチ
ングするエツチング剤により、最終フルミニラムパター
ンと最終銅パターンに相当する部分以外のアルミニウム
を取除く。次に銅ノみをエツチングするエツチング剤で
エツチングし、最後に銅パターンに相当する部分のアル
ミニウムをアルミニウムのみをエツチングするエツチン
グ剤により取除く方法である。
能である。第1の方法はまず、アルミニウムのみをエツ
チングさせるエツチング剤により、′アルミニウムの不
要部分を取除き、つぎに銅をエツチングさせるエツチン
グ剤により銅の不要部分を取除く方法である。第2の方
法はまず、アルミニウムと銅をエツチングさせるエツチ
ング剤により、アルミニウムと銅の両方とも不要な部分
を取除き、つぎにアルミニウムのみエツチングさせるエ
ツチング剤によりアルミニウムの不要部分を取除く方法
である。第6の方法はまず、アルミニウムのみをエツチ
ングするエツチング剤により、最終フルミニラムパター
ンと最終銅パターンに相当する部分以外のアルミニウム
を取除く。次に銅ノみをエツチングするエツチング剤で
エツチングし、最後に銅パターンに相当する部分のアル
ミニウムをアルミニウムのみをエツチングするエツチン
グ剤により取除く方法である。
上記6通りの方法のいずれを採用するかはパターンの配
置、形状および必要なパターンの精度によって決めれば
よい。
置、形状および必要なパターンの精度によって決めれば
よい。
この様に本発明による低抵抗体は回路パターンを形成す
る際に同時に形成されるので余分な工程を必要としない
。また、本発明の回路基板上の抵抗体はその少なくとも
一端にアルミニウム箔片が積層されて厚くなっているた
め、その部分の電気抵抗は非常に小さくて無視すること
ができ、抵抗体の精度はその端末の影響を受けることが
なく高精度である。
る際に同時に形成されるので余分な工程を必要としない
。また、本発明の回路基板上の抵抗体はその少なくとも
一端にアルミニウム箔片が積層されて厚くなっているた
め、その部分の電気抵抗は非常に小さくて無視すること
ができ、抵抗体の精度はその端末の影響を受けることが
なく高精度である。
さらに、本発明による低抵抗付回路基板においては必要
に応じてワイヤーボンディング用のアルミニウム回路を
形成することも出来、半導体チップを塔載する混成集積
回路用基板として有利である。
に応じてワイヤーボンディング用のアルミニウム回路を
形成することも出来、半導体チップを塔載する混成集積
回路用基板として有利である。
以下、本発明を実施例により具体的に説明する。
実施例1
厚さ0.1mmのエポキシ含浸がラス布入りシリプレグ
を16枚重ねて静置し、更にこの上にアルミニウム(厚
さ40μm)と銅(厚さ10μm)から成る複合金属箔
をアルミ面を上にして配置した後、圧力60 kg/c
TL2、温度170°Cで60分間、積層プレス成形し
、複合金属箔張がラスエポキシ基板を得た。
を16枚重ねて静置し、更にこの上にアルミニウム(厚
さ40μm)と銅(厚さ10μm)から成る複合金属箔
をアルミ面を上にして配置した後、圧力60 kg/c
TL2、温度170°Cで60分間、積層プレス成形し
、複合金属箔張がラスエポキシ基板を得た。
次にこの基板のアルミニウム箔の所望の部位にエツチン
グレジスト(アサヒ化研社製M R−50[1)をスク
リーン印刷法で印刷し、乾燥後、苛性ソーダ10%水溶
液で60°Cで5分間、アルミニウムを選択エツチング
して下層の銅箔を露出させた。
グレジスト(アサヒ化研社製M R−50[1)をスク
リーン印刷法で印刷し、乾燥後、苛性ソーダ10%水溶
液で60°Cで5分間、アルミニウムを選択エツチング
して下層の銅箔を露出させた。
その後、得られた基板をトルエンで洗浄し、エツチング
レジストを剥離した後、更にエツチングレジストを印刷
し、乾燥後、過硫酸アンモニウムの15%水溶液で40
’Cで3分間、銅を選択的にエツチングし、最終的にエ
ツチングレジストをトルエンで剥離し、第1図および第
2図に示すパターンの幅1朋、長さ80 mmの低抵抗
付回路基板にした。
レジストを剥離した後、更にエツチングレジストを印刷
し、乾燥後、過硫酸アンモニウムの15%水溶液で40
’Cで3分間、銅を選択的にエツチングし、最終的にエ
ツチングレジストをトルエンで剥離し、第1図および第
2図に示すパターンの幅1朋、長さ80 mmの低抵抗
付回路基板にした。
同一条件で同一回路基板を10枚製作し、それらの抵抗
値を低抵抗計で測定した結果、測定値はそれぞれ238
.236.244.241.239.237.234.
246.239.241であり、その平均値は239.
5、標準偏差は6.6(単位はすべてmΩ)で高精度で
あった。
値を低抵抗計で測定した結果、測定値はそれぞれ238
.236.244.241.239.237.234.
246.239.241であり、その平均値は239.
5、標準偏差は6.6(単位はすべてmΩ)で高精度で
あった。
実施例2
実施例1と同じ複合金属箔張基板を用いた。まず基板の
アルミニウム箔の所望の部位にエッチングレジストを印
刷し、乾燥後、塩化第2鉄の30%水溶液で45℃で3
分間エツチングして不用部分のアルミニウムと銅の両方
の金属箔を除去した。
アルミニウム箔の所望の部位にエッチングレジストを印
刷し、乾燥後、塩化第2鉄の30%水溶液で45℃で3
分間エツチングして不用部分のアルミニウムと銅の両方
の金属箔を除去した。
その後、得られた基板のエラチンブレジストラ剥離した
後、更にエツチングレジストを所望の部位に印刷し、乾
燥後、苛性ソーダ10%水溶液で60℃で5分間、アル
ミニウムを選択エツチングし、実施例1と同じパターン
の低抵抗付回路基板にした。
後、更にエツチングレジストを所望の部位に印刷し、乾
燥後、苛性ソーダ10%水溶液で60℃で5分間、アル
ミニウムを選択エツチングし、実施例1と同じパターン
の低抵抗付回路基板にした。
同一条件で同−回路基鈑を10枚農作し、それらの抵抗
値を低抵抗計で測定した結果、測定値はそれぞれ、24
2.244.241.249.240.242.246
.246.237.246であり、その平均値は243
.0、標準偏差は6.4(単位はすべてmΩ)で高精度
であった。
値を低抵抗計で測定した結果、測定値はそれぞれ、24
2.244.241.249.240.242.246
.246.237.246であり、その平均値は243
.0、標準偏差は6.4(単位はすべてmΩ)で高精度
であった。
実施例3
厚さ40μmのアルミニウム箔(上層)と厚さ10μm
の銅箔(下層)から成る複合金属箔をフィラー人りエポ
キシ樹脂絶縁層(80μm)を介して厚さ1.5朋のア
ルミニウム板に積層して製造したアルミ・銅複合箔付基
板(電気化学工業株式会社與、商品名: H工TTプレ
ート)を用意した。
の銅箔(下層)から成る複合金属箔をフィラー人りエポ
キシ樹脂絶縁層(80μm)を介して厚さ1.5朋のア
ルミニウム板に積層して製造したアルミ・銅複合箔付基
板(電気化学工業株式会社與、商品名: H工TTプレ
ート)を用意した。
マス前記H工TTプレートのベースアルミニウム板の裏
面を粘着剤付ポリ塩化ビニルフィルムをラミネートして
保獲した。
面を粘着剤付ポリ塩化ビニルフィルムをラミネートして
保獲した。
次に基板のアルミニウム箔の所望の部位にエツチングレ
ジスト(アサヒ化研社製MR−500)をスクリーン印
刷し、乾燥後、苛性ソーダ10%水溶液で60°Cで5
分間アルミニウムを選択エツチングして下層の銅箔を露
出した。エツチングレジストをトルエンで剥離し、次に
過硫酸アンモニウムの15%水溶液で40°Cで3分間
、銅を選択的にエツチングした。
ジスト(アサヒ化研社製MR−500)をスクリーン印
刷し、乾燥後、苛性ソーダ10%水溶液で60°Cで5
分間アルミニウムを選択エツチングして下層の銅箔を露
出した。エツチングレジストをトルエンで剥離し、次に
過硫酸アンモニウムの15%水溶液で40°Cで3分間
、銅を選択的にエツチングした。
更にエツチングレジスト(アサヒ化研社製MR−500
)をスクリーン印刷し、乾燥後、苛性ソーダ10%水溶
液で60°Cで5分間、アルミニウムを選択エツチング
して、下層の銅箔を露出させ、最終的にエツチングレジ
ストをトルエンで剥離させ第1図および第2図に示すパ
ターン幅1朋、長さ80mmの低抵抗付回路基板を作製
した。
)をスクリーン印刷し、乾燥後、苛性ソーダ10%水溶
液で60°Cで5分間、アルミニウムを選択エツチング
して、下層の銅箔を露出させ、最終的にエツチングレジ
ストをトルエンで剥離させ第1図および第2図に示すパ
ターン幅1朋、長さ80mmの低抵抗付回路基板を作製
した。
同一条件で同−回路基鈑を10枚作裂し、それらの抵抗
値を低抵抗計で測定した結果、測定値はそれぞれ、26
4.266.241.240.246.269.241
.238.264.242であり、その平均値は238
.8、標準偏差は4.1(単位はすべてmΩ)で高精度
であった。
値を低抵抗計で測定した結果、測定値はそれぞれ、26
4.266.241.240.246.269.241
.238.264.242であり、その平均値は238
.8、標準偏差は4.1(単位はすべてmΩ)で高精度
であった。
本発明の方法によれば低抵抗付回路基板を容易に製造で
きる。本発明の回路基板上の低抵抗体はとくに抵抗値の
精度が高い。
きる。本発明の回路基板上の低抵抗体はとくに抵抗値の
精度が高い。
第1図および第2図は本発明の実施例の低抵抗付回路基
板であり、第1図はその平面図、第2図は断面図である
。 符号1・・・ガラス・エポキシ基板、2・・・銅箔、3
A。 3B・・・アルミニウム箔 特許出願人 電気化学工業株式会社 第1図 第2図
板であり、第1図はその平面図、第2図は断面図である
。 符号1・・・ガラス・エポキシ基板、2・・・銅箔、3
A。 3B・・・アルミニウム箔 特許出願人 電気化学工業株式会社 第1図 第2図
Claims (1)
- 【特許請求の範囲】 1)絶縁体上に銅箔からなる抵抗体を設け、該抵抗体の
少なくとも一端にアルミニウム箔片を積層させて端子と
した低抵抗付回路基板。 2)絶縁体上にアルミニウム箔と銅箔との複合箔をアル
ミニウム箔を表側にして張り付け、 ついで前記アルミニウム箔と銅箔とをエッチングするこ
とにより、前記抵抗体を形成させるとともに、その少な
くとも一端にアルミニウムの積層箔を残存させて端子と
することを特徴とする低抵抗付回路基板の製造法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62090883A JP2634592B2 (ja) | 1987-04-15 | 1987-04-15 | 低抵抗付回路基板およびその製造法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62090883A JP2634592B2 (ja) | 1987-04-15 | 1987-04-15 | 低抵抗付回路基板およびその製造法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63257258A true JPS63257258A (ja) | 1988-10-25 |
JP2634592B2 JP2634592B2 (ja) | 1997-07-30 |
Family
ID=14010837
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62090883A Expired - Lifetime JP2634592B2 (ja) | 1987-04-15 | 1987-04-15 | 低抵抗付回路基板およびその製造法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2634592B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03180094A (ja) * | 1989-12-08 | 1991-08-06 | Hitachi Chem Co Ltd | 抵抗層付き金属ベース積層板の製造方法 |
JP2018137477A (ja) * | 2018-04-27 | 2018-08-30 | ローム株式会社 | チップ抵抗器、チップ抵抗器の実装構造 |
JP2021044585A (ja) * | 2020-12-10 | 2021-03-18 | ローム株式会社 | チップ抵抗器 |
-
1987
- 1987-04-15 JP JP62090883A patent/JP2634592B2/ja not_active Expired - Lifetime
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03180094A (ja) * | 1989-12-08 | 1991-08-06 | Hitachi Chem Co Ltd | 抵抗層付き金属ベース積層板の製造方法 |
JP2018137477A (ja) * | 2018-04-27 | 2018-08-30 | ローム株式会社 | チップ抵抗器、チップ抵抗器の実装構造 |
JP2021044585A (ja) * | 2020-12-10 | 2021-03-18 | ローム株式会社 | チップ抵抗器 |
JP2022160609A (ja) * | 2020-12-10 | 2022-10-19 | ローム株式会社 | チップ抵抗器 |
JP2022166308A (ja) * | 2020-12-10 | 2022-11-01 | ローム株式会社 | チップ抵抗器 |
Also Published As
Publication number | Publication date |
---|---|
JP2634592B2 (ja) | 1997-07-30 |
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