JPS63114423A - デ−タ復調方法 - Google Patents
デ−タ復調方法Info
- Publication number
- JPS63114423A JPS63114423A JP61260493A JP26049386A JPS63114423A JP S63114423 A JPS63114423 A JP S63114423A JP 61260493 A JP61260493 A JP 61260493A JP 26049386 A JP26049386 A JP 26049386A JP S63114423 A JPS63114423 A JP S63114423A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- state
- bit cell
- circuit
- digital
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000000034 method Methods 0.000 title claims description 15
- 230000003111 delayed effect Effects 0.000 claims description 4
- 230000001934 delay Effects 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 6
- 230000000694 effects Effects 0.000 description 1
- 230000005415 magnetization Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/14—Digital recording or reproducing using self-clocking codes
- G11B20/1403—Digital recording or reproducing using self-clocking codes characterised by the use of two levels
- G11B20/1407—Digital recording or reproducing using self-clocking codes characterised by the use of two levels code representation depending on a single bit, i.e. where a one is always represented by a first code symbol while a zero is always represented by a second code symbol
- G11B20/1419—Digital recording or reproducing using self-clocking codes characterised by the use of two levels code representation depending on a single bit, i.e. where a one is always represented by a first code symbol while a zero is always represented by a second code symbol to or from biphase level coding, i.e. to or from codes where a one is coded as a transition from a high to a low level during the middle of a bit cell and a zero is encoded as a transition from a low to a high level during the middle of a bit cell or vice versa, e.g. split phase code, Manchester code conversion to or from biphase space or mark coding, i.e. to or from codes where there is a transition at the beginning of every bit cell and a one has no second transition and a zero has a second transition one half of a bit period later or vice versa, e.g. double frequency code, FM code
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、デジタル磁気記録再生におけるデータ復調方
法に関する。
法に関する。
(従来の技術)
高密度化、高速転送が可能といった磁気テープの長所を
生かして、磁気テープによるデジタル記録再生装置が磁
気ディスクのバックアップ、データ保存等の用途に使わ
れている。
生かして、磁気テープによるデジタル記録再生装置が磁
気ディスクのバックアップ、データ保存等の用途に使わ
れている。
そしてデジタル磁気記録再生の一方法として、ビットセ
ル周期の時間間隔での” H” llL++信号の状態
反転によって論理変数″1″l 、 71 Q 11の
一方を、またこのビットセル周期の1/2の時間間隔で
の前記状態反転によってその他方の論理変数をそれぞれ
表わすデジタル信号を磁気媒体上に記録し、その再生に
おいてはデジタル値の上記−方の再生(it号を利用し
てデータ復調を行なうことが提案されており、例えば特
開昭58−494118号公報が参照されるものである
。
ル周期の時間間隔での” H” llL++信号の状態
反転によって論理変数″1″l 、 71 Q 11の
一方を、またこのビットセル周期の1/2の時間間隔で
の前記状態反転によってその他方の論理変数をそれぞれ
表わすデジタル信号を磁気媒体上に記録し、その再生に
おいてはデジタル値の上記−方の再生(it号を利用し
てデータ復調を行なうことが提案されており、例えば特
開昭58−494118号公報が参照されるものである
。
本発明はかかるデジタル記録再生におけるデータ復調の
一方法を提供するものである。
一方法を提供するものである。
(本発明方法)
ビットセル周期の時間間隔でのII Hll 、 IT
L”信号の状態反転によって論理変数$111I 、
II Qy+の一方を、またこのビットセル周期の1/
2の時間間隔での前記状態反転によってその他方の論理
変数をそれぞれ表わすように磁気媒体上に記録されたデ
ジタル信号を再生して復調するデータ復調方法であり。
L”信号の状態反転によって論理変数$111I 、
II Qy+の一方を、またこのビットセル周期の1/
2の時間間隔での前記状態反転によってその他方の論理
変数をそれぞれ表わすように磁気媒体上に記録されたデ
ジタル信号を再生して復調するデータ復調方法であり。
前記論理変数の前記一方に対応する状態反転にのみ応答
してPI H”、”L”の信号状態が変わる再生信号を
得、この再生信号とこの再生信号を1ビットセル周期の
時間間隔遅延した遅延信号との排他的論理和をとること
により前記デジタル信号のNRZ信号を形成するデータ
復調方法。
してPI H”、”L”の信号状態が変わる再生信号を
得、この再生信号とこの再生信号を1ビットセル周期の
時間間隔遅延した遅延信号との排他的論理和をとること
により前記デジタル信号のNRZ信号を形成するデータ
復調方法。
(実施例)
第1図、第2図は本発明データ復調方法の一実施例のブ
ロック図、及び回路図を、また第3図はその説明に供す
る波形図をそれぞれ示す。
ロック図、及び回路図を、また第3図はその説明に供す
る波形図をそれぞれ示す。
第3図すに示す信号は入力端子1に入力されるデジタル
記録信号S1で、同図aに示すデジタルデータ”101
100011・・・”の論理変数”1”のときはビット
セル周期Tの時間間隔でIt HIT 、 IFL I
Iの各状態が反転する周波数成分子の信号とされ、論理
変数20”のときはビットセル周期の1/2の時間間隔
で各状態が反転する周波数成分2fの信号とされる。
記録信号S1で、同図aに示すデジタルデータ”101
100011・・・”の論理変数”1”のときはビット
セル周期Tの時間間隔でIt HIT 、 IFL I
Iの各状態が反転する周波数成分子の信号とされ、論理
変数20”のときはビットセル周期の1/2の時間間隔
で各状態が反転する周波数成分2fの信号とされる。
この記録信号S1は、記録アンプ2により磁気テープ4
での磁化状態が最適になる所要のレベルに増幅された後
、記録ヘッド3に供給されて磁気テープ4上に記録され
るものである。
での磁化状態が最適になる所要のレベルに増幅された後
、記録ヘッド3に供給されて磁気テープ4上に記録され
るものである。
この磁気テープを介して再生ヘッド5により再生される
前記デジタルデータの再生信号は記録信号S1の略微分
波形となる。従って、この再生信号は、積分器6.及び
周波数fに対して周波数2fの信号成分を所望レベル減
衰するローパスフィルタ7を通過することにより、第3
図Cに示す再生処理信号S2となって復調回路旦の入力
端子81に入力される。そしてこの復調回路の出力端子
82から出力される復調された前記デジタルデータが出
力端子14からとり出される。
前記デジタルデータの再生信号は記録信号S1の略微分
波形となる。従って、この再生信号は、積分器6.及び
周波数fに対して周波数2fの信号成分を所望レベル減
衰するローパスフィルタ7を通過することにより、第3
図Cに示す再生処理信号S2となって復調回路旦の入力
端子81に入力される。そしてこの復調回路の出力端子
82から出力される復調された前記デジタルデータが出
力端子14からとり出される。
第2図はこの復調回路旦の構成を示したもので、その入
力端子8□に入力された再生処理信号S2は比較器9に
より、その振幅の中央レベルに予め設定された基準レベ
ル信号S8と比較されてゼロクロスが検出され、論理変
数”1”に基づく反転にのみ応答して”H” II L
”の各状態が変わる処理信号S3(第3図d)が形成さ
れる。
力端子8□に入力された再生処理信号S2は比較器9に
より、その振幅の中央レベルに予め設定された基準レベ
ル信号S8と比較されてゼロクロスが検出され、論理変
数”1”に基づく反転にのみ応答して”H” II L
”の各状態が変わる処理信号S3(第3図d)が形成さ
れる。
この処理信号S3は、遅延回路10.EX−OR回路1
1の一方の入力端子、クロック発生回路12にそれぞれ
供給される。遅延回路10は処理信号S3をビットセル
周期Tだけ遅延し、この遅延信号S4(第3図e)をE
X−OR回路11の他方の入力端子に与える。
1の一方の入力端子、クロック発生回路12にそれぞれ
供給される。遅延回路10は処理信号S3をビットセル
周期Tだけ遅延し、この遅延信号S4(第3図e)をE
X−OR回路11の他方の入力端子に与える。
クロック発生回路12は、処理信号S3が入力され、こ
れと位相同期した第3図gに示す周期T、周波数2fの
データ読み取りクロック信号S6をデジタルデータ判別
回路13のクロック入力端子13□に出力する。
れと位相同期した第3図gに示す周期T、周波数2fの
データ読み取りクロック信号S6をデジタルデータ判別
回路13のクロック入力端子13□に出力する。
このデジタルデータ判別回路のNRZ信号入力端子13
□はEX−OR:回路11の出力端子に。
□はEX−OR:回路11の出力端子に。
またそのデータ出力端子13.は復調回路差の出力端子
8.にそれぞれ接続されている。
8.にそれぞれ接続されている。
以上の構成の復調回路旦において、EX−OR回路11
は処理信号S3と遅延信号S4との排他的論理和から、
第3図fに示すように、′H”、”L”の各状態からな
る前記デジタルデータ”101100011・・・”の
NRZ信号S5を形成出力する。そしてデジタルデータ
判別回路13はこのNRZ信号とクロック信号S6が入
力され、このクロック信号の立下り時におけるNRZ信
号の状態をチェックして”H”状態の場合は論理変数”
1”に、またPI L”状態の場合は論理変数1107
1にそれぞれ対応する前記デジタルデータの復調信号S
7を逐次出力する。
は処理信号S3と遅延信号S4との排他的論理和から、
第3図fに示すように、′H”、”L”の各状態からな
る前記デジタルデータ”101100011・・・”の
NRZ信号S5を形成出力する。そしてデジタルデータ
判別回路13はこのNRZ信号とクロック信号S6が入
力され、このクロック信号の立下り時におけるNRZ信
号の状態をチェックして”H”状態の場合は論理変数”
1”に、またPI L”状態の場合は論理変数1107
1にそれぞれ対応する前記デジタルデータの復調信号S
7を逐次出力する。
なお1本発明は上述の実施例に限定されるものではなく
、例えばデジタル記録信号が、論理変数”0”のときは
ビットセル周期Tの時間間隔で”H”jlll#の各状
態が反転する周波数成分子の信号とされ、論理変数11
111のときはビットセル間隔の172の時間間隔で各
状態が反転する周波数成分2fの信号とされように構成
した場合も同様に適用でき、その他種々の態様がとりえ
ることは勿論である。
、例えばデジタル記録信号が、論理変数”0”のときは
ビットセル周期Tの時間間隔で”H”jlll#の各状
態が反転する周波数成分子の信号とされ、論理変数11
111のときはビットセル間隔の172の時間間隔で各
状態が反転する周波数成分2fの信号とされように構成
した場合も同様に適用でき、その他種々の態様がとりえ
ることは勿論である。
(発明の効果)
ビットセル周期の時間間隔での′″H71,1lLl+
H71,1lLl+信号理変数″1″′、″′0′″の
一方を、また該ビットセル周期の1/2の時間間隔での
状態反転によってその他方をそれぞれ表わすデジタル信
号を磁気媒体上に記録し、その再生においては論理変数
の上記一方に対応して検出される再生信号を利用してデ
ータ復調を行なうデジタル磁気記録再生におけるデータ
復調の一方法を簡単に実現できるものである。
H71,1lLl+信号理変数″1″′、″′0′″の
一方を、また該ビットセル周期の1/2の時間間隔での
状態反転によってその他方をそれぞれ表わすデジタル信
号を磁気媒体上に記録し、その再生においては論理変数
の上記一方に対応して検出される再生信号を利用してデ
ータ復調を行なうデジタル磁気記録再生におけるデータ
復調の一方法を簡単に実現できるものである。
第1図、第2図は本発明データ復調方法の一実施例のブ
ロック図、及び回路図を、また第3図はその説明に供す
る波形図をそれぞれ示す。 2・・・記録アンプ、3・・・記録ヘッド、4・・・磁
気テープ、5・・・再生ヘッド、6・・・積分器、7・
・・ローパスフィルタ、旦・・・復調回路、9・・・比
較器、10・・・遅延回路、11・・・EX−〇R回路
、12・・・クロック発生回路、13・・・デジタルデ
ータ判別回路。
ロック図、及び回路図を、また第3図はその説明に供す
る波形図をそれぞれ示す。 2・・・記録アンプ、3・・・記録ヘッド、4・・・磁
気テープ、5・・・再生ヘッド、6・・・積分器、7・
・・ローパスフィルタ、旦・・・復調回路、9・・・比
較器、10・・・遅延回路、11・・・EX−〇R回路
、12・・・クロック発生回路、13・・・デジタルデ
ータ判別回路。
Claims (1)
- ビットセル周期の時間間隔での”H”、”L”信号の状
態反転によって論理変数”1”、”0”の一方を、また
該ビットセル周期の1/2の時間間隔での前記状態反転
によってその他方の論理変数をそれぞれ表わすように磁
気媒体上に記録されたデジタル信号を復調するデータ復
調方法であり、前記論理変数の前記一方に対応する状態
反転にのみ応答して”H”、”L”の信号状態が変わる
再生信号を得、該再生信号とこの再生信号を1ビットセ
ル周期の時間間隔遅延した遅延信号との排他的論理和を
とることにより前記デジタル信号のNRZ信号を形成す
ることを特徴とするデータ復調方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61260493A JPS63114423A (ja) | 1986-10-31 | 1986-10-31 | デ−タ復調方法 |
US07/114,777 US4876615A (en) | 1986-10-31 | 1987-10-30 | Data decoding system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61260493A JPS63114423A (ja) | 1986-10-31 | 1986-10-31 | デ−タ復調方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63114423A true JPS63114423A (ja) | 1988-05-19 |
Family
ID=17348729
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61260493A Pending JPS63114423A (ja) | 1986-10-31 | 1986-10-31 | デ−タ復調方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4876615A (ja) |
JP (1) | JPS63114423A (ja) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5113187A (en) * | 1991-03-25 | 1992-05-12 | Nec America, Inc. | CMI encoder circuit |
JPH07503353A (ja) * | 1992-11-18 | 1995-04-06 | ゼネラル・エレクトリック・カンパニイ | 無接触スリップリング信号結合器 |
US6072340A (en) * | 1997-03-24 | 2000-06-06 | Tellabs Operations, Inc. | Pulse shaping and filtering circuit for digital pulse data transmissions |
US9094077B2 (en) * | 2013-04-02 | 2015-07-28 | Samsung Display Co., Ltd. | Slope detecting receiver |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57124954A (en) * | 1981-01-26 | 1982-08-04 | Victor Co Of Japan Ltd | Data playback circuit |
JPS60217734A (ja) * | 1984-01-24 | 1985-10-31 | ハネウエル・インコ−ポレ−テツド | マンチエスタデコ−ダ |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4012786A (en) * | 1976-02-05 | 1977-03-15 | Trw Inc. | Magnetic data decoder |
US4260952A (en) * | 1979-07-17 | 1981-04-07 | Teletype Corporation | Circuit for decoding a diphase signal |
US4267595A (en) * | 1980-02-04 | 1981-05-12 | International Telephone And Telegraph Corporation | AMI Decoder apparatus |
US4462051A (en) * | 1982-04-02 | 1984-07-24 | Ampex Corporation | Demodulator for an asynchronous binary signal |
US4503472A (en) * | 1983-09-01 | 1985-03-05 | Burroughs Corp. | Bipolar time modulated encoder/decoder system |
-
1986
- 1986-10-31 JP JP61260493A patent/JPS63114423A/ja active Pending
-
1987
- 1987-10-30 US US07/114,777 patent/US4876615A/en not_active Expired - Fee Related
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57124954A (en) * | 1981-01-26 | 1982-08-04 | Victor Co Of Japan Ltd | Data playback circuit |
JPS60217734A (ja) * | 1984-01-24 | 1985-10-31 | ハネウエル・インコ−ポレ−テツド | マンチエスタデコ−ダ |
Also Published As
Publication number | Publication date |
---|---|
US4876615A (en) | 1989-10-24 |
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