JPS6249461A - 通信方式 - Google Patents
通信方式Info
- Publication number
- JPS6249461A JPS6249461A JP60187241A JP18724185A JPS6249461A JP S6249461 A JPS6249461 A JP S6249461A JP 60187241 A JP60187241 A JP 60187241A JP 18724185 A JP18724185 A JP 18724185A JP S6249461 A JPS6249461 A JP S6249461A
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- JP
- Japan
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- transmission
- cpu
- pattern
- data
- text
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- Pending
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- Small-Scale Networks (AREA)
- Information Transfer Systems (AREA)
- Computer And Data Communications (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は制御装置（ＣＰＵ相当のもの：以降ＣＰＵと略
す）に命令制御される通信装置の通信方式に係り通信に
よるＣＰＵ負荷を軽減し、通信速度を早める通信方式に
関する。
す）に命令制御される通信装置の通信方式に係り通信に
よるＣＰＵ負荷を軽減し、通信速度を早める通信方式に
関する。
従来、日立製作新製ＨＩＤＩＣＶ９０１５０ ＨＣ−３
３１２形通信制御装置（μ、ｃＱｃ−ｓ）のハードマニ
ュアル等によれば、送信処理で通常送信要求が起こると
ＣＰＵはメインメモリ上の送信アドレスと送信データ語
数とを設定し送信命令を通信装置に出す。次に通信装置
は該命令を受は取り送信命令であることを解析し、送信
するデータをメインメモリよりＤＭＡ転送にて受は取り
受は取った送信データを接続相手と約束された送信テキ
ストの形態に整え送信する。この方式だと送信データを
ＤＭＡにて転送中ＣＰＵ負荷が重くなる事や、送信デー
タを送信テキストの形態に整える処理があり、結果処理
が遅れるという難点があった。ところが、送信データす
なわち接続相手へ送りたいデータは、通信装置の知ると
ころではなく、すべてＣＰＵ上のプログラムに依存して
いる為、メインメモリから通信装置へのデータ転送や、
送信データを送信テキストの形態に整える処理は必要不
可欠のものとされていた。
３１２形通信制御装置（μ、ｃＱｃ−ｓ）のハードマニ
ュアル等によれば、送信処理で通常送信要求が起こると
ＣＰＵはメインメモリ上の送信アドレスと送信データ語
数とを設定し送信命令を通信装置に出す。次に通信装置
は該命令を受は取り送信命令であることを解析し、送信
するデータをメインメモリよりＤＭＡ転送にて受は取り
受は取った送信データを接続相手と約束された送信テキ
ストの形態に整え送信する。この方式だと送信データを
ＤＭＡにて転送中ＣＰＵ負荷が重くなる事や、送信デー
タを送信テキストの形態に整える処理があり、結果処理
が遅れるという難点があった。ところが、送信データす
なわち接続相手へ送りたいデータは、通信装置の知ると
ころではなく、すべてＣＰＵ上のプログラムに依存して
いる為、メインメモリから通信装置へのデータ転送や、
送信データを送信テキストの形態に整える処理は必要不
可欠のものとされていた。
しかるに実際の通信システムを調査すると固定的なデー
タを送る場合が多い。たとえば、接続相手局から、定期
的な異常はないかの問い合わせに対し、″異常なし″を
送信する場合等々である。
タを送る場合が多い。たとえば、接続相手局から、定期
的な異常はないかの問い合わせに対し、″異常なし″を
送信する場合等々である。
このような頻発する固定データ送信に対し、ＣＰＵ負荷
を少なくし、送信ができないかという事に着目した。
を少なくし、送信ができないかという事に着目した。
本発明の目的は、通信を行う際ＣＰＵの負荷を軽減し、
かつ送信データを送信テキスト形態へ整える処理オーバ
ヘッドをなくし、結果として低負荷、高速通信方式を提
供することにある。
かつ送信データを送信テキスト形態へ整える処理オーバ
ヘッドをなくし、結果として低負荷、高速通信方式を提
供することにある。
本発明は、ＣＰＵ負荷を軽減し、送信データを送信テキ
スト形態へ整えるオーバヘッドをなくす為、通信システ
ムにおいて、固定的なデータを送信する場合が多いこと
に着目し、該固定送信データをあらかじめ通信装置内部
の記憶機構に送信テキスト形態にして記憶させＣＰＵよ
りは命令のみで、接続相手へ送信することによりその目
的を達成することにある。
スト形態へ整えるオーバヘッドをなくす為、通信システ
ムにおいて、固定的なデータを送信する場合が多いこと
に着目し、該固定送信データをあらかじめ通信装置内部
の記憶機構に送信テキスト形態にして記憶させＣＰＵよ
りは命令のみで、接続相手へ送信することによりその目
的を達成することにある。
本発明の実施例を第１図〜第１０図に従い説明する。
まず、本発明を採用した全体構成を第１０図に示し、通
信手順の例を第３図に示す。
信手順の例を第３図に示す。
第１０図は、全体構成であり、ホスト一端末のシステム
における端末（属局）システムにおける通信装置に本発
明を採用した。
における端末（属局）システムにおける通信装置に本発
明を採用した。
第３図により、制御装置であるＣＰＵとＣＰＵより制御
される通信装置の端末よりみた送信系、受信系の概略動
作を説明する。
される通信装置の端末よりみた送信系、受信系の概略動
作を説明する。
回線手順は′、ポーリング（以降ＰＯＬと略す）／セレ
クション（以降ＳＥＬと略す）手順ＪＩＳ−０６３６２
）を採用しており、端末はその属局側に設定した。
クション（以降ＳＥＬと略す）手順ＪＩＳ−０６３６２
）を採用しており、端末はその属局側に設定した。
送信系では、接続相手（主局）より端末送信起動である
ＰＯＬが送られて来ると、通信装置はＣＰＵに知らせ、
ＣＰＵよりの送信命令を持ち該送信命令が来るとそれに
従い送信を行う。次に接続相手（主局）よりのアクノウ
リッジ（以降ＡＣＫと略す）応答があると、同様にＣＰ
Ｕに報告し、ＣＰＵよりの送信終了命令によりエンドオ
プトランスミッション（以降ＥＯＴと略す）を送信し一
連の送信処理を終る。受信系も同様である。
ＰＯＬが送られて来ると、通信装置はＣＰＵに知らせ、
ＣＰＵよりの送信命令を持ち該送信命令が来るとそれに
従い送信を行う。次に接続相手（主局）よりのアクノウ
リッジ（以降ＡＣＫと略す）応答があると、同様にＣＰ
Ｕに報告し、ＣＰＵよりの送信終了命令によりエンドオ
プトランスミッション（以降ＥＯＴと略す）を送信し一
連の送信処理を終る。受信系も同様である。
次に、本発明の実施例を具体的に説明する。第１図より
、以下説明してゆく。
、以下説明してゆく。
従来の送信処理ではメインメモリ上の送信アドレスと送
信データ語数を送信処理という命令コードをあらかじめ
ＣＰＵＩと通信装置２１との間で決められたメインメモ
リ上の連絡エリアに設定しＣＰＵより通信装置へ割り込
みを入れる。それを受は通信装置はシステムバスコント
ロール５により、ＣＰＵからの割り込みをマイコン９に
知らせ、マイコンはメインメモリ上の連絡エリアより送
信アドレス、送信データ語数、命令コードをアドレスラ
ッチ８．アドレスジスタフ、データレジスタ６、システ
ムバス、ＭＭＵ （メモリマネジメント・ユニット）を
経由してメインメモリより読み込む。
信データ語数を送信処理という命令コードをあらかじめ
ＣＰＵＩと通信装置２１との間で決められたメインメモ
リ上の連絡エリアに設定しＣＰＵより通信装置へ割り込
みを入れる。それを受は通信装置はシステムバスコント
ロール５により、ＣＰＵからの割り込みをマイコン９に
知らせ、マイコンはメインメモリ上の連絡エリアより送
信アドレス、送信データ語数、命令コードをアドレスラ
ッチ８．アドレスジスタフ、データレジスタ６、システ
ムバス、ＭＭＵ （メモリマネジメント・ユニット）を
経由してメインメモリより読み込む。
マイコンは−たんそれらの連絡情報をローカルメモリ１
７のワークに格納し、ＣＰＵからの命令を解析し解析の
結果送信命令であることを判断するとＣＰＵよりの送信
アドレス、送信データ語数に従いメインメモリ上の該ア
ドレスより該データ語数分データを読み出し、−たんロ
ーカルメモリ内ワークに入れ該データを送信テキストと
なる様ＳＴＸ、ＥＴＸ等の付加処理を行った後、ＤＨＡ
Ｃ（ＤＭＡコントローラ）１６にローカルバスコントロ
ール１５を介して起動をかける。ＤＭＡＣはローカルメ
モリのワーク内の送信テキストをローカルバス１２．１
４を介して通信用ＬＳ１１８に１バイトずつ移動させ、
回線ドライバ２０を介して接続相手へ送る６ 以上の流れを第５図にＣＰＵ上の送受信プログラムとし
てそのフローを示し、第６図中一般の送信処理のところ
に該命令をＣＰＵより受けた後。
７のワークに格納し、ＣＰＵからの命令を解析し解析の
結果送信命令であることを判断するとＣＰＵよりの送信
アドレス、送信データ語数に従いメインメモリ上の該ア
ドレスより該データ語数分データを読み出し、−たんロ
ーカルメモリ内ワークに入れ該データを送信テキストと
なる様ＳＴＸ、ＥＴＸ等の付加処理を行った後、ＤＨＡ
Ｃ（ＤＭＡコントローラ）１６にローカルバスコントロ
ール１５を介して起動をかける。ＤＭＡＣはローカルメ
モリのワーク内の送信テキストをローカルバス１２．１
４を介して通信用ＬＳ１１８に１バイトずつ移動させ、
回線ドライバ２０を介して接続相手へ送る６ 以上の流れを第５図にＣＰＵ上の送受信プログラムとし
てそのフローを示し、第６図中一般の送信処理のところ
に該命令をＣＰＵより受けた後。
通信装置内ファームウェア処理内容をフローにして示す
。
。
以上は、従来どうりの方法である。一方、本発明の方式
すなわち、送信データをあらかじめ送信テキスト形態に
して記憶しておき、送信する方式では、通信装置立上げ
時に、ＣＰＵより固定送信テキストのローカルメモリ書
き込みを初期処理にて行い以降送受信の度毎のメインメ
モリとローカルメモリ間のデータ転送を行わない、（以
降固定送信テキストによる送信は、あるデータパターン
を送る為、パターン送信と略す。）その処理フローを第
４図に示し、第１図の送信パターン格納エリアフォーマ
ットを第２図に示す。
すなわち、送信データをあらかじめ送信テキスト形態に
して記憶しておき、送信する方式では、通信装置立上げ
時に、ＣＰＵより固定送信テキストのローカルメモリ書
き込みを初期処理にて行い以降送受信の度毎のメインメ
モリとローカルメモリ間のデータ転送を行わない、（以
降固定送信テキストによる送信は、あるデータパターン
を送る為、パターン送信と略す。）その処理フローを第
４図に示し、第１図の送信パターン格納エリアフォーマ
ットを第２図に示す。
ユーザは第２図に示す様にスタートオブテキスト（以降
ＳＴＸと略す）やエンドオブテキスト（以降ＥＴＸと略
す）を付けた形でそのまま送信できる送信テキストの形
態で、メインメモリ上に書く。その後第４図に示すよう
なフローでＣＰＵは通信装置の立上げ処理を行う。一方
ＣＰＵからの立上げ起動に対し通信装置は第１図送信パ
ターンエリア２２にマイコンがメインメモリ上より第゛
２図のフォーマットで取り込み格納する。
ＳＴＸと略す）やエンドオブテキスト（以降ＥＴＸと略
す）を付けた形でそのまま送信できる送信テキストの形
態で、メインメモリ上に書く。その後第４図に示すよう
なフローでＣＰＵは通信装置の立上げ処理を行う。一方
ＣＰＵからの立上げ起動に対し通信装置は第１図送信パ
ターンエリア２２にマイコンがメインメモリ上より第゛
２図のフォーマットで取り込み格納する。
ユーザが送信パターン格納エリアに入れられたデータパ
ターンを送信したい時、すなわちパターン送信したいと
きは、ＣＰＵよりパターン送信用命令コードのみを設定
し１通信装置への起動情報設定のところで連絡エリアの
通信装置への命令コード１のみ設定する形である。一方
通信装置はＣＰＵからの送信要求に対し第６図のファー
ムウェアフローで動作する。
ターンを送信したい時、すなわちパターン送信したいと
きは、ＣＰＵよりパターン送信用命令コードのみを設定
し１通信装置への起動情報設定のところで連絡エリアの
通信装置への命令コード１のみ設定する形である。一方
通信装置はＣＰＵからの送信要求に対し第６図のファー
ムウェアフローで動作する。
第６図中通信装置内ファームウェアは命令コード解析に
より、パターン送信だと判断すると送信処理を行う。
より、パターン送信だと判断すると送信処理を行う。
どのパターンを送信するかは命令コードによりテ断する
・１記′リー′送信は次の様に行う・該当パターンを取
り出し第２図の各送信パターン格納エリアの先頭にある
パターンインデックスにより例えばパターン１送信だと
、登録Ｆ（登録フラグ）により登録の有無を判断し、パ
ターン１登録キヤラクタ数２により送信語数を決め送信
処理を行う。しかる後第６図中送信後の通信装置遷移先
モード取り込み該モードへ遷移３により第２図中パター
ン１送信後の通信装置遷移モード３により次の遷移先゛
を決め１通信装置は、該遷移先へ遷移する。
・１記′リー′送信は次の様に行う・該当パターンを取
り出し第２図の各送信パターン格納エリアの先頭にある
パターンインデックスにより例えばパターン１送信だと
、登録Ｆ（登録フラグ）により登録の有無を判断し、パ
ターン１登録キヤラクタ数２により送信語数を決め送信
処理を行う。しかる後第６図中送信後の通信装置遷移先
モード取り込み該モードへ遷移３により第２図中パター
ン１送信後の通信装置遷移モード３により次の遷移先゛
を決め１通信装置は、該遷移先へ遷移する。
第８図にモード遷移図を示す。送信処理では、通常送信
装置遷移先モードにより、第８図中回線応答待（送信系
）に移る。
装置遷移先モードにより、第８図中回線応答待（送信系
）に移る。
従来送信と本発明のパターン送信を比較する為そのタイ
ムチャートを第７図に示す。
ムチャートを第７図に示す。
従来処理では、ファームウェアが命令解析処理の後、デ
ータを受は取り処理にてメインメモリ上のデータをロー
カルメモリ中ワークに移す作業と送信データを送信テキ
スト形態に整えるテキスト調整処理のオーバヘッドがあ
り、しかもメインメモリ上のデータを通信装置が取り込
む際システムバスを使用する為ＣＰＵの負荷を伴う。
ータを受は取り処理にてメインメモリ上のデータをロー
カルメモリ中ワークに移す作業と送信データを送信テキ
スト形態に整えるテキスト調整処理のオーバヘッドがあ
り、しかもメインメモリ上のデータを通信装置が取り込
む際システムバスを使用する為ＣＰＵの負荷を伴う。
一方、本発明のパターン送信の際は、命令解析後すぐに
テキスト送信を行え従来方式のオーバヘッドとＣＰＵ負
荷は除ける。
テキスト送信を行え従来方式のオーバヘッドとＣＰＵ負
荷は除ける。
なお、付加的にパターン送信の場合送信後の遷移先モー
ドを指定できる為、端末の異常を想定した異常回復試験
が容易に行える。
ドを指定できる為、端末の異常を想定した異常回復試験
が容易に行える。
例えば通常ＡＣＫ送信後は（受信系）回線応答待に行く
が送信後の遷移先モードを強制的に（送信系）回線応答
待に持って行け、接続相手が異常処理を行うか否かの試
験も可能となる。第９図に通信装置の送受信処理中のモ
ード遷移を一覧にして示す。
が送信後の遷移先モードを強制的に（送信系）回線応答
待に持って行け、接続相手が異常処理を行うか否かの試
験も可能となる。第９図に通信装置の送受信処理中のモ
ード遷移を一覧にして示す。
本発明によれば、頻発する短い固定送信データをＣＰＵ
負荷、パス負荷なしに接続相手まで送ることができるの
で送信処理におけるＣＰＵ負荷を軽減し、しかも送信デ
ータを送信テキスト形態に整える処理がなくなる為、速
い送信ができるとい；う効果がある。
負荷、パス負荷なしに接続相手まで送ることができるの
で送信処理におけるＣＰＵ負荷を軽減し、しかも送信デ
ータを送信テキスト形態に整える処理がなくなる為、速
い送信ができるとい；う効果がある。
第１図は本発明の一実施例の内部構成図、第２図はその
ローカルメモリ内送信パターン格納エリアの内容を示す
説明図、第３図は通信のＣＰＵ回線を含む通信装置の動
作概略例を示す説明図、第４図、第５図はＣＰＵプログ
ラムの立上げ及び実使用例を示す説明図、第６図は通信
装置内ファームウェアの動作図、第７図は通常送信とパ
ターン送信の比較を示すタイムチャート、第８図、第９
図は通信装置の内部モード遷移を示す説明図、第１０図
は本発明を採用した全体構成図である。 １・・・ＣＰＵ （中央処理装置）、３・・・ＭＭＵ
（メモリ マネジネント ユニット）、１６・・・ＤＭ
ＡＣ（ＤＭＡ コントローラ）。
ローカルメモリ内送信パターン格納エリアの内容を示す
説明図、第３図は通信のＣＰＵ回線を含む通信装置の動
作概略例を示す説明図、第４図、第５図はＣＰＵプログ
ラムの立上げ及び実使用例を示す説明図、第６図は通信
装置内ファームウェアの動作図、第７図は通常送信とパ
ターン送信の比較を示すタイムチャート、第８図、第９
図は通信装置の内部モード遷移を示す説明図、第１０図
は本発明を採用した全体構成図である。 １・・・ＣＰＵ （中央処理装置）、３・・・ＭＭＵ
（メモリ マネジネント ユニット）、１６・・・ＤＭ
ＡＣ（ＤＭＡ コントローラ）。
Claims (1)
- １、制御装置と結ばれるバスを経由し制御装置より制御
され、該制御を解読する機構を持ちかつデータ記憶機構
をもちさらに回線により接続される相手と通信する、被
制御装置である通信装置に於いて接続相手へ送るデータ
ストリームをそのままデータ記憶する手段をもちＣＰＵ
から該通信装置への起動により該記憶データを接続相手
へ送信する手段をもつことを特徴とする通信方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60187241A JPS6249461A (ja) | 1985-08-28 | 1985-08-28 | 通信方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60187241A JPS6249461A (ja) | 1985-08-28 | 1985-08-28 | 通信方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6249461A true JPS6249461A (ja) | 1987-03-04 |
Family
ID=16202520
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60187241A Pending JPS6249461A (ja) | 1985-08-28 | 1985-08-28 | 通信方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6249461A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04107028A (ja) * | 1990-08-28 | 1992-04-08 | Hitachi Ltd | データ通信用接続装置、データ通信システム及びデータ通信方法 |
-
1985
- 1985-08-28 JP JP60187241A patent/JPS6249461A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04107028A (ja) * | 1990-08-28 | 1992-04-08 | Hitachi Ltd | データ通信用接続装置、データ通信システム及びデータ通信方法 |
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