JPS62169457A - 半導体装置用リ−ドフレ−ム - Google Patents

半導体装置用リ−ドフレ−ム

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JPS62169457A
JPS62169457A JP61010107A JP1010786A JPS62169457A JP S62169457 A JPS62169457 A JP S62169457A JP 61010107 A JP61010107 A JP 61010107A JP 1010786 A JP1010786 A JP 1010786A JP S62169457 A JPS62169457 A JP S62169457A
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JP
Japan
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lead
plating
wire
wire bonding
semiconductor device
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JP61010107A
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Kumiko Okano
岡野 久美子
Ichiro Anjo
安生 一郎
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Hitachi Microcomputer System Ltd
Hitachi Ltd
Original Assignee
Hitachi Ltd
Hitachi Microcomputer Engineering Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置の製造に用いるリードフレームに関
し、特に、コネクタワイヤのボンディング性やリードの
酸化および腐食を防止するなどのために、そのインナー
リードにメッキなどにより金属被膜を形成して成るリー
ドフレームの改良技術に関する。
〔従来の技術〕
半導体装置の製造釦用いられるリードフレームハ1例え
ば、鉄−ニッケル系合金や銅系合金などよりなる薄い金
属板を精密プレスやエツチング加工でバターニングする
ことKよって形成され、半導体ペレットを取り付ける矩
形のタブと、このタブを支持する細いタブリードと、前
記タブの周囲に非接触で先端を臨ます複数のリードとを
有して成る。
かかるリードフレームを用いてなるレジンモールド型の
半導体装置は、リードフレームのタブ上に半導体ペレッ
トを取付け、かかるペレットの電極とタブの周囲に延在
するリード先端とを細い金属線などで構成されたコネク
タワイヤで接続し、かかるワイヤボンディング後に、レ
ジンをモールドする主要工程を経て得ることができる。
リードフレームのレジンでモールドされている部分は。
インナーリード(部)と称され、モールドの外部に引出
された部分はアウターリード(部)と称されている。
かかるリードフレームにあっては、コネクタワイヤのリ
ードとのボンディング性の向上やリードの酸化および腐
食の防止などのために、インナーリードのワイヤボンデ
ィング部にAgメッキなどによる表面処理が施される。
尚リードフレームに関し記載した文献の例としては、工
業調査会発行[電子材料J 1982年8月号第69頁
〜74頁及び同1984年8月号第68〜73頁並びに
特開昭58−35949号公報があげられる。
〔発明が解決しようとする問題点〕
このように、リードフレームのインナーリードのワイヤ
ボンディング部にAgメッキなどが施される場合におい
て当該メッキの際のメッキ流れによってアウターリード
部までメッキされてしまうと、半導体装置のAgマイグ
レーシlンによる耐湿性不良やワイヤ間のシ璽−トなど
を生起することがある。
本発明の目的は、メッキなどが流れ出ししても。
Agマイグレーションやワイヤショートなどの不良を防
止できるリードフレームを提供し、高信頼性の半導体装
置を得ることKある。
本発明の前記ならびにそのほかの目的と新規な特徴は、
本明細書の記述および添付図面からあきらかになるであ
ろう。
〔問題点を解決するための手段〕
本願において開示される発明のうち代表的なものの概要
を簡単に説明すれば、下記のとおりである。
すなわち、インナーリードのワイヤボンディング部の外
側に溝を設けてなるものである。
〔作用〕
上記のごとき溝を設けることにより、メッキが流れ出し
して半導体装置の外側に流れて(・く際に、当該溝(メ
ッキが吸収されるので、Agマイグレーションや当該メ
ッキの耐着によるリードやワイヤのり冒−トが防止され
る。
〔実施例〕
次に1本発明を1図面に示す実施例に基づいて説明する
第1図は本発明によるリードフレー・ムのインナーリー
ド部の要部を示し、インナーリード1のワイヤボンディ
ング部2に隣接して、V字溝3を有する。
このワイヤボンディング面2にはワイヤボンディング性
(接合性)の向上などを目的として、AgメッキやAu
メッキなどの表面処理が施されている。
このワイヤボンディング部2にはこの第1図では図示し
ていないが、コネクタワイヤがボンディングされる。
V字溝3は該ワイヤボンディング部2の外側に適宜の大
きさ、深さで構成される。
リードフレームは上記のごときメッキがワイヤボンディ
ング面のみならず、側壁にも耐着していることがある。
第2図に示す実施例は、かかる対策として、ワイヤボン
ディングされる面のみならず、インナーリード1の側面
側にも溝4を有してなる例を示す。
第3図はリードフレームの全体を示す平面因で。
このリードフレームは多連のリードフレームでそのユニ
ットの一つを示す。
83図にて、5けタブで、このタブ5上には半導体ペレ
ットが1例えばAgペーストなどの接合材料により、固
着される。6はこのタブ5を支持しているタブリード、
7は内枠、8は外枠であり、また、9はダムでモールド
時のレジンの流れ止めなどの目的で設けられており、レ
ジンモールドは。
例えば、第3図点線で示すように、このダム9の内側に
行われる。
タブ5上の半導体ペレットの電極とインナーリード1の
先端のワイヤボンディング部との間がコネクタワイヤに
より電気的に接続される。
第3図にも示−j 、jうに、本発明によるリードフレ
ーム10では、七のインナーリード1に横方向の溝3が
設けられている。
第4図は本発明圧よるリードフレーム10を用いてなる
半導体装置(レジンモールド型半導体装置)の−例を示
す。
第4図にて、11は半導体ペレ7)、12はレジンモー
ルド体、13はコネクタワイヤである。
当該レジンにはエポキシ樹脂などが使用され。
該モールド体はトランスファーモールドなどにより形成
することができ、該モールド体12により半導体ベレッ
ト11は封止されている。本発明のリードフレームはレ
ジンモールド型の他各種の半導体装置に適用できる。
〔発明の効果〕
本発明によれば、ワイヤボンディング部からメッキが流
れてきても、溝に当該メッキが流れ込みする。したがっ
て、Agマイグレーションや各リードおよび各コネクタ
ワイヤ間が当該メッキによりショートすることが防止さ
れ高信頼性の半導体装置を得ることができる。
本発明は特に、多ビンで、リード間の間隙が狭く、コネ
クタワイヤが接触し易い場合に有効であり、半導体装置
の外部側へのメッキの流出が横方向溝により吸収される
し、また、側壁に流れる当該メッキも側面に形成された
溝に吸収されるため、多ビン化に伴ない問題となるリー
ドショートやワイヤショートが防止される。
以上本発明者i7よってなされi−発明を実施例にもと
づき具体的に説明したが1本発明は上記実施例に限定さ
れるものではなく、その要旨を逸脱1〜ない範囲で種々
変更可能であることはいうまでもない。
例えば、前記実施例では7字溝で例示したが、当該溝を
U字溝とするなど同様の目的を達成できるものであれば
、他の形態のものであってもよい。
本発明のリードフレームは各1形態の半導体装置に適用
することができる。
【図面の簡単な説明】
第1図は一実施例のインナーリード部の斜視図。 第2図は、他の実施例のインナーリード部の斜視図。 第3図はリードフし′−ムの平面図、 i4図はレジン封止半導体装置の断面図である。 1・・・インナーリード、2・・・ワイヤボンディング
部、3・・・横方向n(v字溝)、4・・・側面溝、5
・・・タブ、6・・・タブリード、7・・・内枠、8・
・・外枠、9・・・ダム、】0・・・リードフレーム、
11・・・ペレット。 1.2・・・レジンモ・・・ルド体、13・・・コネク
タワイヤ。

Claims (1)

  1. 【特許請求の範囲】 1、インナーリードのワイヤボンディング部の外側に横
    方向溝を設けて成ることを特徴とする半導体装置用リー
    ドフレーム。 2、溝が、コネクタワイヤがボンディングされる側の面
    および側面に設けて成る、特許請求の範囲第1項記載の
    半導体装置用リードフレーム。
JP61010107A 1986-01-22 1986-01-22 半導体装置用リ−ドフレ−ム Pending JPS62169457A (ja)

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Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62202546A (ja) * 1986-02-28 1987-09-07 Shinko Electric Ind Co Ltd リ−ドフレ−ム
JP2010073830A (ja) * 2008-09-17 2010-04-02 Sumitomo Metal Mining Co Ltd リードフレーム及びリードフレームの製造方法
EP2284886A3 (en) * 2009-06-17 2013-02-27 LSI Corporation Lead frame design to improve reliability
JP2014099534A (ja) * 2012-11-15 2014-05-29 Dainippon Printing Co Ltd リードフレームおよびその製造方法、ならびに半導体装置およびその製造方法
JP2014143434A (ja) * 1999-06-30 2014-08-07 Renesas Electronics Corp 半導体装置
JP2015153987A (ja) * 2014-02-18 2015-08-24 株式会社デンソー モールドパッケージ

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4918591U (ja) * 1972-05-19 1974-02-16
JPS4945447B1 (ja) * 1968-11-01 1974-12-04
JPS56169338A (en) * 1980-05-30 1981-12-26 Hitachi Ltd Semiconductor device

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4945447B1 (ja) * 1968-11-01 1974-12-04
JPS4918591U (ja) * 1972-05-19 1974-02-16
JPS56169338A (en) * 1980-05-30 1981-12-26 Hitachi Ltd Semiconductor device

Cited By (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62202546A (ja) * 1986-02-28 1987-09-07 Shinko Electric Ind Co Ltd リ−ドフレ−ム
JP2014143434A (ja) * 1999-06-30 2014-08-07 Renesas Electronics Corp 半導体装置
JP2016105503A (ja) * 1999-06-30 2016-06-09 ルネサスエレクトロニクス株式会社 半導体装置
US9484288B2 (en) 1999-06-30 2016-11-01 Renesas Technology Corporation Semiconductor device and a method of manufacturing the same and a mounting structure of a semiconductor device
JP2010073830A (ja) * 2008-09-17 2010-04-02 Sumitomo Metal Mining Co Ltd リードフレーム及びリードフレームの製造方法
EP2284886A3 (en) * 2009-06-17 2013-02-27 LSI Corporation Lead frame design to improve reliability
US8869389B2 (en) 2009-06-17 2014-10-28 Lsi Corporation Method of manufacturing an electronic device package
JP2014099534A (ja) * 2012-11-15 2014-05-29 Dainippon Printing Co Ltd リードフレームおよびその製造方法、ならびに半導体装置およびその製造方法
JP2015153987A (ja) * 2014-02-18 2015-08-24 株式会社デンソー モールドパッケージ

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