JPS62109194U - - Google Patents

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JPS62109194U
JPS62109194U JP19937285U JP19937285U JPS62109194U JP S62109194 U JPS62109194 U JP S62109194U JP 19937285 U JP19937285 U JP 19937285U JP 19937285 U JP19937285 U JP 19937285U JP S62109194 U JPS62109194 U JP S62109194U
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JP19937285U
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Description

【図面の簡単な説明】
第1図は本考案の一実施例の構成を示すブロツ
クダイアグラムである。第2図は現在の表示画面
を表示用メモリ内に格納するときのキー操作と表
示画面の移り変りを表す図である。第3図は格納
した画面データを参照したいときのキー操作と、
そのときの表示画面の移り変りを示す。 1…CPU、2…主メモリ、3…表示用メモリ
、4…表示用アドレス装置、5…マルチプレクサ
、6…データバスユニツト、7…キヤラクタジエ
ネレータ、8…デコーダ、9…フリツプフロツプ

Claims (1)

    【実用新案登録請求の範囲】
  1. データを記憶している主メモリと、および表示
    用アドレスを出力するための表示用アドレス装置
    とを有する表示装置において、表示データを格納
    するための複数の表示用メモリからなり、前記各
    表示用メモリは個別に書込み読出し制御信号によ
    つて、データの書込み読出しが制御されている記
    憶手段と、表示用メモリを選択する命令に従つて
    、前記記憶手段内の複数の表示用メモリの中から
    、データの表示または格納に使用される表示用メ
    モリを選択するための制御信号を出力し、前記記
    憶手段内の各表示用メモリのデータの書込み読出
    しを制御する前記書込み読出し制御信号を出力し
    、前記主メモリと前記記憶手段との間でデータの
    転送があるときは、データの流れを制御する信号
    と、前記記憶手段にアドレス信号を出力するため
    の制御手段と、前記選択制御信号に従つて、前記
    制御手段および前記表示用アドレス装置から入力
    されたアドレス信号を前記命令によつて指定され
    た表示用メモリに出力し、必要に応じて現在デー
    タの表示に使用されている表示用メモリにも前記
    アドレス信号を出力するためのアドレス手段と、
    および前記データの流れを制御する信号に従つて
    、データの流れを制御するデータ出力制御手段か
    らなることを特徴とする表示装置。
JP19937285U 1985-12-27 1985-12-27 Pending JPS62109194U (ja)

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JP19937285U JPS62109194U (ja) 1985-12-27 1985-12-27

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JP19937285U JPS62109194U (ja) 1985-12-27 1985-12-27

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JPS62109194U true JPS62109194U (ja) 1987-07-11

Family

ID=31160931

Family Applications (1)

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JP19937285U Pending JPS62109194U (ja) 1985-12-27 1985-12-27

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