JPS6160352U - - Google Patents
Info
- Publication number
- JPS6160352U JPS6160352U JP1984142363U JP14236384U JPS6160352U JP S6160352 U JPS6160352 U JP S6160352U JP 1984142363 U JP1984142363 U JP 1984142363U JP 14236384 U JP14236384 U JP 14236384U JP S6160352 U JPS6160352 U JP S6160352U
- Authority
- JP
- Japan
- Prior art keywords
- storage device
- address
- signal
- control signal
- supplying
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/06—Addressing a physical block of locations, e.g. base addressing, module addressing, memory dedication
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Bus Control (AREA)
Description
第1図はマイクロコンピユータシステムの概要
ブロツク図、第2図は第1図のシステムのアドレ
スバスを拡張した、本考案を実施したシステムの
概要ブロツク図、第3図はアドレス信号の切換え
と、読み取り・書き込み制御信号の発生タイミン
グを示すタイムチヤートである。 M1…第1記憶装置、M2…第2記憶装置、6
…第1アドレスバス、8…第2アドレスバス、C
PU2…データ処理装置、7…データバス、13
,17…セレクタ手段。
ブロツク図、第2図は第1図のシステムのアドレ
スバスを拡張した、本考案を実施したシステムの
概要ブロツク図、第3図はアドレス信号の切換え
と、読み取り・書き込み制御信号の発生タイミン
グを示すタイムチヤートである。 M1…第1記憶装置、M2…第2記憶装置、6
…第1アドレスバス、8…第2アドレスバス、C
PU2…データ処理装置、7…データバス、13
,17…セレクタ手段。
Claims (1)
- 【実用新案登録請求の範囲】 アドレス指定可能な複数の記憶位置をもち、外
部からの制御信号に応答してデータの読み出しま
たは書き込みを行うための第1記憶装置と、 アドレス指定可能な複数の記憶位置をもち、外
部からの制御信号に応答してデータの読み出しま
たは書き込みを行うための第2記憶装置と、 上記第1記憶装置に対してアドレス指定するた
めの複数本のラインからなる第1アドレスバスと
、 上記第1アドレスバスと並列に組合わせて上記
第2記憶装置に対してアドレス指定するための少
くとも1本のラインからなる第2アドレスバスと
、 データバスを介して上記第1及び第2記憶装置
とデータのやりとりを行う際、上記第1及び第2
アドレスバスを介してアドレス信号を供給すると
ともに、データの読み出しまたは書き込み制御を
行うための上記制御信号を発生するためのデータ
処理装置と、 上記第2アドレスバス上のアドレス信号が特定
の信号であることを感知して上記データ処理装置
からの上記制御信号を上記第1記憶装置のみに供
給し、該アドレス信号が該特定の信号でないこと
を感知して上記データ処理装置からの上記制御信
号を上記第2記憶装置のみに供給するためのセレ
クタ手段、 とを具備するアドレス制御装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1984142363U JPS6160352U (ja) | 1984-09-21 | 1984-09-21 | |
KR2019850008323U KR900009212Y1 (ko) | 1984-09-21 | 1985-07-05 | 어드레스 제어장치 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1984142363U JPS6160352U (ja) | 1984-09-21 | 1984-09-21 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6160352U true JPS6160352U (ja) | 1986-04-23 |
Family
ID=30700685
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1984142363U Pending JPS6160352U (ja) | 1984-09-21 | 1984-09-21 |
Country Status (2)
Country | Link |
---|---|
JP (1) | JPS6160352U (ja) |
KR (1) | KR900009212Y1 (ja) |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5210737B2 (ja) * | 1973-03-02 | 1977-03-25 | ||
JPS58225458A (ja) * | 1982-06-25 | 1983-12-27 | Nec Corp | シングル・チツプ・マイクロコンピユ−タ |
JPS59144966A (ja) * | 1983-02-08 | 1984-08-20 | Nec Corp | デ−タ処理装置 |
-
1984
- 1984-09-21 JP JP1984142363U patent/JPS6160352U/ja active Pending
-
1985
- 1985-07-05 KR KR2019850008323U patent/KR900009212Y1/ko not_active IP Right Cessation
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5210737B2 (ja) * | 1973-03-02 | 1977-03-25 | ||
JPS58225458A (ja) * | 1982-06-25 | 1983-12-27 | Nec Corp | シングル・チツプ・マイクロコンピユ−タ |
JPS59144966A (ja) * | 1983-02-08 | 1984-08-20 | Nec Corp | デ−タ処理装置 |
Also Published As
Publication number | Publication date |
---|---|
KR860004022U (ko) | 1986-04-25 |
KR900009212Y1 (ko) | 1990-10-06 |
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