JPS6184111A - クロツク断検出回路 - Google Patents

クロツク断検出回路

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Publication number
JPS6184111A
JPS6184111A JP20583884A JP20583884A JPS6184111A JP S6184111 A JPS6184111 A JP S6184111A JP 20583884 A JP20583884 A JP 20583884A JP 20583884 A JP20583884 A JP 20583884A JP S6184111 A JPS6184111 A JP S6184111A
Authority
JP
Japan
Prior art keywords
gate
input
monostable
output
clocks
Prior art date
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Pending
Application number
JP20583884A
Other languages
English (en)
Inventor
Yoshinobu Nakanishi
中西　良信
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPS6184111A publication Critical patent/JPS6184111A/ja
Pending legal-status Critical Current

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Classifications

    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/19—Monitoring patterns of pulse trains

Landscapes

  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Manipulation Of Pulses (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、デジタル回路を動作させる際に必要となる各
種クロックを一括して監視し、いずれか一つのクロック
でも断になったときに、警報を出力してクロックの断を
検出するクロック断検出回路に関する。
〔従来の技術〕
従来、クロック断を検出する回路として、第２図に示す
ように、各クロックごとに単安定回路２を用いた回路が
ある。すなわち、この単安定回路を用いた検出回路にお
いては、信号線工からの入力が低レベルＩＩＩ、ＩＩか
ら高レベル′Ｈ゛に変化すると、信号線３の出力はＬ゛
から“Ｈ″に変化する。前記単安定回路２において設定
された時定数によって決まる時間内に入力ｌが“Ｈ′″
から“Ｈ′″に変化しなければ、出力は“Ｈ′″から“
Ｈ′″に戻るが、前記時間内に入力が′″Ｌ゛から“Ｈ
゛に変化すれば、出力は再び前記時間までＪＩ［ｌ１１
になシ続ける。従って、前記時間内の周期を有するクロ
ックが入力に入力されると、出力は常に“Ｈ′″となる
が、前記クロックが断になると、出力は“Ｈ′″になシ
、クロック断の検出を行なうことができる。
〔解決すべき問題点〕
上記のごとき構成からなる従来のクロック断検出回路に
おいては、各クロックごとに単安定回路を必要とするた
め、多数のクロックを同時に監視する場合には、単安定
回路を監視するクロックの数だけ用意しなければならな
いといった問題点を有していた。
〔問題点の解決手段〕
本発明は、上記の問題点に鑑みてなされたもので、多入
力のＡＮＤゲートと、多入力のＯＲゲートと、これらの
ＡＮＤゲート及びＯＲゲートの出力をそれぞれ入力とす
る単安定回路と、これらの単安定回路の出力のＡＮＤを
とるＡＮＤゲートとで構成しである。そして、このよう
に構成することにより、多数のクロックを同時に監視す
る場合でも、多数の単安定回路を用意することなく数個
の単安定回路で行なえるようにしたものである。
〔実施例〕
以下、本発明の一実施例を第１図に示すブロック図にも
とづいて説明する。
各クロックを入力する信号線１１　、１２　、１３　、
１４は、クロックがＡＮＤゲート１５とＯＲゲート１６
に並列に入力されるように接続しである。ＡＮＤゲート
１５とＯＲゲート１６の出力の信号線ｌ。
工はそれぞれ単安定回路２，２に入力されるよう接続し
である。また、二個の単安定回路２゜２の出力の信号線
３，３は、それぞれ一つのＡＮＤゲート１７に入力する
ように接続しである。
１８はＡＮＤゲート１７からの出力の信号線である。
入力の信号線１１　、１２　、１３　、１４に、ＡＮＤ
ゲート１５及びＯＲゲート１６によって、入力クロック
のＡＮＤ及びＯＲをとったときに、ＡＮＤゲート１５及
びＯＲゲート１６の出力が“Ｌ“と“Ｈ′に相互変化す
るようなりロックを入力すると、このようなりロックが
入力しているときには、単安定回路２Ｑ出力はそれぞれ
Ｈ゛となり、ＡＮＤゲート１７の出力はｇｕｍとなる。
このような回路において、いずれかの入力クロックが断
にな）“Ｌ′または“Ｈ”になったときには、ＡＮＤゲ
ート１５またはＯＲゲート１６の出力がそれぞれ“Ｌ゛
または“Ｈ゛に固定されるため、二個の単安定回路２，
２の出力のいずれかが′Ｌ１１とな、り、ＡＮＤゲート
１７の出力は“Ｌ″となる。
これにより、入力クロックが断になったことを検出する
。
〔発明の効果〕
以上のごとく構成からなる本発明によれば、多数のクロ
ックを監視するクロック断検出回路に用いられる単安定
回路の数を減少させることが可能となシ、クロック断検
出回路の回路規模を小さくできるといった効果を有する
。
【図面の簡単な説明】
第１図は本発明クロック断検出回路の一実施例のブロッ
ク図、第２図は従来のクロック断検出回路を説明するた
めのブロック図を示す。 １　、３．１１，１２，１３，１４．１８・・−信号線
２・・・単安定回路　　　１５　、１７・・・ＡＮＤゲ
ート１６・・・ＯＲゲート

Claims (1)

    【特許請求の範囲】
  1. 多入力のＡＮＤゲートと、多入力のＯＲゲートと、前記
    ＡＮＤゲートの出力により動作する単安定回路と、前記
    ＯＲゲートの出力により動作する単安定回路と、これら
    ２つの単安定回路の出力のＡＮＤをとるＡＮＤゲートと
    で構成したことを特徴とするクロック断検出回路。
JP20583884A 1984-10-01 1984-10-01 クロツク断検出回路 Pending JPS6184111A (ja)

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JP20583884A JPS6184111A (ja) 1984-10-01 1984-10-01 クロツク断検出回路

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JPS6184111A true JPS6184111A (ja) 1986-04-28

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07146731A (ja) * 1993-11-22 1995-06-06 Nec Corp クロック出力監視方法及びその装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07146731A (ja) * 1993-11-22 1995-06-06 Nec Corp クロック出力監視方法及びその装置

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