JPH01220557A - クロックダウン検出回路 - Google Patents
クロックダウン検出回路Info
- Publication number
- JPH01220557A JPH01220557A JP63044173A JP4417388A JPH01220557A JP H01220557 A JPH01220557 A JP H01220557A JP 63044173 A JP63044173 A JP 63044173A JP 4417388 A JP4417388 A JP 4417388A JP H01220557 A JPH01220557 A JP H01220557A
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- Japan
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- 238000001514 detection method Methods 0.000 title claims abstract description 18
- 230000001360 synchronised effect Effects 0.000 claims description 8
- 230000005856 abnormality Effects 0.000 abstract description 3
- 235000013290 Sagittaria latifolia Nutrition 0.000 abstract 1
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- 239000003990 capacitor Substances 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000630 rising effect Effects 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
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- 230000001960 triggered effect Effects 0.000 description 1
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- Monitoring And Testing Of Exchanges (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ディジタル電子交換機におけるシステム同期
クロックの障害を検出するクロックダウン検出回路に関
するものである。
クロックの障害を検出するクロックダウン検出回路に関
するものである。
従来、この種のクロックダウン検出回路は、コンデンサ
および抵抗を使用して所定の時定数を設定し、設定した
時定数に相当する時間内にシステム同期クロックの変化
が検出されなかったときなんらかの障害が発生し、クロ
ックがダウンしたと判断していた。
および抵抗を使用して所定の時定数を設定し、設定した
時定数に相当する時間内にシステム同期クロックの変化
が検出されなかったときなんらかの障害が発生し、クロ
ックがダウンしたと判断していた。
このような従来のシステムクロックダウン検出回路では
、クロック周波数に応じて時定数を決定する必要がある
ため、電子交換機によって抵抗値およびコンデンサの容
量を変化させなければならない。
、クロック周波数に応じて時定数を決定する必要がある
ため、電子交換機によって抵抗値およびコンデンサの容
量を変化させなければならない。
本発明の目的は、このような欠点を除去し、クロック周
波数に応じて時定数を設定することなくクロック障害を
検出できるクロックダウン検出回路を提供することにあ
る。
波数に応じて時定数を設定することなくクロック障害を
検出できるクロックダウン検出回路を提供することにあ
る。
本発明は、ディジタル電子交換機におけるシステム同期
クロックの障害を検出するクロックダウン検出回路にお
いて、 第１の回線を通じてシステム同期クロックが入力される
ごとに出力を反転させる第１のフリップフロップと、 第１のフリップフロップからの非反転出力にょリリセッ
トされ、第２の回線を通じて入力されるシステム同期ク
ロックにより歩進する第１のカウンタと、 第１のフリップフロップの反転出力によりリセットされ
、第２の回線を通じて入力されるシステム同期クロック
により歩進する第２のカウンタと、第２の回線を通じて
システム同期クロックが入力されるごとに出力を反転さ
せる第２のフリップフロップと、 第２のフリップフロップからの非反転出力によりリセッ
トされ、第１の回線を通じて入力されるシステム同期ク
ロックにより歩進する第３のカウンタと、 第２のフリップフロップの反転出力によりリセットされ
、第１の回線を通じて入力されるシステム同期クロック
により歩進する第４のカウンタと、第１〜第４のカウン
タの出力の論理和をとるオアゲートとを備えたことを特
徴とする。
クロックの障害を検出するクロックダウン検出回路にお
いて、 第１の回線を通じてシステム同期クロックが入力される
ごとに出力を反転させる第１のフリップフロップと、 第１のフリップフロップからの非反転出力にょリリセッ
トされ、第２の回線を通じて入力されるシステム同期ク
ロックにより歩進する第１のカウンタと、 第１のフリップフロップの反転出力によりリセットされ
、第２の回線を通じて入力されるシステム同期クロック
により歩進する第２のカウンタと、第２の回線を通じて
システム同期クロックが入力されるごとに出力を反転さ
せる第２のフリップフロップと、 第２のフリップフロップからの非反転出力によりリセッ
トされ、第１の回線を通じて入力されるシステム同期ク
ロックにより歩進する第３のカウンタと、 第２のフリップフロップの反転出力によりリセットされ
、第１の回線を通じて入力されるシステム同期クロック
により歩進する第４のカウンタと、第１〜第４のカウン
タの出力の論理和をとるオアゲートとを備えたことを特
徴とする。
次に本発明の実施例について図面を参照して説明する。
第１図は本発明によるクロックダウン検出回路の一実施
例を示すブロック図である。
例を示すブロック図である。
トグルフリップフロップ３はシステム同期クロック第２
回線２を通じてシステム同期クロックが入力されるごと
にその非反転出力および反転出力をそれぞれ反転させる
。３ビットカウンタ５．６はシステム同期クロック第１
回線１からのシステム同期クロックにより歩進し、カウ
ンタ５はフリップフロップ３の非反転出力がカウンタリ
セット出力線１０を通じて入力されるとリセットされ、
カウンタ６はフリップフロップ３の反転出力が反転カウ
ンタリセット出力線１１を通じて入力されるとリセット
される。
回線２を通じてシステム同期クロックが入力されるごと
にその非反転出力および反転出力をそれぞれ反転させる
。３ビットカウンタ５．６はシステム同期クロック第１
回線１からのシステム同期クロックにより歩進し、カウ
ンタ５はフリップフロップ３の非反転出力がカウンタリ
セット出力線１０を通じて入力されるとリセットされ、
カウンタ６はフリップフロップ３の反転出力が反転カウ
ンタリセット出力線１１を通じて入力されるとリセット
される。
トグルフリップフロップ４はシステム同期クロック第１
回線１を通じてシステム同期クロックが入力されるごと
にその非反転出力および反転出力をそれぞれ反転させる
。３ビツトカウンタ７．８はシステム同期クロック第２
回線２からのシステム同期クロックにより歩進し、カウ
ンタ７はフリップフロップ４の非反転出力がカウンタリ
セット出力線１２を通じて入力されるとリセットされ、
カウンタ８はフリップフロップ４の反転出力が反転カウ
ンタリセット出力線１３を通じて入力されるとリセット
される。
回線１を通じてシステム同期クロックが入力されるごと
にその非反転出力および反転出力をそれぞれ反転させる
。３ビツトカウンタ７．８はシステム同期クロック第２
回線２からのシステム同期クロックにより歩進し、カウ
ンタ７はフリップフロップ４の非反転出力がカウンタリ
セット出力線１２を通じて入力されるとリセットされ、
カウンタ８はフリップフロップ４の反転出力が反転カウ
ンタリセット出力線１３を通じて入力されるとリセット
される。
オアゲート９はカウンタ５〜８の出力の論理和をとり、
その結果をクロックダウン検出伝達回線１４を通じて出
力する。
その結果をクロックダウン検出伝達回線１４を通じて出
力する。
次に動作を説明する。まずシステム同期クロックが正常
である場合の動作を第２図に示すタイミングチャートを
用いて説明する。システム同期クロック１５は、検出回
路が設けられた電子交換機に対向する電子交換機から回
線１．２の２本の回線を通じて入力される。フリップフ
ロップ３はこのクロック１５の立ち上がりでトリガされ
、リセット信号１６．１７をカウンタ５．６にそれぞれ
出力する。
である場合の動作を第２図に示すタイミングチャートを
用いて説明する。システム同期クロック１５は、検出回
路が設けられた電子交換機に対向する電子交換機から回
線１．２の２本の回線を通じて入力される。フリップフ
ロップ３はこのクロック１５の立ち上がりでトリガされ
、リセット信号１６．１７をカウンタ５．６にそれぞれ
出力する。
カウンタ５，６は回線ｌを通じて入力されるクロック１
５の立ち上がりで歩進するが、１クロツクおきに論理“
１”のリセット信号１６．１７が入力されるためカウン
タ５．６の出力は論理“０”を維持する。
５の立ち上がりで歩進するが、１クロツクおきに論理“
１”のリセット信号１６．１７が入力されるためカウン
タ５．６の出力は論理“０”を維持する。
そしてカウンタ７．８もカウンタ５，６と同様に動作す
るので、それらの出力は論理“０”となっている、従っ
てオアゲート９の出力は論理“０”が維持され、回線１
４を通じてクロックダウン表示装置（図示せず）にシス
テム同期クロックが正常であることが通知される。
るので、それらの出力は論理“０”となっている、従っ
てオアゲート９の出力は論理“０”が維持され、回線１
４を通じてクロックダウン表示装置（図示せず）にシス
テム同期クロックが正常であることが通知される。
次にシステム同期クロックが異常となった場合の動作を
第３図に示すタイミングチャートを用いて説明する０回
線１を通じて入力されるシステム同期クロック（第１回
線クロック）１Ｂが矢印で示した時点でダウンし、論理
″１′″のままとなると、フリップフロップ４は動作を
停止し、その出力、すなわちリセット信号２０．２１は
いずれも一定値となる。かりにリセット信号２０は論理
“１”、リセット信号２１は論理１０″″であったとす
ると、カウンタ７は常にリセットされた状態となり、カ
ウンタ８は常に歩進可能状態となる。その結果カウンタ
８はクロック１９が入力されるごとに歩進し、その４つ
目のクロックが入力されたとき出力は論理“１”となる
、従ってオアゲート９はこのとき論理“１”の検出信号
２２をクロックダウン表示装置に送り、クロックの異常
を通知する。
第３図に示すタイミングチャートを用いて説明する０回
線１を通じて入力されるシステム同期クロック（第１回
線クロック）１Ｂが矢印で示した時点でダウンし、論理
″１′″のままとなると、フリップフロップ４は動作を
停止し、その出力、すなわちリセット信号２０．２１は
いずれも一定値となる。かりにリセット信号２０は論理
“１”、リセット信号２１は論理１０″″であったとす
ると、カウンタ７は常にリセットされた状態となり、カ
ウンタ８は常に歩進可能状態となる。その結果カウンタ
８はクロック１９が入力されるごとに歩進し、その４つ
目のクロックが入力されたとき出力は論理“１”となる
、従ってオアゲート９はこのとき論理“１”の検出信号
２２をクロックダウン表示装置に送り、クロックの異常
を通知する。
回線２からのクロックが異常となった場合も動作は同様
であり、その場合にはカウンタ５またはカウンタ６の出
力が論理“１１となってオアゲート９から論理“１′″
の検出信号が出力される。
であり、その場合にはカウンタ５またはカウンタ６の出
力が論理“１１となってオアゲート９から論理“１′″
の検出信号が出力される。
以上説明したように本発明は、ディジタル電子交換機に
おけるシステム同期クロックの障害を検出するクロック
ダウン検出回路において、第１の回線を通じてシステム
同期クロックが入力されるごとに出力を反転させる第１
のフリップフロップと、第１のフリップフロップからの
非反転出力によりリセットされ、第２の回線を通じて入
力されるシステム同期クロックにより歩進する第１のカ
ウンタと、第１のフリップフロップの反転出力によりリ
セットされ、第２の回線を通じて入力されるシステム同
期クロックにより歩進する第２のカウンタと、第２の回
線を通じてシステム同期クロックが入力されるごとに出
力を反転させる第２のフリップフロップと、第２のフリ
ップフロップからの非反転出力によりリセットされ、第
１の回線を通じて入力されるシステム同期クロックによ
り歩進する第３のカウンタと、第２のフリップフロップ
の反転出力によりリセットされ、第１の回線を通じて入
力されるシステム同期クロックにより歩進する第４のカ
ウンタと、第１〜第４のカウンタの出力の論理和をとる
オアゲートとを備えている。
おけるシステム同期クロックの障害を検出するクロック
ダウン検出回路において、第１の回線を通じてシステム
同期クロックが入力されるごとに出力を反転させる第１
のフリップフロップと、第１のフリップフロップからの
非反転出力によりリセットされ、第２の回線を通じて入
力されるシステム同期クロックにより歩進する第１のカ
ウンタと、第１のフリップフロップの反転出力によりリ
セットされ、第２の回線を通じて入力されるシステム同
期クロックにより歩進する第２のカウンタと、第２の回
線を通じてシステム同期クロックが入力されるごとに出
力を反転させる第２のフリップフロップと、第２のフリ
ップフロップからの非反転出力によりリセットされ、第
１の回線を通じて入力されるシステム同期クロックによ
り歩進する第３のカウンタと、第２のフリップフロップ
の反転出力によりリセットされ、第１の回線を通じて入
力されるシステム同期クロックにより歩進する第４のカ
ウンタと、第１〜第４のカウンタの出力の論理和をとる
オアゲートとを備えている。
従って本発明のクロックダウン検出回路では２系統のシ
ステム同期クロックが相互に監視され、従来の検出回路
では必要であったクロック周波数に応じた時定数の設定
を行うことな（クロック障害を検出できる。
ステム同期クロックが相互に監視され、従来の検出回路
では必要であったクロック周波数に応じた時定数の設定
を行うことな（クロック障害を検出できる。
第１図は本発明の一実施例を示すブロック図、第２図、
第３図は第１図の実施例の動作を示すタイミングチャー
トである。 １・・・システム同期クロック第１回線２・・・システ
ム同期クロック第２回線３．４・・・トグルフリップフ
ロップ ５〜８・・・３ビツトカウンタ ９・・・オアゲート
第３図は第１図の実施例の動作を示すタイミングチャー
トである。 １・・・システム同期クロック第１回線２・・・システ
ム同期クロック第２回線３．４・・・トグルフリップフ
ロップ ５〜８・・・３ビツトカウンタ ９・・・オアゲート
Claims (1)
- （１）ディジタル電子交換機におけるシステム同期クロ
ックの障害を検出するクロックダウン検出回路において
、 第１の回線を通じてシステム同期クロックが入力される
ごとに出力を反転させる第１のフリップフロップと、 第１のフリップフロップからの非反転出力によりリセッ
トされ、第２の回線を通じて入力されるシステム同期ク
ロックにより歩進する第１のカウンタと、 第１のフリップフロップの反転出力によりリセットされ
、第２の回線を通じて入力されるシステム同期クロック
により歩進する第２のカウンタと、第２の回線を通じて
システム同期クロックが入力されるごとに出力を反転さ
せる第２のフリップフロップと、 第２のフリップフロップからの非反転出力によりリセッ
トされ、第１の回線を通じて入力されるシステム同期ク
ロックにより歩進する第３のカウンタと、 第２のフリップフロップの反転出力によりリセットされ
、第１の回線を通じて入力されるシステム同期クロック
により歩進する第４のカウンタと、第１〜第４のカウン
タの出力の論理和をとるオアゲートとを備えたことを特
徴とするクロックダウン検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63044173A JPH0714184B2 (ja) | 1988-02-29 | 1988-02-29 | クロックダウン検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63044173A JPH0714184B2 (ja) | 1988-02-29 | 1988-02-29 | クロックダウン検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01220557A true JPH01220557A (ja) | 1989-09-04 |
| JPH0714184B2 JPH0714184B2 (ja) | 1995-02-15 |
Family
ID=12684192
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63044173A Expired - Lifetime JPH0714184B2 (ja) | 1988-02-29 | 1988-02-29 | クロックダウン検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0714184B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03253135A (ja) * | 1990-03-02 | 1991-11-12 | Nec Corp | クロツク監視回路 |
-
1988
- 1988-02-29 JP JP63044173A patent/JPH0714184B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03253135A (ja) * | 1990-03-02 | 1991-11-12 | Nec Corp | クロツク監視回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0714184B2 (ja) | 1995-02-15 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080215 Year of fee payment: 13 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090215 Year of fee payment: 14 |
|
| EXPY | Cancellation because of completion of term | ||
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090215 Year of fee payment: 14 |