JPS6157541U - - Google Patents

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JPS6157541U
JPS6157541U JP14109984U JP14109984U JPS6157541U JP S6157541 U JPS6157541 U JP S6157541U JP 14109984 U JP14109984 U JP 14109984U JP 14109984 U JP14109984 U JP 14109984U JP S6157541 U JPS6157541 U JP S6157541U
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Description

【図面の簡単な説明】
第1図は本考案に係る半導体集積回路装置の一
実施例を示す図、第2図は本考案の半導体集積回
路装置の断面図、第3図は本考案の半導体集積回
路装置の平面図、第4図は従来の半導体集積回路
装置の説明の為の図である。 1:電源端子、2,3:バイサアス用端子、4
:接地端子、5:出力端子、17:信号処理回路
、M1:主電源、M2,M3:バイアス電源、A
1,A2:バツフアー回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 第一導電型の島領域に第二導電型の拡散層
    抵抗が形成された半導体集積回路装置に於いて、
    該拡散層抵抗に第1と第2の電極が設けられ、該
    第1の電極が所定の回路領域に接続され、且つ該
    第2の電極が第1のバイアス電源に接続され、該
    島領域の第3の電極に第1と第2のダイオードの
    アノードが接続され、第1のダイオードのカソー
    ドに該バイアス電源と同電位か、或いはその電位
    より高い第2のバイアス電源が接続され、第2の
    ダイオードのカソードに電圧源が接続された該島
    領域を含むことを特徴とする半導体集積回路装置
    。 (2) 前記ダイオードがトランジスタのベースと
    コレクタ間に抵抗が接続されてなる実用新案登録
    請求の範囲第1項記載の半導体集積回路装置。
JP14109984U 1984-09-18 1984-09-18 Pending JPS6157541U (ja)

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JP14109984U JPS6157541U (ja) 1984-09-18 1984-09-18

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JPS6157541U true JPS6157541U (ja) 1986-04-17

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4960181A (ja) * 1972-10-06 1974-06-11

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4960181A (ja) * 1972-10-06 1974-06-11

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