JPS60193708U - 低入力端子電圧型カレントミラ−回路 - Google Patents

低入力端子電圧型カレントミラ−回路

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JPS60193708U
JPS60193708U JP7949584U JP7949584U JPS60193708U JP S60193708 U JPS60193708 U JP S60193708U JP 7949584 U JP7949584 U JP 7949584U JP 7949584 U JP7949584 U JP 7949584U JP S60193708 U JPS60193708 U JP S60193708U
Authority
JP
Japan
Prior art keywords
input terminal
current mirror
terminal voltage
low input
mirror circuit
Prior art date
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Pending
Application number
JP7949584U
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English (en)
Inventor
江森　隆久
Original Assignee
ソニー株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図ａｔ　　ｂｔ　　Ｃｙ　ｄは従来のカレントミラ
ー回路例を示す回路図、第２図はカレントミラー回路の
電流を制御する場合の説明図、第３図はこの考案の低入
力端子電圧型カレントミラー回路の基本的な実施例を示
す回路図、第４図はトランジスタの■。Ｅとコレクタ電
流の関係を示す特性図、第５図はトランジスタ構造の一
実施例を示す断面図、第６図はバランス精度を良くした
この考案の他の実施例を示す回路図、第７図、第８図は
この考案のさらに他の実施例を示す回路図である。 図中、Ｑ、、、　Ｑ、□はカレントミラー接続されたＮ
ＰＮ形トランジスタ、Ｑ１３はＰＮＰ形のトランジスタ
、Ｓは電流源、１１は入力端子、１２は出力端子を示す
。

Claims (1)

    【実用新案登録請求の範囲】
  1. ベース電極が相互に結合されている第１の導電形式の複
    数のトランジスタと、前記複数のトランジスタの共通ベ
    ース回路に電流を供給する電流源と、前記共通ベース回
    路にエミッタ電極が接続され、そのベース電極が前記複
    数のトランジスタのいずれか１個のコレクタ電極に接続
    されている第２の導電形式のトランジスタを備えている
    ことを特徴とする低入力端子電圧型カレントミラー回路
    。
JP7949584U 1984-05-31 1984-05-31 低入力端子電圧型カレントミラ−回路 Pending JPS60193708U (ja)

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JP7949584U JPS60193708U (ja) 1984-05-31 1984-05-31 低入力端子電圧型カレントミラ−回路

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JPS60193708U true JPS60193708U (ja) 1985-12-23

Family

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JP (1) JPS60193708U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0738348A (ja) * 1993-07-23 1995-02-07 Nec Corp 半導体集積回路

Cited By (1)

* Cited by examiner, † Cited by third party
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