JPS61102057U - - Google Patents

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JPS61102057U
JPS61102057U JP18608184U JP18608184U JPS61102057U JP S61102057 U JPS61102057 U JP S61102057U JP 18608184 U JP18608184 U JP 18608184U JP 18608184 U JP18608184 U JP 18608184U JP S61102057 U JPS61102057 U JP S61102057U
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JP
Japan
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region
conductivity type
emitter
substrate
substrate formed
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JP18608184U
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  • Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)

Description

【図面の簡単な説明】
第1図は本考案の一実施例の回路図、第2図は
従来装置の一例図、第3図は従来装置の特性図、
第4図は一実施例の断面図、第5図は本考案の信
号波形図、第6図は本考案の製造工程を示す一実
施例図である。 符号の説明、1……負荷、2……nチヤンネル
MOSトランジスタ、3……電源端子、4……入
力端子、5……バイポーラ・トランジスタ、6…
…抵抗、7……MOSトランジスタ、8……コン
デンサ、9……ツエナダイオード。

Claims (1)

    【実用新案登録請求の範囲】
  1. 半導体基板中に形成された該基板と反対導電型
    の領域中に形成された上記基板と同一導電型の一
    対の領域をソース及びドレインとするMOSトラ
    ンジスタと、上記基板中に形成された該基板と反
    対導電型の第1の領域をベースとし、該第1の領
    域中に形成された上記基板と同一導電型の領域を
    エミツタとし、上記基板をコレクタとするバイポ
    ーラ・トランズスタと、該バイポーラ・トランジ
    スタのエミツタと上記MOSトランジスタのドレ
    インとの間に電気的に接続して形成された抵抗と
    、上記バイポーラ・トランジスタのエミツタに電
    気的に接続して形成されたコンデンサとを備えた
    半導体集積回路。
JP18608184U 1984-12-10 1984-12-10 Pending JPS61102057U (ja)

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JP18608184U JPS61102057U (ja) 1984-12-10 1984-12-10

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JP18608184U JPS61102057U (ja) 1984-12-10 1984-12-10

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JPS61102057U true JPS61102057U (ja) 1986-06-28

Family

ID=30743543

Family Applications (1)

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JP18608184U Pending JPS61102057U (ja) 1984-12-10 1984-12-10

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JP (1) JPS61102057U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100317236B1 (ko) * 1992-09-01 2002-07-18 마찌다 가쯔히꼬 Mos전계효과트랜지스터

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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