JPS6151930A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
- Publication number
- JPS6151930A JPS6151930A JP17465084A JP17465084A JPS6151930A JP S6151930 A JPS6151930 A JP S6151930A JP 17465084 A JP17465084 A JP 17465084A JP 17465084 A JP17465084 A JP 17465084A JP S6151930 A JPS6151930 A JP S6151930A
- Authority
- JP
- Japan
- Prior art keywords
- ion
- implanted
- substrate
- oxygen
- atoms
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000004065 semiconductor Substances 0.000 title claims abstract description 22
- 238000004519 manufacturing process Methods 0.000 title claims description 5
- 239000000758 substrate Substances 0.000 claims abstract description 21
- 239000013078 crystal Substances 0.000 claims abstract description 10
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims abstract description 8
- 229910052760 oxygen Inorganic materials 0.000 claims abstract description 8
- 239000001301 oxygen Substances 0.000 claims abstract description 8
- 125000004430 oxygen atom Chemical group O* 0.000 claims abstract description 6
- 230000005465 channeling Effects 0.000 claims abstract description 5
- 229910021421 monocrystalline silicon Inorganic materials 0.000 claims abstract description 5
- 238000010438 heat treatment Methods 0.000 claims abstract description 4
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical group [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 19
- 238000005247 gettering Methods 0.000 abstract description 11
- 238000000034 method Methods 0.000 abstract description 10
- 230000001133 acceleration Effects 0.000 abstract description 4
- 125000004429 atom Chemical group 0.000 abstract description 3
- 238000005468 ion implantation Methods 0.000 abstract description 3
- 238000002513 implantation Methods 0.000 abstract description 2
- 230000002950 deficient Effects 0.000 abstract 2
- 229910052710 silicon Inorganic materials 0.000 description 16
- 239000010703 silicon Substances 0.000 description 16
- 230000007547 defect Effects 0.000 description 8
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical group [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 229910052698 phosphorus Inorganic materials 0.000 description 2
- 239000011574 phosphorus Substances 0.000 description 2
- 238000001556 precipitation Methods 0.000 description 2
- 238000009826 distribution Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000012535 impurity Substances 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 238000011866 long-term treatment Methods 0.000 description 1
- 235000021395 porridge Nutrition 0.000 description 1
- 239000002244 precipitate Substances 0.000 description 1
- 150000003376 silicon Chemical class 0.000 description 1
- 238000011282 treatment Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/322—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections
- H01L21/3221—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections of silicon bodies, e.g. for gettering
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Element Separation (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、半導体装置の製造方法、特に大規模集積回路
装置の製造プロセス中の不純物原子のゲッタリング方法
に係る。
装置の製造プロセス中の不純物原子のゲッタリング方法
に係る。
昨今の集積回路装置の大規模化に伴い、歩留シ及び信頼
性向上のため、ゲッタリングの技術が重要性を増してき
ている。ゲッタリングの技術として最も一般的なものは
裏面から高温でリンを拡散するリンゲッタリングの技術
でその他にも裏面に機械的に欠陥層を形成するもの、結
晶内部に、高密度の欠陥領域を形成するインドリノシッ
クゲッタリングが知られている。
性向上のため、ゲッタリングの技術が重要性を増してき
ている。ゲッタリングの技術として最も一般的なものは
裏面から高温でリンを拡散するリンゲッタリングの技術
でその他にも裏面に機械的に欠陥層を形成するもの、結
晶内部に、高密度の欠陥領域を形成するインドリノシッ
クゲッタリングが知られている。
従来、このイントリンシックゲッタリング（以下、ＩＧ
と略す）の技術を適用する場合、第１図 ′に示すよう
に、格子間酸素濃度（以下０１と略す）が１０〜１７Ｘ
１０’″／ｃｃのシリコン半導体１を用い、１１００°
Ｃ〜１２００°Ｃの高温処理を行い、前記シリコン半導
体基板素面の格子間酸素をアウトディフェージョンさせ
る工程と、５５０’Ｃ〜ｓｏｏ’ｃの低温で長時間処理
を行いシリコン半導体基板内部のみに酸素析出核を成長
させる工程を経た後、通常の集積回路装置の製造プロセ
スに移る。ところで、ＩＧの結果はＩＧ処理によシ形成
された前記シリコン半導体表面のデニューデソドゾーン
２（以下ＤＺ層と略す）内に、欠陥がなく、内部欠陥領
域３は、前記シリコン半導体表面に形成されたデバイス
の直下に高密度で形成された時に最大となる。ところが
、前記内部欠陥領域３が少しでも前記デバイスの空乏層
の広がシと重なるようになると、逆に接合リークが生じ
る。そこで、通常はＤＺ層幅はそれほど狭く設定するこ
とは行なわない。なぜなら、ＤＺ層の幅及びＤ２Ｊ内の
欠陥は、同じＩＯ処理を施しても前記シリコン半導体基
板の初期Ｏ１，及びインゴット引き上げ時の析出核の大
きさの密度分布のばらつきなどから、制御するのが非常
にむずかしいからである。
と略す）の技術を適用する場合、第１図 ′に示すよう
に、格子間酸素濃度（以下０１と略す）が１０〜１７Ｘ
１０’″／ｃｃのシリコン半導体１を用い、１１００°
Ｃ〜１２００°Ｃの高温処理を行い、前記シリコン半導
体基板素面の格子間酸素をアウトディフェージョンさせ
る工程と、５５０’Ｃ〜ｓｏｏ’ｃの低温で長時間処理
を行いシリコン半導体基板内部のみに酸素析出核を成長
させる工程を経た後、通常の集積回路装置の製造プロセ
スに移る。ところで、ＩＧの結果はＩＧ処理によシ形成
された前記シリコン半導体表面のデニューデソドゾーン
２（以下ＤＺ層と略す）内に、欠陥がなく、内部欠陥領
域３は、前記シリコン半導体表面に形成されたデバイス
の直下に高密度で形成された時に最大となる。ところが
、前記内部欠陥領域３が少しでも前記デバイスの空乏層
の広がシと重なるようになると、逆に接合リークが生じ
る。そこで、通常はＤＺ層幅はそれほど狭く設定するこ
とは行なわない。なぜなら、ＤＺ層の幅及びＤ２Ｊ内の
欠陥は、同じＩＯ処理を施しても前記シリコン半導体基
板の初期Ｏ１，及びインゴット引き上げ時の析出核の大
きさの密度分布のばらつきなどから、制御するのが非常
にむずかしいからである。
本発明は、これらの問題点を解決し、安定にシリコン半
導体基板の表面に設けられたデバイスの直下に酸素析出
物によるゲッタリングシンクを形成する技術で、単結晶
シリコン半導体基板の結晶軸にチャネリングして酸素及
びシリコン原子をイオン注入する工程と、熱処理を施し
前記酸素原子を前記単結晶シリコン半導体基板中に析出
させる工程よシなる。本発明によれば、ゲッタリングシ
ンクの表面からの深さは、・酸素のイオン注入エネルギ
ーによυ安定にかつ任意に制御できる。またシリコン原
子をイオン注入することによシ、シリコン結晶中の格子
間位置のシリコン原子を導入し前記酸素原子の析出を容
易にしている。前記シリコン半導体基板として、ＦＺ結
晶のよりな低Ｏｉのものを使用したとしても、同様の効
果を得ることができる。
導体基板の表面に設けられたデバイスの直下に酸素析出
物によるゲッタリングシンクを形成する技術で、単結晶
シリコン半導体基板の結晶軸にチャネリングして酸素及
びシリコン原子をイオン注入する工程と、熱処理を施し
前記酸素原子を前記単結晶シリコン半導体基板中に析出
させる工程よシなる。本発明によれば、ゲッタリングシ
ンクの表面からの深さは、・酸素のイオン注入エネルギ
ーによυ安定にかつ任意に制御できる。またシリコン原
子をイオン注入することによシ、シリコン結晶中の格子
間位置のシリコン原子を導入し前記酸素原子の析出を容
易にしている。前記シリコン半導体基板として、ＦＺ結
晶のよりな低Ｏｉのものを使用したとしても、同様の効
果を得ることができる。
以下、本発明の実施例に従い説明する。第２図に於いて
シリコン半導体基板１１としては、Ｐ型（１００）の面
方位を持ち０１＝１０１８″／ｃＴＩ？のウェハースを
用いた。まず、室温で該シリコン半導体基板１１の結晶
軸にチャネリングして、酸素原子をイオン注入した。注
入条件としては、ＩＭｅＶの加速エネルギーで１０”ｃ
ｍ−２のドーズを注入した。
シリコン半導体基板１１としては、Ｐ型（１００）の面
方位を持ち０１＝１０１８″／ｃＴＩ？のウェハースを
用いた。まず、室温で該シリコン半導体基板１１の結晶
軸にチャネリングして、酸素原子をイオン注入した。注
入条件としては、ＩＭｅＶの加速エネルギーで１０”ｃ
ｍ−２のドーズを注入した。
引き続いてシリコン原子上同様に結晶軸にチャネリング
して、ＩＭｅＶの加速エネルギー、１０ 工のドーズを
イオン注入した。次に該イオン注入した酸素を析出てせ
、前記シリコン半導体基板１１の表面の前記イオン注入
により損傷を受けた部分のアニーリングのために、１０
００’Ｃ不活性雰囲気中で２時間の熱処理を行った。以
上の工程を経ることによシ前記シリコン半導体基板の表
面から約５μｍの所までが無欠陥領域１２さらにそこか
ら内部欠陥領域１３を持つ構造が得られた。
して、ＩＭｅＶの加速エネルギー、１０ 工のドーズを
イオン注入した。次に該イオン注入した酸素を析出てせ
、前記シリコン半導体基板１１の表面の前記イオン注入
により損傷を受けた部分のアニーリングのために、１０
００’Ｃ不活性雰囲気中で２時間の熱処理を行った。以
上の工程を経ることによシ前記シリコン半導体基板の表
面から約５μｍの所までが無欠陥領域１２さらにそこか
ら内部欠陥領域１３を持つ構造が得られた。
本実施例では、（１００）の面方位を持つものを用いた
が他の面方位でも良い。またＯｉとしてはＦＺ等の１０
”ｃｍ−３以下のものでもＭＣＺ、ＣＺの０ｉ＝１〜ｌ
０ＸＩＯ１７ｃｒｒＬ”のものでもかまわない。さらに
、従来技術であるリンゲッタリング又は通常のイントリ
ンシックゲッタリングと、本発明を組み合わせるのも効
果的である。
が他の面方位でも良い。またＯｉとしてはＦＺ等の１０
”ｃｍ−３以下のものでもＭＣＺ、ＣＺの０ｉ＝１〜ｌ
０ＸＩＯ１７ｃｒｒＬ”のものでもかまわない。さらに
、従来技術であるリンゲッタリング又は通常のイントリ
ンシックゲッタリングと、本発明を組み合わせるのも効
果的である。
第１図が従来のＩＧ処理後のシリコン基板内部の構造、
第２図は、本発明による構造を表わす。 図中、１．１１・・シリコン半導体基板、２．１２・・
・該シリコン半導体基板表面に形成されたＤＺ領領域び
無欠陥領域を、３．１３・・・内部欠陥領域を表わす。 粥１図 婚Ｚ図
第２図は、本発明による構造を表わす。 図中、１．１１・・シリコン半導体基板、２．１２・・
・該シリコン半導体基板表面に形成されたＤＺ領領域び
無欠陥領域を、３．１３・・・内部欠陥領域を表わす。 粥１図 婚Ｚ図
Claims (1)
- 単結晶シリコン半導体基板の結晶軸にチャネリングして
、酸素及びシリコン原子をイオン注入する工程と、熱処
理を施し、前記酸素原子を、前記単結晶シリコン半導体
基板中に析出させる工程とを含む半導体装置の製造方法
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17465084A JPS6151930A (ja) | 1984-08-22 | 1984-08-22 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17465084A JPS6151930A (ja) | 1984-08-22 | 1984-08-22 | 半導体装置の製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6151930A true JPS6151930A (ja) | 1986-03-14 |
Family
ID=15982300
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17465084A Pending JPS6151930A (ja) | 1984-08-22 | 1984-08-22 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6151930A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63246831A (ja) * | 1987-04-02 | 1988-10-13 | Seiko Instr & Electronics Ltd | シリコン結晶基板の製造方法 |
| JPH0254933A (ja) * | 1988-08-19 | 1990-02-23 | Toshiba Corp | 半導体装置の製造方法 |
| EP0717437A3 (en) * | 1994-12-12 | 1997-04-02 | Advanced Micro Devices Inc | Process for the production of buried oxide layers |
| US6577568B1 (en) | 1999-03-30 | 2003-06-10 | Matsushita Electric Industrial Co., Ltd. | Optical disk apparatus using tilt and aberration correction control system |
| JP2015204316A (ja) * | 2014-04-11 | 2015-11-16 | 信越半導体株式会社 | シリコンウェーハ及びその製造方法 |
-
1984
- 1984-08-22 JP JP17465084A patent/JPS6151930A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63246831A (ja) * | 1987-04-02 | 1988-10-13 | Seiko Instr & Electronics Ltd | シリコン結晶基板の製造方法 |
| JPH0254933A (ja) * | 1988-08-19 | 1990-02-23 | Toshiba Corp | 半導体装置の製造方法 |
| EP0717437A3 (en) * | 1994-12-12 | 1997-04-02 | Advanced Micro Devices Inc | Process for the production of buried oxide layers |
| US6577568B1 (en) | 1999-03-30 | 2003-06-10 | Matsushita Electric Industrial Co., Ltd. | Optical disk apparatus using tilt and aberration correction control system |
| JP2015204316A (ja) * | 2014-04-11 | 2015-11-16 | 信越半導体株式会社 | シリコンウェーハ及びその製造方法 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US3128530A (en) | Production of p.n. junctions in semiconductor material | |
| US4401506A (en) | Process for producing semiconductor device | |
| JPS6151930A (ja) | 半導体装置の製造方法 | |
| JPS59124136A (ja) | 半導体ウエハの処理方法 | |
| JP4302879B2 (ja) | 酸素析出物核形成中心の制御された分布を有するシリコンウエハの製造方法 | |
| JP3066968B2 (ja) | 半導体ウエハのゲッタリング方法 | |
| JP4647732B2 (ja) | Ｐ／ｐ−エピタキシャルウェーハの製造方法 | |
| JPS6326541B2 (ja) | ||
| KR0170907B1 (ko) | 반도체 소자의 무결함층 제조방법 | |
| JPH023539B2 (ja) | ||
| JPS63164440A (ja) | 半導体装置の製造方法 | |
| JPH0453140A (ja) | シリコン単結晶ウエハの処理方法 | |
| JPS60198735A (ja) | 半導体装置の製造方法 | |
| JPS59119842A (ja) | 半導体装置の製造方法 | |
| JPH02164040A (ja) | シリコン半導体基板の処理方法 | |
| JPH04175300A (ja) | シリコン単結晶の熱処理方法 | |
| JPS60176241A (ja) | 半導体基板の製造方法 | |
| JPS594128A (ja) | 半導体装置の製造方法 | |
| JPH0247836A (ja) | 半導体装置の製造方法 | |
| JPS6149427A (ja) | 半導体装置の製造方法 | |
| JP2762190B2 (ja) | シリコンウェーハの製造方法 | |
| JPS62219529A (ja) | 半導体装置の製造方法 | |
| JP2004056132A (ja) | 半導体ウェーハの製造方法 | |
| JPH03293718A (ja) | シリコン単結晶基板の処理方法 | |
| JPS624327A (ja) | 半導体装置の製造方法 |