JPS61269462A - Ｃｃｄ密着センサの制御回路 - Google Patents
Ｃｃｄ密着センサの制御回路Info
- Publication number
- JPS61269462A JPS61269462A JP60109288A JP10928885A JPS61269462A JP S61269462 A JPS61269462 A JP S61269462A JP 60109288 A JP60109288 A JP 60109288A JP 10928885 A JP10928885 A JP 10928885A JP S61269462 A JPS61269462 A JP S61269462A
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- JP
- Japan
- Prior art keywords
- ccd
- analog memory
- group
- signals
- lines
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- Pending
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/04—Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（発明の技術分野〕
この発明はファクシミリ、複写機等オフィスオートメー
ション機器の画像読取装置として電荷結合素子ＣＣＤを
用いた密着センサ装置の制御回路に関する。
ション機器の画像読取装置として電荷結合素子ＣＣＤを
用いた密着センサ装置の制御回路に関する。
〔発明の技術的背景およびその問題点〕オフィスオート
メーション機器の画像読取装置では、例えば原稿像の全
幅を網羅するために、ライン形の複数のＣＣＤセンサを
千鳥状に配置した密着センサが用いられる。ＣＣＤセン
ザは両端部に光に不感部分があるため、−線状に並べる
と、センサの継ぎ目で原稿像を読み取らない。そこで、
相互に重複部分をつくる配置、すなわち千鳥状配置とす
るがセンサが一定の幅をもつために、読取り位置がＣＣ
Ｄごとに前後する。このため千鳥状の間隔を副走査密度
のｎ部になるように配置し、前後のＣＣＤの読み取り位
置が副走査密度のｎ倍離れた位置の画像に対応するよう
にして、ＣＣＤの出力画像を−Ｈメモリに蓄え、処理し
た後、同一ラインの画信号として取り出す方法を用いて
いた。この方法では、少なくとも主走査ｎライン部分の
メモリを確保する必要があり、例えば副走査密度を変え
ると、それに応じてメモリの処理方法も変えなければな
らず、メモリのライン数も当然変る。そのためメモリの
確保も最大必要ライン数を設ける必要があり、副走査密
度に応じてはかなりの無駄が生じる。
メーション機器の画像読取装置では、例えば原稿像の全
幅を網羅するために、ライン形の複数のＣＣＤセンサを
千鳥状に配置した密着センサが用いられる。ＣＣＤセン
ザは両端部に光に不感部分があるため、−線状に並べる
と、センサの継ぎ目で原稿像を読み取らない。そこで、
相互に重複部分をつくる配置、すなわち千鳥状配置とす
るがセンサが一定の幅をもつために、読取り位置がＣＣ
Ｄごとに前後する。このため千鳥状の間隔を副走査密度
のｎ部になるように配置し、前後のＣＣＤの読み取り位
置が副走査密度のｎ倍離れた位置の画像に対応するよう
にして、ＣＣＤの出力画像を−Ｈメモリに蓄え、処理し
た後、同一ラインの画信号として取り出す方法を用いて
いた。この方法では、少なくとも主走査ｎライン部分の
メモリを確保する必要があり、例えば副走査密度を変え
ると、それに応じてメモリの処理方法も変えなければな
らず、メモリのライン数も当然変る。そのためメモリの
確保も最大必要ライン数を設ける必要があり、副走査密
度に応じてはかなりの無駄が生じる。
（発明の目的〕
本発明は上記の欠点を鑑み、位置ずれのための補正メモ
リを設（プることなく、かつ副走査密度が劣ってもＣＣ
Ｄへの制御信号をそれに応じて簡単に発生できる制御回
路を安価に提供するにある。
リを設（プることなく、かつ副走査密度が劣ってもＣＣ
Ｄへの制御信号をそれに応じて簡単に発生できる制御回
路を安価に提供するにある。
本発明は読み取り画像の副走査方向に一定間隔ずらして
複数のＣＣＤを配置した密着センサにおいて、複数ライ
ンのアナログメモリを内蔵したライン形ＣＣＤを用いて
外部よりの例えば数ピッ１への人力信号を切り変えるこ
とによって、複数ラインのアナログメモリのライン数を
変えるようにアナログメモリ制御信号を発生するＲＯＭ
で構成したＣＣＤ密着センサの制御回路である。
複数のＣＣＤを配置した密着センサにおいて、複数ライ
ンのアナログメモリを内蔵したライン形ＣＣＤを用いて
外部よりの例えば数ピッ１への人力信号を切り変えるこ
とによって、複数ラインのアナログメモリのライン数を
変えるようにアナログメモリ制御信号を発生するＲＯＭ
で構成したＣＣＤ密着センサの制御回路である。
第１図に本発明の一実施例を示す。
密着センサ（１０）は複数ライン例えば主走査４ライン
部分のアナログメモリを内蔵した光セン４ノ′である４
個のライン形ＣＣＤ （ｌａ）、（１ｂ）、（１Ｃ）、
（１ｄ）を備えている。その配置は例えばＡ４版の原稿
像を読むため、千鳥状に、かつ上下の間隔は副走査密度
のｎ倍、ここでｔＪ：４倍に設定されている。副走査は
Ａ４原稿の一方例えば縦長方向に原稿センサに対して相
対移動させて得る。（２）はＣＣＤへ供給する信号群を
レベル変換するドライバー回路である。ＣＣＤへ供給す
る信号群としてタロツク信号群（３）とアナログメ［り
制御信号群（４ａ）、（４ｂ）か市る。クロック信号群
（３）は外部よりの同期信号１１￥（５）にもとづきタ
イミング発生回路（６）で作り出されている。アナログ
メモリ制御信号群（４ａ）、（４ｂ）は外部よりの入力
信号群（７）の状態に応じてＲＯＭ （８）より発生さ
せている。
部分のアナログメモリを内蔵した光セン４ノ′である４
個のライン形ＣＣＤ （ｌａ）、（１ｂ）、（１Ｃ）、
（１ｄ）を備えている。その配置は例えばＡ４版の原稿
像を読むため、千鳥状に、かつ上下の間隔は副走査密度
のｎ倍、ここでｔＪ：４倍に設定されている。副走査は
Ａ４原稿の一方例えば縦長方向に原稿センサに対して相
対移動させて得る。（２）はＣＣＤへ供給する信号群を
レベル変換するドライバー回路である。ＣＣＤへ供給す
る信号群としてタロツク信号群（３）とアナログメ［り
制御信号群（４ａ）、（４ｂ）か市る。クロック信号群
（３）は外部よりの同期信号１１￥（５）にもとづきタ
イミング発生回路（６）で作り出されている。アナログ
メモリ制御信号群（４ａ）、（４ｂ）は外部よりの入力
信号群（７）の状態に応じてＲＯＭ （８）より発生さ
せている。
第１図の動作について説明すると、まず同期信号群（５
）によって作りだされたクロック信号群（３）がＣ０Ｄ
（１ａ）〜（１ｄ）に常時入力されている。ＣＣＤは前
述したようにＣＣＤ （１ａ） （ｌｂ）の組とＣ０Ｄ
（１ｂ） （１ｄ）の絹とは読み取り位置が４ライン分
ずれているため同時刻には違った位置の画信号が出力さ
れる。本実施例のＣＣＤではＣＣＤ内にアナログメモリ
が４ライン分設（プておるので、このアナログメモリを
使用することで同時刻に同一位置の信号を取り出すこと
ができる。具体的に説明すると、ＣＣＤ （１ａＨ１ｃ
）はアナログメモリ制御信号群（４ａ）によって４ライ
ン分遅れて画信号を出力するように制御信号パターンで
供給されている。ＣＣＤ（１ｂ）（ｌｄ）はアナログメ
モリ制御信号群（４ｂ）によって読み取った位置の画信
号を同一ラインの時刻に出力されるように制御信号パタ
ーンが供給されている。このため、同時刻に同一位置の
画信号を取り出すことができる。したがって、ＣＣＤ
（ｌａ）〜（１ｄ）が千鳥状に配設されているがＣＣＤ
（ｌａ）〜（１ｄ）が−直線上に並んでいるのと同等
の結果が得られ、外部に読み取り位置補正用のメモリは
必要がなく、アナログ制御信号もＲＯＭを用いることで
簡単な回路構成で実現できる。
）によって作りだされたクロック信号群（３）がＣ０Ｄ
（１ａ）〜（１ｄ）に常時入力されている。ＣＣＤは前
述したようにＣＣＤ （１ａ） （ｌｂ）の組とＣ０Ｄ
（１ｂ） （１ｄ）の絹とは読み取り位置が４ライン分
ずれているため同時刻には違った位置の画信号が出力さ
れる。本実施例のＣＣＤではＣＣＤ内にアナログメモリ
が４ライン分設（プておるので、このアナログメモリを
使用することで同時刻に同一位置の信号を取り出すこと
ができる。具体的に説明すると、ＣＣＤ （１ａＨ１ｃ
）はアナログメモリ制御信号群（４ａ）によって４ライ
ン分遅れて画信号を出力するように制御信号パターンで
供給されている。ＣＣＤ（１ｂ）（ｌｄ）はアナログメ
モリ制御信号群（４ｂ）によって読み取った位置の画信
号を同一ラインの時刻に出力されるように制御信号パタ
ーンが供給されている。このため、同時刻に同一位置の
画信号を取り出すことができる。したがって、ＣＣＤ
（ｌａ）〜（１ｄ）が千鳥状に配設されているがＣＣＤ
（ｌａ）〜（１ｄ）が−直線上に並んでいるのと同等
の結果が得られ、外部に読み取り位置補正用のメモリは
必要がなく、アナログ制御信号もＲＯＭを用いることで
簡単な回路構成で実現できる。
第２図に本発明の一実施例で用いたくラインのアナログ
メモリを内蔵したＣＣＤ、例えば（１ａ）の構成を示す
。すなわちＣＣＤ （１ａ）は感光画素群（１１）を有
し、これに対してアナログメモリ群（２０） （２１）
（２２Ｈ２３）が接続される。（３０）〜（３３）はア
ナログメモリ制御信号群（４）の入力端子群である。感
光画素群（１１）に入力された画情報はアナログメモリ
群（２０）〜（２３）へ順次転送される。アナログメモ
リ（２３）へ転送された画情報は転送パルス（４０）に
Ｊ：って転送レジスタ（５０）へ移され、クロック信号
群（３）の信号によってシリアルに転送され出力端子（
６０）より画信号として出力される。この時アナログメ
モリ群（２０）〜（２３）へ転送された画情報を同時刻
に出力するか４ライン分送らせるかを入力端子群（３０
）〜（３３）へ人力するアナログ制御信号を制御するこ
とで行なう。第３図（Ａ）は同時刻に出力するように制
御するためのアナログ制御信号パターンであり、（Ｂ）
は４ライン分送らせて出力するようにするパターンであ
る。
メモリを内蔵したＣＣＤ、例えば（１ａ）の構成を示す
。すなわちＣＣＤ （１ａ）は感光画素群（１１）を有
し、これに対してアナログメモリ群（２０） （２１）
（２２Ｈ２３）が接続される。（３０）〜（３３）はア
ナログメモリ制御信号群（４）の入力端子群である。感
光画素群（１１）に入力された画情報はアナログメモリ
群（２０）〜（２３）へ順次転送される。アナログメモ
リ（２３）へ転送された画情報は転送パルス（４０）に
Ｊ：って転送レジスタ（５０）へ移され、クロック信号
群（３）の信号によってシリアルに転送され出力端子（
６０）より画信号として出力される。この時アナログメ
モリ群（２０）〜（２３）へ転送された画情報を同時刻
に出力するか４ライン分送らせるかを入力端子群（３０
）〜（３３）へ人力するアナログ制御信号を制御するこ
とで行なう。第３図（Ａ）は同時刻に出力するように制
御するためのアナログ制御信号パターンであり、（Ｂ）
は４ライン分送らせて出力するようにするパターンであ
る。
次に副走査密度が変ってもそれに応じてＲＯＭ（８）よ
りの発生パターンを変えるべく人力信号群（７）の状態
を設定するだ【プで処置できる。
りの発生パターンを変えるべく人力信号群（７）の状態
を設定するだ【プで処置できる。
以上実施例を説明したが本発明の制御回路はＣＣＤのア
ナログメモリライン数が増減しても同様に実施できる。
ナログメモリライン数が増減しても同様に実施できる。
また、副走査密度およびＣＣＤの−〇 −
上下間隔が変ってもそれに応じて同様に実施できる。
本発明からも明らかなように）アナログメモリライン放
向でおれば自由にライン数を制御できるので、副走査方
向の密度変換が行なえるため、主走査方向の変換と組み
合せると画像の縮小、拡大が可能になる。
向でおれば自由にライン数を制御できるので、副走査方
向の密度変換が行なえるため、主走査方向の変換と組み
合せると画像の縮小、拡大が可能になる。
以上説明したように本発明によれば次の効果を奏するこ
とができる。
とができる。
（１） ＲＯＭを用いて制御信号をパターン化したた
め、回路構成が簡単で且つ安価に実現できる。
め、回路構成が簡単で且つ安価に実現できる。
（２）外部に補正用のメモリを設【プることなく、実現
できる。副走査密度が変っても数ピッ１〜の入力信号の
設定を実現するだ【ブで対処できる。
できる。副走査密度が変っても数ピッ１〜の入力信号の
設定を実現するだ【ブで対処できる。
第１図は本発明の一実施例のブロック図、第２図は本発
明の一実施例のＣＣＤの構成図、第３図（Ａ） 、（Ｂ
）は本発明の一実施例のＣＣＤの制御信号のタイミング
図。 （ｌａ）（ｌｂ） （ｌｃ） （１ｄ）−−・−ＣＣＤ
、（２）・・・・・・ドライバー回路、 （３）・・・・・・クロック信号群、 （４ａ）（４ｂ）・・・・・・アナログメモリ制御信号
群、（５）・・・・・・同期信号群、 （６）・・・・・・タイミング発生回路、（７）・・・
・・・人力信号群、 （８）・・・・・・ＲＯＭ
明の一実施例のＣＣＤの構成図、第３図（Ａ） 、（Ｂ
）は本発明の一実施例のＣＣＤの制御信号のタイミング
図。 （ｌａ）（ｌｂ） （ｌｃ） （１ｄ）−−・−ＣＣＤ
、（２）・・・・・・ドライバー回路、 （３）・・・・・・クロック信号群、 （４ａ）（４ｂ）・・・・・・アナログメモリ制御信号
群、（５）・・・・・・同期信号群、 （６）・・・・・・タイミング発生回路、（７）・・・
・・・人力信号群、 （８）・・・・・・ＲＯＭ
Claims (1)
- 画像の副走査方向に方向に一定間隔ずらして配置された
複数個のライン形ＣＣＤにより画像を読取るＣＣＤ密着
センサにおいて、前記各ＣＣＤに複数ラインのアナログ
メモリを内蔵させ、外部からの複数ビットの入力信号状
態に対応してアナログメモリ制御信号を発生するＲＯＭ
を設けてアナログメモリのライン数を制御できるように
したことを特徴とするＣＣＤ密着センサの制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60109288A JPS61269462A (ja) | 1985-05-23 | 1985-05-23 | Ｃｃｄ密着センサの制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60109288A JPS61269462A (ja) | 1985-05-23 | 1985-05-23 | Ｃｃｄ密着センサの制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61269462A true JPS61269462A (ja) | 1986-11-28 |
Family
ID=14506373
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60109288A Pending JPS61269462A (ja) | 1985-05-23 | 1985-05-23 | Ｃｃｄ密着センサの制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61269462A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS642467A (en) * | 1987-06-25 | 1989-01-06 | Toshiba Corp | Image reader |
| DE3843999A1 (de) * | 1987-12-25 | 1989-08-03 | Fuji Xerox Co Ltd | Bildlesevorrichtung |
-
1985
- 1985-05-23 JP JP60109288A patent/JPS61269462A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS642467A (en) * | 1987-06-25 | 1989-01-06 | Toshiba Corp | Image reader |
| DE3843999A1 (de) * | 1987-12-25 | 1989-08-03 | Fuji Xerox Co Ltd | Bildlesevorrichtung |
| US5148296A (en) * | 1987-12-25 | 1992-09-15 | Fuji Xerox Co., Ltd. | Original document reading apparatus |
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