JPS61183950A - 半導体用リ−ドフレ−ムの製造方法 - Google Patents

半導体用リ−ドフレ−ムの製造方法

Info

Publication number
JPS61183950A
JPS61183950A JP60023749A JP2374985A JPS61183950A JP S61183950 A JPS61183950 A JP S61183950A JP 60023749 A JP60023749 A JP 60023749A JP 2374985 A JP2374985 A JP 2374985A JP S61183950 A JPS61183950 A JP S61183950A
Authority
JP
Japan
Prior art keywords
lead frame
semiconductor
plating
resin
plated
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60023749A
Other languages
English (en)
Inventor
Mitsuhiko Sugiyama
光彦 杉山
Masaru Watanabe
勝 渡辺
Sadao Nagayama
長山 定夫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Cable Ltd
Original Assignee
Hitachi Cable Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hitachi Cable Ltd filed Critical Hitachi Cable Ltd
Priority to JP60023749A priority Critical patent/JPS61183950A/ja
Publication of JPS61183950A publication Critical patent/JPS61183950A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/48Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
    • H01L21/4814Conductive parts
    • H01L21/4821Flat leads, e.g. lead frames with or without insulating supports
    • H01L21/4828Etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 、 [産業上の利用分野コ 本発明はIC、トランジスタ、ダイオードなどの電子回
路用部品に使用される半導体用リードフレームの製造方
法に関するものである。
[従来の技術] 最近の半導体用リードフレームは、貴金属節約の観点か
ら、第4図に示すように、プレスにより所定のパターン
に打法いて形成されたリードフレーム素体1のほぼ中央
に位置する半導体素子固定部4及び内部リード端子部5
にのみ、金、銀などの貴金属を部分めっきすることによ
り製造されるのが普通である。2は樹脂封止領域である
。そしてこの場合、前記部分めっき方法としてはゴム等
のマスクにより非めっき液から遮蔽するマスク法が一般
に採用され、又、めっき液の供給形態ではノズルからめ
つき液を高速で噴射する所謂高速めつき法がマスク法と
合わせて採用されることが非常に多い。
[発明が解決しようとする問題点] ここで従来の製造方法においては、マスクを用いて部分
めっきする方法は、非めっき部分に対するめつき液の遮
蔽を完全に行うことが難しく、めっき液が非めっき部分
に回ねり込んで生じるにじみ出しの問題が心配されるが
、この点に関しては殊に最近のリードフレームの製造方
法はめつき処理をもって仕上加工としたいとの要求から
、第4図に示すようにプレス後のリードフレーム素体1
にめっきすることが多く、この場合素体1の開口部側面
を通じて非めっき部分にめっき液が十分回わりやすいた
めに、益々にじみ出しの問題が生じやすい状況にある。
このような状況から素体1の開口部側面をもマスクする
手段が種々検討されているが、例えば前記開口部に合致
した形状の特殊マスクを使用する方法ではリードフレー
ムのパターンの種類に応じて幾種類もの特殊マスクを用
意しなければならず、しかもこの方法によってもにじみ
出しの問題を皆無にすることは容易でないという問題が
ある。ざらに、めっき金属として銀を使用することは非
常に多いが、銀を使用する場合銀めっきのにじみ出しの
程度が樹脂封止領域外に出るようなことになると、銀マ
イグレーションを起こし、にじみ出しが半導体装置の信
頼性を著しく低下させる原因となるという問題がある。
一方、ICなどの半導体装置は高集積化、多ピン化が急
激に進み、3iチツプ等の半導体素子の面積もそれに応
じて大型化されてきているが、装置そのものの大きさは
変らず、むしろ小形化される傾向にある。このためIC
に使用される半導体用リードフレームにおいては、第3
図に示すように半導体素子固定部及び内部リード端子部
のポンディング領域8の長さに比較して、樹脂封止領域
11において実際に樹脂によって封止される部分13の
長さが逆にみじかくなり、それによって銀マイグレーイ
ヨンの問題や耐湿性の低下の問題が一層大きくクローズ
アップされつつある。
本発明の目的は前記した従来技術の欠点を解消し、にじ
み出しの問題を解消することが出来るとともに樹脂との
密着性を改善し耐湿性を確保及び向上させることができ
る半導体用リードフレームの製造方法を提供することに
ある。
[問題点を解決するための手段] すなわち本発明は、半導体用リードフレーム素体の半導
体素子固定部及び内部リード端子部を含む樹脂封止領域
内の表面に金、銀などの金属をめっきした後、前記半導
体素子固定部及び内部リード端子部に施されためつき金
属を残して他の部分のめつき金属を除去することにより
当該他の部分の表面を粗面化し、これによってにじみ出
しの問題を解消すると同時に樹脂との密着性を一挙に改
善したもので必り、非めっき部分にめっきを付ない工夫
を追及していた従来の裏をかくものでめる。
本発明において、半導体用リードフレーム素体の材料と
しては、例えば銅、銅合金、鉄、ステンレス、42アロ
イ、インバー、コバーなとの金属材料が使用され、又め
つき金属としては、金、銀、ニッケル、半田、錫などが
使用される。
めっき金属の除去方法としては、エツチング液に浸漬し
て除去する方法あるいは逆電解による方法などかめる。
[実施例] 次に添付図面を参照しながら本発明半導体用リードフレ
ームの製造方法の一実施例を説明する。
まず、第2図に示すように、プレスにより所定のパター
ンに打央いて形成された4270イ製半導体用リードフ
レーム素体1の樹脂封止領域2内の表面に厚さ3Mの銀
めつき3を施す。この銀めっきはマスク法による部分め
っきにより行われる。
ついで銀めっきされた樹脂封止領域2内の半導体素子固
定部4及び内部リード端子部5にのみマスクを当てて、
リードフレーム素体1全体をエツチング液中に浸漬する
。すると第1図に示すように、前記半導体素子固定部4
及び内部リード端子部5に施された銀めっきのみが残さ
れ、他の部分の銀めっきが除去されてその部分の表面が
粗面化された状態6の半導体用リードフレーム7が製造
される。
このようにして製造されたリードフレーム7を用いて組
立てられた半導体装置をみたのが第3図であり、半導体
素子固定部及び内部リード端子部からなるホンディング
領域8においては半導体素子の接合とホンディングワイ
ヤ9の接合がそれぞれ行われ、樹脂封止領域11におい
ては樹脂12によって封止される部分13が上記粗面化
された状態6のフレーム部分であることがわかる。14
は外部リードと称される部分で、普通この部分には半田
あるいは錫めっきが施されるように半田付性が必要なと
ころであるから、粗面化しないほうか良い。
[発明の効果] 以上の説明から明らかなように、本発明半導体用リード
フレームの製造方法によれば、非めっき部分を含む広範
囲の部分を積極的にめっきしそこから必要部分のめつき
金属を残して他の部分のめっき金属を除去するという方
法であるから、従来のように部分めっきの精度を上げる
工夫を追及しなくても、確実かつ容易ににじみ出しの問
題を解消することができると共に、めっき金属の除去を
もって当該部分を粗面化することにより樹脂との密着性
に関して接触面積を増加し且つ樹脂封止距離を長くする
ことができるために、樹脂との密着性を改善し半導体装
置においては耐湿性を確保及び向上させることができる
効果がめる。
【図面の簡単な説明】
第1図は本発明の一実施例に係る半導体用リードフレー
ムの部分正面図、第2図は同本発明−実施例にかかる半
導体用リードフレームの素体にめっきを施した構造を示
す部分正面図、第3図は半導体装置の断面図、第4図は
従来の半導体用リードフレームの部分正面図である。 1:リードフレーム素体、 2:樹脂封止領域、 3:銀めっき、 4:半導体素子固定部、 5:内部リード端子部、 6:粗面化された状態、 7:半導体用リードフレーム。

Claims (1)

    【特許請求の範囲】
  1. (1)半導体用リードフレーム素体の半導体素子固定部
    及び内部リード端子部を含む樹脂封止領域内の表面に金
    、銀などの金属をめつきした後、前記半導体素子固定部
    及び内部リード端子部に施されためつき金属を残して他
    の部分のめつき金属を除去することにより、当該他の部
    分の表面を粗面化することを特徴とする半導体用リード
    フレームの製造方法。
JP60023749A 1985-02-08 1985-02-08 半導体用リ−ドフレ−ムの製造方法 Pending JPS61183950A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP60023749A JPS61183950A (ja) 1985-02-08 1985-02-08 半導体用リ−ドフレ−ムの製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP60023749A JPS61183950A (ja) 1985-02-08 1985-02-08 半導体用リ−ドフレ−ムの製造方法

Publications (1)

Publication Number Publication Date
JPS61183950A true JPS61183950A (ja) 1986-08-16

Family

ID=12118961

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60023749A Pending JPS61183950A (ja) 1985-02-08 1985-02-08 半導体用リ−ドフレ−ムの製造方法

Country Status (1)

Country Link
JP (1) JPS61183950A (ja)

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63234602A (ja) * 1987-03-23 1988-09-29 Fujitsu Ten Ltd 車載用スピーカ一体形アンテナの製造方法
JPS63234603A (ja) * 1987-03-23 1988-09-29 Fujitsu Ten Ltd 車載用スピーカ一体形アンテナの製造方法
US6210548B1 (en) 1998-03-26 2001-04-03 Sumitomo Metal Mining Co., Ltd. Apparatus for partially removing plating films of leadframe
JP2007180247A (ja) * 2005-12-27 2007-07-12 Dainippon Printing Co Ltd 回路部材の製造方法
JP2009032906A (ja) * 2007-07-27 2009-02-12 Seiko Instruments Inc 半導体装置パッケージ
JP2011044748A (ja) * 2010-11-29 2011-03-03 Sumitomo Metal Mining Co Ltd リードフレームの製造方法
JP2011171770A (ja) * 2011-06-06 2011-09-01 Dainippon Printing Co Ltd 回路部材、回路部材の製造方法、半導体装置、及び回路部材表面の積層構造

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63234602A (ja) * 1987-03-23 1988-09-29 Fujitsu Ten Ltd 車載用スピーカ一体形アンテナの製造方法
JPS63234603A (ja) * 1987-03-23 1988-09-29 Fujitsu Ten Ltd 車載用スピーカ一体形アンテナの製造方法
US6210548B1 (en) 1998-03-26 2001-04-03 Sumitomo Metal Mining Co., Ltd. Apparatus for partially removing plating films of leadframe
JP2007180247A (ja) * 2005-12-27 2007-07-12 Dainippon Printing Co Ltd 回路部材の製造方法
JP4620584B2 (ja) * 2005-12-27 2011-01-26 大日本印刷株式会社 回路部材の製造方法
JP2009032906A (ja) * 2007-07-27 2009-02-12 Seiko Instruments Inc 半導体装置パッケージ
JP2011044748A (ja) * 2010-11-29 2011-03-03 Sumitomo Metal Mining Co Ltd リードフレームの製造方法
JP2011171770A (ja) * 2011-06-06 2011-09-01 Dainippon Printing Co Ltd 回路部材、回路部材の製造方法、半導体装置、及び回路部材表面の積層構造

Similar Documents

Publication Publication Date Title
US6194777B1 (en) Leadframes with selective palladium plating
KR101026586B1 (ko) 반도체 장치의 개선된 습기 신뢰성 및 개선된 납땜가능성을 위한 리드프레임을 포함하는 반도체 장치 및 그제조 방법
JP2005057067A (ja) 半導体装置およびその製造方法
US6706561B2 (en) Method for fabricating preplated nickel/palladium and tin leadframes
JPS61183950A (ja) 半導体用リ−ドフレ−ムの製造方法
JP2020053420A (ja) リードフレーム及びリードフレームの製造方法
JP4620584B2 (ja) 回路部材の製造方法
JP5954871B2 (ja) 半導体装置の製造方法並びにそれに用いられる半導体素子搭載用基板とその製造方法
JPS6097654A (ja) 封止型半導体装置
JP2000058730A (ja) リードフレーム及びその製造方法
JPH08274231A (ja) リードフレームおよびリードフレームの製造方法
JP2503595B2 (ja) 半導体リ―ドフレ―ム
KR100203334B1 (ko) 다층도금 리드프레임
JPS60150656A (ja) 半導体装置の製造方法およびそれに使用されるリ−ドフレ−ム
JPS61152053A (ja) リ−ドフレ−ム、それを用いた半導体装置およびその製造方法
JPH02250364A (ja) リードフレーム及びその製造方法
JPS5882543A (ja) レジンモ−ルド型半導体装置
JP2000091493A (ja) 表面実装型半導体装置
JPH05211261A (ja) 半導体装置
JPH02170454A (ja) リードフレーム
JPH04174546A (ja) 銅合金製半導体リードフレームの製造方法
JPS60149155A (ja) 半導体装置の製造方法およびそれに使用されるリ−ドフレ−ム
JPS6347343B2 (ja)
JPS63202944A (ja) リ−ドフレ−ム
JP2011014691A (ja) リードフレーム及び半導体装置の製造方法