JPS60182748A - 半導体装置のパツケ−ジおよびその組立方法 - Google Patents

半導体装置のパツケ−ジおよびその組立方法

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JPS60182748A
JPS60182748A JP59037845A JP3784584A JPS60182748A JP S60182748 A JPS60182748 A JP S60182748A JP 59037845 A JP59037845 A JP 59037845A JP 3784584 A JP3784584 A JP 3784584A JP S60182748 A JPS60182748 A JP S60182748A
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sealing glass
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綿奈部 章
Isato Usami
宇佐美 勇人
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Fujitsu Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (a)0発明の技術分野 本発明は半導体装置等に用いられるサーディップ・シー
ルのパッケージに関する。
(b)、技術の背景 集積回路の高集積化、高機能化に伴い、半導体チップを
収容するパッケージの外部接続端子(ビン)数は増え、
パンケージは大型のものが用いられる場合が多くなって
きた。
第1図は半導体チップを搭載したパンケージの断面図で
、パッケージの平面図における矩形の短辺に平行な断面
である。図において1はベース、2はキャンプ、3,4
は低融点ガラス、5はチップ、6はリード・ベース、7
はボンディング・ワイヤを示す。
リードベース6は、外部接続用端子で封止ガラスと膨張
係数の整合がとれた金属を用い、パンケージ内に搭載し
た半導体チップとポンディング・ワイヤ7により接続す
る。
このようなパッケージのキャンプとベースを重ねて封止
を行う場合、封止ガラス3によりベース1に融着された
リードベース6が封止時の加熱により動き、ボンディン
グ・ワイヤ7が切断されたり、引っ張られたり、或いは
たるんだりして半導体素子の信頼性を著しく阻害する。
近年パッケージが大型化されるに伴い、封着面内のリー
ドの長さが大きくなり、またリードの数も増えるため、
この影響を受け易くなった。
(C)、従来技術と問題点 従来はベースに被着された封止ガラスとキヤ・7プに被
着された封止ガラスは同じ融点のものが用いられていた
。従って封止時にベース側の封止ガラスも溶融状態にな
り、リードベースが動いて前記のような障害をきたす。
このような障害を防ぐため、封止温度を低めにして、リ
ードベースの動きを防止すれば封止状態が悪くなり、極
めてクリティカルな封止条件が要求される。
(d)0発明の目的 本発明の目的は従来技術の有する上記の欠点を除去し、
キャンプとチップが搭載′されたベースを封止する際に
、ベースの封止用低融点ガラスに融着されたリードベー
スが動かないような構造を有するパッケージを提供する
ことにある。
(e)0発明の構成 上記の目的は本発明によれば、 ■、半導体チップを搭載するベースと、該ベース周辺に
被着される第1の封止ガラスと、該ベース上に封着され
て該半導体チップを封止するキャップと、該キャップ周
辺に被着され該第1の封止ガラスより軟化点の低い第2
の封止ガラスとよりなり、該ベースと該キャップがリー
ドフレームを介在させて、該第1.第2の封止ガラスに
より封止されてなることを特徴とする半導体装置のパッ
ケージ。
2、半導体チップが搭載されるベースの周辺に被着され
た第1の封止ガラス上に第1の温度でリードフレームを
融着する工程と、周辺に該第1の封止ガラスより軟化点
の低い第2の封止ガラスが被着されたキャンプを該第1
の温度より低い第2の温度で該ベースに封止する工程と
を有することを特徴とする半導体装置のパッケージの組
立方法を提供することによって達成される。
本発明によるパッケージは、キャンプに被着した低い軟
化点の封止ガラスに合わせた温度で封止を行う。
一般にガラスは非結晶性固体で、′冷却または加熱時、
一定の凝固点または融点を示さないので、ここでは粘度
が成る一定値になる温度である軟化点を用いる。
低融点ガラスは金属、ガラス、セラミックス等を低温で
接着できるので、電子管、半導体素子、集積回路等の封
止に用いられている。
その成分は、母体ガラスとしてPb0(75〜85%)
、B203(8〜18%)を主成分として5i02 、
ZnO,へ1203等を含む。これに熱膨張係数を小さ
くし、粘性を調節するためフィラーとしてベータ・ニー
クリップタイト(Li20・八1203 ・2SiOz
 )を混入する。
低融点ガラスの封止温度は上記母体ガラスの成分を調節
することにより、300〜6oo℃のものが得られる。
(f)8発明の実施例 本発明の一実施例として、ベース用の封止ガラスとして
軟化点が400℃の低融点ガラスを用い、キャンプ封止
ガラスとして軟化点が350 ’cの低融点ガラスを用
いる。
第2図にパンケージと半導体装置のマウントの工程図を
示す。
まずリードベース付げにおいて、ベースに軟化点が40
0℃の低融点ガラスを用いリードベースを450〜50
0℃で融着する。
つぎにチップ付けにおいて、半導体チップをベースに4
00〜450″Cで蝋付けを行う。
ワイヤ付げにおいて、ボンディング・ワイヤをボンディ
ングにより半導体チップのバンドと、リードベース間を
結ぶ。
最後に軟化点が350 ”Cの低融点ガラスを被着した
キャンプを用い、400〜450 ”cで封止を行う。
(g)0発明の詳細 な説明したように本発明によれば、キヤ・7プとチップ
が搭載されたベースを封止する際に、ベースの封止用低
融点ガラスに融着されたり一ドベースが動かないような
構造を有するパンケージを提供することができる。
【図面の簡単な説明】
第1図はパッケージの断面図、第2図はパッケージと半
導体装置のマウントの工程図を示す。 図において1はベース、2はキャップ、3.4は低融点
ガラス、5はチップ、6はリード・ベース、7はボンデ
ィング・ワイヤを示す。 革/因 とン?) とb) 第2図

Claims (1)

  1. 【特許請求の範囲】 1、半導体チップを搭載するベースと、該ベース周辺に
    被着される第1の封止ガラスと、該ベース上に封着され
    て該半導体チップを封止するキャップと、該キャンプ周
    辺に被着され該第1の封止ガラスより軟化点の低い第2
    の封止ガラスとよりなり、該ベースと該キャップがリー
    ドフレームを介在させて、該第1.第2の封止ガラスに
    より封止されてなることを特徴とする半導体装置のパン
    ケージ。 2、半導体チップが搭載されるベースの周辺に被着され
    た第1の封止ガラス上に第1の温度でリードフレームを
    融着する工程と、周辺に該第1の封止ガラスより軟化点
    の低い第2の封止ガラスが被着されたキャップを該第1
    の温度より低い第2の温度で該ベースに封止する工程と
    を有することを特徴とする半導体装置のパンケージの組
    立方法。
JP59037845A 1984-02-29 1984-02-29 半導体装置のパツケ−ジおよびその組立方法 Granted JPS60182748A (ja)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62128155A (ja) * 1985-11-29 1987-06-10 Fujitsu Ltd 半導体装置の製造方法
JPH02127039U (ja) * 1989-03-29 1990-10-19
JPH02303053A (ja) * 1989-05-17 1990-12-17 Sumitomo Special Metals Co Ltd 半導体パッケージの製造方法
JPH02303052A (ja) * 1989-05-17 1990-12-17 Sumitomo Special Metals Co Ltd 半導体パッケージ

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4834355A (ja) * 1971-09-07 1973-05-18
JPS58138353U (ja) * 1982-03-12 1983-09-17 京セラ株式会社 半導体パツケ−ジ
JPS5936947A (ja) * 1982-08-25 1984-02-29 Mitsubishi Electric Corp 半導体装置
JPS5936947U (ja) * 1982-09-02 1984-03-08 株式会社クボタ コンバイン

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5936947B2 (ja) * 1976-12-22 1984-09-06 日石三菱株式会社 ポリ酢酸ビニル組成物

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4834355A (ja) * 1971-09-07 1973-05-18
JPS58138353U (ja) * 1982-03-12 1983-09-17 京セラ株式会社 半導体パツケ−ジ
JPS5936947A (ja) * 1982-08-25 1984-02-29 Mitsubishi Electric Corp 半導体装置
JPS5936947U (ja) * 1982-09-02 1984-03-08 株式会社クボタ コンバイン

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62128155A (ja) * 1985-11-29 1987-06-10 Fujitsu Ltd 半導体装置の製造方法
JPH02127039U (ja) * 1989-03-29 1990-10-19
JPH02303053A (ja) * 1989-05-17 1990-12-17 Sumitomo Special Metals Co Ltd 半導体パッケージの製造方法
JPH02303052A (ja) * 1989-05-17 1990-12-17 Sumitomo Special Metals Co Ltd 半導体パッケージ

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