JPS60151767A - デイジ−チエ−ン回路 - Google Patents
デイジ−チエ−ン回路Info
- Publication number
- JPS60151767A JPS60151767A JP664984A JP664984A JPS60151767A JP S60151767 A JPS60151767 A JP S60151767A JP 664984 A JP664984 A JP 664984A JP 664984 A JP664984 A JP 664984A JP S60151767 A JPS60151767 A JP S60151767A
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- JP
- Japan
- Prior art keywords
- circuit
- signal
- station
- line
- data
- Prior art date
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- Granted
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/14—Handling requests for interconnection or transfer
- G06F13/36—Handling requests for interconnection or transfer for access to common bus or bus system
- G06F13/368—Handling requests for interconnection or transfer for access to common bus or bus system with decentralised access control
- G06F13/37—Handling requests for interconnection or transfer for access to common bus or bus system with decentralised access control using a physical-position-dependent priority, e.g. daisy chain, round robin or token passing
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明はデータ通信における通信制御装置に係り、とく
にディジーチェーン回路に関する。
にディジーチェーン回路に関する。
第１図は従来から使用されているディジーチェーン回路
の主要部を示す構成図である。親局からの送信データを
伝送する線１０１．１つの子局の受信ュータを伝送する
線１０２および拡張されるディジーチェーンの親局から
の送信データを伝送する線１０３とが一点で結合されて
いる。同様にして、子局から親局への送信データを伝送
する緋１１１は、１つの子局からの送信データを伝送す
るｓ１＋２によひ拡張されたディジーチェーンの他の子
局からの送信データを伝送する線１１３を入力端に依続
した論理和回路１２０の出力端に接続されている。
の主要部を示す構成図である。親局からの送信データを
伝送する線１０１．１つの子局の受信ュータを伝送する
線１０２および拡張されるディジーチェーンの親局から
の送信データを伝送する線１０３とが一点で結合されて
いる。同様にして、子局から親局への送信データを伝送
する緋１１１は、１つの子局からの送信データを伝送す
るｓ１＋２によひ拡張されたディジーチェーンの他の子
局からの送信データを伝送する線１１３を入力端に依続
した論理和回路１２０の出力端に接続されている。
すなわち、図示せぬ親局と子局間の通信は、前記親１局
が線１０１を介してポーリングを行い、指定された前記
子局は、そのポーリングに対し、線１１１を介して応答
するといり半２重通信のシーケンスを用いているもので
ある。
が線１０１を介してポーリングを行い、指定された前記
子局は、そのポーリングに対し、線１１１を介して応答
するといり半２重通信のシーケンスを用いているもので
ある。
しかしながら、このように構成された従来のディジーチ
ェーン回路では、親局は唯１つだけしか設置することが
できなかった。これは、親局が２つ以上設置されていた
場合、子局との通信を確立しようとして独立にポーリン
グを行うと、データの衝突が発生してしまうからである
。
ェーン回路では、親局は唯１つだけしか設置することが
できなかった。これは、親局が２つ以上設置されていた
場合、子局との通信を確立しようとして独立にポーリン
グを行うと、データの衝突が発生してしまうからである
。
本発明は、複数の通信局間をカスケード接続するディジ
ーチェーン回路において、前記各通信局の送信要求信号
を入力としてそのうちの１つの局への送信可信号をＯＮ
とする送信優先順位決定回路と、前記各通信局の送信デ
ータ信号を他局に分岐するデータ分岐回路と、カスケー
ド接続された所定の通信局で送信要求信号を送信可信号
として折り返すスイッチとを備え、親局が２つ以上設置
され、独立してポーリングが行われても、データの衝突
が発生しないようにしたものである。
ーチェーン回路において、前記各通信局の送信要求信号
を入力としてそのうちの１つの局への送信可信号をＯＮ
とする送信優先順位決定回路と、前記各通信局の送信デ
ータ信号を他局に分岐するデータ分岐回路と、カスケー
ド接続された所定の通信局で送信要求信号を送信可信号
として折り返すスイッチとを備え、親局が２つ以上設置
され、独立してポーリングが行われても、データの衝突
が発生しないようにしたものである。
第２図は本発明の一実施例を示すディジーチェーン回路
の構成図である。なお、このディジー千エーン回路によ
り接続される複数の通信局は図示しない。１は分岐局の
要求信号（以下Ｒ８と略称する）を伝送する線、２は優
先順位の高い局（以下高位局と略称する）からの信号几
Ｓを伝送する線、３は優先順位の低い局（以下低位局と
略称する）への分岐局の信号Ｒ８を含めての佃号几Ｓを
伝送する線である。１１は低位局に接続されるディジー
チェーン回路からの送信可信号（以下Ｃ８と略称する）
を伝送する線、１２は分岐局への信号Ｃ８を伝送する線
、１３は高位局への信号Ｃ８を伝送する線である。２０
３はこのディジーチェーン回路がカスケード接続された
低位局の端に存在する場合オンにし、高位局からの信号
）１８を低位局からの信号Ｃ８として折り返す終端用ス
イッチである。なお、２０４，２０５はフリップフロッ
プを構成するＮＡＮＤ回路であり、線１１．想１．ｉｆ
ｉ！２を入力端に接続し、線１２．線１３を出力端に接
続している。２０６はＯＲ回路であり、線１．線２を入
力端に接続し、線３を出力端に接続している。
の構成図である。なお、このディジー千エーン回路によ
り接続される複数の通信局は図示しない。１は分岐局の
要求信号（以下Ｒ８と略称する）を伝送する線、２は優
先順位の高い局（以下高位局と略称する）からの信号几
Ｓを伝送する線、３は優先順位の低い局（以下低位局と
略称する）への分岐局の信号Ｒ８を含めての佃号几Ｓを
伝送する線である。１１は低位局に接続されるディジー
チェーン回路からの送信可信号（以下Ｃ８と略称する）
を伝送する線、１２は分岐局への信号Ｃ８を伝送する線
、１３は高位局への信号Ｃ８を伝送する線である。２０
３はこのディジーチェーン回路がカスケード接続された
低位局の端に存在する場合オンにし、高位局からの信号
）１８を低位局からの信号Ｃ８として折り返す終端用ス
イッチである。なお、２０４，２０５はフリップフロッ
プを構成するＮＡＮＤ回路であり、線１１．想１．ｉｆ
ｉ！２を入力端に接続し、線１２．線１３を出力端に接
続している。２０６はＯＲ回路であり、線１．線２を入
力端に接続し、線３を出力端に接続している。
したがって、線１．線２を介して伝送される信号Ｒ８の
遷移状態と線１１を介して伝送される信号Ｃ８の状態に
よシ、前記フリップフロップの状態が決定され、線１２
．線１３へ信号Ｃ８を出力する。２１．２２および２３
は、それぞれ高位局からのデータ、分岐局からのデータ
および低位局へのデータを伝送する巌であシ、３１．３
２および３３は、それぞれ尚位局へのデータ、分岐局へ
のデータおよび低位局からのデータ葡伝送する線である
。なお、２０７，２０８および２０９はＯＲ回路であり
、線２１．線２２を入力端に接続するＯＲ回路２０７の
出力端は線２３に接続され、［２２，祿３３を入力端に
接続するＯ Ｒ回路２０８の出力端は線３１に接続され
、線２１．線３３を入力端に接続するＯＲ回路２０９の
出力端は巌３２に接続される。したがって、分岐局から
のデータはＯＲ回路２０７．０）１．回路２０８を介し
て送信され、他局のデータはＯＲ回路２０９を介して受
信さ九る。なお、２０１は送信優先順位決定回路、２０
２は送信受信データ分岐総合回路を示す。
遷移状態と線１１を介して伝送される信号Ｃ８の状態に
よシ、前記フリップフロップの状態が決定され、線１２
．線１３へ信号Ｃ８を出力する。２１．２２および２３
は、それぞれ高位局からのデータ、分岐局からのデータ
および低位局へのデータを伝送する巌であシ、３１．３
２および３３は、それぞれ尚位局へのデータ、分岐局へ
のデータおよび低位局からのデータ葡伝送する線である
。なお、２０７，２０８および２０９はＯＲ回路であり
、線２１．線２２を入力端に接続するＯＲ回路２０７の
出力端は線２３に接続され、［２２，祿３３を入力端に
接続するＯ Ｒ回路２０８の出力端は線３１に接続され
、線２１．線３３を入力端に接続するＯＲ回路２０９の
出力端は巌３２に接続される。したがって、分岐局から
のデータはＯＲ回路２０７．０）１．回路２０８を介し
て送信され、他局のデータはＯＲ回路２０９を介して受
信さ九る。なお、２０１は送信優先順位決定回路、２０
２は送信受信データ分岐総合回路を示す。
このように構成した一実施例によると、送信要求のある
通信局は信号Ｒ８をオンにし、ついで信号Ｃ８がオフか
らオンに遷移すれば送信データを送出ｌ〜、送信を終了
すれば信号Ｒ８をオフにずぶ手順にて通信を行うことに
なる。
通信局は信号Ｒ８をオンにし、ついで信号Ｃ８がオフか
らオンに遷移すれば送信データを送出ｌ〜、送信を終了
すれば信号Ｒ８をオフにずぶ手順にて通信を行うことに
なる。
第３図はこの一実施例によるディジーチェーン回路をカ
スケード接続した場合について示した構成図である。３
０１，３０２および３０３はそれぞれ低位局１分岐局お
よび高位局であシ、４０１ 、４０２および４０３はそ
れぞれ婬２図に示した本発明のディジーチェーン回路で
ある。なお、信号ＲＤ、信号ＳＤはそれぞれ分岐局への
データ分岐局からのデータを示す。
スケード接続した場合について示した構成図である。３
０１，３０２および３０３はそれぞれ低位局１分岐局お
よび高位局であシ、４０１ 、４０２および４０３はそ
れぞれ婬２図に示した本発明のディジーチェーン回路で
ある。なお、信号ＲＤ、信号ＳＤはそれぞれ分岐局への
データ分岐局からのデータを示す。
さて、このように構成した場合の動作について説明する
。いま、低位局３ｏ１．高位局３０３に送信要求がなく
、線５１．線５３の信号ｋＬ８がオフであシ、分岐局３
０２に送信要求がある場合、線５２の信号１（Ｓをオン
にすると、前述の通シ、この信号Ｒ８はディジーチェー
ン回路４０１の終端用スイッチ３０４で信号Ｃ８に折シ
返され、線６１の信号Ｃ８はオンとなる。線６１の信号
ｃｓがオンになると、線７２の信号Ｃ８がオンになシ、
線６２の信号Ｃ８はオフのままを保持する。一旦線７１
の信号Ｃ８がオンになると、線５２の信号Ｒ８をオフに
するまで線５１の信号Ｒ’Ｓおよび線５３の信号几Ｓを
オンにしても線７１の信号Ｃ８および線７３の信号Ｃ８
はオンにならない。
。いま、低位局３ｏ１．高位局３０３に送信要求がなく
、線５１．線５３の信号ｋＬ８がオフであシ、分岐局３
０２に送信要求がある場合、線５２の信号１（Ｓをオン
にすると、前述の通シ、この信号Ｒ８はディジーチェー
ン回路４０１の終端用スイッチ３０４で信号Ｃ８に折シ
返され、線６１の信号Ｃ８はオンとなる。線６１の信号
ｃｓがオンになると、線７２の信号Ｃ８がオンになシ、
線６２の信号Ｃ８はオフのままを保持する。一旦線７１
の信号Ｃ８がオンになると、線５２の信号Ｒ８をオフに
するまで線５１の信号Ｒ’Ｓおよび線５３の信号几Ｓを
オンにしても線７１の信号Ｃ８および線７３の信号Ｃ８
はオンにならない。
線５１の佃号几Ｓおよび線５３の信号Ｒ８がオンしだま
すの状態で緋５２の信号几Ｓがオンからオフに遷移する
と、ＮＡＮＤ回路３０５ 、３０６からなるフリップフ
ロップが反転し、線７２の信号Ｃ８がオフとなり、線６
２の信号Ｃ８がオンとなシ、線７２の信号Ｃ８がオンと
なる。
すの状態で緋５２の信号几Ｓがオンからオフに遷移する
と、ＮＡＮＤ回路３０５ 、３０６からなるフリップフ
ロップが反転し、線７２の信号Ｃ８がオフとなり、線６
２の信号Ｃ８がオンとなシ、線７２の信号Ｃ８がオンと
なる。
このようにして、複数の要求償号几Ｓが独してオンにな
っても、送信可信号Ｃ８はただ１局に対してのみオンと
なるのである。
っても、送信可信号Ｃ８はただ１局に対してのみオンと
なるのである。
本発明は、ディジーチェーン回路に送信優先順位決定回
路、データ分岐回路および終端用スイッチを設け、独立
に送信要求を出すディジーチェーンの各通信局に対し、
データの衝突がない通信を可能としたものであり、スル
ープットの向上が図れるという効果がある。
路、データ分岐回路および終端用スイッチを設け、独立
に送信要求を出すディジーチェーンの各通信局に対し、
データの衝突がない通信を可能としたものであり、スル
ープットの向上が図れるという効果がある。
第１図は従来のディジーチェーン回路を示す構成図、第
２図は本発明の一実施例を示すディジーチェーン回路の
構成図、第３図は第２図に示したディジーチェーン回路
をカスケード接続した場合の構成図である。 １．２．３−拳９・信号ＦＬ８の伝送線、１１゜１２．
１３・・・・信号ＣＳの伝送線、２１，２２．２３，３
１，３２．３３−・１会データの伝送線、２０１・Φ・
・送信優先順位決定回路、２０２・会Φ・送信受信デー
タ分岐回路、２０３・拳・・スイッチ、２０４ 、２０
５・争・、ＮＡＮＤ回路、２〃６゜２０７ 、２０８
、２０９−−・拳ＯＲ回路。 で−≧ ゝ＼−ノ
２図は本発明の一実施例を示すディジーチェーン回路の
構成図、第３図は第２図に示したディジーチェーン回路
をカスケード接続した場合の構成図である。 １．２．３−拳９・信号ＦＬ８の伝送線、１１゜１２．
１３・・・・信号ＣＳの伝送線、２１，２２．２３，３
１，３２．３３−・１会データの伝送線、２０１・Φ・
・送信優先順位決定回路、２０２・会Φ・送信受信デー
タ分岐回路、２０３・拳・・スイッチ、２０４ 、２０
５・争・、ＮＡＮＤ回路、２〃６゜２０７ 、２０８
、２０９−−・拳ＯＲ回路。 で−≧ ゝ＼−ノ
Claims (3)
- （１）複数の通信局間をカスケード接続するディジーチ
ェーン回路において、前記各通信局の送信要求信号を入
力としてそのうちの１つの局への送信可信号をオンとす
る送信優先順位決定回路と、前記各通信局の送信データ
信号を他局に分岐するデータ分岐回路と、カスケード接
続された所定の通信局で送信要求信号を送信可信号とし
て折シ返すスイッチとから構成されることを特徴とする
ディジーチェーン回路。 - （２）送（Ｓ優先順位決定回路がフリップフロップ回路
およびオア回路とからなることを特徴とする特許請求の
範囲第１項記載のディジーチェーン回路。 - （３）データ分岐回路がオア回路からなることを特徴と
する特許請求の範囲第１項記載のディジーチェーン回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP664984A JPS60151767A (ja) | 1984-01-18 | 1984-01-18 | デイジ−チエ−ン回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP664984A JPS60151767A (ja) | 1984-01-18 | 1984-01-18 | デイジ−チエ−ン回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60151767A true JPS60151767A (ja) | 1985-08-09 |
| JPH0115103B2 JPH0115103B2 (ja) | 1989-03-15 |
Family
ID=11644221
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP664984A Granted JPS60151767A (ja) | 1984-01-18 | 1984-01-18 | デイジ−チエ−ン回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60151767A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62267850A (ja) * | 1986-05-15 | 1987-11-20 | Pfu Ltd | シリアルインタフエ−ス衝突検出方式 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5172244A (ja) * | 1974-12-20 | 1976-06-22 | Hitachi Ltd | |
| JPS5329463A (en) * | 1976-08-30 | 1978-03-18 | Hitachi Maxell Ltd | Lublicant to be used when manufacturing zinc can for dry battery |
-
1984
- 1984-01-18 JP JP664984A patent/JPS60151767A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5172244A (ja) * | 1974-12-20 | 1976-06-22 | Hitachi Ltd | |
| JPS5329463A (en) * | 1976-08-30 | 1978-03-18 | Hitachi Maxell Ltd | Lublicant to be used when manufacturing zinc can for dry battery |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62267850A (ja) * | 1986-05-15 | 1987-11-20 | Pfu Ltd | シリアルインタフエ−ス衝突検出方式 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0115103B2 (ja) | 1989-03-15 |
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