JPS5962926A - 定電流回路 - Google Patents
定電流回路Info
- Publication number
- JPS5962926A JPS5962926A JP57170874A JP17087482A JPS5962926A JP S5962926 A JPS5962926 A JP S5962926A JP 57170874 A JP57170874 A JP 57170874A JP 17087482 A JP17087482 A JP 17087482A JP S5962926 A JPS5962926 A JP S5962926A
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- JP
- Japan
- Prior art keywords
- current
- circuit
- voltage
- constant current
- constant
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/10—Regulating voltage or current
- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/462—Regulating voltage or current wherein the variable actually regulated by the final control device is dc as a function of the requirements of the load, e.g. delay, temperature, specific voltage/current characteristic
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- Amplifiers (AREA)
- Continuous-Control Power Sources That Use Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は定電流回路に関し、特にｌ２Ｌ（Ｉｎｔｅｇｒ
ａｔｅｄＩｎｊｅｃｔｉｏｎ Ｌｏｇｉｃ ）回路を用
いた定電流回路に関する。
ａｔｅｄＩｎｊｅｃｔｉｏｎ Ｌｏｇｉｃ ）回路を用
いた定電流回路に関する。
Ｉ２Ｌ２Ｌを用いた定電流回路は、回路構成が簡単であ
る、等の利点を有１２ている。
る、等の利点を有１２ている。
しかし、本願発明に先立ち本発明者が検討したところに
よれば、Ｉ”Ｌ回路においてインジェクション電流を一
定にしても、インバース直流電流増幅率−βｉΩ誤差が
犬であるため、出力定電流■χが変動することが判明し
た。このため、Ｉ’Ｌ回路で構成された定電流回路をア
ナログ回路に用いた場合は、ノイズ発生の一因となる。
よれば、Ｉ”Ｌ回路においてインジェクション電流を一
定にしても、インバース直流電流増幅率−βｉΩ誤差が
犬であるため、出力定電流■χが変動することが判明し
た。このため、Ｉ’Ｌ回路で構成された定電流回路をア
ナログ回路に用いた場合は、ノイズ発生の一因となる。
発振回路に用いた場合は、発振周波数が不安定になる。
また、差動増幅回路等に用いた場合、直流オフセント電
圧が大になる、等の欠陥が明らかにされた。
圧が大になる、等の欠陥が明らかにされた。
本発明は上述の如き実状からなされたものであシ、その
目的とするところは、Ｉ’Ｌ回路で構成され、かつ出力
定電流の変動を防止するようにした定電流回路を提供す
ることにある。
目的とするところは、Ｉ’Ｌ回路で構成され、かつ出力
定電流の変動を防止するようにした定電流回路を提供す
ることにある。
以下、図面を参照して本発明の一実施例を述べる。
定電圧電源回路１は、バイポーラトランジスタで構成さ
れている。＋ｖｏｃ 電源から、抵抗Ｉｔ、。
れている。＋ｖｏｃ 電源から、抵抗Ｉｔ、。
ツェナーダイオードＤＩ ＩダイオードＤｔ 、Ｄ
ｓを介してアースラインへ電流が流れることにより、ト
ランジスタＱ、のベース電圧ｖＢＦ、１が決定される。
ｓを介してアースラインへ電流が流れることにより、ト
ランジスタＱ、のベース電圧ｖＢＦ、１が決定される。
トランジスタＱ、がオン状態に動作し、トランジスタＱ
ｔ ＋ Ｑ＋ ＋抵抗Ｒ，を介してアースラインへ
’Ｉ、流が流れる。トランジスタＱｔ 、Ｑ３は。
ｔ ＋ Ｑ＋ ＋抵抗Ｒ，を介してアースラインへ
’Ｉ、流が流れる。トランジスタＱｔ 、Ｑ３は。
カレントミラー回路に１１″・Ｙ成されているので、ト
ランジスタＱ２を流れる′１；ｂ流と同一の電流が、ト
ランジスタＱ８を流れる。トランジスタＱ３を流れる電
流によって、抵抗Ｒ３に電圧降下が生じ、この電圧が基
準電圧として電圧比較器２の第１の入力端子へ供給され
る。なお、上記トランジスタＱ。
ランジスタＱ２を流れる′１；ｂ流と同一の電流が、ト
ランジスタＱ８を流れる。トランジスタＱ３を流れる電
流によって、抵抗Ｒ３に電圧降下が生じ、この電圧が基
準電圧として電圧比較器２の第１の入力端子へ供給され
る。なお、上記トランジスタＱ。
〜Ｑ、は、Ｉ２Ｌ回路を構成するインバーストランジス
タに比較して、電流増幅率ｈＦ、Ｅ が安定している
。従って、上ｎＣ基準電圧は極めて安定している。
タに比較して、電流増幅率ｈＦ、Ｅ が安定している
。従って、上ｎＣ基準電圧は極めて安定している。
電流源３ｉ、ｌ：、Ｉ２Ｌ回路へ供給されるインジェク
ション電流Ｉ ｉ ｎ ｊを発生するだめのものであり
。
ション電流Ｉ ｉ ｎ ｊを発生するだめのものであり
。
その電流量は電圧比較器２の出力信号によ〜て制御され
る。トランジスタＱ ｕ ＋ Ｑｌｔ ＋ Ｑｔｓ ＋
Ｑ１４（ｒ：Ｊ、Ｉ２Ｌ回路を＄？￥成し、上記電流
源３の出力電流が。
る。トランジスタＱ ｕ ＋ Ｑｌｔ ＋ Ｑｔｓ ＋
Ｑ１４（ｒ：Ｊ、Ｉ２Ｌ回路を＄？￥成し、上記電流
源３の出力電流が。
インジェクション電流ｌ１ｎｊとしてトランジスタＱ
ｏのエミッタに供給される。このインジェクション電流
のほとんどはダイオード接続されたトランジスタＱ ＋
２に流れ、トランジスタＱ’＋２のベースにバイアス電
圧が発生する。このバイアス電圧によって、トランジス
タＱ＋３１Ｑ＋４の定電流Ｉｘが選定される。−また、
上記インジェクションｔＬｔ流の電流値に対応した電圧
信号がＱ、、Ｒ４によシ、電圧比較器２の第２の入力端
子へ供給される。
ｏのエミッタに供給される。このインジェクション電流
のほとんどはダイオード接続されたトランジスタＱ ＋
２に流れ、トランジスタＱ’＋２のベースにバイアス電
圧が発生する。このバイアス電圧によって、トランジス
タＱ＋３１Ｑ＋４の定電流Ｉｘが選定される。−また、
上記インジェクションｔＬｔ流の電流値に対応した電圧
信号がＱ、、Ｒ４によシ、電圧比較器２の第２の入力端
子へ供給される。
いま仮りに、インバータ４によってトランジスタＱ＋ｔ
＋ ＱＣｓ ＋ Ｑ１４０ベースが開放状態に変化し
たとする。トランジスタＱ Ｉｔ ＋’ Ｑ ｒｓ ＋
Ｑ ＋４に電流が流れ、トランジスタＱ＋ｓ ＋ Ｑ
１０がオン秋態に動作して、定電流Ｉｘが流れる。定’
（ｉ５．流Ｉｘは、トランジスタＱ １ｔ ＋ ＱＣｓ
＋ Ｑｌｔのインバース直流電流増幅率βｉによって
変化する。定電流Ｉｘの変化ハ、Ｒ４によって電圧変化
に変換されて１ｉＬ圧比較器２へ伝達される。電圧比較
器２は、２つの入力信号の電圧比較を行ない、電圧差に
対応した出力信号を電流源３に供給する。電流源３から
イ（Ｉられるインジェクション電流は、上記出力信号に
対応して増減する。この結果、トランジスタＱ ｌｔの
ベース・コレクタ電流と、トランジスタＱ Ｉｓ ＋
Ｑ１４のベース電流とが制御される。そして、トランジ
スタＱ１２ ＋ ＱＣｓ ＋ Ｑ１０のインノ（−ス直
流電流増幅率βｉＫ無関係な定宿、流Ｉｘが所定の電流
値に制御されり）。
＋ ＱＣｓ ＋ Ｑ１４０ベースが開放状態に変化し
たとする。トランジスタＱ Ｉｔ ＋’ Ｑ ｒｓ ＋
Ｑ ＋４に電流が流れ、トランジスタＱ＋ｓ ＋ Ｑ
１０がオン秋態に動作して、定電流Ｉｘが流れる。定’
（ｉ５．流Ｉｘは、トランジスタＱ １ｔ ＋ ＱＣｓ
＋ Ｑｌｔのインバース直流電流増幅率βｉによって
変化する。定電流Ｉｘの変化ハ、Ｒ４によって電圧変化
に変換されて１ｉＬ圧比較器２へ伝達される。電圧比較
器２は、２つの入力信号の電圧比較を行ない、電圧差に
対応した出力信号を電流源３に供給する。電流源３から
イ（Ｉられるインジェクション電流は、上記出力信号に
対応して増減する。この結果、トランジスタＱ ｌｔの
ベース・コレクタ電流と、トランジスタＱ Ｉｓ ＋
Ｑ１４のベース電流とが制御される。そして、トランジ
スタＱ１２ ＋ ＱＣｓ ＋ Ｑ１０のインノ（−ス直
流電流増幅率βｉＫ無関係な定宿、流Ｉｘが所定の電流
値に制御されり）。
ところで、トランジスタＱ＋ｓの出力端には、負荷とｊ
〜て’？５イｔｌｉ回路が接Ｌ’ｊ＋’、されるが、そ
の−例として差動増幅器５が接続８れた場合について述
べる。
〜て’？５イｔｌｉ回路が接Ｌ’ｊ＋’、されるが、そ
の−例として差動増幅器５が接続８れた場合について述
べる。
トランジスタＱ２１１Ｑ２２＋抵抗Ｒｏ 、Ｒ，、によ
って差ルυ増ｌＩす３Ｓ器５が第１・ｙ成されている。
って差ルυ増ｌＩす３Ｓ器５が第１・ｙ成されている。
入力端子Ｔ１＋Ｔ、に供給される入力信号の極性に対応
して、差動増幅動作が行われろ。この際、電流Ｉｘが上
述した定”Ｌ ？ｌｆｆ１回路によって所定の電流値に
制御されるので、上記差動増幅動作が正確に行われる。
して、差動増幅動作が行われろ。この際、電流Ｉｘが上
述した定”Ｌ ？ｌｆｆ１回路によって所定の電流値に
制御されるので、上記差動増幅動作が正確に行われる。
なお、Ｉ２Ｌ回路は、半導体集積回路を構成する同一チ
ップ上に他のバイポーラ回路と共存させるσとができる
。従って、音響用集積回路、或いはテレビジョン受像機
やＶ Ｔ Ｒ等に使用されるリニア（１８積回路に」二
記定電流回路を共存させて、簡便な回路＋：、ｙ成で正
確な回路動作を行わせることができる。
ップ上に他のバイポーラ回路と共存させるσとができる
。従って、音響用集積回路、或いはテレビジョン受像機
やＶ Ｔ Ｒ等に使用されるリニア（１８積回路に」二
記定電流回路を共存させて、簡便な回路＋：、ｙ成で正
確な回路動作を行わせることができる。
また、第１図に示す定電圧電源１は、特別に設ける必要
がなく、他のバイポーラ回路において使用される定１］
Ｌ圧電源を利用することができる。
がなく、他のバイポーラ回路において使用される定１］
Ｌ圧電源を利用することができる。
更に、市、流源３に接続されるＩ２Ｌ回路は１回路のみ
でなく、複数のＩ２Ｌ回路を接続することもできる。
でなく、複数のＩ２Ｌ回路を接続することもできる。
以上に述べた如く、本発明を適用した定電流回路によれ
ば、Ｉ’Ｌ回路を構成するトランジスタの直流電流増幅
率の誤差に対応して出力電流を所定の定電流に制御し得
る。また、本発明を適用した定電流回路は、四−チップ
上に他のバイポーラ回路とともに共存させることができ
、半導体集積回路の集積度が向上する。
ば、Ｉ’Ｌ回路を構成するトランジスタの直流電流増幅
率の誤差に対応して出力電流を所定の定電流に制御し得
る。また、本発明を適用した定電流回路は、四−チップ
上に他のバイポーラ回路とともに共存させることができ
、半導体集積回路の集積度が向上する。
第１図は本発明の一実施例を示す定電流回路の回路図で
ある。 ｌ・・定電圧電源、２・・・電圧比較器、３・・電流源
、Ｑ Ｉｔ Ｉ Ｑｌｔ ＋ ＱＣｓ・・・■２Ｌ回路
を構成するトランジスタ、Ｉｘ・・出力矩、流。
ある。 ｌ・・定電圧電源、２・・・電圧比較器、３・・電流源
、Ｑ Ｉｔ Ｉ Ｑｌｔ ＋ ＱＣｓ・・・■２Ｌ回路
を構成するトランジスタ、Ｉｘ・・出力矩、流。
Claims (1)
- １、 Ｉ’Ｌ回路のインジェクション電流（ｌ１ｎｊ
）に応答した定電流（Ｉｘ）に対応した信号を比較器
（２）の一方の入力端子に印加せしめ、基準信号を上記
比較器（２）の他方の入力端子に印加するとともに、上
記比較器（２）の出力信号によって上記インジェクショ
ン電流（ｌ１ｎｊ ）の電流値を制御することによって
、上記定電流（Ｉｘ）の電流値を上記基準信号に応じた
所定の値に制御せしめてなるこ吉を特徴上する定電流回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57170874A JPS5962926A (ja) | 1982-10-01 | 1982-10-01 | 定電流回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57170874A JPS5962926A (ja) | 1982-10-01 | 1982-10-01 | 定電流回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5962926A true JPS5962926A (ja) | 1984-04-10 |
Family
ID=15912910
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57170874A Pending JPS5962926A (ja) | 1982-10-01 | 1982-10-01 | 定電流回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5962926A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6370550A (ja) * | 1986-09-12 | 1988-03-30 | Nec Corp | 半導体集積回路装置 |
| US4999567A (en) * | 1988-12-21 | 1991-03-12 | Nec Corporation | Constant current circuit |
| EP0483125A2 (en) * | 1988-06-30 | 1992-04-29 | ALCATEL BELL Naamloze Vennootschap | Current-source |
-
1982
- 1982-10-01 JP JP57170874A patent/JPS5962926A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6370550A (ja) * | 1986-09-12 | 1988-03-30 | Nec Corp | 半導体集積回路装置 |
| JPH0565059B2 (ja) * | 1986-09-12 | 1993-09-16 | Nippon Electric Co | |
| EP0483125A2 (en) * | 1988-06-30 | 1992-04-29 | ALCATEL BELL Naamloze Vennootschap | Current-source |
| US4999567A (en) * | 1988-12-21 | 1991-03-12 | Nec Corporation | Constant current circuit |
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