JPS59205717A - 半導体集積回路の低抵抗接触生成方法 - Google Patents
半導体集積回路の低抵抗接触生成方法Info
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- JPS59205717A JPS59205717A JP59081680A JP8168084A JPS59205717A JP S59205717 A JPS59205717 A JP S59205717A JP 59081680 A JP59081680 A JP 59081680A JP 8168084 A JP8168084 A JP 8168084A JP S59205717 A JPS59205717 A JP S59205717A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、シリコンからなり内部および上部に回路を構
成する素子が作られている基板と、アルミニウム又はア
ルミニウム合金からなシ金属/リコン化物中間層を介し
て集積回路の拡散シリコン領域と接続されている外側接
触導体路面とを有する半導体集積回路の安定で、低抵抗
の接触生成方法に関する。
成する素子が作られている基板と、アルミニウム又はア
ルミニウム合金からなシ金属/リコン化物中間層を介し
て集積回路の拡散シリコン領域と接続されている外側接
触導体路面とを有する半導体集積回路の安定で、低抵抗
の接触生成方法に関する。
2μmの最小構造を特徴とする今日のV L S1集積
回路においては、アルミニウム導体路とその下に位置す
る単結晶または多結晶のシリコン領域との間の接触は一
般に、例えば約1μmの厚さの5j02 層のような絶
縁層の中にコンタクトホールをエツチングすることによ
って行われる。そのとき、多くはシリコンおよび銅がわ
ずか添加されたアルミニウムからなる導体路パターンが
形成され、その結果コンタクトホールにおいて金属とド
ーピングされたシリコンとの間の直接接触が生ずる。
回路においては、アルミニウム導体路とその下に位置す
る単結晶または多結晶のシリコン領域との間の接触は一
般に、例えば約1μmの厚さの5j02 層のような絶
縁層の中にコンタクトホールをエツチングすることによ
って行われる。そのとき、多くはシリコンおよび銅がわ
ずか添加されたアルミニウムからなる導体路パターンが
形成され、その結果コンタクトホールにおいて金属とド
ーピングされたシリコンとの間の直接接触が生ずる。
横方向構造寸法の縮小化が進歩するに伴ない、接触され
るべきドーピングシリコン領域の侵入深さも一般に小ざ
ぐなる。その深さは1μm構造のMO8回路においては
約02μmになる。他方、分離層の厚さおよびそれと共
にコンタクトホールの深さは、寄生容重をできるだけ小
さく保つために減らきないかわずか減らすだけという傾
向がある。1μmのコンタクトホールの大きさを持つM
O8集積回路に対しては、例えば1μmの分離層厚さか
望ましい値である。
るべきドーピングシリコン領域の侵入深さも一般に小ざ
ぐなる。その深さは1μm構造のMO8回路においては
約02μmになる。他方、分離層の厚さおよびそれと共
にコンタクトホールの深さは、寄生容重をできるだけ小
さく保つために減らきないかわずか減らすだけという傾
向がある。1μmのコンタクトホールの大きさを持つM
O8集積回路に対しては、例えば1μmの分離層厚さか
望ましい値である。
小さくされた集積回路(小さい侵入深さ、小さいコンタ
クトホール面積、深いコンタクトホール)におけるこの
状態によシ条件付けられて、従来技術で公知のアルミニ
ウム接触を使用する場合KanチャネルMO8集積回路
の例に対して次に列記するような一連の問題が生じる。
クトホール面積、深いコンタクトホール)におけるこの
状態によシ条件付けられて、従来技術で公知のアルミニ
ウム接触を使用する場合KanチャネルMO8集積回路
の例に対して次に列記するような一連の問題が生じる。
(1)拡散領域の層抵抗がより小さい侵入深さのために
上昇し1例えばMOSトランジスタの電流電圧の立上シ
特性を劣化させる。
上昇し1例えばMOSトランジスタの電流電圧の立上シ
特性を劣化させる。
(2) アルミニウム中にシリコンが過剰の際にta
コンタクトホール中にシリコンが析出することがある。
コンタクトホール中にシリコンが析出することがある。
この析出は、コンタクトホールの寸法が析出するシリコ
ン結晶の大きさの桁にあるほど小さいときか、析出が(
熱処理が後につづく場合K)コンタクトホール全体にエ
ピタキシャル成長するときには接触抵抗を高める結果に
なる。
ン結晶の大きさの桁にあるほど小さいときか、析出が(
熱処理が後につづく場合K)コンタクトホール全体にエ
ピタキシャル成長するときには接触抵抗を高める結果に
なる。
(3) アルミニウム中のシリコン含有量が低すぎる
場合には、コンタクトホール中にアルミニウムーシリコ
ン反応が起こる。反応帯域が拡散範囲の侵入深さまで局
部的のみにも達するならば、そこでpn接合で短絡され
る。侵入深ざが小さいときはこの問題が高まる。
場合には、コンタクトホール中にアルミニウムーシリコ
ン反応が起こる。反応帯域が拡散範囲の侵入深さまで局
部的のみにも達するならば、そこでpn接合で短絡され
る。侵入深ざが小さいときはこの問題が高まる。
(41’!Jt 流dコンタクトホール中おいて均一な
電流密度でアルミニウムから拡散領域内へ流れない。
電流密度でアルミニウムから拡散領域内へ流れない。
むしろ、拡散領域の侵入深さが小さい場合には大きくな
る電流集中がフンタクトホールの縁に起こる。局部的に
高まった電流密度は材料移動(エレクトロマイグレーシ
ョン)とコンタクトホール中の強い局部的温度上昇(信
頼性)をもたらすことがある。
る電流集中がフンタクトホールの縁に起こる。局部的に
高まった電流密度は材料移動(エレクトロマイグレーシ
ョン)とコンタクトホール中の強い局部的温度上昇(信
頼性)をもたらすことがある。
(5)1μmの範囲にある構造を有する集積回路におい
ては、アルεニウム導体路はワニスマスクの丁のアンダ
ーエツチングをできるだけ少なく保つために、異方性エ
ツチング法によシエッチングしなければならない。現在
公知のアルミニウムに対する異方性エツチング法(プラ
ズマエツチング、反応性イオンエツチング、反応性イオ
ンビームエツチング)は、シリコンモ、シカも比較でき
るほどのエツチング速度で、いずれにしろ−桁小さいエ
ツチング速度ではなくエツチングする性質を持つ。この
こさば、/リコンの上のアルミニウム層がエツチングさ
れるような場所(例えばコンタクトホールff域中)テ
、アルミニウムの完全な除去の後にそのFにあるシリコ
ンもまたわずかだけ除去される結果になる。拡散領域の
侵入深さが小さい場合に1・ま、これはpn接合まで貫
通エツチングされることがあり、それによってpn接合
の電気的な阻市特性が害される。集積回路中では確かに
、アルミニウム導体路がコンタクトホールを完全vc伊
い、その結果拡散領域の上述の貫通エツチングの場合が
実際には起こらないことが普通であるが、しかし唯一の
その上小さいマスク欠陥あるいはアルεニウムマスクの
位置合わせの際の若干太きすぎる位置合わせ誤差が上述
の結果と、場合によっては集積回路全体の不良に導くこ
とがある。
ては、アルεニウム導体路はワニスマスクの丁のアンダ
ーエツチングをできるだけ少なく保つために、異方性エ
ツチング法によシエッチングしなければならない。現在
公知のアルミニウムに対する異方性エツチング法(プラ
ズマエツチング、反応性イオンエツチング、反応性イオ
ンビームエツチング)は、シリコンモ、シカも比較でき
るほどのエツチング速度で、いずれにしろ−桁小さいエ
ツチング速度ではなくエツチングする性質を持つ。この
こさば、/リコンの上のアルミニウム層がエツチングさ
れるような場所(例えばコンタクトホールff域中)テ
、アルミニウムの完全な除去の後にそのFにあるシリコ
ンもまたわずかだけ除去される結果になる。拡散領域の
侵入深さが小さい場合に1・ま、これはpn接合まで貫
通エツチングされることがあり、それによってpn接合
の電気的な阻市特性が害される。集積回路中では確かに
、アルミニウム導体路がコンタクトホールを完全vc伊
い、その結果拡散領域の上述の貫通エツチングの場合が
実際には起こらないことが普通であるが、しかし唯一の
その上小さいマスク欠陥あるいはアルεニウムマスクの
位置合わせの際の若干太きすぎる位置合わせ誤差が上述
の結果と、場合によっては集積回路全体の不良に導くこ
とがある。
(e) 小さくされた集積回路のコンタクトホールは
比較的大きな深さく例えば1μm)の場合に極めて小さ
い横方向寸法(例えば1μm X 1μm)を有するこ
とがあるから、金属被覆の際にコンタクトホール中に陰
影効果のためにコンタクトホール中で垂直のコンタクト
ホール側面における著しく薄い金属被覆をもたらす。こ
の結果は集積回路の1言幀性を低下させる。この問題は
多層メタライジングが備えられるときにはなお重大にな
る。なぜならそのときは後につづく各層(金属層および
絶縁層)が状況によってはその問題に襲われるからであ
る。
比較的大きな深さく例えば1μm)の場合に極めて小さ
い横方向寸法(例えば1μm X 1μm)を有するこ
とがあるから、金属被覆の際にコンタクトホール中に陰
影効果のためにコンタクトホール中で垂直のコンタクト
ホール側面における著しく薄い金属被覆をもたらす。こ
の結果は集積回路の1言幀性を低下させる。この問題は
多層メタライジングが備えられるときにはなお重大にな
る。なぜならそのときは後につづく各層(金属層および
絶縁層)が状況によってはその問題に襲われるからであ
る。
第1項および第3項に述べられた問題は、例え1aθS
の論文から判るように、拡散区域上のシリコン化物層1
1Cよって除くか又は緩和することができる。
の論文から判るように、拡散区域上のシリコン化物層1
1Cよって除くか又は緩和することができる。
第2、第3、第4および第6項に述べられた問題[n
処するために、J、Appl= Phys、第39巻(
第11号)、900ないし902頁(1981年12月
)中の阻Va 1dyaの論文に、アルεニウム(+約
1%シリコン)合金の代りにn+ドープ多結晶シリコン
とアルミニウムの二重層を用いることが提案された。
処するために、J、Appl= Phys、第39巻(
第11号)、900ないし902頁(1981年12月
)中の阻Va 1dyaの論文に、アルεニウム(+約
1%シリコン)合金の代りにn+ドープ多結晶シリコン
とアルミニウムの二重層を用いることが提案された。
第6項に記述されたコンタクトホール中の著しく薄い金
属被覆の問題は、例えばIEEE Trans。
属被覆の問題は、例えばIEEE Trans。
K:1ectron、 Dev、 Fi D −20,
804頁(1973年)中のFl、 A、 Mo1in
eの論文において公知であるように、斜めのコンタクト
ホール側面の形成によっても減少させることができる。
804頁(1973年)中のFl、 A、 Mo1in
eの論文において公知であるように、斜めのコンタクト
ホール側面の形成によっても減少させることができる。
本発明は、上述の一連の問題のすべてを解決し、VLS
I集積回路においても安定で低抵抗の接触を製造するこ
とができる方法を提供することを目的とするものである
。
I集積回路においても安定で低抵抗の接触を製造するこ
とができる方法を提供することを目的とするものである
。
本発明によれば上述の問題点は次の特徴を有する方法に
よって解決することができる。
よって解決することができる。
a)接触形成のために備えられる集積回路の拡散領域に
、回路素子の最小寸法に適合した等しい大キサのコンタ
クトホールを設け、 b)場合によっては大面積の拡散領域において複数のそ
のような等しい大きさのコンタクトホールを設け、 C)コノタクトホール領域中の拡散領域を金属・ンリコ
ン化物層あるいは金属/金属シリコン化物二重層によっ
て覆い。
、回路素子の最小寸法に適合した等しい大キサのコンタ
クトホールを設け、 b)場合によっては大面積の拡散領域において複数のそ
のような等しい大きさのコンタクトホールを設け、 C)コノタクトホール領域中の拡散領域を金属・ンリコ
ン化物層あるいは金属/金属シリコン化物二重層によっ
て覆い。
d)外側の接触導体路面としてn+にドープされた多結
晶シリコンとアルミニウムとの二重層を用いる。
晶シリコンとアルミニウムとの二重層を用いる。
本発明の他の構成・、′i特許請求の範囲第2項以■に
記載されている。
記載されている。
次に図面によりコンタクトホール中の接触の層構造を詳
細に説明する。図において1はn+もしく1・よp+に
ドープされた領域2を含むンリコン基板、 :Jkd
1 n m×1μmの大きさのコンタクトホール(矢印
4参照)を含む8102層である。n+もしくはり+に
ドープされた領域2のフンタクトホール領域(4)の上
に、例えば50ないし1100nの層厚さで珪化白金層
5のような/リコン化物層が公知の方法で堆積され、そ
の上に減圧気相成長によってn+にドープされた多結晶
シリコン6が設けられる。コンタクトホール4がほとん
ど完全に多結晶シリコン6によって満たされ、その結果
はとんど平らな表面が生ずることが重要である。多結晶
シリコン層6aの厚さは5i02層3の上にコンタクト
ホール縁の長さの約半分に調整され、それは実施例です
ま約0.4ないし05μmである。続いてアルミニウム
層7が約1μmの)4 If サに蒸着される。フォト
マスクを設けた隣、導体路パターンが二重層(1μmの
アルミニウム、04ないし0.5μmの多結晶シリコン
)のエツチングによって画成される。
細に説明する。図において1はn+もしく1・よp+に
ドープされた領域2を含むンリコン基板、 :Jkd
1 n m×1μmの大きさのコンタクトホール(矢印
4参照)を含む8102層である。n+もしくはり+に
ドープされた領域2のフンタクトホール領域(4)の上
に、例えば50ないし1100nの層厚さで珪化白金層
5のような/リコン化物層が公知の方法で堆積され、そ
の上に減圧気相成長によってn+にドープされた多結晶
シリコン6が設けられる。コンタクトホール4がほとん
ど完全に多結晶シリコン6によって満たされ、その結果
はとんど平らな表面が生ずることが重要である。多結晶
シリコン層6aの厚さは5i02層3の上にコンタクト
ホール縁の長さの約半分に調整され、それは実施例です
ま約0.4ないし05μmである。続いてアルミニウム
層7が約1μmの)4 If サに蒸着される。フォト
マスクを設けた隣、導体路パターンが二重層(1μmの
アルミニウム、04ないし0.5μmの多結晶シリコン
)のエツチングによって画成される。
最初に挙げた問題1ないし6は本発明によれば次のよう
に除かれる。
に除かれる。
問題1: 金属シリコン化物5による。
問題2: アルミニウム層7の丁の多結晶シリコン層6
による6 かなシ高い伝導度を持つ層がコンタク トホール(4)中に存在する。エネル ゲティク的根拠からこの場合VCハコンタクトホール4
中にほとんど均一な電 流密度分布が生ずる。上にあげた1μm2の面積を持つ
18mの深さのコンタク トホールに対しては、コンタクトホー ル中のたて方向の電aK対する抵抗は、多結晶シリコン
の比抵抗をlOΩ儒 ツヂングの際に、コンタクトホール4 がエツチングマスクによって不完全に ングされる多結晶シリコン層6aよシ かなり厚いから、シリコン層5までの 貫通エツチングは顧慮されなくてもよ い。局部的なマスク欠陥あるいはマス クの位置合きの大きな誤差の場合に、 これらの欠陥あるいは誤差がは々んど コンタクトホールの寸法の大きさを持 つときにさえも、破滅的な結果が予期 されることはない7.接触抵抗だけが苔干高くなる。
による6 かなシ高い伝導度を持つ層がコンタク トホール(4)中に存在する。エネル ゲティク的根拠からこの場合VCハコンタクトホール4
中にほとんど均一な電 流密度分布が生ずる。上にあげた1μm2の面積を持つ
18mの深さのコンタク トホールに対しては、コンタクトホー ル中のたて方向の電aK対する抵抗は、多結晶シリコン
の比抵抗をlOΩ儒 ツヂングの際に、コンタクトホール4 がエツチングマスクによって不完全に ングされる多結晶シリコン層6aよシ かなり厚いから、シリコン層5までの 貫通エツチングは顧慮されなくてもよ い。局部的なマスク欠陥あるいはマス クの位置合きの大きな誤差の場合に、 これらの欠陥あるいは誤差がは々んど コンタクトホールの寸法の大きさを持 つときにさえも、破滅的な結果が予期 されることはない7.接触抵抗だけが苔干高くなる。
問題6: この問題はコンタクトホール領域4のほぼ平
面状の表面によって除かれる、。
面状の表面によって除かれる、。
本発明による方法は、ここで大部分例として述べられた
nチャ永ルMO8集積回路に対してだけでなく、原理的
にIは、nドープ区域にもnドープ区域にも接触されな
ければならない0MO8およびバイポーラ集積回路に対
しても適している。
nチャ永ルMO8集積回路に対してだけでなく、原理的
にIは、nドープ区域にもnドープ区域にも接触されな
ければならない0MO8およびバイポーラ集積回路に対
しても適している。
分離層(実施例ではS]02)が耐熱性の小さい材料、
例えば約4 I) 0 ’Cの最高温度に耐えるボリア
εドから形成される場合、多結晶シリコン被覆(6)な
らびに多結晶シリコン中のドーピング元素(リン又はヒ
素)の活性化が/100℃以下の温度で行われるかもし
くは分離層を害さないときにこの方法も適用可能である
。これは、例えば多結晶シリコ;/のプラズマ析出およ
びドーピング元素のレーザ光線あるいは電子線活性化に
よって行うことができる。
例えば約4 I) 0 ’Cの最高温度に耐えるボリア
εドから形成される場合、多結晶シリコン被覆(6)な
らびに多結晶シリコン中のドーピング元素(リン又はヒ
素)の活性化が/100℃以下の温度で行われるかもし
くは分離層を害さないときにこの方法も適用可能である
。これは、例えば多結晶シリコ;/のプラズマ析出およ
びドーピング元素のレーザ光線あるいは電子線活性化に
よって行うことができる。
この方法は、第一および第二のメタライズ面からなるア
ルミニウム導体路間の接触が実現されなければならない
多層メタライズにおけるコンタク]・ホールに対しても
適用可能である。
ルミニウム導体路間の接触が実現されなければならない
多層メタライズにおけるコンタク]・ホールに対しても
適用可能である。
本発明の別の実施態様においては、J、E]θch−t
;rochem、 Soc、第128巻、第2号(19
81年)425ないし429ページのAdameおよび
C!apioカビオの論文中に記載されているような層
の平面化の公知の方法を多結晶シリコン層(6)[(ア
ルミニウム層(7)の横着の前(/C)適用される。多
結晶シリコンは、この処置の場合に表面の平らな部分に
堆積された多結晶ンリコン層よりいくらか大きい厚さで
全面に亘って除去される。
;rochem、 Soc、第128巻、第2号(19
81年)425ないし429ページのAdameおよび
C!apioカビオの論文中に記載されているような層
の平面化の公知の方法を多結晶シリコン層(6)[(ア
ルミニウム層(7)の横着の前(/C)適用される。多
結晶シリコンは、この処置の場合に表面の平らな部分に
堆積された多結晶ンリコン層よりいくらか大きい厚さで
全面に亘って除去される。
層の除去の後VLq−!、多結晶シリコン(6)1は、
はとんど完全に多結晶シリコンによって満たされたコン
タクトホール(4)中にだけ残る。それによシ、5i0
2領域の上には二重層はもはや存在せず、そのことは特
別なエツチング問題に対して重要である。
はとんど完全に多結晶シリコンによって満たされたコン
タクトホール(4)中にだけ残る。それによシ、5i0
2領域の上には二重層はもはや存在せず、そのことは特
別なエツチング問題に対して重要である。
本発明によれば半導体集積回路において接触を生成する
場合に生ずる一連の問題をすべて解決することができ、
安定で低抵抗の接触を得ることができるものである。
場合に生ずる一連の問題をすべて解決することができ、
安定で低抵抗の接触を得ることができるものである。
汐1図は本発明方法によシ製造されたMO8集積回路の
要部断面図である。 ■・・・シリコン基板、2・・・拡散領域、4・・・コ
ンタクトホール、5・金属/リコン化物層、6,6a・
多結晶/リコン層、7・・・アルミニウム層。 83
要部断面図である。 ■・・・シリコン基板、2・・・拡散領域、4・・・コ
ンタクトホール、5・金属/リコン化物層、6,6a・
多結晶/リコン層、7・・・アルミニウム層。 83
Claims (1)
- 【特許請求の範囲】 1)7リコ/からなシ内部および上部に回路を構成する
素子が作られている基板と、アルミニウム又はアルミニ
ウム合金からなシ金属シリコン化物中間層を介して集積
回路の拡散シリコン領域と接続されている外側接触導体
路とを有する半導体集積回路の安定で低抵抗の接触を生
成するための方法において、 a)接触形成のために備えられる集積回路の拡散領域に
、回路素子の最小寸法に適合した等しい大きさのコンタ
クトホールを設け、b)場合Vこよっては大面債の拡散
領域において俵数のそのような等しい大きさのコンタク
トホールを設け、 C)コンタクトホール領域中の拡散領域を金属/リコン
化物層あるいは金属/金属シリコン化物二重層によって
覆い、 d)外側の接触導体路面としてn+ドープ多結晶シリコ
ンとアルミニウムとの二重層を用いる ことを特徴とする半導体集積回路の低抵抗接触生成方法
。 2)コンタクトホールの上のn+ドープ多結晶シリコン
層の厚さをコンタクトホール縁部長ざのほぼ半分に調整
することを特徴とする特許請求の範囲第1項記載の接触
生成方法。 3)金属シリコン化物として珪化白金を用いることを特
徴とする特許請求の範囲第1項または第2項記載の接触
生成方法。 リ 金属シリコン化物層とn+ドープ多結晶シリコンと
の間にクロム−酸化クロム(C!rC!r)(Oy)か
らなる障壁層を形成することを特徴とする特許請求の範
囲第1項ないし第3項のZずれかに記載の接触生成方法
。 5)アルミニウム層が1ないし2%のノリコン分を含む
ことを特徴とする特許請求の範囲第1項ないし第3項の
いずれかに記載の接触生成方法。 6)アルミニウム層[6%までの銅を添加することを特
徴とする特許請求の範囲第5項記載の接触生成方法。 7)n4 ドープ多、結晶ンリコンの析出を、基板の
水平および垂直部分の上の析出速度が同じ高さであるよ
うに行うことを特徴とする特許請求の範囲第1項ないし
第6項のいずれかに記載の接触生成方法。 8) n+ドープ多結晶シリコンを減圧気相成長、プ
ラズマ誘起気相成長あるいは光化学誘起気相成長によっ
て堆積することを特徴とする特許請求の範囲第7項記載
の接触生成方法。 9)アルεニウム層の析出の前にΩ1ド一プ多結晶7リ
コン層を、コンタクトホールだけが多結晶シリコンで満
たされる程度に全面に亘って除去することを特徴とする
特許請求の範囲第1項ないし第8項のいずれかに記載の
接触生成方法。 10)VLSIのM OSおよびバイポーラ集積回路に
使用することを特徴とする特許請求の範囲第1項ないし
第9項のいずれかに記載の接触生成方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19833314879 DE3314879A1 (de) | 1983-04-25 | 1983-04-25 | Verfahren zum herstellen von stabilen, niederohmigen kontakten in integrierten halbleiterschaltungen |
DE33148791 | 1983-04-25 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS59205717A true JPS59205717A (ja) | 1984-11-21 |
Family
ID=6197276
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59081680A Pending JPS59205717A (ja) | 1983-04-25 | 1984-04-23 | 半導体集積回路の低抵抗接触生成方法 |
Country Status (5)
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---|---|
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EP (1) | EP0123309B1 (ja) |
JP (1) | JPS59205717A (ja) |
AT (1) | ATE54227T1 (ja) |
DE (2) | DE3314879A1 (ja) |
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---|---|---|---|---|
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1983
- 1983-04-25 DE DE19833314879 patent/DE3314879A1/de not_active Withdrawn
-
1984
- 1984-03-22 US US06/592,402 patent/US4562640A/en not_active Expired - Fee Related
- 1984-04-23 JP JP59081680A patent/JPS59205717A/ja active Pending
- 1984-04-24 DE DE8484104577T patent/DE3482611D1/de not_active Expired - Fee Related
- 1984-04-24 EP EP84104577A patent/EP0123309B1/de not_active Expired - Lifetime
- 1984-04-24 AT AT84104577T patent/ATE54227T1/de not_active IP Right Cessation
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