JPS59146309A - Ｎｃ用カラ−グラフイツク表示装置 - Google Patents
Ｎｃ用カラ−グラフイツク表示装置Info
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- JPS59146309A JPS59146309A JP2087883A JP2087883A JPS59146309A JP S59146309 A JPS59146309 A JP S59146309A JP 2087883 A JP2087883 A JP 2087883A JP 2087883 A JP2087883 A JP 2087883A JP S59146309 A JPS59146309 A JP S59146309A
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- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
- G05B19/18—Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of programme data in numerical form
- G05B19/406—Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of programme data in numerical form characterised by monitoring or safety
- G05B19/4069—Simulating machining process on screen
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- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/30—Nc systems
- G05B2219/35—Nc in input of data, input till input file format
- G05B2219/35349—Display part, programmed locus and tool path, traject, dynamic locus
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/30—Nc systems
- G05B2219/35—Nc in input of data, input till input file format
- G05B2219/35489—Discriminate, different colour, highlight between two states
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/30—Nc systems
- G05B2219/35—Nc in input of data, input till input file format
- G05B2219/35501—Colour display
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Automation & Control Theory (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の技術分野
本発明はＮＣ用カラーグラフィック表示装置に関し、特
に非切削面と切削面とを併せて表示する場合に両者を区
別して表示する技術に関するものである。
に非切削面と切削面とを併せて表示する場合に両者を区
別して表示する技術に関するものである。
従来技術と問題点
最近、ＮＣ（数値制御）加ニブログラムを仮に実行した
ときの工具の軌跡等を用いて素材形状や切削形状を描画
するグラフィック表示装置を備えた数値制御装置が提案
され、これによりＮＣ加ニブログラムが正しいか否かの
確認等が従来に比し格段に容易になった。しかしながら
、従来のこの種表示装置は、素材形状と切削形状を線で
表示するものである為、意外と加工状態の認識が容易で
なかった。
ときの工具の軌跡等を用いて素材形状や切削形状を描画
するグラフィック表示装置を備えた数値制御装置が提案
され、これによりＮＣ加ニブログラムが正しいか否かの
確認等が従来に比し格段に容易になった。しかしながら
、従来のこの種表示装置は、素材形状と切削形状を線で
表示するものである為、意外と加工状態の認識が容易で
なかった。
発明の目的
本発明はこのような事情に鑑みて為さｈたものであり、
その目的は、非切削面と切削面とを面表示し且つそれぞ
ｆｔ異なる色で表示することにより、加工状態の言忍識
を視覚的に容易なものにすることにある。
その目的は、非切削面と切削面とを面表示し且つそれぞ
ｆｔ異なる色で表示することにより、加工状態の言忍識
を視覚的に容易なものにすることにある。
発明の構成
第１図は本発明のＮＣ用カラーグラフィック表示装置の
構成説明図である。ＮＣ加工用プログラム記憶手段ＭＥ
ｒ”１１にＮＣ加工用プログラムが、素材形状記憶手段
ＭＥＭ２に素材の形状を特定し得る形状データが、色情
報記憶手段ＭＥＭ３＋二各形状に付する色の情報がそれ
ぞれ記憶されており、図形作成手段ＣＮＴば、複数個の
画面用ＲＡＭＢＲ，〜ＢＲ。
構成説明図である。ＮＣ加工用プログラム記憶手段ＭＥ
ｒ”１１にＮＣ加工用プログラムが、素材形状記憶手段
ＭＥＭ２に素材の形状を特定し得る形状データが、色情
報記憶手段ＭＥＭ３＋二各形状に付する色の情報がそれ
ぞれ記憶されており、図形作成手段ＣＮＴば、複数個の
画面用ＲＡＭＢＲ，〜ＢＲ。
のうち色情報で特定される画面用ＲＡＭ （：ＮＣ加工
用プログラム記憶手段ＭＥＭ１．素材形状記憶手段ＨＥ
Ｍ ２の記憶情報を基にして作成した素材形状。
用プログラム記憶手段ＭＥＭ１．素材形状記憶手段ＨＥ
Ｍ ２の記憶情報を基にして作成した素材形状。
切削形状のぬりつぶし図形を書込み、カラーグラフィッ
ク表示部ＤＰは、複数個の画面用ＲＡＭの出力を入力と
して画面用ＲＡＭの組合せで定まる色の図形を表示する
。
ク表示部ＤＰは、複数個の画面用ＲＡＭの出力を入力と
して画面用ＲＡＭの組合せで定まる色の図形を表示する
。
発明の実施例
第２図は本発明ＮＣ甲カラーグラフィック表示装置のハ
ードワエア構成の一例を示す要部ブロック図であり、１
はマイクロコンピュータ、２，３はそのデータバス及び
アドレスバス、４Ｒは赤画面用ＲＡＭ、４Ｇは録画画用
ＲＡＭ、４Ｂは前画面用ＲＡＭ、５はワークＲＡＭ、７
は優先順位回路、１３Ｒ，Ｆ３Ｇ。
ードワエア構成の一例を示す要部ブロック図であり、１
はマイクロコンピュータ、２，３はそのデータバス及び
アドレスバス、４Ｒは赤画面用ＲＡＭ、４Ｇは録画画用
ＲＡＭ、４Ｂは前画面用ＲＡＭ、５はワークＲＡＭ、７
は優先順位回路、１３Ｒ，Ｆ３Ｇ。
８Ｂ、９はパラレル・シリアル変換器、１０Ｒ，１０Ｇ
、ｉｏＢはフリップフロップ、１１Ｒ，１１Ｇ、１１Ｂ
はシリアル・パラレル変換器、１２はＣＲＴコントロー
ラ、１６はカラーグラフィックディスプレイ部、１４は
タイミングパルス発生回路、１５はデータドライバ、１
６は書換情報切換回路、１７は画面指定情報ラッチ回路
、１８はアドレスデコーダ、１９は垂直同期信号同期回
路、２ＯＲ，２０Ｇ、２０Ｂ、２１Ｒ。
、ｉｏＢはフリップフロップ、１１Ｒ，１１Ｇ、１１Ｂ
はシリアル・パラレル変換器、１２はＣＲＴコントロー
ラ、１６はカラーグラフィックディスプレイ部、１４は
タイミングパルス発生回路、１５はデータドライバ、１
６は書換情報切換回路、１７は画面指定情報ラッチ回路
、１８はアドレスデコーダ、１９は垂直同期信号同期回
路、２ＯＲ，２０Ｇ、２０Ｂ、２１Ｒ。
２１Ｇ、２１Ｂ、２２．２８はオア回路、２５ Ｒ、２
３Ｇ 、２５Ｂはアンド回路、２４Ｒ，２４Ｇ、２４Ｂ
、 ３０Ｒ，６０Ｇ、３０Ｂは禁止入力付きのアンド回
路、２５は色情報ファイルメモリ、２６はＣＭＯＳメモ
リ、２７は素材ファイルメモリ、２９は優先順位選択回
路である。
３Ｇ 、２５Ｂはアンド回路、２４Ｒ，２４Ｇ、２４Ｂ
、 ３０Ｒ，６０Ｇ、３０Ｂは禁止入力付きのアンド回
路、２５は色情報ファイルメモリ、２６はＣＭＯＳメモ
リ、２７は素材ファイルメモリ、２９は優先順位選択回
路である。
第２図において、赤、緑、前画面用ＲＡＭ４Ｒ。
４Ｇ、４Ｅは、画面に表示させる図形を記憶する書込み
、読出し可能なメモリで、ディスプレイ画面の各ドツト
に対応する記憶領域を有する。一画面のうち、赤画面用
ＲＡＭ４Ｒにのみ表示部の情報（例えば“’１”）が記
憶された部分は赤で表示が行なわれ、線画商用ＲＡＭ４
Ｇ或は前画面用ＲＡＭ４Ｂにのみ記憶された部分は緑或
は青で表示される。また、２以」二の画面用ＲＡＭに重
複して“１”の情報が書込まれた部分は、それらの混合
色で表示が行なわれる。ワークＲＡＭ５は、後述するぬ
りつぶし作業に使用する芹込み、続出し可能なメモリで
、画面用Ｒｊ４Ｍ ４ Ｒ、４Ｇ 、 ４ Ｂの記憶領
域に対応する記憶領域を有する。これらＲＡＭ４Ｒ、４
Ｇ 、 ４Ｂ 、 ５は、マイクロコンピュータ１から
任意のアドレスに情報を書込むことができ、また読出す
ことができる他、ＣＲＴコントローラ１２のスキャン用
アドレスにより全領域が順次に且つ同期してアクセスさ
れ、画面用ＲＡＭ４Ｒ，４Ｇ、４Ｅの出力は優先順位回
路７に、ワークＲＡＭ５の出力はパラレル・シリアル変
換器９にそれぞれ出力される。また、優先順位回路７の
出力がアンド回路ｚｉ、２６Ｇ、２３Ｂを介して、及び
シリアル・パラレル変換器１１Ｒ，ＩＩＧ、１１Ｂの出
力がオア回路２０Ｒ、２０Ｇ 、 ２０Ｂを介してそれ
ぞれ画面用ＲＡＭ４Ｂ、４Ｇ、４Ｂの入力に加えられて
おり、これらのＲＡＭはその入力によっても書換え可能
である。
、読出し可能なメモリで、ディスプレイ画面の各ドツト
に対応する記憶領域を有する。一画面のうち、赤画面用
ＲＡＭ４Ｒにのみ表示部の情報（例えば“’１”）が記
憶された部分は赤で表示が行なわれ、線画商用ＲＡＭ４
Ｇ或は前画面用ＲＡＭ４Ｂにのみ記憶された部分は緑或
は青で表示される。また、２以」二の画面用ＲＡＭに重
複して“１”の情報が書込まれた部分は、それらの混合
色で表示が行なわれる。ワークＲＡＭ５は、後述するぬ
りつぶし作業に使用する芹込み、続出し可能なメモリで
、画面用Ｒｊ４Ｍ ４ Ｒ、４Ｇ 、 ４ Ｂの記憶領
域に対応する記憶領域を有する。これらＲＡＭ４Ｒ、４
Ｇ 、 ４Ｂ 、 ５は、マイクロコンピュータ１から
任意のアドレスに情報を書込むことができ、また読出す
ことができる他、ＣＲＴコントローラ１２のスキャン用
アドレスにより全領域が順次に且つ同期してアクセスさ
れ、画面用ＲＡＭ４Ｒ，４Ｇ、４Ｅの出力は優先順位回
路７に、ワークＲＡＭ５の出力はパラレル・シリアル変
換器９にそれぞれ出力される。また、優先順位回路７の
出力がアンド回路ｚｉ、２６Ｇ、２３Ｂを介して、及び
シリアル・パラレル変換器１１Ｒ，ＩＩＧ、１１Ｂの出
力がオア回路２０Ｒ、２０Ｇ 、 ２０Ｂを介してそれ
ぞれ画面用ＲＡＭ４Ｂ、４Ｇ、４Ｂの入力に加えられて
おり、これらのＲＡＭはその入力によっても書換え可能
である。
優先順位回路７は、同期して続出された６個のＲＡＭ４
Ｒ，４Ｇ、４Ｂの出力を指定された優先順位に従って処
理し、優先順位の低くないＲＡＭの出力のみをパラレル
・シリアル変換器８Ｒ、８Ｇ 、 ８Ｂｉ二出力するも
ので、優先順位の指定は、マイクロコンピュータ１から
書込み可能な６ビツトのラッチを有する優先順位選択回
路２９の出力Ｒ１，Ｒｏ 、Ｇ１、ＧＯ，Ｂ１ 、ＢＯ
で行なわれる。第６図は優先順位回路７の実施例を示す
要部ブロック図であり、各画面用ＲＡＭ４Ｒ，４Ｇ、４
Ｂの１ビット当りの処理回路部分のみを図示したもので
ある。各画面用ＲＡＭの出力は四つの経路でマルチプレ
クｆ ４０Ｒ、４０Ｇ、４０Ｂに入力され、その四つの
入力のいずれか−つが優先順位指定回路２９の出力Ｒ１
，Ａ’ｏ、Ｇｉ 。
Ｒ，４Ｇ、４Ｂの出力を指定された優先順位に従って処
理し、優先順位の低くないＲＡＭの出力のみをパラレル
・シリアル変換器８Ｒ、８Ｇ 、 ８Ｂｉ二出力するも
ので、優先順位の指定は、マイクロコンピュータ１から
書込み可能な６ビツトのラッチを有する優先順位選択回
路２９の出力Ｒ１，Ｒｏ 、Ｇ１、ＧＯ，Ｂ１ 、ＢＯ
で行なわれる。第６図は優先順位回路７の実施例を示す
要部ブロック図であり、各画面用ＲＡＭ４Ｒ，４Ｇ、４
Ｂの１ビット当りの処理回路部分のみを図示したもので
ある。各画面用ＲＡＭの出力は四つの経路でマルチプレ
クｆ ４０Ｒ、４０Ｇ、４０Ｂに入力され、その四つの
入力のいずれか−つが優先順位指定回路２９の出力Ｒ１
，Ａ’ｏ、Ｇｉ 。
ＧＯ２Ｂ１．ＢＯで選択さ八る。なお、ゲート回路４１
Ｒ〜４３［，４１Ｇ〜４６Ｇ、４１Ｂ〜４６Ｅは禁止入
力付きのゲート回路である。第４図は優先順位選択回路
２９の出力と優先順位回路７の選択動作との関係例を示
す図であり、優先順位はＡが最も高く、Ｃが最も低いと
定められ、ｖｌ）えは優先順位指定回路２９の出力が（
００００００）のときは優先順位に差がないので６個の
ＲＡＭ４Ｒ、４Ｇ 、 ４Ｂの出力が全てパラレル・シ
リアル変換器４Ｒ，４Ｇ、４Ｂに出力される（このとき
白の着色となる）。また、出力が（０００１１１）のと
きに、春画商用ＲＡＭ４Ｒの出力によって緑。
Ｒ〜４３［，４１Ｇ〜４６Ｇ、４１Ｂ〜４６Ｅは禁止入
力付きのゲート回路である。第４図は優先順位選択回路
２９の出力と優先順位回路７の選択動作との関係例を示
す図であり、優先順位はＡが最も高く、Ｃが最も低いと
定められ、ｖｌ）えは優先順位指定回路２９の出力が（
００００００）のときは優先順位に差がないので６個の
ＲＡＭ４Ｒ、４Ｇ 、 ４Ｂの出力が全てパラレル・シ
リアル変換器４Ｒ，４Ｇ、４Ｂに出力される（このとき
白の着色となる）。また、出力が（０００１１１）のと
きに、春画商用ＲＡＭ４Ｒの出力によって緑。
前画面用ＲＡＭ４ Ｇ 、 ４ Ｂの出力がゲートされ
、録画商用ＲＡＭ４Ｇの出力によって前画面用ＲＡＭ
４ Ｂの出力がゲートされる。なお第２図で優先順位の
指定を行なう為には４ビツトあれば十分であるが、優先
順位回路７の構成を簡単にする為には本実施例では６ビ
ツト用いている。
、録画商用ＲＡＭ４Ｇの出力によって前画面用ＲＡＭ
４ Ｂの出力がゲートされる。なお第２図で優先順位の
指定を行なう為には４ビツトあれば十分であるが、優先
順位回路７の構成を簡単にする為には本実施例では６ビ
ツト用いている。
また第２図におい℃、パラレル・シリアル変換器８Ｒ，
８Ｇ、ＢＥは画面用ＲＡＭ４Ｒ，４Ｇ、 ４Ｂがら出力
される例えば８ビツトの並列出力ＲＤＯ−ＲＤ７、ＧＤ
Ｏ〜ＧＤ７．ＢＤＯ〜ＢＤ７をシリアルなデータに変換
し、それぞれ赤ビデオ信号、緑ビデオ信号。
８Ｇ、ＢＥは画面用ＲＡＭ４Ｒ，４Ｇ、 ４Ｂがら出力
される例えば８ビツトの並列出力ＲＤＯ−ＲＤ７、ＧＤ
Ｏ〜ＧＤ７．ＢＤＯ〜ＢＤ７をシリアルなデータに変換
し、それぞれ赤ビデオ信号、緑ビデオ信号。
青ビデオ信号としてカラーグラフィックディスプレイ部
１３及びノリツブ２０ツブｉｏＲ，ｉＤＧ 、 １０Ｂ
のセット入力端子に出力する。上記ディスプレイ部１６
は公知のように赤、緑、青のビデオ信号の組合せ（二よ
り色度信号の位相差を決定し、全部で８通りの色の着色
を行なうもので、その水平、垂直同期信号はＣＲＴコン
トローラ１２で発生される。
１３及びノリツブ２０ツブｉｏＲ，ｉＤＧ 、 １０Ｂ
のセット入力端子に出力する。上記ディスプレイ部１６
は公知のように赤、緑、青のビデオ信号の組合せ（二よ
り色度信号の位相差を決定し、全部で８通りの色の着色
を行なうもので、その水平、垂直同期信号はＣＲＴコン
トローラ１２で発生される。
また、パラレル・シリアル変換器９は、ワークＲＡＭ５
の並列出力を直列出力に変換するものであり、その出力
は、オア回路２２を介してソリツブフロップ１０Ｒ、１
０Ｇ 、 １０Ｂのリセット入力端子およびゲート２４
Ｒ、２４Ｇ 、 ２４Ｂの禁止入力に入力される。これ
らフリップフロップ１０Ｒ，ＩＯＧ 、 １［１１Ｂの
出力はシリアル・パラレル変換器１１Ｒ，１１Ｇ、１１
７１？にて並列ビット出力に変換され、前述したように
画面用ＲＡＭ４Ｒ，４Ｇ、４Ｅの入力に帰還される。
の並列出力を直列出力に変換するものであり、その出力
は、オア回路２２を介してソリツブフロップ１０Ｒ、１
０Ｇ 、 １０Ｂのリセット入力端子およびゲート２４
Ｒ、２４Ｇ 、 ２４Ｂの禁止入力に入力される。これ
らフリップフロップ１０Ｒ，ＩＯＧ 、 １［１１Ｂの
出力はシリアル・パラレル変換器１１Ｒ，１１Ｇ、１１
７１？にて並列ビット出力に変換され、前述したように
画面用ＲＡＭ４Ｒ，４Ｇ、４Ｅの入力に帰還される。
画面指定情報ラッチ回路１７は、上記シリアル・パラレ
ル変換器１１Ｒ，１１Ｇ、１１Ｂの出力あるいは優先順
位回路７の出力によって書換える画面用ＲＡＡｆ４Ｒ、
４Ｇ 、 ４Ｂを指定するもので、赤画面用ＲＡＭ ４
Ｒ指定時に使用されるラッチ回路１７Ｒ２録画面用Ｒ
ＡＭ４Ｇ指定時に使用されるラッチ回路１７Ｇ、前側曲
用ＲＡＭ ４ Ｂ指定時に使用されるラッチ回路１７Ｂ
を有する。このラッチ回路１７Ｒ，１７Ｇ、１７Ｂの出
力は、ＣＲＴコントローラ１２から垂直同期信号が加わ
る垂直同期信号同期回路１９にて同期をとられた後、画
面用ＲＡＭ４Ｒ，４Ｇ、４Ｂのチップセレクト端子Ｃ８
に入力される。また書換情報切換回路１６は、画面用Ｒ
ＡＭ４Ｒ，４Ｇ、４Ｂを優先順位回路７の出力で書換え
るか、シリアル・パラレル変換器１１Ｒ２１１Ｇ、１１
Ｂの出力で書換えるかを選定するもので、この例ではク
リップフロッグ１６Ｂ、 １６Ｇ 、 １６Ｂをセット
したとき優先順位回路７の出力で赴換えが行なわれ、リ
セットしたときシリアル・パラレル変換器１１Ｒ，１１
Ｇ、１１Ｂの出力で書換えが行なわれる。
ル変換器１１Ｒ，１１Ｇ、１１Ｂの出力あるいは優先順
位回路７の出力によって書換える画面用ＲＡＡｆ４Ｒ、
４Ｇ 、 ４Ｂを指定するもので、赤画面用ＲＡＭ ４
Ｒ指定時に使用されるラッチ回路１７Ｒ２録画面用Ｒ
ＡＭ４Ｇ指定時に使用されるラッチ回路１７Ｇ、前側曲
用ＲＡＭ ４ Ｂ指定時に使用されるラッチ回路１７Ｂ
を有する。このラッチ回路１７Ｒ，１７Ｇ、１７Ｂの出
力は、ＣＲＴコントローラ１２から垂直同期信号が加わ
る垂直同期信号同期回路１９にて同期をとられた後、画
面用ＲＡＭ４Ｒ，４Ｇ、４Ｂのチップセレクト端子Ｃ８
に入力される。また書換情報切換回路１６は、画面用Ｒ
ＡＭ４Ｒ，４Ｇ、４Ｂを優先順位回路７の出力で書換え
るか、シリアル・パラレル変換器１１Ｒ２１１Ｇ、１１
Ｂの出力で書換えるかを選定するもので、この例ではク
リップフロッグ１６Ｂ、 １６Ｇ 、 １６Ｂをセット
したとき優先順位回路７の出力で赴換えが行なわれ、リ
セットしたときシリアル・パラレル変換器１１Ｒ，１１
Ｇ、１１Ｂの出力で書換えが行なわれる。
第５図は本発明ＮＣ用カラーグラフィック表示装置の平
面図形作成機能を実現するソフトウェア例を示すフロー
チャートである。例えば第６図（Ａ＞に示すような形状
の図形を赤色で表示する場合、その平面図形に対応する
赤画面用ＲＡＭ４Ｒの領域に“′１”を書込む必要があ
る。この場合を例に採り、本実施例装置の平面図形作成
機能を先ず説明する。
面図形作成機能を実現するソフトウェア例を示すフロー
チャートである。例えば第６図（Ａ＞に示すような形状
の図形を赤色で表示する場合、その平面図形に対応する
赤画面用ＲＡＭ４Ｒの領域に“′１”を書込む必要があ
る。この場合を例に採り、本実施例装置の平面図形作成
機能を先ず説明する。
平面図形の輪郭に関する図形データは、別途に作成ある
いは入力され、マイクロコンピュータ１はその図形デー
タに円弧・直線変換等の公知の技術を施して先ず図形デ
ータを全て直線で近似する（ステップＰ１）。これは、
第６図（、’ｌ）に示す図形の輪郭を第６図（Ｂ）に示
すような線分１１〜１１０に分割することを意味する。
いは入力され、マイクロコンピュータ１はその図形デー
タに円弧・直線変換等の公知の技術を施して先ず図形デ
ータを全て直線で近似する（ステップＰ１）。これは、
第６図（、’ｌ）に示す図形の輪郭を第６図（Ｂ）に示
すような線分１１〜１１０に分割することを意味する。
次に、直線で近似された図形の輪郭を赤画面用ＲＡＭ４
Ｂに書込み、直線で近似された図形のぬりつぶしの終点
をワークＲＡＭ５に書込む為、先ず、各直線の始点を原
点としてその直線が何象限に存在するかを調べる（ステ
ップ７’３）。これは、始点及び終点の座標値の符号を
判別することで可能である。そしてこの象限解析の結果
と別途六方されるぬりつぶし方向に関する情報とから、
マイクロコンピュータ１は以下の処理を実行する（ステ
ップＰ４〜Ｐ９）。
Ｂに書込み、直線で近似された図形のぬりつぶしの終点
をワークＲＡＭ５に書込む為、先ず、各直線の始点を原
点としてその直線が何象限に存在するかを調べる（ステ
ップ７’３）。これは、始点及び終点の座標値の符号を
判別することで可能である。そしてこの象限解析の結果
と別途六方されるぬりつぶし方向に関する情報とから、
マイクロコンピュータ１は以下の処理を実行する（ステ
ップＰ４〜Ｐ９）。
（１）直線が第１象限又は第２象限にあり且つぬりつぶ
しが進行方向に対して左のとき、及び直線が第６象限又
は第４象限にあり且つぬりつぶしが進行方向に対して右
のとき、 その直線を直線補間し、その結果を赤画面用ＲＡＭ ４
ＲとワークＲＡＭ５の双方に書込む。
しが進行方向に対して左のとき、及び直線が第６象限又
は第４象限にあり且つぬりつぶしが進行方向に対して右
のとき、 その直線を直線補間し、その結果を赤画面用ＲＡＭ ４
ＲとワークＲＡＭ５の双方に書込む。
（２）直線が第１象限又は第２象限にあり且つぬりつぶ
しが進行方向に対して右のとき、及び直線が第６象限又
は第４象限（二あり且つぬりつぶしが進行方向に対して
左のとき、 その直線を直線補間し、その結果を赤画面用ＲＡＭ ４
Ｈに書込む。
しが進行方向に対して右のとき、及び直線が第６象限又
は第４象限（二あり且つぬりつぶしが進行方向に対して
左のとき、 その直線を直線補間し、その結果を赤画面用ＲＡＭ ４
Ｈに書込む。
従って、第６図（Ｂ）の場合、直線の進行方向を右廻り
と定めると、ぬりつぶす側は右側になり、直線ｌＩ ＋
１２ ＋ ｌＩ。は第１象限又は第２象限と判別され、
直線１３〜ｌ、は第３象限又は第４象限と判別される結
果、赤画面用ＲＡＭ４Ｈには第４図（Ｃ）に示すように
図形の輪郭（’ｒ〜ｌ＋ｏ）が書込まれ、ワークＲＡＭ
５には第６図（Ｄ）に示すようにぬりつぶしの終点の位
置（ｌｓ〜ｌｏ）が書込まれる。なお、第４図（Ｃ）
、 ＣＤ＞における矢印はスキャン方向を示す。またＸ
軸と一致するどきはステップＰ７へ移行する（ステップ
Ｐ１１）。
と定めると、ぬりつぶす側は右側になり、直線ｌＩ ＋
１２ ＋ ｌＩ。は第１象限又は第２象限と判別され、
直線１３〜ｌ、は第３象限又は第４象限と判別される結
果、赤画面用ＲＡＭ４Ｈには第４図（Ｃ）に示すように
図形の輪郭（’ｒ〜ｌ＋ｏ）が書込まれ、ワークＲＡＭ
５には第６図（Ｄ）に示すようにぬりつぶしの終点の位
置（ｌｓ〜ｌｏ）が書込まれる。なお、第４図（Ｃ）
、 ＣＤ＞における矢印はスキャン方向を示す。またＸ
軸と一致するどきはステップＰ７へ移行する（ステップ
Ｐ１１）。
さて、以上の処理が完了すると、ハードウェア処理によ
るぬりつぶし作業を行なわせる為に、マイクロコンピュ
ータ１は、ぬりつぶしを行なう画面用ＲＡＭを指定し、
ＣＲＴコントローラ１２を起動する。画面用ＲＡＭの指
定は画面指定情報ラッチ回路１７のラッテ回路１７Ｒを
セットすることで行ない、また書換情報切換回路１６の
フリップフロップ１６Ｒをリセットする。この操作によ
り赤画面用ＲＡｈｆ４ＲとワークＲＡＭ５の全領域が同
期してアクセスされ、赤画面用ＲＡＭ ４ Ｈの出力は
優先順位回路７．パラレル・シリアル変換器８Ｒを介し
てノリツブフロップ１０Ｒのセット端子に、ワークＲＡ
Ｍ５の出力はパラレル・シリアル変換器９を介してフリ
ップフロップ１０Ｒのリセット端子にそれぞれ入力され
る。
るぬりつぶし作業を行なわせる為に、マイクロコンピュ
ータ１は、ぬりつぶしを行なう画面用ＲＡＭを指定し、
ＣＲＴコントローラ１２を起動する。画面用ＲＡＭの指
定は画面指定情報ラッチ回路１７のラッテ回路１７Ｒを
セットすることで行ない、また書換情報切換回路１６の
フリップフロップ１６Ｒをリセットする。この操作によ
り赤画面用ＲＡｈｆ４ＲとワークＲＡＭ５の全領域が同
期してアクセスされ、赤画面用ＲＡＭ ４ Ｈの出力は
優先順位回路７．パラレル・シリアル変換器８Ｒを介し
てノリツブフロップ１０Ｒのセット端子に、ワークＲＡ
Ｍ５の出力はパラレル・シリアル変換器９を介してフリ
ップフロップ１０Ｒのリセット端子にそれぞれ入力され
る。
第７図はハードウェア処理にてぬりつぶし作業が行なわ
れているときの第２図示装置各部の信号波形の一例を示
すタイミングチャートであり、ＣＲＴコントローラ１２
から出力されるスキャン用アドレスの前段でリードサイ
クルを発生させて赤画面用ＲＡＡｆ ４ Ｒ及びワーク
ＲＡＭ５の内容を同期して読出し、赤画面用ＲＡＭ ４
Ｒの直列変換出力中の“１”の信号でノリツブフロッ
プ１０Ｒをセットし、ワークＲＡＭ５の直列変換出力中
のｔｒｉｌ＋の信号でソリツブフロップ９をリセットす
るものである。また、ソリツブフロップ９の出力はシリ
アル・パラレル変換器１０で並列データに変換され、ス
キャン用アドレスの後段でライトサイクルを発生させて
、赤画面用ＲＡＭ ４ Ｒの内容をシリアル・パラレル
変換器１１Ｒの出力で書換える。この結果、赤画面用Ｒ
ＡＭ４Ｒは第６図（Ｅ）に示すように書換えられ、ぬり
つぶされた平面図形が得られる。なお、水平同期信号に
よりノリツブソロツブＩｏＲ，ＩＯＧ、１０Ｂをリセッ
トする構成としたのは、画面全体をぬりつぶす場合の便
宜を考慮したものである。
れているときの第２図示装置各部の信号波形の一例を示
すタイミングチャートであり、ＣＲＴコントローラ１２
から出力されるスキャン用アドレスの前段でリードサイ
クルを発生させて赤画面用ＲＡＡｆ ４ Ｒ及びワーク
ＲＡＭ５の内容を同期して読出し、赤画面用ＲＡＭ ４
Ｒの直列変換出力中の“１”の信号でノリツブフロッ
プ１０Ｒをセットし、ワークＲＡＭ５の直列変換出力中
のｔｒｉｌ＋の信号でソリツブフロップ９をリセットす
るものである。また、ソリツブフロップ９の出力はシリ
アル・パラレル変換器１０で並列データに変換され、ス
キャン用アドレスの後段でライトサイクルを発生させて
、赤画面用ＲＡＭ ４ Ｒの内容をシリアル・パラレル
変換器１１Ｒの出力で書換える。この結果、赤画面用Ｒ
ＡＭ４Ｒは第６図（Ｅ）に示すように書換えられ、ぬり
つぶされた平面図形が得られる。なお、水平同期信号に
よりノリツブソロツブＩｏＲ，ＩＯＧ、１０Ｂをリセッ
トする構成としたのは、画面全体をぬりつぶす場合の便
宜を考慮したものである。
第８図は本発明ＮＣ用カラーグラフィックディスプレイ
装置の色制御機能を実現するソフトウェア例を示すフロ
ーチャートである。例えば第９図に示すように、ワーク
８０をカッタ８１で切削して行く状態を、ワーク８０は
赤、カッタ８１は緑で表示する場合を例に採り、本実施
例装置の色制御機能を以下説明する。
装置の色制御機能を実現するソフトウェア例を示すフロ
ーチャートである。例えば第９図に示すように、ワーク
８０をカッタ８１で切削して行く状態を、ワーク８０は
赤、カッタ８１は緑で表示する場合を例に採り、本実施
例装置の色制御機能を以下説明する。
先ず、マイクロコンピュータ１は画面指定情報ラッチ回
路１７内のラッチ回路を全てリセットしくステップＰ１
）、次に、赤画面用ＲＡＭ ４ Ｂに第９図（Ｂ）に示
すようなワーク８００図形を、録画重用ＲＡＭ４Ｇに第
９図（Ｃ）（二示すようなカッタ８１の図形をそれぞれ
書込む（ステップｐ２．ｐ５）。次いで優先順位指定回
路２９に、赤より緑の方が優先順位が高くなるような情
報を設定する（ステップｐ４）。
路１７内のラッチ回路を全てリセットしくステップＰ１
）、次に、赤画面用ＲＡＭ ４ Ｂに第９図（Ｂ）に示
すようなワーク８００図形を、録画重用ＲＡＭ４Ｇに第
９図（Ｃ）（二示すようなカッタ８１の図形をそれぞれ
書込む（ステップｐ２．ｐ５）。次いで優先順位指定回
路２９に、赤より緑の方が優先順位が高くなるような情
報を設定する（ステップｐ４）。
これにより、カラーグラフィックディスプレイ部１６の
画面には第９図（Ａ）（＝示した内容の図形及び色が表
示される。次に、マイクロコンピュータ１は画面指定情
報ラッチ回路１７のラッチ回路１７Ｒをセットすると共
に書換情報切換回路１６のフリップフロップ１６Ｒをセ
ットする（ステップｐ５．ｐ６＞。
画面には第９図（Ａ）（＝示した内容の図形及び色が表
示される。次に、マイクロコンピュータ１は画面指定情
報ラッチ回路１７のラッチ回路１７Ｒをセットすると共
に書換情報切換回路１６のフリップフロップ１６Ｒをセ
ットする（ステップｐ５．ｐ６＞。
この状態で公知の方法（二より録画曲用ＲＡＭ４Ｇの内
容をマイクロコンピュータ１から順次書換えてカッタ８
１の図形を切削方向に移動していくと、それに従って表
示画面は（Ｄ） 、 （Ｅ） 、 （Ｆ）のように変化
して行く。即ち、優先順位回路７の出力ＲＤＯ〜ＲＤ７
、 ＧＤｏ−ＧＤ７ 、 ＢＤＯ〜ＢＤ７ 、！：同
期して出力されるライト１＠号により赤画面用ＲＡＭ４
Ｒの内容のみ優先順位回路７の赤に対応する出力ＲＤＯ
〜ＲＤ７により書換えられるので、切削されたワーク部
分は表示されないものとなる。
容をマイクロコンピュータ１から順次書換えてカッタ８
１の図形を切削方向に移動していくと、それに従って表
示画面は（Ｄ） 、 （Ｅ） 、 （Ｆ）のように変化
して行く。即ち、優先順位回路７の出力ＲＤＯ〜ＲＤ７
、 ＧＤｏ−ＧＤ７ 、 ＢＤＯ〜ＢＤ７ 、！：同
期して出力されるライト１＠号により赤画面用ＲＡＭ４
Ｒの内容のみ優先順位回路７の赤に対応する出力ＲＤＯ
〜ＲＤ７により書換えられるので、切削されたワーク部
分は表示されないものとなる。
第１０図（α）〜（Ｃ）は、上述のような平面図形作成
機能及び色制御機能を用いて描画させた表示例であり、
線１００を中心（二素材１０１を回転させ工具１０２で
切削するＮＣ旋盤加工の場合を示す。この実施例は、素
材１０１と一度以上切削した面（切削面）１０３とを面
表示し且つ異なる色で表示するようにしたものである。
機能及び色制御機能を用いて描画させた表示例であり、
線１００を中心（二素材１０１を回転させ工具１０２で
切削するＮＣ旋盤加工の場合を示す。この実施例は、素
材１０１と一度以上切削した面（切削面）１０３とを面
表示し且つ異なる色で表示するようにしたものである。
例えば素材−１０１を赤、工具１０２を緑、切削面１０
３を紫で表示するには、素材１０１の形状を赤画面用Ｒ
ＡＭ４Ｈに、工具１０２の形状を録画曲用ＲＡＭ ４
Ｇに、切削面１０３の形状を前画面用ＲＡＭ４Ｂにそれ
ぞれ書込むと共に、優先順位指定回路２９に、緑が最も
優先順位が高く、青、先がそれよりも低く且つ同じ優先
順位となるような情報を設定し、且つ赤画面用ＲＪ４Ｍ
４ Ｒの内容が優先順位回路７の出力で書換えるよう
に制御すれば良い。
３を紫で表示するには、素材１０１の形状を赤画面用Ｒ
ＡＭ４Ｈに、工具１０２の形状を録画曲用ＲＡＭ ４
Ｇに、切削面１０３の形状を前画面用ＲＡＭ４Ｂにそれ
ぞれ書込むと共に、優先順位指定回路２９に、緑が最も
優先順位が高く、青、先がそれよりも低く且つ同じ優先
順位となるような情報を設定し、且つ赤画面用ＲＪ４Ｍ
４ Ｒの内容が優先順位回路７の出力で書換えるよう
に制御すれば良い。
第１１図は本発明による表示画面の別の実施例を示す線
図であり、素材１０１と切削面１０６と切削を完了した
而（仕上げ［）１０４とをそれぞれ別々の色をつけて描
画したものである。第１２図はこのような表示を行なわ
せるソフトフェアの一構成例を示すフローチャートであ
り、ＣＭＯＳメモリ２６に記憶されたＮＣ加ニブログラ
ムを仮に実行して荒削り形状、仕上げ形状を知るもので
ある。また、素材の形状は素材形状を特定するデータを
記憶する素材ファイルメモリ２７の内容を読取って行な
われ、各形状にどのような色を付するかは色情報ファイ
ルメモリ２５の内容に従う。なお、切削面は分配量から
求めることができる。
図であり、素材１０１と切削面１０６と切削を完了した
而（仕上げ［）１０４とをそれぞれ別々の色をつけて描
画したものである。第１２図はこのような表示を行なわ
せるソフトフェアの一構成例を示すフローチャートであ
り、ＣＭＯＳメモリ２６に記憶されたＮＣ加ニブログラ
ムを仮に実行して荒削り形状、仕上げ形状を知るもので
ある。また、素材の形状は素材形状を特定するデータを
記憶する素材ファイルメモリ２７の内容を読取って行な
われ、各形状にどのような色を付するかは色情報ファイ
ルメモリ２５の内容に従う。なお、切削面は分配量から
求めることができる。
以上の実施例では、平面図形のぬりつぶし作業をハード
ウェア処理で行なったが、これは処理速度を高める為で
あるから、通常行なわれているようにソフトフェア処理
にてぬりつぶし作業を行なっても良い。また工具軌跡を
併せて表示したが、その表示を省略する構成としても良
い。更に優先順位回路７を使用して色制御を行なったが
、これは重なり合う図形を表示する場合のソフトフェア
の負荷を軽減する為であり、通常行なわれているように
各図形の重なりを考慮した図形を各画面用ＲＡＭに書込
む構成としても良い。この場合は、優先順位回路７等は
省略できる。
ウェア処理で行なったが、これは処理速度を高める為で
あるから、通常行なわれているようにソフトフェア処理
にてぬりつぶし作業を行なっても良い。また工具軌跡を
併せて表示したが、その表示を省略する構成としても良
い。更に優先順位回路７を使用して色制御を行なったが
、これは重なり合う図形を表示する場合のソフトフェア
の負荷を軽減する為であり、通常行なわれているように
各図形の重なりを考慮した図形を各画面用ＲＡＭに書込
む構成としても良い。この場合は、優先順位回路７等は
省略できる。
発明の詳細
な説明したように、本発明に依れば、非切削面と切削面
とが面表示され且つそれぞれ異なる色で表示されるので
、加工状態の認識が視覚的に容易となり、ＮＣ加ニブロ
グラムの正当性判断も確実に行ない得るものとなる。
とが面表示され且つそれぞれ異なる色で表示されるので
、加工状態の認識が視覚的に容易となり、ＮＣ加ニブロ
グラムの正当性判断も確実に行ない得るものとなる。
第１図は本発明の構成説明図、第２図は本発明ＮＣ用カ
ラーグラフィック表示装置のハードフェア構成の一例を
示す要部ブロック図、＄３図は優先順位回路の実施例を
示す要部ブロック図、第４図は優先順位選択回路の出力
と優先順位回路の選択動作との関係例を示す図、第５図
は本発明ＮＣ用カラーグラフィック表示装置の平面図形
作成機能を実現するソフトフェア例を示すフローチャー
ト、第６図（Ａ）〜（Ｅ）は平面図形作成機能の説明図
、第７図はハードフェア処理にてぬりつぶし作業が行な
われているときの第２図示装置各部の信号波形の一例を
示すタイミングチャート、第８図は本発明ＮＣ用カラー
グラフィックディスプレ装置の色制御機能を実現するソ
フトフェア例を示すフローチャート、第９図（Ａ）〜（
Ｆ）は色制御機能の説明図、第１０図（α）〜（Ｃ）、
第１１図は本発明ＮＣ用カラーグラフィック表示装置の
表示例を示す画面平面図、第１２図は第１１図示表示画
面を実現するソフトフェア構成の一例を示すフローチャ
ートである。 ４Ｒは赤画面用ＲＡＭ、４Ｇは録画重用ＲＡｈｆ、４Ｂ
ハ青画ｉＭｉ 用ＲＡＭ、５ ハワー、’７ ＲＡＭ、
８Ｒ，８Ｇ、ＢＥ、９はパラレル・シリアル変換器、
１０Ｒ、１ｏＧ 。 １ｏＢはフリツブフ「Ｉツブ、１１Ｒ，１１Ｇ 、 １
１ Ｂはシリアル・パラレル変換器、１６は書換情報切
換回１．“Ｋ、１７は画面指定情報ラッチ回路である。 特許出願人 ファナック株式会社 代理人 弁理士 玉蟲久五部（外６名）第５図 第６図 第８図 第９図 ８１ノ
ラーグラフィック表示装置のハードフェア構成の一例を
示す要部ブロック図、＄３図は優先順位回路の実施例を
示す要部ブロック図、第４図は優先順位選択回路の出力
と優先順位回路の選択動作との関係例を示す図、第５図
は本発明ＮＣ用カラーグラフィック表示装置の平面図形
作成機能を実現するソフトフェア例を示すフローチャー
ト、第６図（Ａ）〜（Ｅ）は平面図形作成機能の説明図
、第７図はハードフェア処理にてぬりつぶし作業が行な
われているときの第２図示装置各部の信号波形の一例を
示すタイミングチャート、第８図は本発明ＮＣ用カラー
グラフィックディスプレ装置の色制御機能を実現するソ
フトフェア例を示すフローチャート、第９図（Ａ）〜（
Ｆ）は色制御機能の説明図、第１０図（α）〜（Ｃ）、
第１１図は本発明ＮＣ用カラーグラフィック表示装置の
表示例を示す画面平面図、第１２図は第１１図示表示画
面を実現するソフトフェア構成の一例を示すフローチャ
ートである。 ４Ｒは赤画面用ＲＡＭ、４Ｇは録画重用ＲＡｈｆ、４Ｂ
ハ青画ｉＭｉ 用ＲＡＭ、５ ハワー、’７ ＲＡＭ、
８Ｒ，８Ｇ、ＢＥ、９はパラレル・シリアル変換器、
１０Ｒ、１ｏＧ 。 １ｏＢはフリツブフ「Ｉツブ、１１Ｒ，１１Ｇ 、 １
１ Ｂはシリアル・パラレル変換器、１６は書換情報切
換回１．“Ｋ、１７は画面指定情報ラッチ回路である。 特許出願人 ファナック株式会社 代理人 弁理士 玉蟲久五部（外６名）第５図 第６図 第８図 第９図 ８１ノ
Claims (1)
- （１）ＮＣ加工用プログラムを記憶するＮＣ加工用プロ
グラム記憶手段、素材の形状データを記憶する素材形状
記臆手段、各形状に付する色の清報を記［、はする色情
報記憶手段１表示画面のドツトに対応する記憶領域を有
Ｊ−る複数個の画面用ＲＡＭ、該複数個の画面用ＲＡＭ
のうち前記色情報で特定される画面用１１ＡＭにｉｌＪ
記ＮＣ加工用プログラム記・億手段、累（」形状記憶手
段の記憶情報を栽にして作成した素材形状、切削形状の
ぬりつぶし図形を書込む図形作成手段、前記複数個の画
面用ＲＡＭの出力を入力とじ画商用ＲＡＭの組合せで定
まる色の図形を表示するカラーグラフィック表示部を具
備したことを特徴とするＮＣ用カラーグラフィック表示
装置。 （２、特許請求の範囲第１項記載のＮＣ用カラーグラフ
ィック表示装置において、前記切削形状は仕上げ面形状
とそれ以外の切削面形状に区分され、それぞれ異なる色
を付して表示する構成としたことを特徴とするＮＣ用カ
ラーグラフィック表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2087883A JPS59146309A (ja) | 1983-02-10 | 1983-02-10 | Ｎｃ用カラ−グラフイツク表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2087883A JPS59146309A (ja) | 1983-02-10 | 1983-02-10 | Ｎｃ用カラ−グラフイツク表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59146309A true JPS59146309A (ja) | 1984-08-22 |
Family
ID=12039441
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2087883A Pending JPS59146309A (ja) | 1983-02-10 | 1983-02-10 | Ｎｃ用カラ−グラフイツク表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59146309A (ja) |
Cited By (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59216208A (ja) * | 1983-05-23 | 1984-12-06 | Mitsubishi Electric Corp | 数値制御装置 |
| JPS6194109A (ja) * | 1984-08-31 | 1986-05-13 | ゼネラル・エレクトリツク・カンパニイ | コンピユ−タ数値制御機械加工装置の視覚的表示を強調する方法およびコンピユ−タ制御機械加工装置のビデオ表示装置に色を付加する装置 |
| JPS61184610A (ja) * | 1985-02-12 | 1986-08-18 | Fanuc Ltd | 移動軌跡描画方式 |
| JPS649507A (en) * | 1987-07-02 | 1989-01-12 | Fanuc Ltd | Nc data preparing system |
| JPS6428706A (en) * | 1987-07-24 | 1989-01-31 | Fanuc Ltd | Interactive programming device |
| JPH0519838A (ja) * | 1991-07-15 | 1993-01-29 | Fanuc Ltd | 順送金型用ｃａｄシステムにおける製品作成シユミレーシヨン方式 |
| JPH06209596A (ja) * | 1993-01-08 | 1994-07-26 | Nec Corp | ステッピングモータ制御シミュレータ |
| JP2009014042A (ja) * | 2007-07-02 | 2009-01-22 | Tsubakimoto Chain Co | 無給油チェーン |
| US8033390B2 (en) | 2006-07-03 | 2011-10-11 | Tsubakimoto Chain Co. | Wear resistant, heat resistant conveyor chain |
-
1983
- 1983-02-10 JP JP2087883A patent/JPS59146309A/ja active Pending
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59216208A (ja) * | 1983-05-23 | 1984-12-06 | Mitsubishi Electric Corp | 数値制御装置 |
| JPH0561649B2 (ja) * | 1983-05-23 | 1993-09-06 | Mitsubishi Electric Corp | |
| JPS6194109A (ja) * | 1984-08-31 | 1986-05-13 | ゼネラル・エレクトリツク・カンパニイ | コンピユ−タ数値制御機械加工装置の視覚的表示を強調する方法およびコンピユ−タ制御機械加工装置のビデオ表示装置に色を付加する装置 |
| JPS61184610A (ja) * | 1985-02-12 | 1986-08-18 | Fanuc Ltd | 移動軌跡描画方式 |
| JPS649507A (en) * | 1987-07-02 | 1989-01-12 | Fanuc Ltd | Nc data preparing system |
| JPS6428706A (en) * | 1987-07-24 | 1989-01-31 | Fanuc Ltd | Interactive programming device |
| JPH0519838A (ja) * | 1991-07-15 | 1993-01-29 | Fanuc Ltd | 順送金型用ｃａｄシステムにおける製品作成シユミレーシヨン方式 |
| JPH06209596A (ja) * | 1993-01-08 | 1994-07-26 | Nec Corp | ステッピングモータ制御シミュレータ |
| US8033390B2 (en) | 2006-07-03 | 2011-10-11 | Tsubakimoto Chain Co. | Wear resistant, heat resistant conveyor chain |
| JP2009014042A (ja) * | 2007-07-02 | 2009-01-22 | Tsubakimoto Chain Co | 無給油チェーン |
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