JPS5869071A - インパクト型シリアル・ドット・プリンタ - Google Patents
インパクト型シリアル・ドット・プリンタInfo
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- JPS5869071A JPS5869071A JP16923781A JP16923781A JPS5869071A JP S5869071 A JPS5869071 A JP S5869071A JP 16923781 A JP16923781 A JP 16923781A JP 16923781 A JP16923781 A JP 16923781A JP S5869071 A JPS5869071 A JP S5869071A
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- Japan
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- printing
- latch circuit
- circuit group
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- 230000003247 decreasing effect Effects 0.000 abstract 1
- 230000000994 depressogenic effect Effects 0.000 abstract 1
- 230000035939 shock Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 5
- 230000004913 activation Effects 0.000 description 1
- 210000001217 buttock Anatomy 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 239000000428 dust Substances 0.000 description 1
- 230000005284 excitation Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/485—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes
- B41J2/505—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes from an assembly of identical printing elements
- B41J2/5056—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes from an assembly of identical printing elements using dot arrays providing selective dot disposition modes, e.g. different dot densities for high speed and high-quality printing, array line selections for multi-pass printing, or dot shifts for character inclination
Landscapes
- Engineering & Computer Science (AREA)
- Quality & Reliability (AREA)
- Dot-Matrix Printers And Others (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、インパクト型のシリアル・ドラ）・プリンタ
において、衝撃音の少ない静かな印字そ−ドを選択でき
るようにしたものである。
において、衝撃音の少ない静かな印字そ−ドを選択でき
るようにしたものである。
インパクト型のシリアルφドツトープリンタの欠点の一
つに印字時の印字ビンの衝撃音の大きいことが挙げられ
る。この衝撃音対策として、従来は防音カバーを取付け
ることやプラテンの材質を改良すること等で対処して米
たが、装置コストの上昇やプラテン寿曾の低下などの不
都合があった。
つに印字時の印字ビンの衝撃音の大きいことが挙げられ
る。この衝撃音対策として、従来は防音カバーを取付け
ることやプラテンの材質を改良すること等で対処して米
たが、装置コストの上昇やプラテン寿曾の低下などの不
都合があった。
また、最近のインパクト型の７リアル・ドツト・プリン
タにおいては、印字速度がますま、す高速になって米て
おり、従って印字ビンの衝撃音も非常に太き（なって米
ている。一方、この種Ｑ＋プリンｌの設置場所は一般の
オフィス内であることが非常に多く、場合においては高
速性よりも静粛性を優先しなければならないケースも多
く発生している。
タにおいては、印字速度がますま、す高速になって米て
おり、従って印字ビンの衝撃音も非常に太き（なって米
ている。一方、この種Ｑ＋プリンｌの設置場所は一般の
オフィス内であることが非常に多く、場合においては高
速性よりも静粛性を優先しなければならないケースも多
く発生している。
本発明は上記の考察にもとづくものであって、高速性よ
りも静粛性を優先させたい場合、オペレータの操作など
によって寝具にその要求を満足できるようにしたインパ
クト型シリアル・ドツト・プリンタの制御方式を提供す
ることを目的としている。そしてそのため、本発明のイ
ンパクト型シリアル匈ドツト・プリンタの制御方式は、
溝側の印字ビンと溝個の印字ビン駆動用マグネット・；
イルを有する印字ヘッドを搭載するキャリア、該キャリ
アを駆動するキャリア駆動モータ、１行分の印字ドツト
・パターンを格納する印字パターン・メモリ、プリンタ
全体を制御する全体制御回路、ゲート信号がオンのとき
にデータ書込み可能となると共に上記印字パターン・メ
モリから読出された講ビットの列エレメントを格納でき
る謀ビットのラッチを少なくとも有する印字データ・ラ
ッチ回路群、該印字データ・ラッチ回路群にセットされ
る列エレメントの各ビット信号を対応する印字ビン駆動
マグネット・コイルに供給する信号線を備えるインパク
ト塵シリアルｅドツト・プリンタでありて、外部から入
力される印字モード指令情報を記憶する印字モード記憶
手段を有し、上記全体制御回路は、印字を開始するとき
上記印字モード配憶手段の内容が分割印字モードである
ことを示している場合には、上記印字データ・ラッチ回
路群の簿ビットのラッチを複数の分割ラッチ・グループ
に分割し、１個の分割ラッチ・グループに属するラッチ
のゲート信号のみをオンとして上記印字パターン・メそ
りの全印字ドツト・パターンを所定のタイミング信号と
同期して１列エレメントずつ取出して上記印字データ・
ラッチ回路群に供給する動作を、各分割ラッチ°グルー
プ毎和行うよう構成されていることを特徴とするもので
ある。
りも静粛性を優先させたい場合、オペレータの操作など
によって寝具にその要求を満足できるようにしたインパ
クト型シリアル・ドツト・プリンタの制御方式を提供す
ることを目的としている。そしてそのため、本発明のイ
ンパクト型シリアル匈ドツト・プリンタの制御方式は、
溝側の印字ビンと溝個の印字ビン駆動用マグネット・；
イルを有する印字ヘッドを搭載するキャリア、該キャリ
アを駆動するキャリア駆動モータ、１行分の印字ドツト
・パターンを格納する印字パターン・メモリ、プリンタ
全体を制御する全体制御回路、ゲート信号がオンのとき
にデータ書込み可能となると共に上記印字パターン・メ
モリから読出された講ビットの列エレメントを格納でき
る謀ビットのラッチを少なくとも有する印字データ・ラ
ッチ回路群、該印字データ・ラッチ回路群にセットされ
る列エレメントの各ビット信号を対応する印字ビン駆動
マグネット・コイルに供給する信号線を備えるインパク
ト塵シリアルｅドツト・プリンタでありて、外部から入
力される印字モード指令情報を記憶する印字モード記憶
手段を有し、上記全体制御回路は、印字を開始するとき
上記印字モード配憶手段の内容が分割印字モードである
ことを示している場合には、上記印字データ・ラッチ回
路群の簿ビットのラッチを複数の分割ラッチ・グループ
に分割し、１個の分割ラッチ・グループに属するラッチ
のゲート信号のみをオンとして上記印字パターン・メそ
りの全印字ドツト・パターンを所定のタイミング信号と
同期して１列エレメントずつ取出して上記印字データ・
ラッチ回路群に供給する動作を、各分割ラッチ°グルー
プ毎和行うよう構成されていることを特徴とするもので
ある。
以下１本発明を図面を参照しつつ説明する。
第１図は本発明の１実施例のプｑツク図、＃Ｉ２図は本
発明の詳細な説明するための７０−チャート、第３図は
４分割印字を行う場合の印字パターンを示す図である。
発明の詳細な説明するための７０−チャート、第３図は
４分割印字を行う場合の印字パターンを示す図である。
第１図において、ｌはオペレータ嗜コンソール２はイン
タフェース回路、３はマイクロブμセッサを含む全体制
御回路、４はキャリア駆動タイＪリア駆動モータ、７は
印字ヘッド、８はキャリア、９はメモリ、１０はキャラ
クタ−ジェネレータ用ＲＯＭ、Ｘ ｌは印字データのラ
ッチ回路群、１２はマグネット駆動ドライバ、１３ない
し１６はラッチ回路をそれぞれ示している。
タフェース回路、３はマイクロブμセッサを含む全体制
御回路、４はキャリア駆動タイＪリア駆動モータ、７は
印字ヘッド、８はキャリア、９はメモリ、１０はキャラ
クタ−ジェネレータ用ＲＯＭ、Ｘ ｌは印字データのラ
ッチ回路群、１２はマグネット駆動ドライバ、１３ない
し１６はラッチ回路をそれぞれ示している。
オ、ベレー！・；ンソールｌには オンライン／オフラ
イン指定キーや通常印字モード指令キー、４分割印字モ
ード指令洋−等の各種のキーが設けられており、オペレ
ータはオペレーターコンソール１を介し文種々のコマン
ドをドツト・プリンタに与えることが出来る。インタフ
ェース回路２はドツト・プリンタとホスト計算機との間
の通信を行うものである。ホスト計算機から送られて米
る印字データに基づく印字を行う場合には、下記のよう
な処理が行われる。ホスト計算機から１行分の印字デー
タが送られて来ると、インタフェース回路２はこの印字
データなメ七す９に格納する。
イン指定キーや通常印字モード指令キー、４分割印字モ
ード指令洋−等の各種のキーが設けられており、オペレ
ータはオペレーターコンソール１を介し文種々のコマン
ドをドツト・プリンタに与えることが出来る。インタフ
ェース回路２はドツト・プリンタとホスト計算機との間
の通信を行うものである。ホスト計算機から送られて米
る印字データに基づく印字を行う場合には、下記のよう
な処理が行われる。ホスト計算機から１行分の印字デー
タが送られて来ると、インタフェース回路２はこの印字
データなメ七す９に格納する。
次いで、ホスト計算機から印字開始コマンドが送られて
来ると、インタフェース回路２はこの旨を全体制御回路
３に通知する。１行分の印字が終了すると、全体制御回
路３は印字終了をホスト計算機へ通知すべきことをイン
タフェース回路２ＬＣ依頼する。インタフェース回路２
から印字終了が送られて米ると、ホスト計算機は次の処
理を行う。
来ると、インタフェース回路２はこの旨を全体制御回路
３に通知する。１行分の印字が終了すると、全体制御回
路３は印字終了をホスト計算機へ通知すべきことをイン
タフェース回路２ＬＣ依頼する。インタフェース回路２
から印字終了が送られて米ると、ホスト計算機は次の処
理を行う。
全体制御回路３は、マイクロプロセッサを含んでいるも
のであり、タイミング制御やドツト・パターン編集制御
などの各種の制御を行う、タイミング制御回路４は、キ
ャリア駆動モータ６を起動する起動信号を出力するもの
である。キャリア駆動ドライバ５は上記の起動信号を増
幅するものである。キャリア駆動モータ６はキャリア８
を左右に駆動するためのものであり、キャリア８は印字
ヘッド７を搭載している。印字へラド７は２４個の印字
ビンを有しているものであり、各印字ビンに対応してマ
グネット・コイルが設けらねている。
のであり、タイミング制御やドツト・パターン編集制御
などの各種の制御を行う、タイミング制御回路４は、キ
ャリア駆動モータ６を起動する起動信号を出力するもの
である。キャリア駆動ドライバ５は上記の起動信号を増
幅するものである。キャリア駆動モータ６はキャリア８
を左右に駆動するためのものであり、キャリア８は印字
ヘッド７を搭載している。印字へラド７は２４個の印字
ビンを有しているものであり、各印字ビンに対応してマ
グネット・コイルが設けらねている。
メモリ９は、ホスト計算機から送られて米た印字データ
の格納域や作業領域、漢字ドツト・パターン格納域とし
て用いられるものであり、メモリ１０には英数字や仮名
文字のドラ）ｅパターンや各種のプ弯グラムが格納され
ている。印字を行う場合、全体制御回路３は、ホスト計
算機から送られて来た印字データに基づいてメモリ９又
は１０をアクセスし、１行文の印字ドツト番パターン・
データを作成し、作成した１行文の印字ドツト・パター
ン・データを印字パターン・メモリ （図示せス）に格
納する。説明を簡単にするため、この印字パターン拳メ
モリは１語２４ビツト構成のものとする。印字データ・
ラッチ回路群１１は、１行分の印字ドツト・パターン・
データを格納している印字パターン・メモリから読出さ
れた２４ビツト構成の列エレメントを格納するものであ
る。印字データ・ラッチ回路群１１は４個のラッチ１１
，１４．１５．１６回路から構成されている。ラッチ１
３ないし１６回路のゲート信号が全てオンであると、上
記の印字パターン・メモリから読出された２４ビツト構
成の列エレメントのうちのビット０．２゜４、６．８．
１０はラッチ回路１３のビット０．１．２゜３．４．５
ｔＣセツトされ、列エレメントのうちのビット１２，１
４，１６．１８，２０．２２はラッチ回路ビット０．１
．２．３．４．５ Ｋセットされ、列エレメントのうち
のビットＬ ３．５．７． Ｑ、 １１はラッチ回路１
Ｂ１Ｆ）ビｙ ） Ｏｓ １．２．３．４．５ ＦＣセ
ｆｆ）され、列エレメントのビット１Ｂ、 １５．１７
．１９．２１゜２３はラッチ回路１６０ビット０．１．
２．３．４゜５にセットされる。しかし、ラッチ回路ｉ
３．１４゜１５．１６へのゲート信号は個別に制御可能
であり、ゲート信号がオフであるラッチ回路に対しては
データがセットされない。なお、列エレメントのビット
１は第１番目の印字ビンに対応している。
の格納域や作業領域、漢字ドツト・パターン格納域とし
て用いられるものであり、メモリ１０には英数字や仮名
文字のドラ）ｅパターンや各種のプ弯グラムが格納され
ている。印字を行う場合、全体制御回路３は、ホスト計
算機から送られて来た印字データに基づいてメモリ９又
は１０をアクセスし、１行文の印字ドツト番パターン・
データを作成し、作成した１行文の印字ドツト・パター
ン・データを印字パターン・メモリ （図示せス）に格
納する。説明を簡単にするため、この印字パターン拳メ
モリは１語２４ビツト構成のものとする。印字データ・
ラッチ回路群１１は、１行分の印字ドツト・パターン・
データを格納している印字パターン・メモリから読出さ
れた２４ビツト構成の列エレメントを格納するものであ
る。印字データ・ラッチ回路群１１は４個のラッチ１１
，１４．１５．１６回路から構成されている。ラッチ１
３ないし１６回路のゲート信号が全てオンであると、上
記の印字パターン・メモリから読出された２４ビツト構
成の列エレメントのうちのビット０．２゜４、６．８．
１０はラッチ回路１３のビット０．１．２゜３．４．５
ｔＣセツトされ、列エレメントのうちのビット１２，１
４，１６．１８，２０．２２はラッチ回路ビット０．１
．２．３．４．５ Ｋセットされ、列エレメントのうち
のビットＬ ３．５．７． Ｑ、 １１はラッチ回路１
Ｂ１Ｆ）ビｙ ） Ｏｓ １．２．３．４．５ ＦＣセ
ｆｆ）され、列エレメントのビット１Ｂ、 １５．１７
．１９．２１゜２３はラッチ回路１６０ビット０．１．
２．３．４゜５にセットされる。しかし、ラッチ回路ｉ
３．１４゜１５．１６へのゲート信号は個別に制御可能
であり、ゲート信号がオフであるラッチ回路に対しては
データがセットされない。なお、列エレメントのビット
１は第１番目の印字ビンに対応している。
通常印字動作の場合、第１図の実施例は下記のように動
作する。印字データがインタフェース回路２１Ｃ入力さ
れると、印字データは順番にメモリ９に格納される。印
字データの格納後、印字開始がインタフェース回路２を
経由して全体制御回路３に通知される。全体制御回路３
は、メモリ９又は１０をアクセスして印字に必要なドツ
ト・／＜ ｐ−ンを編集し、タイミング制御回路４に対
してキャリア駆動モータ６を起動すべきことを指令する
。
作する。印字データがインタフェース回路２１Ｃ入力さ
れると、印字データは順番にメモリ９に格納される。印
字データの格納後、印字開始がインタフェース回路２を
経由して全体制御回路３に通知される。全体制御回路３
は、メモリ９又は１０をアクセスして印字に必要なドツ
ト・／＜ ｐ−ンを編集し、タイミング制御回路４に対
してキャリア駆動モータ６を起動すべきことを指令する
。
キャリア８が走行し、印字エリアに達すると、全体制御
回路３は編集済みのドツト・ノくターフ・データの内の
最初の列エレメントを印字’Ｆ−タ６５ツチ回路群１１
１Ｃ転送し、マグネット・コイル励磁信号をオンとする
。このとき、ラッチ回路群１１にラッチされたドツト・
パターン・データのうちＭＷ ｒ Ｉ Ｊのビットに対
応するマグネット・コイルのみが励磁され、文字パター
ンのうちｎ’１個の列エレメントが印字される。キャリ
ア８が次のドツト位置に達すると、同様に次の列エレメ
ントがラッチ回路群１１に転送され、この列エレメント
が印字される。これ以降、１行分の全ドツト・パターン
・データを転送し終るまで、この動作を（り返し、１行
分の印字を完成させる。
回路３は編集済みのドツト・ノくターフ・データの内の
最初の列エレメントを印字’Ｆ−タ６５ツチ回路群１１
１Ｃ転送し、マグネット・コイル励磁信号をオンとする
。このとき、ラッチ回路群１１にラッチされたドツト・
パターン・データのうちＭＷ ｒ Ｉ Ｊのビットに対
応するマグネット・コイルのみが励磁され、文字パター
ンのうちｎ’１個の列エレメントが印字される。キャリ
ア８が次のドツト位置に達すると、同様に次の列エレメ
ントがラッチ回路群１１に転送され、この列エレメント
が印字される。これ以降、１行分の全ドツト・パターン
・データを転送し終るまで、この動作を（り返し、１行
分の印字を完成させる。
次に、４分割印字が指令された場合における第１図の実
施例の動作を、第２図を参照しつつ説明する。オペレー
タがオペレーターコンソール１０４分割印字モード指定
キー（図示せず）を押下すると、ドツト−プリンタの中
の印字モード指示レジスタ（図示せず）に４分割印字七
−ドであることを示す情報がセットされる。ホスト側計
算機が１行分の印字データをドラ＞−プリンタへ送す。
施例の動作を、第２図を参照しつつ説明する。オペレー
タがオペレーターコンソール１０４分割印字モード指定
キー（図示せず）を押下すると、ドツト−プリンタの中
の印字モード指示レジスタ（図示せず）に４分割印字七
−ドであることを示す情報がセットされる。ホスト側計
算機が１行分の印字データをドラ＞−プリンタへ送す。
次いで印字開始を指令すると、ドツト・プリンタは１行
分の印字データに対応する１行分の印字ドツト・パター
ン・データを作成する。この点は通常印字モードの場合
と同じである。次いで、全体制御回路８は、第３図に示
されるような処理を行う。
分の印字データに対応する１行分の印字ドツト・パター
ン・データを作成する。この点は通常印字モードの場合
と同じである。次いで、全体制御回路８は、第３図に示
されるような処理を行う。
■ ４分割印字モードか、否かを詞、ｉる。Ｙ・虐の場
合には■の処理を行い、ＮＯの場合には■の処理を行う
、なお、この処理は通常印字のときも行われる。
合には■の処理を行い、ＮＯの場合には■の処理を行う
、なお、この処理は通常印字のときも行われる。
■ 分割印字カウンタに初期値″１”をセットする。
分割印字カウンタはメモリ９に設けられているものと考
えて良い。
えて良い。
■ 分割印字カウンタの内容で担定されるラッチ回路σ
）ゲート信号のみをオンとする。−例えば、分割印字カ
ウンタの計数値が“ｌ＃のとキ和はラッチ回路１３のゲ
ート信号かオンされ、計数値が“２″のとぎはラッチ回
路１４のゲート信号がオンされる。
）ゲート信号のみをオンとする。−例えば、分割印字カ
ウンタの計数値が“ｌ＃のとキ和はラッチ回路１３のゲ
ート信号かオンされ、計数値が“２″のとぎはラッチ回
路１４のゲート信号がオンされる。
■ １行分の印字ドツトｅパターン・データが格納され
ている印字パターン・メモリから列エレメントを１個ず
つ取出しながら通常の印字動作（１行分）を行５゜ ■ 分割印字カウンタの計数値を＋１する。
ている印字パターン・メモリから列エレメントを１個ず
つ取出しながら通常の印字動作（１行分）を行５゜ ■ 分割印字カウンタの計数値を＋１する。
■ 分１割印字カクンタの計数値が１５ｍであるか一否
かを調べ、Ｙｅ＠であれば終りとしてホスト計算機に印
字終了を送り、ＮＯであれば■の処理に戻る。
かを調べ、Ｙｅ＠であれば終りとしてホスト計算機に印
字終了を送り、ＮＯであれば■の処理に戻る。
なお、■、■は４分割印字モードではない通常印字モー
ド時に行われる。
ド時に行われる。
第３図は「洟」という文字を４分割印字毫−ドで印字す
る場合における印字ドツト・パターンを示す′ものであ
る。第３図０）はラッチ回路１３のゲート信号１１３み
がオンのときの印字ドラ）−パターンを示すものであり
、第３図（ロ）はラッチ回路１４のゲート信号のみがオ
ンのときの印字ドツト−パターンを示すものであり、第
３図（ハ）はラッチ回路１５のゲート信号のみがオンの
ときの印字ドツト・パターンを示すものであり、第３図
に）はラッチ回路１６のゲート信号のみかオンのときの
印字ドツト・パターンを示すものであり、第３図（ホ）
は結果として作成される印字ドツト・パターンを示すも
のである。
る場合における印字ドツト・パターンを示す′ものであ
る。第３図０）はラッチ回路１３のゲート信号１１３み
がオンのときの印字ドラ）−パターンを示すものであり
、第３図（ロ）はラッチ回路１４のゲート信号のみがオ
ンのときの印字ドツト−パターンを示すものであり、第
３図（ハ）はラッチ回路１５のゲート信号のみがオンの
ときの印字ドツト・パターンを示すものであり、第３図
に）はラッチ回路１６のゲート信号のみかオンのときの
印字ドツト・パターンを示すものであり、第３図（ホ）
は結果として作成される印字ドツト・パターンを示すも
のである。
上述の説明においては、オペレータ・コンソールより分
割印字を指示しているが、分割印字をホスト計算機より
インタフェース回路２を介して指示することも出来る。
割印字を指示しているが、分割印字をホスト計算機より
インタフェース回路２を介して指示することも出来る。
以上の説明から明らかなよ５に１本発明によれば、外部
からの指令によって容易に印字デエーテイを低下させる
ことが出来、これｋより衝撃音を低下させることが出来
るので、静粛な印字環境を得ることが出来る。また、イ
ンパクト皺のシリアル・ドツト・プリンタでグラフやイ
メージ、臀線を印字する場合、従来技術においては、印
字ビンやマグネット・フィルの焼損が生ずることがあっ
たが、このような印字を行５場合、本発明を用い分割印
字モードにして印字を行えば、上記のような印字ビンや
マグネット・コイルの゛焼損を防止することが出来る。
からの指令によって容易に印字デエーテイを低下させる
ことが出来、これｋより衝撃音を低下させることが出来
るので、静粛な印字環境を得ることが出来る。また、イ
ンパクト皺のシリアル・ドツト・プリンタでグラフやイ
メージ、臀線を印字する場合、従来技術においては、印
字ビンやマグネット・フィルの焼損が生ずることがあっ
たが、このような印字を行５場合、本発明を用い分割印
字モードにして印字を行えば、上記のような印字ビンや
マグネット・コイルの゛焼損を防止することが出来る。
第１図は本発明の１実施例のブロック図、第２図は本発
明の詳細な説明するためのフローチャート、第３図は４
分割印字を行う場合の印字パターンを示す図である。 ｌ・・・オペレーターコンソール、２・・・インタフエ
５・・・キャリア駆動ドライバ、′６・・・キャリア駆
動モータ、７・・・印字ヘッド、８・・・キャリア、９
−・・メモリ、１０・・・キャラクタ・ジェネレータ用
ＲＯＭ。 １１・・・印字データ・ラッチ回路群、１２・・・マグ
ネット駆動ドライバ、１３ないし１６・・・ラッチ。 特許出願人 ユーザツク電子工業株式会社代理人弁
理士 京 谷 四 部 外１名党 １ 図 太２図
明の詳細な説明するためのフローチャート、第３図は４
分割印字を行う場合の印字パターンを示す図である。 ｌ・・・オペレーターコンソール、２・・・インタフエ
５・・・キャリア駆動ドライバ、′６・・・キャリア駆
動モータ、７・・・印字ヘッド、８・・・キャリア、９
−・・メモリ、１０・・・キャラクタ・ジェネレータ用
ＲＯＭ。 １１・・・印字データ・ラッチ回路群、１２・・・マグ
ネット駆動ドライバ、１３ないし１６・・・ラッチ。 特許出願人 ユーザツク電子工業株式会社代理人弁
理士 京 谷 四 部 外１名党 １ 図 太２図
Claims (1)
- 爲−個の印字ビンと罵個の印字ビン駆動用１グネツト・
フィルを有する印字ヘッドを搭、載するキャリア、該キ
ャリアを駆動するキャリア駆動モータ、１行分の印字ド
ツト・パターンを格納する印字パターン・メモリ、プリ
ンタ全体を制御する全体制御回路、ゲート信号がオンの
ときにデータ書込み可能となると共に上記印字パターン
・メモリから読出された琳ピットの列エレメントを格納
できる寓ビットのラッチを少なくとも有する印字データ
・ラッチ回路群、該印字データ・ラッチ回路群にセット
される列エレメントの各ビット信号を対広する印字ビン
駆動マグネット・コイルに供給する信号線を備えるイン
パクト型シリアル・ドツト・プリンクであって、外部か
ら入力される印字モード指令情報を記憶する印字モード
記憶手段を有し、上記全体制御回路は、印字を開始する
とき上記印字モード記憶手段の内容が分割印字モードで
あることを示している場合には、上記印字データーラッ
チ回路群の篇ビットのラッチを複数の分割ラッチ・グル
ープに分割し、１個の分割ラッチ会グループに属するツ
ッデＩ−ト信号のみをオンとして上記印字パターン・メ
毫りの全印字ドツト・パターンヲ所定のタイセンダ信号
と同期して１列エレメントずつ取出して上記印字データ
ーラッチ回路群に供給する動作を、各分割ラッチ・グル
ープ毎に行うよう構成されていることを特徴とするイン
パクト型シリアル・ドツト・プリンタの制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16923781A JPS5869071A (ja) | 1981-10-22 | 1981-10-22 | インパクト型シリアル・ドット・プリンタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16923781A JPS5869071A (ja) | 1981-10-22 | 1981-10-22 | インパクト型シリアル・ドット・プリンタ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5869071A true JPS5869071A (ja) | 1983-04-25 |
| JPH022428B2 JPH022428B2 (ja) | 1990-01-18 |
Family
ID=15882774
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16923781A Granted JPS5869071A (ja) | 1981-10-22 | 1981-10-22 | インパクト型シリアル・ドット・プリンタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5869071A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59176050A (ja) * | 1983-03-25 | 1984-10-05 | Seikosha Co Ltd | 多色印字方法 |
| JPS62249748A (ja) * | 1986-04-15 | 1987-10-30 | レックスマーク・インターナショナル・インコーポレーテッド | ドツト・マトリツクス・プリンタの動作を静粛にする方法 |
| EP0518670A2 (en) * | 1991-06-14 | 1992-12-16 | Canon Kabushiki Kaisha | Ink jet recording apparatus |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5585985A (en) * | 1978-12-22 | 1980-06-28 | Nec Corp | Print method for dot matrix printer |
| JPS5653084A (en) * | 1979-10-08 | 1981-05-12 | Hitachi Ltd | Printer |
-
1981
- 1981-10-22 JP JP16923781A patent/JPS5869071A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5585985A (en) * | 1978-12-22 | 1980-06-28 | Nec Corp | Print method for dot matrix printer |
| JPS5653084A (en) * | 1979-10-08 | 1981-05-12 | Hitachi Ltd | Printer |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59176050A (ja) * | 1983-03-25 | 1984-10-05 | Seikosha Co Ltd | 多色印字方法 |
| JPH0356190B2 (ja) * | 1983-03-25 | 1991-08-27 | ||
| JPS62249748A (ja) * | 1986-04-15 | 1987-10-30 | レックスマーク・インターナショナル・インコーポレーテッド | ドツト・マトリツクス・プリンタの動作を静粛にする方法 |
| EP0244604A2 (en) * | 1986-04-15 | 1987-11-11 | Lexmark International, Inc. | Method and apparatus for quieting the operation of a dot matrix printer |
| EP0518670A2 (en) * | 1991-06-14 | 1992-12-16 | Canon Kabushiki Kaisha | Ink jet recording apparatus |
| US5359355A (en) * | 1991-06-14 | 1994-10-25 | Canon Kabushiki Kaisha | Ink jet recording apparatus for recording with variable scanning speeds |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH022428B2 (ja) | 1990-01-18 |
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