JPS58179072A - 階調信号発生回路 - Google Patents
階調信号発生回路Info
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- JPS58179072A JPS58179072A JP6295682A JP6295682A JPS58179072A JP S58179072 A JPS58179072 A JP S58179072A JP 6295682 A JP6295682 A JP 6295682A JP 6295682 A JP6295682 A JP 6295682A JP S58179072 A JPS58179072 A JP S58179072A
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04N3/00—Scanning details of television systems; Combination thereof with generation of supply voltages
- H04N3/10—Scanning details of television systems; Combination thereof with generation of supply voltages by means not exclusively optical-mechanical
- H04N3/12—Scanning details of television systems; Combination thereof with generation of supply voltages by means not exclusively optical-mechanical by switched stationary formation of lamps, photocells or light relays
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
ル表示装置に関する。
近年 携帯用小型テレビ受像機にして、ブラウン管の代
りに液晶マトリクスパネルを使用し７た液晶テレビ受像
機が開発され、すでに実用化されている。第１図は液晶
マトリクスノＪ？ネルを用いて映像信号を表示する場合
の構成図である。
りに液晶マトリクスパネルを使用し７た液晶テレビ受像
機が開発され、すでに実用化されている。第１図は液晶
マトリクスノＪ？ネルを用いて映像信号を表示する場合
の構成図である。
映像増幅回路（図示せず）で増幅された映像信号は、制
御回路ノにおいて水平周期信号及び垂直周期信号が分離
される。制御回路１は上記水平周期信号及び垂直周期信
号を元Ｖこ各種制御信号を作成Ｌ．、Ａ／’Ｄ （アナ
ログ／デジタル）変換回路２、走査電極駆動回路３、信
号電極駆動回路４の動作を制御する。また、上記映倫信
号は、上記Ａ／Ｄ変換回路２によってにビットのデジタ
ル信号に変換され、信号電極駆動回路４ Ｖｃ加えられ
る。この信号電極駆動回路４は、上記にビットのデジタ
ル信号を用いて液晶駆動用の２に扮類の階調波形を作り
、ｍＸｎの液晶マトリクス・セネル５の各信号電極に駆
動信号Ｙ１〜Ｙｒｒｌを印加する。また、走査電極駆動
回路３は、液晶マトリクス・？ネル５のｎ本の走査電極
を線順次駆動する。
御回路ノにおいて水平周期信号及び垂直周期信号が分離
される。制御回路１は上記水平周期信号及び垂直周期信
号を元Ｖこ各種制御信号を作成Ｌ．、Ａ／’Ｄ （アナ
ログ／デジタル）変換回路２、走査電極駆動回路３、信
号電極駆動回路４の動作を制御する。また、上記映倫信
号は、上記Ａ／Ｄ変換回路２によってにビットのデジタ
ル信号に変換され、信号電極駆動回路４ Ｖｃ加えられ
る。この信号電極駆動回路４は、上記にビットのデジタ
ル信号を用いて液晶駆動用の２に扮類の階調波形を作り
、ｍＸｎの液晶マトリクス・セネル５の各信号電極に駆
動信号Ｙ１〜Ｙｒｒｌを印加する。また、走査電極駆動
回路３は、液晶マトリクス・？ネル５のｎ本の走査電極
を線順次駆動する。
しかして、上記信号電極駆動回路４は、従来第２図に示
すように構成されている。また、第３図は信号電極駆動
回路４の動作を示すタイミングチャートである。なお、
第２図及び第３図は、Ｋ−４で階調が「１６」、液晶マ
トリクスパネル５の電極構造は二重マトリクス、絵素数
はｒ１２０Ｘ１６０Ｊの場合について示したものである
。
すように構成されている。また、第３図は信号電極駆動
回路４の動作を示すタイミングチャートである。なお、
第２図及び第３図は、Ｋ−４で階調が「１６」、液晶マ
トリクスパネル５の電極構造は二重マトリクス、絵素数
はｒ１２０Ｘ１６０Ｊの場合について示したものである
。
第２図において、１１は４ピツ）Ｘ３２０段のシフトレ
ジスタで、Ａ／Ｄ変換回路２からの４ビ、トデジタル信
号をサンプリングクロックφ、によシ順次読込む。そし
て、このシフトレジスタ１ノに読込まれたデータは、う
、チ・やルス礼に同期し、て動作する４ビ、）Ｘ３２０
段のバッフアノ２を介して１６チヤンネルのマルチプレ
クサ１３へ送られる。また、このマルチプレクサ１３に
は、輝度変調・ンルス発生回路１４から輝度変調・そル
スＰＹ０〜ＰＹ１５が入力される。上記輝度変調・ンル
ス発生回路１４は、クロ、り・やルスＣＰ１及びタイミ
ング信号Ｍによって、１ｇ３図に示すようにそれぞれ時
間幅の異なる１６種の輝度変調・セルスＰＹｏ−ＰＹ、
５を発生する。上記タイミング信号Ｍは、２Ｈ（Ｈは水
平走査周期）の周期で発生する。しかして、上記マルチ
プレクサ１３は、バッファ１２からのデータに従って輝
度変調・平ルスＰＹｏ−ＰＹ１５を選択し、信号８１〜
”’ ５２０として２チヤンネル・アナログ・マルチプ
レクサ１５へ出力する。また、このマルチプレクサ１５
には、駆動パルス発生回路１６から２種の選択電圧ＹＢ
、ＹＮ８が与えられる。この駆動パルス発生回路１６は
、それぞれレベルの異なる■。、Ｖ、Ｖ３．Ｖ５の電圧
をタイミング信号Ｍに同期して選４７＜ １、第３図に
示すようにＶ、、とｖ５との間で２Ｈ毎に反転する選択
電圧Ｙ８、■２と■３との間で２Ｈ毎に反転する選択電
圧ＹＮＳを出力する。そして、上記マルチプレクサ１５
は、信号８１〜５３２０がハイレベルの時は選択電圧Ｙ
８ 、。
ジスタで、Ａ／Ｄ変換回路２からの４ビ、トデジタル信
号をサンプリングクロックφ、によシ順次読込む。そし
て、このシフトレジスタ１ノに読込まれたデータは、う
、チ・やルス礼に同期し、て動作する４ビ、）Ｘ３２０
段のバッフアノ２を介して１６チヤンネルのマルチプレ
クサ１３へ送られる。また、このマルチプレクサ１３に
は、輝度変調・ンルス発生回路１４から輝度変調・そル
スＰＹ０〜ＰＹ１５が入力される。上記輝度変調・ンル
ス発生回路１４は、クロ、り・やルスＣＰ１及びタイミ
ング信号Ｍによって、１ｇ３図に示すようにそれぞれ時
間幅の異なる１６種の輝度変調・セルスＰＹｏ−ＰＹ、
５を発生する。上記タイミング信号Ｍは、２Ｈ（Ｈは水
平走査周期）の周期で発生する。しかして、上記マルチ
プレクサ１３は、バッファ１２からのデータに従って輝
度変調・平ルスＰＹｏ−ＰＹ１５を選択し、信号８１〜
”’ ５２０として２チヤンネル・アナログ・マルチプ
レクサ１５へ出力する。また、このマルチプレクサ１５
には、駆動パルス発生回路１６から２種の選択電圧ＹＢ
、ＹＮ８が与えられる。この駆動パルス発生回路１６は
、それぞれレベルの異なる■。、Ｖ、Ｖ３．Ｖ５の電圧
をタイミング信号Ｍに同期して選４７＜ １、第３図に
示すようにＶ、、とｖ５との間で２Ｈ毎に反転する選択
電圧Ｙ８、■２と■３との間で２Ｈ毎に反転する選択電
圧ＹＮＳを出力する。そして、上記マルチプレクサ１５
は、信号８１〜５３２０がハイレベルの時は選択電圧Ｙ
８ 、。
−レベルでは選択電圧ＹＮ、を選択し、第３図に示すよ
うに駆動信号Ｙｉ （Ｙ、〜Ｙ３２ｏ）として液晶マト
リクスパネル５へ出力する。なお、ＷＪ３図における駆
動信号Ｙｉは、４ビツトデータがｒｏｏｌｏＪで、輝度
変調・９ルスＰＹ２が選択され九場合の波形を示し九も
のである。
うに駆動信号Ｙｉ （Ｙ、〜Ｙ３２ｏ）として液晶マト
リクスパネル５へ出力する。なお、ＷＪ３図における駆
動信号Ｙｉは、４ビツトデータがｒｏｏｌｏＪで、輝度
変調・９ルスＰＹ２が選択され九場合の波形を示し九も
のである。
このようにして液晶駆動信号Ｙ１〜Ｙ、２ｏが作成され
るが、従来の回路では１６の輝度ｉｆ、１４・ＰルスＰ
Ｙｏ−ＰＹ、５をマルチプレクサ１３Ｖこ入力するので
、信号線が多くなると共に、マルチプレクサ１３を構成
するダートの数が多くなり、ＬＳＩのチップサイズが大
きくなるという問題がある。
るが、従来の回路では１６の輝度ｉｆ、１４・ＰルスＰ
Ｙｏ−ＰＹ、５をマルチプレクサ１３Ｖこ入力するので
、信号線が多くなると共に、マルチプレクサ１３を構成
するダートの数が多くなり、ＬＳＩのチップサイズが大
きくなるという問題がある。
本発明は上記の点に鑑みてなされたもので、信号電極駆
動回路の構成を簡略化し得ると共に、ＬＳＩテツｆｔｊ
イズを小さくし得る液晶・やネル表示装置を提供するこ
とを目的とする。
動回路の構成を簡略化し得ると共に、ＬＳＩテツｆｔｊ
イズを小さくし得る液晶・やネル表示装置を提供するこ
とを目的とする。
以下図面を参照して本発明の一実施例を説明する。第４
図は第１図における信号電極駆動回路４部分の構成を示
し九もので、２ノは４ピツ）Ｘ３２０段のシフトレジス
タである。とのシフトレジスタ２ノには、第１図のＡ／
Ｄ変換回路２から送られてくる４ビ、トの映倫信号がサ
ンプリングクロックφ８に同期して読み込まれる。
図は第１図における信号電極駆動回路４部分の構成を示
し九もので、２ノは４ピツ）Ｘ３２０段のシフトレジス
タである。とのシフトレジスタ２ノには、第１図のＡ／
Ｄ変換回路２から送られてくる４ビ、トの映倫信号がサ
ンプリングクロックφ８に同期して読み込まれる。
そして、このシフトレジスタ２ノに保持されたデータは
、ラノチノフルスφ、により４ビット×３２０段のバッ
ファ２２にラッチされ、階調信号作成回路２３へ転送さ
れる。また、２４は輝度変調・ンルス発生回路で、う、
チクロックφ１及びクロ７り・やルスφ１．でよって輝
度変調信号Ｐ１〜Ｐ４を発生し、上記階調信号作成回路
２３へ入力する。
、ラノチノフルスφ、により４ビット×３２０段のバッ
ファ２２にラッチされ、階調信号作成回路２３へ転送さ
れる。また、２４は輝度変調・ンルス発生回路で、う、
チクロックφ１及びクロ７り・やルスφ１．でよって輝
度変調信号Ｐ１〜Ｐ４を発生し、上記階調信号作成回路
２３へ入力する。
上記輝度変調・Ｐルス発生回路２４は、ラッチクロ、り
φ、でリセットされ、クロックツｅルスφ２を分周する
カウンタからなり、このカウンタにより順次Ａ分周され
た輝度変調パルスＰ１〜Ｐ４が作成される。しかして、
上記階調信号作成回路２３は、バッファ２２からの信号
及び輝度変調パルス発生回路２４からの輝度変調ノフル
スＰ、〜Ｐ４によって時間幅の異なる１６種の階調信号
８１〜”３２０を作成シフ、２チヤンネル・アナログ・
マルチゾレクヤ２５へ出力する。このマルチルりｆ２５
ｔｄ、フレームパルスφ、及びそれぞれレベルの異なる
■。、 Ｖ、、 、 Ｖ３． Ｖ５ の電圧Ｖこよっ
て駆動信号￥１〜Ｙ３□。を発生する。この駆動信号Ｙ
、〜Ｙ５２０によってＭＩ図における液晶マトリクス・
２ネル５の信号電極が駆動される。
φ、でリセットされ、クロックツｅルスφ２を分周する
カウンタからなり、このカウンタにより順次Ａ分周され
た輝度変調パルスＰ１〜Ｐ４が作成される。しかして、
上記階調信号作成回路２３は、バッファ２２からの信号
及び輝度変調パルス発生回路２４からの輝度変調ノフル
スＰ、〜Ｐ４によって時間幅の異なる１６種の階調信号
８１〜”３２０を作成シフ、２チヤンネル・アナログ・
マルチゾレクヤ２５へ出力する。このマルチルりｆ２５
ｔｄ、フレームパルスφ、及びそれぞれレベルの異なる
■。、 Ｖ、、 、 Ｖ３． Ｖ５ の電圧Ｖこよっ
て駆動信号￥１〜Ｙ３□。を発生する。この駆動信号Ｙ
、〜Ｙ５２０によってＭＩ図における液晶マトリクス・
２ネル５の信号電極が駆動される。
次に上記シフトレジスタ２１．パ、ファ２２、階調信号
作成回路２３、Ｔルナプレクサ２５の眸細について第５
図によ＃）説明する 第５図は上記各回路の３２０段中
の１段のみを取出して示したものである。シフトレジス
タ２ノは、各段が４ビツトの第１及び第２のレジスタ２
１ノ。
作成回路２３、Ｔルナプレクサ２５の眸細について第５
図によ＃）説明する 第５図は上記各回路の３２０段中
の１段のみを取出して示したものである。シフトレジス
タ２ノは、各段が４ビツトの第１及び第２のレジスタ２
１ノ。
２１２からなっており、第１図のＡ／Ｄ変換回路２から
送られてくる４ビツトのデータＤ１〜Ｄ４がサンプリン
グクロックφ、ＫｆＷ１期して第１のレジスタ２１ノに
読込まれる。この＄１のレジスタ２１１に保持されたデ
ータは、パ、ファ２２へ出力されると共ｅこ、サンプリ
ングクロンクφ、ＶＣよって動作する第２のレジスタ２
１２を介して次段のレジスタへ送られる。上記パ、ファ
２２は、各段が４ビツトの・９ツ７アレノスタ２２ノに
よって構成されており、第１のレジスタ２１１からのデ
ータをラッチ・９ルスφ、に同期して読み込み、階調信
号作成回路２３へ出力する。この階調信号作成回路２３
は、オア回路２３１〜２３４、アンド回路２３５、フリ
ップフロッグ２３６〜２３８からなっておシ、上記パ、
７丁レノスタ２２ノからのデータが、輝度変調パルス発
生但路２４からの輝度変調パルスＰ、〜Ｐ４と共にオア
回路２３１〜２３４を介してアンド回路２３５に入力さ
れる。このアンド回路２３５の出力はクロ、クバルスφ
ユに同期してフリツノ７０ツグ２３６に読み込まれ、そ
の出力がフリップフロ、ｆ２３７のリセット端子Ｒへ入
力される。このフリップフロラｆ２３７は、ラッチノ母
ルスφ１によってセットされ、フリ７・グツロッジ２３
６はう、テ・ンルスφ、によってリセットされる。そし
７て、フリツノフロ、プ２３７の出力がクロックパルス
φ２に同期してフリップフロラｆ２３８に読み込まれ、
ＩｖＦＩ１４信号Ｓｉとしてアナログ・マｋ ｆ ｆ
Ｌ／ クザ２５へ送られる。このマルチブレフサ２５は
、デコーダ２５１及びトランスファゲート２５２〜２５
５からなり、Ｌ記フリッゾフロッゾ２３８からの階調信
号Ｓｌ及びフレームパルスφｆがデコーダ２５１に入力
される、トランス７アグート２５２〜２５５には、Ｖ、
ｌＶ２゜Ｖ３． Ｖｏ、の電圧がそれぞれ入力されてお
り、デコーダ２５１の出力によってｆ−）制御が行なわ
れ、ｖ５． ｖ２． ｖ３． ｖｏの電圧が選択されて
信号電極駆動信号Ｙｉとして出力される、 次に上記実施例の動作を第６図のタイミングチャートを
参照Ｉ７て説明する。Ａ／Ｄ変換回路２から出力される
４ビツトのデータＤ１〜Ｄ４Ｕ シフトレジスタ２１
に入力され サンプリングノタルスφ８によってレジス
タ２１１に読み込まれ、その後う７．チパルスφＬによ
ってパッファレノスタ２２ノに転送される。このパ、フ
ァレジスタ２２ノに保持されたデータは、輝度変調・平
ルスＰ１〜Ｐ４と共にオア回路２３１〜２３４を介］７
てアンド回路２３５に入力される。上記輝度変調・ンル
スＰ１〜Ｐ４は、第６図に示すようにクロック・ンルス
φ２を基準として順次Ｖ分周したものである。Ｉ７かし
て、今例えば、パ、７アレジスタ２２１に「９」のデー
タつまシｒｌｏｏ］Ｊが入力されたとすると、階調信号
作成回路２３においては、オア回路２３１〜２３４のう
ち最下位及び最上位のオア回路２３１，２３４の出力は
”１″となり、オア回路２３２，２３３の出力はそれぞ
れ輝度変調信号Ｐ２． Ｐ６となる。上記オア回路２３
１〜２３４の出力は、アンド回路２３５を介し２て取り
出され、クロック・やルスφ２に同期してフリ、ノフロ
ッｆ２３６に読み込まれる。上記の例では、第６図に示
すように輝度変調ノルスＰ２． Ｐ、、が共に１＃とな
るタイミングでアンド回路２３５の論理条件が成立し、
その出力が” １ ”となってフリップフロップ２３６
に読ミ込まれる。一方、フリ、グツロッジ２３７は、う
、す・ンルスφ１が与えられるｔｌのタイミングでセッ
トされ、その後、ｔ２タイミングにおいて、輝度変調・
ｅ ／Ｌ−スＰ２． Ｐ５が共に“１″になった時の土
記アンド回路２３５の出力によってリセ、）される。上
記フリ、ｆフロ、プ２３７の出力は、クロック・ぞルス
φ２に同期してフリッデフロッ！２３８に読み込−まれ
、その出力が信号Ｓ１となる。
送られてくる４ビツトのデータＤ１〜Ｄ４がサンプリン
グクロックφ、ＫｆＷ１期して第１のレジスタ２１ノに
読込まれる。この＄１のレジスタ２１１に保持されたデ
ータは、パ、ファ２２へ出力されると共ｅこ、サンプリ
ングクロンクφ、ＶＣよって動作する第２のレジスタ２
１２を介して次段のレジスタへ送られる。上記パ、ファ
２２は、各段が４ビツトの・９ツ７アレノスタ２２ノに
よって構成されており、第１のレジスタ２１１からのデ
ータをラッチ・９ルスφ、に同期して読み込み、階調信
号作成回路２３へ出力する。この階調信号作成回路２３
は、オア回路２３１〜２３４、アンド回路２３５、フリ
ップフロッグ２３６〜２３８からなっておシ、上記パ、
７丁レノスタ２２ノからのデータが、輝度変調パルス発
生但路２４からの輝度変調パルスＰ、〜Ｐ４と共にオア
回路２３１〜２３４を介してアンド回路２３５に入力さ
れる。このアンド回路２３５の出力はクロ、クバルスφ
ユに同期してフリツノ７０ツグ２３６に読み込まれ、そ
の出力がフリップフロ、ｆ２３７のリセット端子Ｒへ入
力される。このフリップフロラｆ２３７は、ラッチノ母
ルスφ１によってセットされ、フリ７・グツロッジ２３
６はう、テ・ンルスφ、によってリセットされる。そし
７て、フリツノフロ、プ２３７の出力がクロックパルス
φ２に同期してフリップフロラｆ２３８に読み込まれ、
ＩｖＦＩ１４信号Ｓｉとしてアナログ・マｋ ｆ ｆ
Ｌ／ クザ２５へ送られる。このマルチブレフサ２５は
、デコーダ２５１及びトランスファゲート２５２〜２５
５からなり、Ｌ記フリッゾフロッゾ２３８からの階調信
号Ｓｌ及びフレームパルスφｆがデコーダ２５１に入力
される、トランス７アグート２５２〜２５５には、Ｖ、
ｌＶ２゜Ｖ３． Ｖｏ、の電圧がそれぞれ入力されてお
り、デコーダ２５１の出力によってｆ−）制御が行なわ
れ、ｖ５． ｖ２． ｖ３． ｖｏの電圧が選択されて
信号電極駆動信号Ｙｉとして出力される、 次に上記実施例の動作を第６図のタイミングチャートを
参照Ｉ７て説明する。Ａ／Ｄ変換回路２から出力される
４ビツトのデータＤ１〜Ｄ４Ｕ シフトレジスタ２１
に入力され サンプリングノタルスφ８によってレジス
タ２１１に読み込まれ、その後う７．チパルスφＬによ
ってパッファレノスタ２２ノに転送される。このパ、フ
ァレジスタ２２ノに保持されたデータは、輝度変調・平
ルスＰ１〜Ｐ４と共にオア回路２３１〜２３４を介］７
てアンド回路２３５に入力される。上記輝度変調・ンル
スＰ１〜Ｐ４は、第６図に示すようにクロック・ンルス
φ２を基準として順次Ｖ分周したものである。Ｉ７かし
て、今例えば、パ、７アレジスタ２２１に「９」のデー
タつまシｒｌｏｏ］Ｊが入力されたとすると、階調信号
作成回路２３においては、オア回路２３１〜２３４のう
ち最下位及び最上位のオア回路２３１，２３４の出力は
”１″となり、オア回路２３２，２３３の出力はそれぞ
れ輝度変調信号Ｐ２． Ｐ６となる。上記オア回路２３
１〜２３４の出力は、アンド回路２３５を介し２て取り
出され、クロック・やルスφ２に同期してフリ、ノフロ
ッｆ２３６に読み込まれる。上記の例では、第６図に示
すように輝度変調ノルスＰ２． Ｐ、、が共に１＃とな
るタイミングでアンド回路２３５の論理条件が成立し、
その出力が” １ ”となってフリップフロップ２３６
に読ミ込まれる。一方、フリ、グツロッジ２３７は、う
、す・ンルスφ１が与えられるｔｌのタイミングでセッ
トされ、その後、ｔ２タイミングにおいて、輝度変調・
ｅ ／Ｌ−スＰ２． Ｐ５が共に“１″になった時の土
記アンド回路２３５の出力によってリセ、）される。上
記フリ、ｆフロ、プ２３７の出力は、クロック・ぞルス
φ２に同期してフリッデフロッ！２３８に読み込−まれ
、その出力が信号Ｓ１となる。
この信号５ｊｉｉ、第６図に示す波形からも明らかなよ
うに１＃の期間が６／４Ｈ，′０”の期間が９／４Ｈと
なっており、“１″の期間は４ビツトデータ「９」の補
数の「６」となっている。
うに１＃の期間が６／４Ｈ，′０”の期間が９／４Ｈと
なっており、“１″の期間は４ビツトデータ「９」の補
数の「６」となっている。
マタ、パ、ファレジスタ２２１に例えば「１３」のデー
タつｉ 、９ ｒｌｌｏＩＪが入力された場合は、第６
図に示すようにオア回路２２１．２２３゜２２４の出力
が°１”となシ、オア回路２２２の出力は輝度変調信号
Ｐ２となる。従ってフリップフロップ２３７が２ツチノ
９ルスφＬによってセットされると、その後、輝度変調
信号Ｐ２が立ち上がった際のアンド回路２３５の出力に
よってリセットされる。従ってフリップフロップ２３８
から出力される信号ＳＩは、”１″の期間が２／４Ｈ１
゛０“の期間が１３／４ Ｈとなり、１″の期間は４ビ
ツトデータ「１３」の補数の「２」となっている。
タつｉ 、９ ｒｌｌｏＩＪが入力された場合は、第６
図に示すようにオア回路２２１．２２３゜２２４の出力
が°１”となシ、オア回路２２２の出力は輝度変調信号
Ｐ２となる。従ってフリップフロップ２３７が２ツチノ
９ルスφＬによってセットされると、その後、輝度変調
信号Ｐ２が立ち上がった際のアンド回路２３５の出力に
よってリセットされる。従ってフリップフロップ２３８
から出力される信号ＳＩは、”１″の期間が２／４Ｈ１
゛０“の期間が１３／４ Ｈとなり、１″の期間は４ビ
ツトデータ「１３」の補数の「２」となっている。
従って階調と４ビツトデータとの対応は次の表のように
なる・ しかして、上記フリップフロップ２３８から出力される
信号Ｓ１は、フレーム毎に１＃と１０″が切換するフレ
ーム・臂ルスφｆとがデコーダ２５１ＶＣ入力サレ、ｖ
ｏ、 ｖ２． ｖ３． ｖ５の４ａｆ類の電圧のうち、
何れか１つがデコーダ２５１の出力によりトランスファ
ダート２５２〜２５５を介して選択され、駆動信号Ｙ１
として出力される０例えばＳｌ＝”Ｏ”、φｆ−″０１
の場合はｖ２、ｓ１＝ ”ｏ”’ 。
なる・ しかして、上記フリップフロップ２３８から出力される
信号Ｓ１は、フレーム毎に１＃と１０″が切換するフレ
ーム・臂ルスφｆとがデコーダ２５１ＶＣ入力サレ、ｖ
ｏ、 ｖ２． ｖ３． ｖ５の４ａｆ類の電圧のうち、
何れか１つがデコーダ２５１の出力によりトランスファ
ダート２５２〜２５５を介して選択され、駆動信号Ｙ１
として出力される０例えばＳｌ＝”Ｏ”、φｆ−″０１
の場合はｖ２、ｓ１＝ ”ｏ”’ 。
φｆ＝゛１″の場合はｖ３、Ｓ１＝″１＃、φｆ＝−０
”の場合はｖ。、ＳＩ−′１”、φｆ＝″′１″の場合
は■５が選択される。そして、上記駆動信号Ｙ１によっ
て第１図における液昂マドＩＪクス・ンネル５の信号電
極が駆動される。
”の場合はｖ。、ＳＩ−′１”、φｆ＝″′１″の場合
は■５が選択される。そして、上記駆動信号Ｙ１によっ
て第１図における液昂マドＩＪクス・ンネル５の信号電
極が駆動される。
以上述べたように本発明によれば、輝度変調パルス発生
回路２４から４本の信号ラインを介して階調信号作成回
路２３に輝度変調・平ルスを与えて１６８１の階調信号
を作成することができ、信号線数の減少韮びに階調信号
作成回路２３の構成を簡略化してチップサイズを小さく
することができる。
回路２４から４本の信号ラインを介して階調信号作成回
路２３に輝度変調・平ルスを与えて１６８１の階調信号
を作成することができ、信号線数の減少韮びに階調信号
作成回路２３の構成を簡略化してチップサイズを小さく
することができる。
第１図は液晶テレビ受儂機における液晶マトリクスパネ
ルの駆動系の概略構成を示す図、第２図は従来の信号電
極駆動回路を示すブロック図、第３図Ｆｉ第２図の動作
を説明するためのタイミングチャート、第４図は本発明
の一実施例における信号電極駆動回路の構成を示すブロ
ック図、第５図は第４図の主要部を示す回路構成図、第
６図は第５図の動作を説明するためのタイミングチャー
トである。 １ 制御回路、２・・・Ａ／Ｄ変換回路、３・・・走査
［極部側回路、４・・信号電極駆動回路、５・・液晶マ
トリクスノ？イル、２）・・・シフトレジスタ、２２・
バ、ノア、２３・・階８１４（ｉ！号作成回路、２４
輝度に調・Ｐルス発生回路、２５・・・２チヤンネル
アナログ・マルチプレクサ。
ルの駆動系の概略構成を示す図、第２図は従来の信号電
極駆動回路を示すブロック図、第３図Ｆｉ第２図の動作
を説明するためのタイミングチャート、第４図は本発明
の一実施例における信号電極駆動回路の構成を示すブロ
ック図、第５図は第４図の主要部を示す回路構成図、第
６図は第５図の動作を説明するためのタイミングチャー
トである。 １ 制御回路、２・・・Ａ／Ｄ変換回路、３・・・走査
［極部側回路、４・・信号電極駆動回路、５・・液晶マ
トリクスノ？イル、２）・・・シフトレジスタ、２２・
バ、ノア、２３・・階８１４（ｉ！号作成回路、２４
輝度に調・Ｐルス発生回路、２５・・・２チヤンネル
アナログ・マルチプレクサ。
Claims (1)
- テレビ映像信号をデジタル信号に変換するＡ／Ｄ変換回
路と、このＡ／Ｄ変換回路から出力されるｎビ、ト単位
のデジタル信号を一時記憶するシフトレノスタと、基準
クロックを順次分周して０種の輝度変調・９ルスを発生
する輝度変調・ぞルス発生回路と、上記輝度変調・七ル
ス及び上記シフトレソスクから出力されるｎビ、トのデ
ータとのオア出力により論理積出力を得る論理回路と、
水平走査周期の整数倍の周期を持つラッチパルスによリ
セットされると共ｐＣ上記論理回路の出力によりリセッ
トされて２ｎ種の階調信号を得る手段と、上記階調信号
と１ル−ム毎にｌ″と“′Ｏ”が反転するフレーム・ゼ
ルスとをデコードシて複数レベルの電圧を順次選択して
液晶マトリクス・平ネルの信号電極駆動信号を得るマル
チプレクサとを具備したことを％徴とする液晶・ヂ不ル
表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6295682A JPS58179072A (ja) | 1982-04-15 | 1982-04-15 | 階調信号発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6295682A JPS58179072A (ja) | 1982-04-15 | 1982-04-15 | 階調信号発生回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58179072A true JPS58179072A (ja) | 1983-10-20 |
| JPH0443249B2 JPH0443249B2 (ja) | 1992-07-16 |
Family
ID=13215275
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6295682A Granted JPS58179072A (ja) | 1982-04-15 | 1982-04-15 | 階調信号発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58179072A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6256936A (ja) * | 1985-09-06 | 1987-03-12 | Matsushita Electric Ind Co Ltd | 液晶マトリツクス表示パネルの駆動法 |
| JPS6334593A (ja) * | 1986-07-30 | 1988-02-15 | ホシデン株式会社 | 多階調表示方法 |
| JPH09171189A (ja) * | 1997-01-27 | 1997-06-30 | Seiko Epson Corp | 液晶表示装置 |
| CN108831392A (zh) * | 2018-06-25 | 2018-11-16 | 武汉天马微电子有限公司 | 显示面板和显示装置 |
-
1982
- 1982-04-15 JP JP6295682A patent/JPS58179072A/ja active Granted
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6256936A (ja) * | 1985-09-06 | 1987-03-12 | Matsushita Electric Ind Co Ltd | 液晶マトリツクス表示パネルの駆動法 |
| JPS6334593A (ja) * | 1986-07-30 | 1988-02-15 | ホシデン株式会社 | 多階調表示方法 |
| JPH09171189A (ja) * | 1997-01-27 | 1997-06-30 | Seiko Epson Corp | 液晶表示装置 |
| CN108831392A (zh) * | 2018-06-25 | 2018-11-16 | 武汉天马微电子有限公司 | 显示面板和显示装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0443249B2 (ja) | 1992-07-16 |
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