JP2004133385A - 能動マトリクス表示装置とそのスイッチング信号発生器 - Google Patents
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Abstract
【課題】回路構成を簡単にした能動マトリクス表示装置とそのスイッチング信号発生器を提供する。
【解決手段】スイッチング信号発生器24,25は、能動マトリクス表示装置の複数のスイッチに接続された少なくとも一つの遅延デバイスを含む。遅延デバイスは、ソーススイッチング信号STを受信し、複数のスイッチを制御する複数のターゲットスイッチング信号S1〜Sn,T1〜Tmを対応させて生成するために、直列に接続された多くの遅延ユニットH1〜Hn,I1〜Imから構成される。複数のスイッチが一定間隔で一つずつスイッチオンされるように、どの二つの連続するターゲットスイッチング信号間にも一定の位相ずれがある。
【選択図】 図4
【解決手段】スイッチング信号発生器24,25は、能動マトリクス表示装置の複数のスイッチに接続された少なくとも一つの遅延デバイスを含む。遅延デバイスは、ソーススイッチング信号STを受信し、複数のスイッチを制御する複数のターゲットスイッチング信号S1〜Sn,T1〜Tmを対応させて生成するために、直列に接続された多くの遅延ユニットH1〜Hn,I1〜Imから構成される。複数のスイッチが一定間隔で一つずつスイッチオンされるように、どの二つの連続するターゲットスイッチング信号間にも一定の位相ずれがある。
【選択図】 図4
Description
【0001】
【発明の属する技術分野】
本発明はスイッチング信号発生器に関し、特に、能動マトリクス表示装置に使用されるスイッチング信号発生器に関する。本発明は、スイッチング信号発生器を備えた能動マトリクス表示装置にも関する。
【0002】
【従来の技術】
コンピュータ装置の設計と製造は大きく進歩している。種々の処理装置の高速化と性能向上により、我々のコンピュータ依存性は増加する。そのうえ、コンピュータ関連の熟練が学生または作業者に不可欠である。モニタはユーザとコンピュータとの直接通信媒体である。ユーザがコンピュータから必要とする全情報がモニタに表示される。したがって、コンピュータの速度と性能だけでなく、モニタの品質にも注意を払う必要がある。
【0003】
以前は、陰極線管(CRT)モニタの画面サイズを大きくすると、モニタの体積が必然的に大きくなっていた。それにより、ユーザがモニタを設置する場合に問題があった。さらに、従来のモニタの放射線は人体に有害である。液晶表示装置(LCD)は、これらの問題を解決するために開発された。
【0004】
図1に先行技術の液晶表示装置の構造を示す。液晶表示装置は主として、薄膜トランジスタ(TFT)アレイ100と駆動回路を含む。駆動回路は、データシフトレジスタ105、走査シフトレジスタ110、データスイッチC1〜Cn、Nビットディジタルアナログ変換器(DAC)D1〜Dnを含む。
【0005】
薄膜トランジスタアレイ100は、複数の列と行に配置された表示セルE11〜Emnから成り、液晶表示装置の表示領域である。図2に表示セルの一個を示す。各表示セルは、キャパシタ構造1001と薄膜トランジスタ1002を含む。キャパシタ構造1001は、アナログビデオ信号を保持する。薄膜トランジスタアレイ100は、複数行の走査線と複数列のデータ線を含む。一本の走査線が、指定行の全表示セルの薄膜トランジスタ1002のオン/オフ状態を制御する。データ線は、薄膜トランジスタ1002がオン状態である表示セルのキャパシタ構造1001にアナログビデオ信号を伝送する。
【0006】
走査シフトレジスタ110は、直列に相互接続された複数のレジスタユニットA1〜Amから成る。各レジスタユニットA1〜Amは、走査線の一つに対応している。走査シフトレジスタ110は、走査線を順次に有効にして薄膜トランジスタ1002のオン状態を行ごとに制御する。
【0007】
データシフトレジスタ105も、直列に相互接続された複数のレジスタユニットB1〜Bnから成る。各レジスタユニットB1〜Bnは、データスイッチC1〜Cnの一つに対応している。データシフトレジスタ105は、データスイッチC1〜Cnを順次にスイッチオンできる。各データスイッチC1〜Cnには、N個の薄膜トランジスタが含まれる(簡単のために図1では一個の薄膜トランジスタだけを示す)。或データスイッチをスイッチオンすると、Nビットデータ線(Din)のディジタルビデオ信号が、このデータスイッチを同時に通過する。
Nビットディジタルアナログ変換器D1〜Dnは、それぞれ対応するデータスイッチC1〜Cnに接続されている。各Nビットディジタルアナログ変換器D1〜Dnは、対応データスイッチC1〜Cnがスイッチオンされると、Nビットデータ線(Din)からディジタルビデオ信号を受信してアナログビデオ信号に変換する。アナログビデオ信号は、薄膜トランジスタアレイ100の対応するデータ線に入力される。
【0008】
図1に戻る。最初に、データスイッチC1は、データシフトレジスタ105のレジスタユニットB1によって制御され、第一グループのディジタルビデオ信号がNビットデータ線(Din)から入力される時にスイッチオンされる。それにより、第一グループのディジタルビデオ信号は、データスイッチC1を通過し、Nビットディジタルアナログ変換器D1によって第一グループのアナログビデオ信号に変換される。第一グループのアナログビデオ信号は、表示セルE11〜Em1を接続しているデータ線に入る。同時に、走査シフトレジスタ110のレジスタユニットA1は、表示セルE11〜E1nを接続している走査線を有効にして表示セルE11〜E1nの薄膜トランジスタをスイッチオンする。それにより、第一グループのアナログビデオ信号は表示セルE11に保持される。
【0009】
次に、データスイッチC2は、第二グループのディジタルビデオ信号がNビットデータ線(Din)から入力される時にデータシフトレジスタ105のレジスタユニットB2によってスイッチオンされる。それにより、第二グループのディジタルビデオ信号は、データスイッチC2を通過し、Nビットディジタルアナログ変換器D2によって第二グループのアナログビデオ信号に変換される。第二グループのアナログビデオ信号は、表示セルE12〜Em2を接続しているデータ線に入る。この段階(時点)では、表示セルE11〜E1nを接続している走査線が駆動されている。それゆえ、第二グループのアナログビデオ信号は、第一行の走査線と第二列のデータ線に対応する表示セルE12に保持される。
【0010】
その後、データシフトレジスタ105は残りの全データスイッチC3〜Cnを順次にスイッチオンし、第一行の表示セルE13〜E1nは対応グループのアナログビデオ信号を保持する。第一行の全表示セルEl1〜E1nがそれぞれのアナログビデオ信号を保持した後、走査シフトレジスタ110のレジスタユニットA2が有効にされ、表示セルE21〜E2nを接続している走査線を駆動する。アナログビデオ信号は、前述の手段によって薄膜トランジスタアレイ100の表示セルE21〜E2nに保持される。走査シフトレジスタ110が全走査線を順番に有効にした後、薄膜トランジスタアレイ100の全表示セルEl1〜Emnはアナログビデオ信号を保持している。それゆえ、液晶表示装置はスクリーンに完全なイメージページを表示する。
【0011】
薄膜トランジスタアレイ100の全表示セルE11〜Emnのアナログビデオ信号は、頻繁にリフレッシュされる。すなわち、液晶表示装置はイメージを高速でリフレッシュする。ユーザがスクリーンで見るものは、動的(前景)画像である。確かに、アナログビデオ信号が同じデータでリフレッシュされている時は静的(背景)画像が表示される。リフレッシュ速度が遅すぎると、液晶表示装置にフリッカ(ちらつき)が起こる場合がある。
【0012】
図3は、データシフトレジスタ105/走査シフトレジスタ110の回路図である。先行技術のシフトレジスタ105または110は、図1のレジスタユニットとして働く複数のフリップフロップ120を含む。フリップフロップ120は、液晶表示装置の駆動回路によって生成されるクロック信号(CLK)とスタートパルス信号(ST)に応答して動作する。フリップフロップ120は、クロック信号(CLK)によって制御され、スタートパルス信号をイネーブル信号に順次に変換して対応データスイッチCl〜Cnまたは走査線を有効にする。言い換えると、駆動回路は、データシフトレジスタ105用と走査シフトレジスタ110用に、二つのクロック信号(CLK)を生成する必要がある。クロック信号(CLK)はシフトレジスタ105と110の各フリップフロップに入力される必要があり、そのため多くのピンが必要である。この必要条件がシフトレジスタ105と110の設計と製造を複雑にすることは明白である。そのような問題を解決するために、より良い設計の開発に努力がなされている。
【0013】
【発明が解決しようとする課題】
本発明の目的は、能動マトリクス表示装置の回路構成を簡単にする、能動マトリクス表示装置の駆動回路用スイッチング信号発生器を提供することである。
本発明の別の目的は、簡略化された回路構造の能動マトリクス表示装置を提供することである。
【0014】
【課題を解決するための手段】
本発明の第一側面は、能動マトリクス表示装置の複数のスイッチと共に使用されるスイッチング信号発生器に関する。スイッチング信号発生器は、複数のスイッチに電気的に接続された複数の遅延ユニットを含む。スイッチング信号発生器は、複数のスイッチを経由して能動マトリクス表示装置の能動マトリクス部分に出力されるように信号を制御するためにソーススイッチング信号に応答して複数のターゲットスイッチング信号を生成する。全ての二つの連続するターゲットスイッチング信号間に一定の位相ずれがあり、それにより順番に複数のスイッチをスイッチオンして能動マトリクス部分に信号を出力する。
【0015】
実施形態では、能動マトリクス部分は、複数の走査線とデータ線で相互接続された薄膜トランジスタ(TFT)アレイを含む。
【0016】
望ましくは、遅延ユニットの最初の一つはソーススイッチング信号を受信し、後続する各遅延ユニットは先行する遅延ユニットの一つから出力されたターゲットスイッチング信号の一つを受信する。
【0017】
実施形態では、スイッチング信号発生器は、複数のスイッチの第一部分を通して能動マトリクス表示装置のデータ線に順次に出力されるように信号を制御するためにソーススイッチング信号に応答して複数のターゲットスイッチング信号の第一部分を生成する第一発生器部分と、複数のスイッチの第二部分を通して能動マトリクス表示装置の走査線に順次に出力されるように信号を制御するためにソーススイッチング信号に応答して複数のターゲットスイッチング信号の第二部分を生成する第二発生器部分を含む。
【0018】
複数のスイッチの第一部分を通して出力された信号がディジタルビデオ信号の場合、ディジタルビデオ信号は、データ線に出力される前に、能動マトリクス表示装置の複数のディジタルアナログ変換器によってアナログビデオ信号に変換されことが望ましい。
【0019】
本発明の第二側面は、能動マトリクス表示装置に使用されるスイッチング信号発生器に関する。このスイッチング信号発生器は、ソーススイッチング信号を受信して一組の第一ターゲットスイッチング信号を生成する第一発生器部分と、ソーススイッチング信号を受信して一組の第二ターゲットスイッチング信号を生成する第二発生器部分を含む。能動マトリクス表示装置の能動マトリクスユニットを順番にスイッチオンするために、第一ターゲットスイッチング信号の全ての二つの間に第一位相ずれがあり、第二ターゲットスイッチング信号の全ての二つの間に第二位相差がある。
【0020】
たとえば、能動マトリクス表示装置の能動マトリクスユニットは、走査線とデータ線で相互接続された薄膜トランジスタアレイを含む。
【0021】
望ましくは、第一発生器部分は複数の遅延ユニットを含み、遅延ユニットの最初の一つはソーススイッチング信号を受信して遅延させ、後続する各遅延ユニットは先行する遅延ユニットの一つから出力されたターゲットスイッチング信号の一つを受信して遅延させる。
【0022】
本発明の第三側面は能動マトリクス表示装置に関する。この能動マトリクス表示装置は、列と行に配置された複数の能動マトリクスユニットを含む能動マトリクス部分と、第一信号が能動マトリクスユニットに出力されるようにそれぞれの第一スイッチング信号に応答してスイッチオンされる複数の第一スイッチを含む第一スイッチ部分と、ソーススイッチング信号に応答して第一スイッチング信号を順番に生成することにより第一スイッチをスイッチオンして能動マトリクスユニットへの第一信号の順次出力を可能にする第一スイッチング信号発生器を含む。
【0023】
望ましくは、第一スイッチング信号発生器は、第一スイッチング信号を順番に生成するために直列に相互接続された複数の遅延ユニットを含む。
【0024】
望ましくは、能動マトリクス表示装置は更に、第二信号が能動マトリクスユニットに出力されるようにそれぞれの第二スイッチング信号に応答してスイッチオンされる複数の第二スイッチ含む第二スイッチ部分と、ソーススイッチング信号に応答して第二スイッチング信号を順番に生成することにより第二スイッチをスイッチオンして能動マトリクスユニットへの第二信号の順次出力を可能にする第二スイッチング信号発生器を含む。
【0025】
望ましくは、第二スイッチング信号発生器は、第二スイッチング信号を順番に生成するために直列に相互接続された複数の遅延ユニットを含む。
【0026】
実施形態では、第一信号はデータ線を経て能動マトリクスユニットに出力され、第二信号は走査線を経て能動マトリクスユニットに出力される。
【0027】
第一信号がディジタルビデオ信号の場合、望ましくは、能動マトリクス表示装置は更に、第一スイッチを通過するディジタルビデオ信号をアナログビデオ信号へ変換するために第一スイッチと能動マトリクスユニットの間に電気的に接続された複数のディジタルアナログ変換器を含む。
【0028】
【発明の実施の形態】
図4は、本発明による能動マトリクス表示装置の好ましい実施形態を概略的に示す回路ブロック図である。能動マトリクス表示装置には、Nビットデータ線(Din)、データスイッチC1〜Cn、走査スイッチG1〜Gm、Nビットディジタルアナログ変換器D1〜Dn、複数の表示セルE1〜Enからなる薄膜トランジスタアレイ23、第一スイッチング信号発生器24、および第二スイッチング信号発生器25が含まれる。
【0029】
第一スイッチング信号発生器24には、少なくとも一つの遅延デバイスが含まれる。この遅延デバイスは、直列に相互接続されたn個の遅延ユニットH1〜Hnから成る。遅延ユニットH1〜Hnは、それぞれのデータスイッチC1〜Cnに接続されている。ソーススイッチング信号(ST)の受信に応答して、遅延ユニットH1〜Hnは、データスイッチC1〜Cnに対応ターゲットスイッチング信号S1〜Snを供給する。全ての二つの連続するターゲットスイッチング信号間に一定の位相ずれがある。したがって、データスイッチC1〜Cnは順番にスイッチオンされる。すなわち、Nビットデータ線(Din)のディジタルビデオ信号は、対応データスイッチCl〜Cnを順次に通過する。
【0030】
遅延ユニットH1〜Hn、Nビットデータ線(Din)およびNビットディジタルアナログ変換器D1〜Dnに接続されたデータスイッチC1〜Cnは、Nビットデータ線からディジタルビデオ信号を受信し、対応ターゲットスイッチング信号に応答して対応Nビットディジタルアナログ変換器Dl〜Dnにディジタルビデオ信号を送信する。Nビットディジタルアナログ変換器は、受信したディジタルビデオ信号を、対応データ線に供給されるアナログビデオ信号に変換する。
【0031】
図4では、各データスイッチC1〜Cnは、簡単のために一つのトランジスタで表示されている。実際は、各データスイッチC1〜Cnは複数のトランジスタを含むことが望ましい。
【0032】
同様に、第二スイッチング信号発生器25には、少なくとも一つの遅延デバイスが含まれる。この遅延デバイスは、直列に相互接続されたm個の遅延ユニットI1〜Imから成る。遅延ユニットI1〜Imは、それぞれの走査スイッチG1〜Gmに接続されている。ソーススイッチング信号(ST)の受信に応答して、遅延ユニットI1〜Imは、走査スイッチG1〜Gmに対応ターゲットスイッチング信号T1〜Tmを供給する。全ての二つの連続するターゲットスイッチング信号間に一定の位相ずれがある。したがって、走査スイッチG1〜Gmは、一つずつ間隔をおいてスイッチオンされる。走査線が順番に駆動され、対応行の表示セルの薄膜トランジスタがスイッチオンされる。
【0033】
図4では、各走査スイッチG1〜Gmは、簡単のために一つのトランジスタで表示されている。実際は、各走査スイッチG1〜Gmは複数のトランジスタを含むことが望ましい。
【0034】
図5と6は、スイッチング信号間の位相関係を示す。ソーススイッチング信号STを受信すると、第一遅延ユニットH1は、ソーススイッチング信号からの位相ずれを有する第一ターゲットスイッチング信号S1を生成する。このスイッチング信号S1に応答して、第一データスイッチC1はスイッチオンされる。その結果、Nビットデータ線(Din)からの第一グループのディジタルビデオ信号は、第一データスイッチC1を通過し、Nビットディジタルアナログ変換器Dlにより第一グループのアナログビデオ信号に変換される。第一グループのアナログビデオ信号は薄膜トランジスタアレイ23の第一データ線に入り、第一データ線は表示セルE11〜Em1を制御する。同時に、第二スイッチング信号発生器25の第一遅延ユニットI1はスイッチング信号T1に応答して第一走査スイッチG1をスイッチオンすることにより薄膜トランジスタアレイ23の第一走査線を駆動し、第一走査線は表示セルEl1〜E1nを制御する。それゆえ、第一グループのアナログビデオ信号は第一走査線と第一データ線に対応する表示セルE11に保持される。
【0035】
遅延ユニットH2は、第一ターゲットスイッチング信号S1を受信して、第一ターゲットスイッチング信号S1よりも遅い位相ずれを有する第二ターゲットスイッチング信号S2を生成する。したがって、第一データスイッチC1に続いて、第二データスイッチC2がスイッチオンされる。それゆえ、Nビットデータ線(Din)からの第二グループのディジタルビデオ信号は、第二データスイッチC2を通過した後、Nビットディジタルアナログ変換器D2によって第二グループのアナログビデオ信号に変換される。第二グループのアナログビデオ信号は、表示セルE12〜Em2を接続している第二データ線に入る。この段階では、E11〜E1nを接続している第一走査線が駆動されている。それゆえ、第二グループのアナログビデオ信号は、第一走査線と第二データ線に対応する表示セルE12に保持される。
【0036】
同様に、他の遅延ユニットH3〜Hnからのスイッチング信号S3〜Snは、データスイッチC3〜Cnを順番にスイッチオンし、表示セルE13〜E1nに対応グループのアナログビデオ信号を保持させる。第一行の表示セルE11〜E1nにアナログビデオ信号が保持された後、第二スイッチング信号発生器25の第二遅延ユニットI2が第二ターゲットスイッチング信号T2を第二走査スイッチG2に供給することにより、表示セルE21〜E2nを接続している第二走査線を駆動する。アナログビデオ信号は、前記手段により薄膜トランジスタアレイ23の第二行の表示セルE21〜E2nに保持される。第二スイッチング信号発生器25が全走査線の駆動を完了した後では、薄膜トランジスタアレイ23の全表示セルE1l〜Emnにアナログビデオ信号が保持されている。それゆえ、液晶表示装置はスクリーンに完全なイメージページを表示する。
【0037】
結論として、スイッチング信号発生器24と25は、先行技術のデータシフトレジスタと走査シフトレジスタの代わりに用いられる。本発明によると、走査線とデータ線を駆動する走査スイッチとデータスイッチのオン/オフ状態を制御するために同じスタートパルス信号(ソーススイッチング信号)が用いられる。従って、回路チップのピン数を最小にできる。また、液晶表示装置の回路構成を単純化できる。
【0038】
現在最も実際的で望ましい実施形態であると考えられるものに関して本発明を記載したが、開示された実施形態に本発明を限定する必要がないことは自明である。それどころか、様々な変形と類似構造を含むように最も広い解釈を与えられるべき請求項の精神と範囲に含まれる変形と類似構成を包含することを意図する。
【図面の簡単な説明】
【図1】先行技術の液晶表示装置を示す概略回路ブロック図である。
【図2】図1の液晶表示装置の表示セルを示す概略回路図である。
【図3】図1のシフトレジスタを示す概略回路図である。
【図4】本発明による能動マトリクス表示装置の望ましい実施形態を示す概略回路ブロック図である。
【図5】本発明に従ってソーススイッチング信号および第一スイッチング信号発生器によって生成されるターゲットスイッチング信号の間の位相関係を示す波形図である。
【図6】本発明に従ってソーススイッチング信号および第二スイッチング信号発生器によって生成されるターゲットスイッチング信号の間の位相関係を示す波形図である。
【符号の説明】
E1〜En 表示セル
23 薄膜トランジスタアレイ
24 第一スイッチング信号発生器
25 第二スイッチング信号発生器
C1〜Cn データスイッチ
G1〜Gm 走査スイッチ
H1〜Hn 遅延ユニット
I1〜Im 遅延ユニット
ST ソーススイッチング信号
S1〜Sn ターゲットスイッチング信号
T1〜Tm ターゲットスイッチング信号
【発明の属する技術分野】
本発明はスイッチング信号発生器に関し、特に、能動マトリクス表示装置に使用されるスイッチング信号発生器に関する。本発明は、スイッチング信号発生器を備えた能動マトリクス表示装置にも関する。
【0002】
【従来の技術】
コンピュータ装置の設計と製造は大きく進歩している。種々の処理装置の高速化と性能向上により、我々のコンピュータ依存性は増加する。そのうえ、コンピュータ関連の熟練が学生または作業者に不可欠である。モニタはユーザとコンピュータとの直接通信媒体である。ユーザがコンピュータから必要とする全情報がモニタに表示される。したがって、コンピュータの速度と性能だけでなく、モニタの品質にも注意を払う必要がある。
【0003】
以前は、陰極線管(CRT)モニタの画面サイズを大きくすると、モニタの体積が必然的に大きくなっていた。それにより、ユーザがモニタを設置する場合に問題があった。さらに、従来のモニタの放射線は人体に有害である。液晶表示装置(LCD)は、これらの問題を解決するために開発された。
【0004】
図1に先行技術の液晶表示装置の構造を示す。液晶表示装置は主として、薄膜トランジスタ(TFT)アレイ100と駆動回路を含む。駆動回路は、データシフトレジスタ105、走査シフトレジスタ110、データスイッチC1〜Cn、Nビットディジタルアナログ変換器(DAC)D1〜Dnを含む。
【0005】
薄膜トランジスタアレイ100は、複数の列と行に配置された表示セルE11〜Emnから成り、液晶表示装置の表示領域である。図2に表示セルの一個を示す。各表示セルは、キャパシタ構造1001と薄膜トランジスタ1002を含む。キャパシタ構造1001は、アナログビデオ信号を保持する。薄膜トランジスタアレイ100は、複数行の走査線と複数列のデータ線を含む。一本の走査線が、指定行の全表示セルの薄膜トランジスタ1002のオン/オフ状態を制御する。データ線は、薄膜トランジスタ1002がオン状態である表示セルのキャパシタ構造1001にアナログビデオ信号を伝送する。
【0006】
走査シフトレジスタ110は、直列に相互接続された複数のレジスタユニットA1〜Amから成る。各レジスタユニットA1〜Amは、走査線の一つに対応している。走査シフトレジスタ110は、走査線を順次に有効にして薄膜トランジスタ1002のオン状態を行ごとに制御する。
【0007】
データシフトレジスタ105も、直列に相互接続された複数のレジスタユニットB1〜Bnから成る。各レジスタユニットB1〜Bnは、データスイッチC1〜Cnの一つに対応している。データシフトレジスタ105は、データスイッチC1〜Cnを順次にスイッチオンできる。各データスイッチC1〜Cnには、N個の薄膜トランジスタが含まれる(簡単のために図1では一個の薄膜トランジスタだけを示す)。或データスイッチをスイッチオンすると、Nビットデータ線(Din)のディジタルビデオ信号が、このデータスイッチを同時に通過する。
Nビットディジタルアナログ変換器D1〜Dnは、それぞれ対応するデータスイッチC1〜Cnに接続されている。各Nビットディジタルアナログ変換器D1〜Dnは、対応データスイッチC1〜Cnがスイッチオンされると、Nビットデータ線(Din)からディジタルビデオ信号を受信してアナログビデオ信号に変換する。アナログビデオ信号は、薄膜トランジスタアレイ100の対応するデータ線に入力される。
【0008】
図1に戻る。最初に、データスイッチC1は、データシフトレジスタ105のレジスタユニットB1によって制御され、第一グループのディジタルビデオ信号がNビットデータ線(Din)から入力される時にスイッチオンされる。それにより、第一グループのディジタルビデオ信号は、データスイッチC1を通過し、Nビットディジタルアナログ変換器D1によって第一グループのアナログビデオ信号に変換される。第一グループのアナログビデオ信号は、表示セルE11〜Em1を接続しているデータ線に入る。同時に、走査シフトレジスタ110のレジスタユニットA1は、表示セルE11〜E1nを接続している走査線を有効にして表示セルE11〜E1nの薄膜トランジスタをスイッチオンする。それにより、第一グループのアナログビデオ信号は表示セルE11に保持される。
【0009】
次に、データスイッチC2は、第二グループのディジタルビデオ信号がNビットデータ線(Din)から入力される時にデータシフトレジスタ105のレジスタユニットB2によってスイッチオンされる。それにより、第二グループのディジタルビデオ信号は、データスイッチC2を通過し、Nビットディジタルアナログ変換器D2によって第二グループのアナログビデオ信号に変換される。第二グループのアナログビデオ信号は、表示セルE12〜Em2を接続しているデータ線に入る。この段階(時点)では、表示セルE11〜E1nを接続している走査線が駆動されている。それゆえ、第二グループのアナログビデオ信号は、第一行の走査線と第二列のデータ線に対応する表示セルE12に保持される。
【0010】
その後、データシフトレジスタ105は残りの全データスイッチC3〜Cnを順次にスイッチオンし、第一行の表示セルE13〜E1nは対応グループのアナログビデオ信号を保持する。第一行の全表示セルEl1〜E1nがそれぞれのアナログビデオ信号を保持した後、走査シフトレジスタ110のレジスタユニットA2が有効にされ、表示セルE21〜E2nを接続している走査線を駆動する。アナログビデオ信号は、前述の手段によって薄膜トランジスタアレイ100の表示セルE21〜E2nに保持される。走査シフトレジスタ110が全走査線を順番に有効にした後、薄膜トランジスタアレイ100の全表示セルEl1〜Emnはアナログビデオ信号を保持している。それゆえ、液晶表示装置はスクリーンに完全なイメージページを表示する。
【0011】
薄膜トランジスタアレイ100の全表示セルE11〜Emnのアナログビデオ信号は、頻繁にリフレッシュされる。すなわち、液晶表示装置はイメージを高速でリフレッシュする。ユーザがスクリーンで見るものは、動的(前景)画像である。確かに、アナログビデオ信号が同じデータでリフレッシュされている時は静的(背景)画像が表示される。リフレッシュ速度が遅すぎると、液晶表示装置にフリッカ(ちらつき)が起こる場合がある。
【0012】
図3は、データシフトレジスタ105/走査シフトレジスタ110の回路図である。先行技術のシフトレジスタ105または110は、図1のレジスタユニットとして働く複数のフリップフロップ120を含む。フリップフロップ120は、液晶表示装置の駆動回路によって生成されるクロック信号(CLK)とスタートパルス信号(ST)に応答して動作する。フリップフロップ120は、クロック信号(CLK)によって制御され、スタートパルス信号をイネーブル信号に順次に変換して対応データスイッチCl〜Cnまたは走査線を有効にする。言い換えると、駆動回路は、データシフトレジスタ105用と走査シフトレジスタ110用に、二つのクロック信号(CLK)を生成する必要がある。クロック信号(CLK)はシフトレジスタ105と110の各フリップフロップに入力される必要があり、そのため多くのピンが必要である。この必要条件がシフトレジスタ105と110の設計と製造を複雑にすることは明白である。そのような問題を解決するために、より良い設計の開発に努力がなされている。
【0013】
【発明が解決しようとする課題】
本発明の目的は、能動マトリクス表示装置の回路構成を簡単にする、能動マトリクス表示装置の駆動回路用スイッチング信号発生器を提供することである。
本発明の別の目的は、簡略化された回路構造の能動マトリクス表示装置を提供することである。
【0014】
【課題を解決するための手段】
本発明の第一側面は、能動マトリクス表示装置の複数のスイッチと共に使用されるスイッチング信号発生器に関する。スイッチング信号発生器は、複数のスイッチに電気的に接続された複数の遅延ユニットを含む。スイッチング信号発生器は、複数のスイッチを経由して能動マトリクス表示装置の能動マトリクス部分に出力されるように信号を制御するためにソーススイッチング信号に応答して複数のターゲットスイッチング信号を生成する。全ての二つの連続するターゲットスイッチング信号間に一定の位相ずれがあり、それにより順番に複数のスイッチをスイッチオンして能動マトリクス部分に信号を出力する。
【0015】
実施形態では、能動マトリクス部分は、複数の走査線とデータ線で相互接続された薄膜トランジスタ(TFT)アレイを含む。
【0016】
望ましくは、遅延ユニットの最初の一つはソーススイッチング信号を受信し、後続する各遅延ユニットは先行する遅延ユニットの一つから出力されたターゲットスイッチング信号の一つを受信する。
【0017】
実施形態では、スイッチング信号発生器は、複数のスイッチの第一部分を通して能動マトリクス表示装置のデータ線に順次に出力されるように信号を制御するためにソーススイッチング信号に応答して複数のターゲットスイッチング信号の第一部分を生成する第一発生器部分と、複数のスイッチの第二部分を通して能動マトリクス表示装置の走査線に順次に出力されるように信号を制御するためにソーススイッチング信号に応答して複数のターゲットスイッチング信号の第二部分を生成する第二発生器部分を含む。
【0018】
複数のスイッチの第一部分を通して出力された信号がディジタルビデオ信号の場合、ディジタルビデオ信号は、データ線に出力される前に、能動マトリクス表示装置の複数のディジタルアナログ変換器によってアナログビデオ信号に変換されことが望ましい。
【0019】
本発明の第二側面は、能動マトリクス表示装置に使用されるスイッチング信号発生器に関する。このスイッチング信号発生器は、ソーススイッチング信号を受信して一組の第一ターゲットスイッチング信号を生成する第一発生器部分と、ソーススイッチング信号を受信して一組の第二ターゲットスイッチング信号を生成する第二発生器部分を含む。能動マトリクス表示装置の能動マトリクスユニットを順番にスイッチオンするために、第一ターゲットスイッチング信号の全ての二つの間に第一位相ずれがあり、第二ターゲットスイッチング信号の全ての二つの間に第二位相差がある。
【0020】
たとえば、能動マトリクス表示装置の能動マトリクスユニットは、走査線とデータ線で相互接続された薄膜トランジスタアレイを含む。
【0021】
望ましくは、第一発生器部分は複数の遅延ユニットを含み、遅延ユニットの最初の一つはソーススイッチング信号を受信して遅延させ、後続する各遅延ユニットは先行する遅延ユニットの一つから出力されたターゲットスイッチング信号の一つを受信して遅延させる。
【0022】
本発明の第三側面は能動マトリクス表示装置に関する。この能動マトリクス表示装置は、列と行に配置された複数の能動マトリクスユニットを含む能動マトリクス部分と、第一信号が能動マトリクスユニットに出力されるようにそれぞれの第一スイッチング信号に応答してスイッチオンされる複数の第一スイッチを含む第一スイッチ部分と、ソーススイッチング信号に応答して第一スイッチング信号を順番に生成することにより第一スイッチをスイッチオンして能動マトリクスユニットへの第一信号の順次出力を可能にする第一スイッチング信号発生器を含む。
【0023】
望ましくは、第一スイッチング信号発生器は、第一スイッチング信号を順番に生成するために直列に相互接続された複数の遅延ユニットを含む。
【0024】
望ましくは、能動マトリクス表示装置は更に、第二信号が能動マトリクスユニットに出力されるようにそれぞれの第二スイッチング信号に応答してスイッチオンされる複数の第二スイッチ含む第二スイッチ部分と、ソーススイッチング信号に応答して第二スイッチング信号を順番に生成することにより第二スイッチをスイッチオンして能動マトリクスユニットへの第二信号の順次出力を可能にする第二スイッチング信号発生器を含む。
【0025】
望ましくは、第二スイッチング信号発生器は、第二スイッチング信号を順番に生成するために直列に相互接続された複数の遅延ユニットを含む。
【0026】
実施形態では、第一信号はデータ線を経て能動マトリクスユニットに出力され、第二信号は走査線を経て能動マトリクスユニットに出力される。
【0027】
第一信号がディジタルビデオ信号の場合、望ましくは、能動マトリクス表示装置は更に、第一スイッチを通過するディジタルビデオ信号をアナログビデオ信号へ変換するために第一スイッチと能動マトリクスユニットの間に電気的に接続された複数のディジタルアナログ変換器を含む。
【0028】
【発明の実施の形態】
図4は、本発明による能動マトリクス表示装置の好ましい実施形態を概略的に示す回路ブロック図である。能動マトリクス表示装置には、Nビットデータ線(Din)、データスイッチC1〜Cn、走査スイッチG1〜Gm、Nビットディジタルアナログ変換器D1〜Dn、複数の表示セルE1〜Enからなる薄膜トランジスタアレイ23、第一スイッチング信号発生器24、および第二スイッチング信号発生器25が含まれる。
【0029】
第一スイッチング信号発生器24には、少なくとも一つの遅延デバイスが含まれる。この遅延デバイスは、直列に相互接続されたn個の遅延ユニットH1〜Hnから成る。遅延ユニットH1〜Hnは、それぞれのデータスイッチC1〜Cnに接続されている。ソーススイッチング信号(ST)の受信に応答して、遅延ユニットH1〜Hnは、データスイッチC1〜Cnに対応ターゲットスイッチング信号S1〜Snを供給する。全ての二つの連続するターゲットスイッチング信号間に一定の位相ずれがある。したがって、データスイッチC1〜Cnは順番にスイッチオンされる。すなわち、Nビットデータ線(Din)のディジタルビデオ信号は、対応データスイッチCl〜Cnを順次に通過する。
【0030】
遅延ユニットH1〜Hn、Nビットデータ線(Din)およびNビットディジタルアナログ変換器D1〜Dnに接続されたデータスイッチC1〜Cnは、Nビットデータ線からディジタルビデオ信号を受信し、対応ターゲットスイッチング信号に応答して対応Nビットディジタルアナログ変換器Dl〜Dnにディジタルビデオ信号を送信する。Nビットディジタルアナログ変換器は、受信したディジタルビデオ信号を、対応データ線に供給されるアナログビデオ信号に変換する。
【0031】
図4では、各データスイッチC1〜Cnは、簡単のために一つのトランジスタで表示されている。実際は、各データスイッチC1〜Cnは複数のトランジスタを含むことが望ましい。
【0032】
同様に、第二スイッチング信号発生器25には、少なくとも一つの遅延デバイスが含まれる。この遅延デバイスは、直列に相互接続されたm個の遅延ユニットI1〜Imから成る。遅延ユニットI1〜Imは、それぞれの走査スイッチG1〜Gmに接続されている。ソーススイッチング信号(ST)の受信に応答して、遅延ユニットI1〜Imは、走査スイッチG1〜Gmに対応ターゲットスイッチング信号T1〜Tmを供給する。全ての二つの連続するターゲットスイッチング信号間に一定の位相ずれがある。したがって、走査スイッチG1〜Gmは、一つずつ間隔をおいてスイッチオンされる。走査線が順番に駆動され、対応行の表示セルの薄膜トランジスタがスイッチオンされる。
【0033】
図4では、各走査スイッチG1〜Gmは、簡単のために一つのトランジスタで表示されている。実際は、各走査スイッチG1〜Gmは複数のトランジスタを含むことが望ましい。
【0034】
図5と6は、スイッチング信号間の位相関係を示す。ソーススイッチング信号STを受信すると、第一遅延ユニットH1は、ソーススイッチング信号からの位相ずれを有する第一ターゲットスイッチング信号S1を生成する。このスイッチング信号S1に応答して、第一データスイッチC1はスイッチオンされる。その結果、Nビットデータ線(Din)からの第一グループのディジタルビデオ信号は、第一データスイッチC1を通過し、Nビットディジタルアナログ変換器Dlにより第一グループのアナログビデオ信号に変換される。第一グループのアナログビデオ信号は薄膜トランジスタアレイ23の第一データ線に入り、第一データ線は表示セルE11〜Em1を制御する。同時に、第二スイッチング信号発生器25の第一遅延ユニットI1はスイッチング信号T1に応答して第一走査スイッチG1をスイッチオンすることにより薄膜トランジスタアレイ23の第一走査線を駆動し、第一走査線は表示セルEl1〜E1nを制御する。それゆえ、第一グループのアナログビデオ信号は第一走査線と第一データ線に対応する表示セルE11に保持される。
【0035】
遅延ユニットH2は、第一ターゲットスイッチング信号S1を受信して、第一ターゲットスイッチング信号S1よりも遅い位相ずれを有する第二ターゲットスイッチング信号S2を生成する。したがって、第一データスイッチC1に続いて、第二データスイッチC2がスイッチオンされる。それゆえ、Nビットデータ線(Din)からの第二グループのディジタルビデオ信号は、第二データスイッチC2を通過した後、Nビットディジタルアナログ変換器D2によって第二グループのアナログビデオ信号に変換される。第二グループのアナログビデオ信号は、表示セルE12〜Em2を接続している第二データ線に入る。この段階では、E11〜E1nを接続している第一走査線が駆動されている。それゆえ、第二グループのアナログビデオ信号は、第一走査線と第二データ線に対応する表示セルE12に保持される。
【0036】
同様に、他の遅延ユニットH3〜Hnからのスイッチング信号S3〜Snは、データスイッチC3〜Cnを順番にスイッチオンし、表示セルE13〜E1nに対応グループのアナログビデオ信号を保持させる。第一行の表示セルE11〜E1nにアナログビデオ信号が保持された後、第二スイッチング信号発生器25の第二遅延ユニットI2が第二ターゲットスイッチング信号T2を第二走査スイッチG2に供給することにより、表示セルE21〜E2nを接続している第二走査線を駆動する。アナログビデオ信号は、前記手段により薄膜トランジスタアレイ23の第二行の表示セルE21〜E2nに保持される。第二スイッチング信号発生器25が全走査線の駆動を完了した後では、薄膜トランジスタアレイ23の全表示セルE1l〜Emnにアナログビデオ信号が保持されている。それゆえ、液晶表示装置はスクリーンに完全なイメージページを表示する。
【0037】
結論として、スイッチング信号発生器24と25は、先行技術のデータシフトレジスタと走査シフトレジスタの代わりに用いられる。本発明によると、走査線とデータ線を駆動する走査スイッチとデータスイッチのオン/オフ状態を制御するために同じスタートパルス信号(ソーススイッチング信号)が用いられる。従って、回路チップのピン数を最小にできる。また、液晶表示装置の回路構成を単純化できる。
【0038】
現在最も実際的で望ましい実施形態であると考えられるものに関して本発明を記載したが、開示された実施形態に本発明を限定する必要がないことは自明である。それどころか、様々な変形と類似構造を含むように最も広い解釈を与えられるべき請求項の精神と範囲に含まれる変形と類似構成を包含することを意図する。
【図面の簡単な説明】
【図1】先行技術の液晶表示装置を示す概略回路ブロック図である。
【図2】図1の液晶表示装置の表示セルを示す概略回路図である。
【図3】図1のシフトレジスタを示す概略回路図である。
【図4】本発明による能動マトリクス表示装置の望ましい実施形態を示す概略回路ブロック図である。
【図5】本発明に従ってソーススイッチング信号および第一スイッチング信号発生器によって生成されるターゲットスイッチング信号の間の位相関係を示す波形図である。
【図6】本発明に従ってソーススイッチング信号および第二スイッチング信号発生器によって生成されるターゲットスイッチング信号の間の位相関係を示す波形図である。
【符号の説明】
E1〜En 表示セル
23 薄膜トランジスタアレイ
24 第一スイッチング信号発生器
25 第二スイッチング信号発生器
C1〜Cn データスイッチ
G1〜Gm 走査スイッチ
H1〜Hn 遅延ユニット
I1〜Im 遅延ユニット
ST ソーススイッチング信号
S1〜Sn ターゲットスイッチング信号
T1〜Tm ターゲットスイッチング信号
Claims (9)
- 能動マトリクス表示装置の複数のスイッチと共に使用され、前記複数のスイッチに電気的に接続された複数の遅延ユニットを含み、前記複数のスイッチを経由して前記能動マトリクス表示装置の能動マトリクス部分に出力される信号を制御するためにソーススイッチング信号に応答して複数のターゲットスイッチング信号を生成するスイッチング信号発生器であり、
全ての二つの連続するターゲットスイッチング信号間に一定の位相ずれがあり、それにより順番に前記複数のスイッチをスイッチオンして前記能動マトリクス部分に前記信号を出力する、スイッチング信号発生器。 - 前記能動マトリクス部分が複数の走査線とデータ線で相互接続された薄膜トランジスタ(TFT)アレイを含む、請求項1によるスイッチング信号発生器。
- 前記遅延ユニットの最初の一つが前記ソーススイッチング信号を受信し、後続する各遅延ユニットが先行する遅延ユニットの一つから出力された前記ターゲットスイッチング信号の一つを受信する、請求項1によるスイッチング信号発生器。
- 前記複数のスイッチの第一部分を通して前記能動マトリクス表示装置のデータ線に順次に出力されるように信号を制御するために前記ソーススイッチング信号に応答して前記複数のターゲットスイッチング信号の第一部分を生成する第一発生器部分、および
前記複数のスイッチの第二部分を通して前記能動マトリクス表示装置の走査線に順次に出力される信号を制御するために前記ソーススイッチング信号に応答して前記複数のターゲットスイッチング信号の第二部分を生成する第二発生器部分
を含む請求項1によるスイッチング信号発生器。 - 前記複数のスイッチの前記第一部分を通して出力された前記信号がディジタルビデオ信号であり、前記ディジタルビデオ信号が前記データ線に出力される前に前記能動マトリクス表示装置の複数のディジタルアナログ変換器によってアナログビデオ信号に変換される、請求項4によるスイッチング信号発生器。
- 列と行に配置された複数の能動マトリクスユニットを含む能動マトリクス部分、
第一信号が前記能動マトリクスユニットに出力されるようにそれぞれの第一スイッチング信号に応答してスイッチオンされる複数の第一スイッチを含む第一スイッチ部分、および
ソーススイッチング信号に応答して前記第一スイッチング信号を順番に生成することにより前記第一スイッチをスイッチオンして前記能動マトリクスユニットへの前記第一信号の順次出力を可能にする第一スイッチング信号発生器
を含む能動マトリクス表示装置。 - 前記第一スイッチング信号発生器が前記第一スイッチング信号を順番に生成するために直列に相互接続された複数の遅延ユニットを含む、請求項6による能動マトリクス表示装置。
- 第二信号が走査線を通って前記能動マトリクスユニットに出力されるようにそれぞれの第二スイッチング信号に応答してスイッチオンされる複数の第二スイッチ含む第二スイッチ部分、および
直列に相互接続された複数の遅延ユニットを含み、前記ソーススイッチング信号に応答して前記第二スイッチング信号を順番に生成することにより、前記第二スイッチをスイッチオンして前記能動マトリクスユニットへの前記第二信号の順次出力を可能にする第二スイッチング信号発生器を更に含む請求項6による能動マトリクス表示装置。 - 前記第一信号がディジタルビデオ信号であり、
前記能動マトリクス表示装置が、前記第一スイッチを通過する前記ディジタルビデオ信号をアナログビデオ信号へ変換するために前記第一スイッチと前記能動マトリクスユニットの間に電気的に接続された複数のディジタルアナログ変換器を更に含む請求項6による能動マトリクス表示装置。
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007079398A (ja) * | 2005-09-16 | 2007-03-29 | Koninkl Philips Electronics Nv | 回路装置 |
JP2016526700A (ja) * | 2013-06-20 | 2016-09-05 | 深▲セン▼市華星光電技術有限公司 | アクティブマトリクス型表示装置、走査駆動回路及び走査駆動方法 |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100514182B1 (ko) * | 2003-09-08 | 2005-09-13 | 삼성에스디아이 주식회사 | 유기전계발광표시장치 |
JP4494050B2 (ja) * | 2004-03-17 | 2010-06-30 | シャープ株式会社 | 表示装置の駆動装置、表示装置 |
JP2018044976A (ja) * | 2016-09-12 | 2018-03-22 | 株式会社ジャパンディスプレイ | 表示装置 |
US9654310B1 (en) * | 2016-11-19 | 2017-05-16 | Nxp Usa, Inc. | Analog delay cell and tapped delay line comprising the analog delay cell |
Family Cites Families (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2653099B2 (ja) | 1988-05-17 | 1997-09-10 | セイコーエプソン株式会社 | アクティブマトリクスパネル,投写型表示装置及びビューファインダー |
JP3476241B2 (ja) | 1994-02-25 | 2003-12-10 | 株式会社半導体エネルギー研究所 | アクティブマトリクス型表示装置の表示方法 |
JP2795190B2 (ja) | 1994-09-14 | 1998-09-10 | 日本電気株式会社 | ディジタル遅延回路ブロック及び走査回路並びにその走査回路の駆動方法 |
US5929464A (en) | 1995-01-20 | 1999-07-27 | Semiconductor Energy Laboratory Co., Ltd. | Active matrix electro-optical device |
CN1495497A (zh) * | 1995-02-01 | 2004-05-12 | 精工爱普生株式会社 | 液晶显示装置 |
TW575196U (en) * | 1996-09-24 | 2004-02-01 | Toshiba Electronic Eng | Liquid crystal display device |
US5854615A (en) | 1996-10-03 | 1998-12-29 | Micron Display Technology, Inc. | Matrix addressable display with delay locked loop controller |
TW491954B (en) * | 1997-11-10 | 2002-06-21 | Hitachi Device Eng | Liquid crystal display device |
JP2000227784A (ja) * | 1998-07-29 | 2000-08-15 | Seiko Epson Corp | 電気光学装置の駆動回路および電気光学装置 |
KR100438525B1 (ko) * | 1999-02-09 | 2004-07-03 | 엘지.필립스 엘시디 주식회사 | 쉬프트 레지스터 회로 |
JP2002203397A (ja) * | 2000-10-24 | 2002-07-19 | Alps Electric Co Ltd | シフトレジスタ回路、表示装置およびイメージセンサ |
JP3729163B2 (ja) * | 2001-08-23 | 2005-12-21 | セイコーエプソン株式会社 | 電気光学パネルの駆動回路、駆動方法、電気光学装置および電子機器 |
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007079398A (ja) * | 2005-09-16 | 2007-03-29 | Koninkl Philips Electronics Nv | 回路装置 |
JP2016526700A (ja) * | 2013-06-20 | 2016-09-05 | 深▲セン▼市華星光電技術有限公司 | アクティブマトリクス型表示装置、走査駆動回路及び走査駆動方法 |
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Legal Events
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