JPS58127375A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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Publication number
JPS58127375A
JPS58127375A JP1074282A JP1074282A JPS58127375A JP S58127375 A JPS58127375 A JP S58127375A JP 1074282 A JP1074282 A JP 1074282A JP 1074282 A JP1074282 A JP 1074282A JP S58127375 A JPS58127375 A JP S58127375A
Authority
JP
Japan
Prior art keywords
layer
high density
wiring
contact window
semiconductor device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1074282A
Other languages
English (en)
Inventor
Akihiro Kanda
神田 彰弘
Michihiro Inoue
道弘 井上
Hideaki Sadamatsu
定松 英明
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP1074282A priority Critical patent/JPS58127375A/ja
Publication of JPS58127375A publication Critical patent/JPS58127375A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/70Bipolar devices
    • H01L29/72Transistor-type devices, i.e. able to continuously respond to applied control signals

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は高速で高精度のトランジスタ及びこのトランジ
スタを有する集積回路の製造方法に関するものである。
近年、電子装置の高性能化の要求からこれに使用する半
導体素子の高速、高精度化が必要となっている。高速化
においては横方向及び縦方向の寸法を小さくすることに
より実現されている。
一方、高精度化に関しては、比較器を例にとるならば入
力段の差動アンプのvBEの差、すなわちΔ■BEを小
さくすることが要求される。このΔ■BEを小さくする
ためには、 1)電流増幅率のバラツキを小さくする。
11)エミッタ寸法のバラツキを小さくする。
呻 コンタクト抵抗のバラツキを小さくする。
ことが必要である。この中で1)はペース・エミッタを
イオン、注入により形成することで実現できる。
1すはエミッタのフォトマスクを精度よく製作すること
が必要であり、現在では電子ビーム等により実現されて
いる。叫のコンタクト抵抗のバラツキを小さくするため
には、エミッタ濃度を高くするなどしてコンタクト抵抗
を下げる必要がある。
コンタクi形成するだめの従来の方法を、簡単に説明す
る。第1図5(a2に示すように半導体基板1上に高濃
度拡散層2を形成した後、全面に酸化膜3を形成し、上
記高濃度拡散領域2上に所望のコンタクト窓を開孔して
からアルミニウム(Al)電極4を形成する。さらに熱
処理を行ない第1図fb)に示すようにAl−8t共晶
部6(波線で示す)を形成してコンタクト抵抗を下げて
いる。この方法には次の様な欠点がある。
1、Al−8t共晶が熱処理の温度と時間に依存してい
るため、深さ方向の制御が難しく、高速化を図るために
深さ方向の寸法を小さくしていく傾向にある集積回路の
製造において、Alの突き抜けが問題になってきている
21 コンタクト窓開孔部表面にNa t u r a
 10w1deがある場合、十分なコンタクトがとれず
、コンタクト抵抗が高くなる。
本発明は上記欠点に鑑みてなされたもので、コンタクト
窓近傍までは従来通り蒸着によりAl配線を形成し、コ
ンタクト部には深さ方向の正確な制御が可能であるイオ
ン注入法を用い、高濃度のN!をイオン注入することに
より、コンタクト抵抗の小さい高速、高精度の集積回路
の製造方法を提供せんとするものである。
本発明の構成を第2図により詳しく説明する。
まず、P形基板1o中にn形高濃度拡散層11を形成し
た後、全面に酸化膜12を形成し、フォトエツチングに
よりコンタクト窓13を開孔する(第2図a)。さらに
、コンタクト窓13近傍1でAl配線14を行なう(第
2図b)。その後、高濃度のAIをソースとし、レジス
ト15をマスクとして高濃度拡散層11の上部にコンタ
クト窓開孔部13よりイオン注入を行ない、高濃度AI
注入層16を形成するとともに、Al配線14と高濃度
AlcE人層16を電気的に接続する(第2図C)。こ
こで、イオン注入におけるAIのドーズ量をNDs、投
影飛程及び分布をそれぞれRp、σとすると、深さXに
おける AIの濃度N (x)は次式%式% たとえば、Alを加速エネルギー20keVでドーズ量
lX10/i打ち込むと、Rp=288(A)。
+7=129(A)であるので、N (Rp> −ND
S/% −a :、−3X 1.、o22/crj、 
 また深さR2の場所よりσだけ離れた場所でのa度は
、N(Rp±σ)中0.607N (Rp ) キ1−
8 X 1022/ crA  となる。つまり、Al
をドーズ量1×1o /cdで打ち込んだ場合、Sl及
び8102表面近傍のAlの濃度は1o22のオーダー
となり、蒸着によるAl配線14の抵抗率922〜3×
1o Ω−備とほぼ等しいものとなり、十分な導電性を
示す。イオン注入後、レジスト膜16を除去すれば、電
極の形成は終了する。
この製造方法によれば、次の様な利点がある。
1、イオン注入においては加速エネルギーによって深さ
方向の制御を正確に行なうことが可能であるため、集積
回路の高速化にともなう深さ方向の寸法の縮小化に対し
てAIの突き抜けを防止することができる。
2 、 Natural 0xideがコンタクト窓開
孔部表面に形成されている場合でも、イオン注入によれ
ばそれを追い越す形でコンタクトが眩れ、コンタクト抵
抗を小さくすることができる。また、Al配線の表面に
AIの酸化物(A1203等)が形成されている場合も
同様にその酸化物層を追い越す形で十分なコンタクトを
取ることが可能である。
3、イオン注入の加速エネルギーを精度よく制御するこ
とにより、n形高濃度拡散層をの最大濃度領域でコンタ
クトを取ることができ、コンタクト抵抗を小さくするこ
とができる。
以上の様に、本発明はAI電極形成にイオン注入を用い
ることにより、高速、高精度のトランジスタ及びこのト
ランジスタを含む半導体装置を供給することができ、今
後、電子装置の高性能化に犬きく寄与するものである。
【図面の簡単な説明】
第1図は従来法による工程断面図、第2図は本発明の一
実施例に係る工程断面図を示す。

Claims (2)

    【特許請求の範囲】
  1. (1)一方導電型領域に拡散層を形成する第一工程と、
    前記拡散層にAlをイオン注入しAl注入層を形成する
    と同時にAl配綜と前記Al注入層を接続する第二工程
    とを含むことを特徴とする半導体装置の製造方法。
  2. (2)第二の工程が拡散層近傍までAl配線層を形成す
    る工程と、前記拡散層及び前記Al配線層にAlをイオ
    ン注入してAl注入層を形成し、前記Al配線層と前記
    Al注入層とを電気的に接続する工程とよりなることを
    特徴とする特許請求の範囲第1項に記載の半導体装置の
    製造方法。
JP1074282A 1982-01-25 1982-01-25 半導体装置の製造方法 Pending JPS58127375A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4939191A (en) * 1987-02-20 1990-07-03 Ube Industries, Ltd. High strength cured cement article and process for manufacturing the same

Cited By (1)

* Cited by examiner, † Cited by third party
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US4939191A (en) * 1987-02-20 1990-07-03 Ube Industries, Ltd. High strength cured cement article and process for manufacturing the same

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