JPH1032328A - ゲート絶縁膜形成方法 - Google Patents
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Abstract
絶縁膜の絶縁破壊耐圧の低下を防止できるゲート絶縁膜
形成方法を提供する。 【解決手段】 不活性ガスからなる雰囲気中で、ウェー
ハ1のシリコン表面1aを洗浄して清浄かつ自然酸化膜
の無い状態にする(工程(a))。ウェーハ1を大気に曝す
ことなく、雰囲気を窒素を含まない酸化性ガスに置換
し、この雰囲気中でウェーハ1を加熱して、シリコン表
面1aに第1のシリコン酸化膜2を形成する(工程
(b))。雰囲気を窒素を含む酸化性ガスに置換し、この雰
囲気中でウェーハ1を加熱して、第1のシリコン酸化膜
2と下地のシリコン1との間に第1の酸窒化膜3を形成
する(工程(c))。この後、再酸化を行って、第1の酸窒
化膜3と下地のシリコン1との間に第2のシリコン酸化
膜4を形成する(工程(d))。
Description
方法に関する。より詳しくは、半導体電子デバイス、特
に絶縁ゲート型電界効果トランジスタ(MOSFET)
のゲート絶縁膜を形成するゲート絶縁膜形成方法に関す
る。
縁膜を形成する方法として、窒素を含まない酸化性ガス
雰囲気で最初の酸化を行ってシリコン(Si)基板の表
面に第1のシリコン酸化膜(SiO2)を形成した後、窒
素と酸素との化合物ガス雰囲気(NO、N2O、NO
2等)で酸窒化を行って、上記第1のシリコン酸化膜とシ
リコン基板との間に窒素を含む酸化膜(以下「酸窒化
膜」という。)を形成し、さらに窒素を含まない酸化性
ガス雰囲気で再び酸化(再酸化)を行って、上記酸窒化
膜とシリコン基板との間に第2のシリコン酸化膜を形成
する方法が提案されている(E.Hasegawa他、Interna
tional Electron Devices Meeting Technical
Digest,327−330頁、1995年)。このよう
に上記酸窒化膜とシリコン基板との間に第2のシリコン
酸化膜を形成することにより、原子の再配列が起こる。
この結果、Si/SiO2界面の歪みの変化や、Si2=N
Hなどの窒素が関与する化学種に起因する正孔トラップ
の増加、あるいはMOS界面に垂直な方向の電界が低い
領域でのキャリア移動度の低下などの酸窒化に伴う種々
の問題を解決することができる。
法を実行した場合、再酸化によってゲート絶縁膜の膜厚
膜厚均一性や界面平坦性が悪くなり、ゲート絶縁膜の絶
縁破壊耐圧が低下するという問題がある(例えば、J.
Kim他、IEEE Electron Device Letter,vo
l.14,No.5,265−267頁、1993年)。
すなわち、上記最初の酸化を行うために、シリコン基板
(図10(a)に201で表す)を洗浄して清浄かつ自然酸
化膜が無い状態にする。しかし、シリコン基板201を
酸化炉に導入するまでの間、特に酸化反応管に入れる途
中でシリコン基板201が高温で大気に曝される。これ
により、図10(a)に示すようにシリコン基板201の
表面に不均一な自然酸化膜202Aが形成され、Si/
SiO2界面201aに凹凸が生ずる。この状態で、図1
0(b)に示すように上記最初の酸化を行って所定の膜厚
のシリコン酸化膜202を形成すると、Si/SiO2界
面201aの凹凸が大きくなる。次に、上記酸窒化を行
うと、図10(c)に示すように酸窒化膜203とシリコ
ン基板201との界面201aが酸窒化前より滑らかに
なるが、元にあったシリコン酸化膜202の膜厚バラツ
キに起因して酸窒化膜203の膜厚あるいは窒素濃度に
不均一が生ずる。次に、図10(d)に示すように上記再
酸化を行って酸窒化膜203とシリコン基板201との
間にシリコン酸化膜204を形成すると、酸窒化膜20
3中の窒素原子の存在のために雰囲気からシリコン基板
201への酸素分子の拡散が阻害されて、シリコン酸化
膜204の膜厚のバラツキが大きくなり、シリコン酸化
膜204とシリコン基板201との界面201aの凹凸
も大きくなる。これが、ゲート絶縁膜全体202,20
3および204としての膜厚バラツキを大きくし、ゲー
ト絶縁膜の絶縁破壊耐圧の低下を引き起こすのである。
化膜204の膜厚を薄くしたり、再酸化時間を短くした
りすると、絶縁破壊耐圧の低下を防げるが、上述の酸窒
化に伴う種々の問題が残る。
酸化を行うゲート絶縁膜形成方法において、酸窒化に伴
う種々の問題を解決できる上、ゲート絶縁膜の膜厚バラ
ツキを抑え、ゲート絶縁膜の絶縁破壊耐圧の低下を防止
できるゲート絶縁膜形成方法を提供することにある。
め、請求項1に記載のゲート絶縁膜形成方法は、不活性
ガスからなる雰囲気中で、ウェーハのシリコンからなる
表面を洗浄して清浄かつ自然酸化膜の無い状態にする工
程(a)と、上記ウェーハを大気に曝すことなく上記雰囲
気を窒素を含まない酸化性ガスに置換し、この雰囲気中
で上記ウェーハを加熱して、上記シリコンからなる表面
に第1のシリコン酸化膜を形成する工程(b)と、上記雰
囲気を窒素を含む酸化性ガスに置換し、この雰囲気中で
上記ウェーハを加熱して、上記第1のシリコン酸化膜と
下地のシリコンとの間に第1の酸窒化膜を形成する工程
(c)と、上記雰囲気を窒素を含まない酸化性ガスに置換
し、この雰囲気中で上記ウェーハを加熱して、上記第1
の酸窒化膜と下地のシリコンとの間に第2のシリコン酸
化膜を形成する工程(d)とを有することを特徴とする。
は、不活性ガスからなる雰囲気中で、ウェーハのシリコ
ンからなる表面を洗浄して清浄かつ自然酸化膜の無い状
態にした後(工程(a))、上記ウェーハを大気に曝すこ
となく上記雰囲気を窒素を含まない酸化性ガスに置換す
るので、上記シリコンからなる表面に自然酸化膜が形成
されることがない。この雰囲気中で上記ウェーハを加熱
して、上記シリコンからなる表面に第1のシリコン酸化
膜を形成すると(工程(b))、第1のシリコン酸化膜と
下地のシリコンとの界面は平坦な状態となり、第1のシ
リコン酸化膜の膜厚が均一になる。次に、上記雰囲気を
窒素を含む酸化性ガスに置換し、この雰囲気中で上記ウ
ェーハを加熱して、上記第1のシリコン酸化膜と下地の
シリコンとの間に第1の酸窒化膜を形成すると(工程
(c))、上記第1のシリコン酸化膜の膜厚が均一になっ
ていることから、第1の酸窒化膜の膜厚および窒素濃度
が均一になる。この結果、上記雰囲気を窒素を含まない
酸化性ガスに置換し、この雰囲気中で上記ウェーハを加
熱して、上記第1の酸窒化膜と下地のシリコンとの間に
第2のシリコン酸化膜を形成すると(工程(d))、第2
のシリコン酸化膜の膜厚が均一になり、第2のシリコン
酸化膜と下地のシリコンとの界面も平坦に仕上がる。し
たがって、従来に比してゲート絶縁膜全体としての膜厚
バラツキが小さくなり、ゲート絶縁膜の絶縁破壊耐圧が
向上する。また、この結果、第2のシリコン酸化膜の膜
厚を十分に設定できるので、Si/SiO2界面の歪みの
変化やSi2=NHなどの窒素が関与する化学種に起因す
る正孔トラップの増加、あるいはMOS界面に垂直な方
向の電界が低い領域でのキャリア移動度の低下などの酸
窒化に伴う種々の問題が解決される。
酸素を極力微量に抑えたアルゴン(Ar)、窒素(N2)等を
用いるのが望ましい。
は、請求項1に記載のゲート絶縁膜形成方法において、
上記第2のシリコン酸化膜を形成する工程(d)の後、上
記雰囲気を窒素を含む酸化性ガスに置換し、この雰囲気
中で上記ウェーハを加熱して、上記第2のシリコン酸化
膜と下地のシリコンとの間に第2の酸窒化膜を形成する
工程(e)と、上記雰囲気を窒素を含まない酸化性ガスに
置換し、この雰囲気中で上記ウェーハを加熱して、上記
第2の酸窒化膜と下地のシリコンとの間に第3のシリコ
ン酸化膜を形成する工程(g)とを有することを特徴とす
る。
れば、請求項1の作用効果を奏することができる。しか
も、形成したゲート絶縁膜上にP+多結晶シリコンから
なるゲート電極(不純物としてボロンがイオン注入され
ている)を形成して表面チャネル型PMOSFETを作
製する場合に、下地のシリコンから遠い側にある第1の
酸窒化膜によって、いわゆるボロンの突き抜け(ゲート
電極中のボロンが熱処理によってゲート絶縁膜を通りシ
リコン基板まで達してフラット・バンド電圧を変動させ
る現象)が防止される。また、ゲート電極上の層間絶縁
膜から水素が拡散するのを上記第1の酸窒化膜によって
遮断して、上記第3のシリコン酸化膜とシリコン基板と
の界面での界面準位の生成を抑えることができる。した
がってホットキャリアによる素子劣化の増大が防止され
る。
は、請求項1又は2に記載のゲート絶縁膜形成方法にお
いて、上記各膜を形成する工程を移行する期間中、上記
雰囲気を不活性ガスに切り替えることを特徴とする。
は、上記各膜を形成する工程を移行する期間中、上記雰
囲気が不活性ガスに切り替えられるので、その期間中の
わずかな酸化が抑制される。したがって、各膜の膜厚バ
ラツキが小さくなり、酸窒化膜の窒素濃度のバラツキも
低減される。また、上記期間中、上記雰囲気から既に形
成された膜中に混入する水素原子も少なくなるので、界
面準位の生成や電子捕獲等の水素に起因した素子劣化が
抑制される。
は、請求項1又は2に記載のゲート絶縁膜形成方法にお
いて、上記第1のシリコン酸化膜を形成する工程で、上
記ウェーハを加熱する温度を300℃以上700℃以下
に設定することを特徴とする。
れば、上記第1のシリコン酸化膜を形成する工程で、上
記ウェーハを加熱する温度が700℃以下に設定される
ので、シリコン表面の酸化が緩やかに行われる。したが
って、上記第1のシリコン酸化膜と下地のシリコンとの
界面がさらに平坦になり、上記第1のシリコン酸化膜の
膜厚がさらに均一になる。なお、下限温度を300℃と
する理由は酸化速度を実用レベルにするためである。
は、請求項1又は2に記載のゲート絶縁膜形成方法にお
いて、上記各シリコン酸化膜を形成する工程で、上記雰
囲気の圧力を大気圧よりも低く設定することを特徴とす
る。
れば、上記各シリコン酸化膜が1原子層毎に層状に形成
され得る。これにより界面の平坦性と酸化膜厚の均一性
が確保できる。また、後工程で形成する酸窒化膜の膜厚
バラツキや窒素濃度バラツキが低減される。
は、請求項1又は2に記載のゲート絶縁膜形成方法にお
いて、上記第1のシリコン酸化膜を形成する工程で、上
記雰囲気として水蒸気、オゾン、または水蒸気若しくは
オゾン含む酸素を用いることを特徴とする。
は、上記第1のシリコン酸化膜を形成する工程で、上記
雰囲気として水蒸気(H2O)、オゾン(O3)、または水蒸
気若しくはオゾン含む酸素(H2O/O2,O3/O2)を用
いるので、酸素分子のみで酸化を行う場合に比して、小
粒径の酸化種の存在により第1のシリコン酸化膜が緻密
に形成される。これとともに、第1のシリコン酸化膜と
下地のシリコンとの界面の平坦性が良くなる。したがっ
て、後工程で形成する酸窒化膜の膜厚バラツキや窒素濃
度バラツキが低減される。
は、請求項2に記載のゲート絶縁膜形成方法において、
上記第1の酸窒化膜を形成する工程で、上記雰囲気とし
て、一酸化窒素、一酸化二窒素、二酸化窒素、及びアン
モニアの中から選ばれた単体ガスまたは混合ガスを用い
ることを特徴とする。
は、上記第1の酸窒化膜を形成する工程で、上記雰囲気
として、一酸化窒素(NO)、一酸化二窒素(N2O)、二
酸化窒素(NO2)、及びアンモニア(NH3)の中から選ば
れた単体ガスまたは混合ガスを用いるので、第1の酸窒
化膜が容易に形成される。
ン表面から遠い側の第1の酸窒化膜において、アンモニ
アを用いた窒化に起因する電子捕獲が起こったとして
も、素子特性に殆ど影響を及ぼすことがない。したがっ
て、第1の酸窒化膜を形成するための雰囲気として、ア
ンモニアを用いても良い。特に、雰囲気をアンモニアか
らなる単体ガスとして、第1の酸窒化膜ではなくシリコ
ン窒化膜を形成するようにしても良い。
は、請求項1又は2に記載のゲート絶縁膜形成方法にお
いて、上記各酸窒化膜を形成する工程で、上記雰囲気と
して、一酸化窒素、一酸化二窒素、及び二酸化窒素の中
から選ばれた単体ガスまたは混合ガスを用いることを特
徴とする。
は、上記各酸窒化膜を形成する工程で、上記雰囲気とし
て、一酸化窒素(NO)、一酸化二窒素(N2O)、及び二
酸化窒素(NO2)の中から選ばれた単体ガスまたは混合
ガスを用いるので、各酸窒化膜が容易に形成される。
は、請求項1又は2に記載のゲート絶縁膜形成方法にお
いて、上記第2のシリコン酸化膜または上記第2及び第
3のシリコン酸化膜を形成する工程で、上記雰囲気とし
てオゾンまたはオゾンを含む酸素を用いることを特徴と
する。
は、上記第2のシリコン酸化膜または上記第2及び第3
のシリコン酸化膜を形成する工程で、上記雰囲気として
オゾン(O3)またはオゾン(O3)を含む酸素ガス(O3/O
2)を用いる。オゾンから解離した単原子状酸素は、酸素
分子に比して酸窒化膜中の窒素原子の存在の影響をあま
り受けることなく、酸窒化膜中を容易に拡散し、かつシ
リコンと容易に反応する。したがって、既に形成されて
いる酸窒化膜の窒素濃度バラツキの影響をあまり受ける
ことなく、上記第2のシリコン酸化膜または上記第2及
び第3のシリコン酸化膜が均一な膜厚に形成される。
を用いると、拡散係数は大きいが、形成される膜と下地
のシリコンとの界面付近に多量の電子トラップが形成さ
れるため、素子の長期的信頼性の点で好ましくない。
は、請求項1又は2に記載のゲート絶縁膜形成方法にお
いて、上記第2のシリコン酸化膜または上記第2及び第
3のシリコン酸化膜を形成する工程で、上記雰囲気の圧
力を大気圧よりも低く設定するとともに、上記ウェーハ
を加熱する温度を700℃以上1200℃以下に設定す
ることを特徴とする。
は、上記第2のシリコン酸化膜または上記第2及び第3
のシリコン酸化膜を形成する工程で、上記ウェーハを加
熱する温度を700℃以上に設定しているので、酸化種
の酸窒化膜中における拡散係数がさらに大きくなる。し
たがって、既に形成されている酸窒化膜の窒素濃度バラ
ツキの影響をあまり受けることなく、上記第2のシリコ
ン酸化膜または上記第2及び第3のシリコン酸化膜が均
一な膜厚に形成される。
く設定する理由は、適切な酸化速度を維持しつつ、加熱
温度を高温化するためである。また、上記ウェーハを加
熱する上限温度を1200℃に設定する理由は、酸化速
度があまりに大きくなるのを抑えるためである。
は、請求項2に記載のゲート絶縁膜形成方法において、
上記第1の酸窒化膜を形成する工程と上記第2の酸窒化
膜を形成する工程とで、形成される第1の酸窒化膜の窒
素濃度が第2の酸窒化膜の窒素濃度よりも大きくなるよ
うに、上記雰囲気の圧力、または上記ウェーハを加熱す
る温度若しくは時間を変えることを特徴とする。
は、第1の酸窒化膜の窒素濃度が第2の酸窒化膜の窒素
濃度よりも大きくなる。シリコンの表面から遠い側の第
1の酸窒化膜の窒素濃度が比較的大きくなるので、いわ
ゆるボロンの突き抜けや層間絶縁膜からの水素の拡散に
関連したホットキャリアによる素子劣化の増大が効果的
に防止される。また、第2の酸窒化膜の窒素濃度が比較
的低くなるので、酸窒化に伴う上述の問題、すなわちS
i/SiO2界面の歪みの変化や、Si2=NHなどの窒素
が関与する化学種に起因する正孔トラップの増加、ある
いはMOS界面に垂直な方向の電界が低い領域でのキャ
リア移動度の低下などが抑えられる。
は、不活性ガスからなる雰囲気中で、ウェーハのシリコ
ンからなる表面を洗浄して清浄かつ自然酸化膜の無い状
態にする工程(a)と、上記ウェーハを大気に曝すことな
く上記雰囲気を窒素を含まない酸化性ガスに置換し、こ
の雰囲気中で上記ウェーハを加熱して、上記シリコンか
らなる表面に第1のシリコン酸化膜を形成する工程(b)
と、上記雰囲気をアンモニアからなる単体ガスに置換
し、この雰囲気中で上記ウェーハを加熱して、上記第1
のシリコン酸化膜と下地のシリコンとの間にシリコン窒
化膜を形成する工程(c)と、上記雰囲気を窒素を含まな
い酸化性ガスに置換し、この雰囲気中で上記ウェーハを
加熱して、上記シリコン窒化膜と下地のシリコンとの間
に第2のシリコン酸化膜を形成する工程(d)と、上記雰
囲気を窒素を含む酸化性ガスに置換し、この雰囲気中で
上記ウェーハを加熱して、上記第2のシリコン酸化膜と
下地のシリコンとの間に第2の酸窒化膜を形成する工程
(e)と、上記雰囲気を窒素を含まない酸化性ガスに置換
し、この雰囲気中で上記ウェーハを加熱して、上記第2
の酸窒化膜と下地のシリコンとの間に第3のシリコン酸
化膜を形成する工程(g)とを有することを特徴とする。
は、請求項2における第1の酸窒化膜に代えてシリコン
窒化膜を形成しているが、請求項2と同じ作用効果を奏
することができる。上記シリコン窒化膜は、アンモニア
からなる単体ガスを用いているので容易に形成すること
ができる。なお、上記シリコン窒化膜は第2の酸窒化膜
よりもシリコン表面から遠い側にあるので、上記シリコ
ン窒化膜においてアンモニアを用いた窒化に起因する電
子捕獲が起こったとしても、素子特性に殆ど影響を及ぼ
すことがない。
細に説明する。
実施するために好適な装置について説明する。図9はそ
のような装置の構成を概略的に示している。
と、洗浄室114と、酸化・酸窒化用チャンバ115
と、処理後・カセット室116とを備えている。処理前
・カセット室113と処理後・カセット室116にはそ
れぞれキャリア111,119を載置するためのステー
ジ112A,112Dが設けられ、洗浄室114と酸化
・酸窒化用チャンバ115にはそれぞれウェーハ110
を載置又は保持するためのステージ(又はウェーハホル
ダ)112B,112Cが設けられている。各室11
3,114,115,116の間はそれぞれ通路117
A,117B,117Cによって連結されており、各通
路117A,117B,117Cには、各室113,1
14,115,116内の圧力及び雰囲気を独立に制御
できるように、それぞれ通路を遮断できるバルブ118
A,118B,118Cが取り付けられている。なお、
この装置は、ウェーハ110を1枚毎に処理するもので
も、複数枚毎に処理するものでも良い。
セット室113が開放され、ウェーハ110はキャリア
111に入れられた状態で処理前・カセット室113内
に置かれる。その状態で、窒素ガスあるいはアルゴン・
ガス等の不活性ガスで置換するか、または高真空にする
ことにより、処理前カセット室113内が、酸素や水分
を極力低減した雰囲気(具体的には、1012cm-3以下、
好ましくは1011cm-3以下の分子濃度)にされる。
ン・ガス等の不活性ガスで置換するか、または高真空に
することにより、酸素や水分を極力低減した雰囲気(具
体的には、1012cm-3以下、好ましくは1011cm-3以下
の分子濃度)にされた後、処理前カセット室113に置
かれたウェーハ110は、通路117Bを通して洗浄室
114内に転送される。洗浄室114では、湿式あるい
は乾式で洗浄が行われて、ウェーハ110のシリコン表
面が清浄かつ自然酸化膜が無い状態にされる。なお、湿
式洗浄または常圧の乾式洗浄の場合は、洗浄室114内
を不活性ガス雰囲気とするので、処理前・カセット室1
13も不活性ガスで置換しておく。低圧の乾式洗浄の場
合、洗浄室114は真空となるので、処理前・カセット
室113も真空にしておく。
Bを通して酸化・酸窒化用チャンバ115に転送され
る。したがって、転送前に予め、酸化・酸窒化用チャン
バ115内を、窒素ガスあるいはアルゴン・ガス等の不
活性ガスで置換するか、または高真空にすることによ
り、酸素や水分を極力低減した雰囲気(具体的には、1
012cm-3以下、好ましくは1011cm-3以下の分子濃度)
にしておく。洗浄室114と酸化・酸窒化用チャンバ1
15とをいずれも不活性ガス雰囲気または高真空にして
おくことによって、清浄かつ自然酸化膜の無い状態のウ
ェーハ110を、大気に曝すことなく酸化・酸窒化用チ
ャンバ115に収容することができる。酸化・酸窒化用
チャンバ115は、抵抗加熱型あるいはランプ加熱式い
ずれでも良い。なお、酸化・酸窒化用チャンバ115
は、低圧でも酸化・酸窒化ができるものである。さら
に、酸化・酸窒化用チャンバ115が1枚毎に処理する
ものである場合、チャンバ容積が小さいので、雰囲気の
切換が高速にできて、膜厚制御性が向上する。
路117Cを通して処理後・カセット室116に転送さ
れる。ウェーハ110は、バルブ118Cを閉じて処理
後・カセット室116を常圧にした状態で外に取り出さ
れる。
化・酸窒化)までの処理を行うようになっているが、こ
れに限られるものではない。酸化・酸窒化用チャンバ1
15と処理後・カセット室116との間に、通路(バル
ブを有する)を介してCVD(化学気相成長)用チャンバ
を取りつけることにより、ウェーハ110を大気に曝す
ことなく、ゲート電極形成までの処理を行うことが可能
となる。
施形態でゲート絶縁膜を形成する場合の工程途中のウェ
ーハ断面を示し、図5はその加熱サイクルを示してい
る。この実施形態では、酸化・酸窒化用チャンバ115
として抵抗加熱型酸化炉(反応管)を用いており、加熱
サイクルは縦軸に炉内温度、横軸に処理時間をとって示
している。ウェーハとしては単結晶シリコン基板1を用
いている。以下、図1(a)〜(c)、図5および図9を適宜
参照しながら、この実施形態のゲート絶縁膜形成方法を
説明する。
ト室113から洗浄室114に転送する。洗浄室114
内で、予め窒素ガス(N2)あるいはアルゴン・ガス(Ar)
等の不活性ガスで置換するか、または10-4〜10-6P
aの高真空にすることにより、酸素や水分を極力低減し
た雰囲気中において、図1(a)に示すシリコン基板1の
表面1aを洗浄する。これにより、シリコン基板1の表
面1aを清浄かつ自然酸化膜の無い状態にする。続い
て、洗浄室114から通路117Aを通して、予め洗浄
室114と同じ雰囲気にしておいた酸化・酸窒化用の反
応管115内にシリコン基板1を転送して設置する。
極力排除した雰囲気中にシリコン基板1を保持した状態
で、炉内温度を上昇させる(図5のV1)。これにより、
昇温時の酸化による膜質の良くない酸化膜の形成が抑制
され、清浄かつ自然酸化膜のないシリコン表面を維持で
きる。なお、炉内温度は700℃以下なので、窒素ガス
雰囲気であっても、シリコン基板1の表面は窒化しな
い。引き続き、300〜700℃の温度で、反応管11
5内の雰囲気を窒素を含まない酸化性ガスに置換して、
図1(a)に示すように、シリコン基板1の表面1aに第
1のシリコン酸化膜2を形成する(図5のH1)。自然酸
化膜のないシリコン表面1aに第1のシリコン酸化膜2
を形成するので、第1のシリコン酸化膜2の膜厚を均一
にすることができ、第1のシリコン酸化膜2と下地のシ
リコン1との界面1aを平坦にすることができる。ま
た、加熱温度を700℃以下に設定することにより、シ
リコン表面1aの酸化を緩やかに行うことができる。特
に、雰囲気の圧力を1Pa以下の低圧に設定することに
より、1原子層毎に層状に酸化することができる。さら
に、上記雰囲気を水蒸気(H2O)、オゾン(O3)、または
これらを含む酸素ガス(H2O/O2,O3/O2)とするこ
とにより、酸素分子のみで酸化を行う場合に比して、小
粒径の酸化種の存在により第1のシリコン酸化膜2を緻
密に形成できる。これとともに、第1のシリコン酸化膜
2と下地のシリコン1との界面1aの平坦性をさらに良
くすることができる。なお、これらの雰囲気では、酸化
速度が大きいので、層状に酸化するためには、1Pa以
下の低圧に設定する必要がある。
の膜厚バラツキを小さくし、かつ第1のシリコン酸化膜
2と下地のシリコン1との界面1aを平坦にすることが
できる。なお、所望の全絶縁膜厚を得るには、主にこの
酸化での圧力、時間を調節する。
素や水分を極力低減した窒素ガス(N2)あるいはアルゴ
ン・ガス(Ar)等の不活性ガスに置換し、炉内温度を上
昇させる(図5のV2)。これにより、工程移行期間中の
わずかな酸化を抑制できる。したがって、次に形成する
酸窒化膜の膜厚バラツキや窒素濃度バラツキを小さくで
きるだけでなく、既に形成された第1のシリコン酸化膜
2中に混入する水素原子も少なくなるので、界面準位の
生成や電子捕獲等の水素に起因した素子劣化も抑制でき
る。
で、反応管115内の雰囲気を窒素を含む酸化性ガスに
置換して、図1(b)に示すように、第1のシリコン酸化
膜2と下地のシリコン1との間に第1の酸窒化膜3(膜
厚1〜5nm)を形成する(図5のH2)。上記雰囲気とし
ては一酸化窒素(NO)、一酸化二窒素(N2O)、二酸化
窒素(NO2)などを用いる。雰囲気の圧力は、常圧でも
低圧でも良い。なお、第1の酸窒化膜3の膜厚は、0.
5〜3原子%の窒素濃度を実現するのに適切である。
厚バラツキを小さくし、かつ第1のシリコン酸化膜2と
下地のシリコン1との界面1aを平坦にしているので、
第1の酸窒化膜3の膜厚バラツキや窒素濃度バラツキを
小さくすることができる。
素や水分を極力低減した窒素ガス(N2)あるいはアルゴ
ン・ガス(Ar)等の不活性ガスに置換し、炉内温度を下
降させる(図5のV3)。これにより、工程移行期間中の
わずかな酸化を抑制できる。
反応管115内の雰囲気を窒素を含まない酸化性ガスに
置換して、図1(c)に示すように、第1の酸窒化膜3
と下地のシリコン1との間に第2のシリコン酸化膜4
(膜厚1〜5nm)を形成する(図5のH3)。上記雰囲気
としてはオゾン(O3)またはオゾン(O3)を含む酸素ガス
(O3/O2)を用い、上記雰囲気の圧力を1Pa以下の低
圧に設定する。なお、第2のシリコン酸化膜4の膜厚
は、酸窒化により増大した正孔トラップを低減するのに
適切であり、酸化温度はこの膜厚範囲で良好な膜質が得
られる温度範囲となっている。
厚バラツキを小さくし、第1の酸窒化膜3の膜厚バラツ
キおよび窒素濃度バラツキを小さくしているので、第2
のシリコン酸化膜4の膜厚バラツキを小さくすることが
でき、第2のシリコン酸化膜4と下地のシリコン1との
界面1aも平坦に仕上げることができる。
単原子状酸素は、酸素分子に比して酸窒化膜中の窒素原
子の存在の影響をあまり受けることなく、酸窒化膜中を
容易に拡散し、かつシリコンと容易に反応する。したが
って、既に形成されている酸窒化膜3の窒素濃度バラツ
キの影響をあまり受けることなく、第2のシリコン酸化
膜4を均一な膜厚に形成することができる。なお、上記
雰囲気の圧力を1Pa以下の低圧に設定する理由は、酸
化種の拡散係数を低下させずに酸化速度を低下させて膜
厚制御性を向上させるためである。
酸素や水分を極力低減した窒素ガス(N2)あるいはアル
ゴン・ガス(Ar)等の不活性ガスで置換し、炉内温度を
下降させる(図5のV4)。十分に降温した後、反応管1
15から通路117Cを通して処理後・カセット室11
6にシリコン基板1を転送し、バルブ118Cを閉じて
処理後・カセット室116を常圧にした状態でシリコン
基板1を外に取り出す。これで、ゲート絶縁膜の形成が
完了する。
酸化膜2,4の膜厚バラツキを小さくし、第1の酸窒化
膜3の膜厚バラツキや窒素濃度バラツキを小さくし、か
つ第2のシリコン酸化膜4と下地のシリコン1との界面
1aを平坦にしているので、従来に比してゲート絶縁膜
全体としての膜厚バラツキを小さくすることができ、ゲ
ート絶縁膜の絶縁破壊耐圧を向上させることができる。
また、ゲート絶縁膜全体の膜厚均一性や界面平坦性を損
なう事なく、第2のシリコン酸化膜4の膜厚を1nm以上
に設定できるので、Si/SiO2界面の歪みの変化やSi
2=NHなどの窒素が関与する化学種に起因する正孔ト
ラップの増加、あるいはMOS界面に垂直な方向の電界
が低い領域でのキャリア移動度の低下などの酸窒化に伴
う種々の問題を解決することができる。
施形態でゲート絶縁膜を形成する場合の工程途中のウェ
ーハ断面を示し、図6はその加熱サイクルを示してい
る。この実施形態では、酸化・酸窒化用チャンバ115
としてランプ加熱型酸化炉(反応管)を用いており、加
熱サイクルは縦軸にウェーハ温度(オプティカル・パイ
ロメータ等で測定する)、横軸に処理時間をとって示し
ている。ウェーハとしては単結晶シリコン基板11を用
いている。以下、図2(a)〜(c)、図6および図9を適宜
参照しながら、この実施形態のゲート絶縁膜形成方法を
説明する。
ット室113から洗浄室114に転送する。洗浄室11
4内で、予め窒素ガス(N2)あるいはアルゴン・ガス(A
r)等の不活性ガスで置換するか、または10-4〜10-6
Paの高真空にすることにより、酸素や水分を極力低減
した雰囲気中において、図2(a)に示すシリコン基板1
1の表面11aを洗浄する。これにより、シリコン基板
11の表面11aを清浄かつ自然酸化膜の無い状態にす
る。続いて、洗浄室114から通路117Aを通して、
予め洗浄室114と同じ雰囲気にしておいた酸化・酸窒
化用の反応管115内にシリコン基板11を転送して設
置する。
にシリコン基板11を保持した状態で、シリコン基板1
1をランプ加熱して昇温する(図6のV1)。これによ
り、昇温時の酸化による膜質の良くない酸化膜の形成が
抑制され、清浄かつ自然酸化膜のないシリコン表面を維
持できる。なお、炉内温度は700℃以下なので、窒素
ガス雰囲気であっても、シリコン基板11の表面は窒化
しない。また、ランプ加熱型酸化炉によれば、抵抗加熱
型酸化炉に比して短時間で昇温(および降温)ができる
ので、さらに酸化を抑制することができる。引き続き、
300〜700℃の温度で、反応管115内の雰囲気を
窒素を含まない酸化性ガスに置換して、図2(a)に示す
ように、シリコン基板11の表面11aに第1のシリコ
ン酸化膜12を形成する(図6のH1)。自然酸化膜のな
いシリコン表面11aに第1のシリコン酸化膜12を形
成するので、第1のシリコン酸化膜12の膜厚を均一に
することができ、第1のシリコン酸化膜12と下地のシ
リコン11との界面11aを平坦にすることができる。
また、加熱温度を700℃以下に設定することにより、
シリコン表面11aの酸化を緩やかに行うことができ
る。特に、雰囲気の圧力を1Pa以下の低圧に設定する
ことにより、1原子層毎に層状に酸化することができ
る。さらに、上記雰囲気を水蒸気(H2O)、オゾン
(O3)、またはこれらを含む酸素ガス(H2O/O2,O3/
O2)とすることにより、酸素分子のみで酸化を行う場合
に比して、小粒径の酸化種の存在により第1のシリコン
酸化膜12を緻密に形成できる。これとともに、第1の
シリコン酸化膜12と下地のシリコン11との界面11
aの平坦性をさらに良くすることができる。なお、これ
らの雰囲気では、酸化速度が大きいので、層状に酸化す
るためには、1Pa以下の低圧に設定する必要がある。
2の膜厚バラツキを小さくし、かつ第1のシリコン酸化
膜12と下地のシリコン11との界面11aを平坦にす
ることができる。なお、所望の全絶縁膜厚を得るには、
主にこの酸化での圧力、時間を調節する。
素や水分を極力低減した窒素ガス(N2)あるいはアルゴ
ン・ガス(Ar)等の不活性ガスに置換し、シリコン基板
11を空冷で降温した後、再度ランプ加熱して昇温する
(図6のV2)。これにより、工程移行期間中のわずかな
酸化を抑制できる。したがって、次に形成する酸窒化膜
の膜厚バラツキや窒素濃度バラツキを小さくできるだけ
でなく、既に形成された第1のシリコン酸化膜12中に
混入する水素原子も少なくなるので、界面準位の生成や
電子捕獲等の水素に起因した素子劣化も抑制できる。ま
た、ランプ加熱型酸化炉によれば、抵抗加熱型酸化炉に
比して短時間で昇温および降温ができるので、さらに酸
化を抑制でき、水素原子の混入も少なくすることができ
る。
で、反応管115内の雰囲気を窒素を含む酸化性ガスに
置換して、図2(b)に示すように、第1のシリコン酸化
膜12と下地のシリコン11との間に第1の酸窒化膜1
3(膜厚1〜5nm)を形成する(図6のH2)。上記雰囲
気としては一酸化窒素(NO)、一酸化二窒素(N2O)、
二酸化窒素(NO2)などを用いる。雰囲気の圧力は、常
圧でも低圧でも良い。なお、第1の酸窒化膜13の膜厚
は、0.5〜3原子%の窒素濃度を実現するのに適切で
ある。
膜厚バラツキを小さくし、かつ第1のシリコン酸化膜1
2と下地のシリコン11との界面11aを平坦にしてい
るので、第1の酸窒化膜13の膜厚バラツキや窒素濃度
バラツキを小さくすることができる。
素や水分を極力低減した窒素ガス(N2)あるいはアルゴ
ン・ガス(Ar)等の不活性ガスに置換し、シリコン基板
11を空冷で降温した後、再度ランプ加熱して昇温する
(図6のV3)。これにより、工程移行期間中のわずかな
酸化を抑制できる。
で、反応管115内の雰囲気を窒素を含まない酸化性ガ
スに置換して、図2(c)に示すように、第1の酸窒化膜
13と下地のシリコン11との間に第2のシリコン酸化
膜14(膜厚1〜5nm)を形成する(図6のH3)。上記
雰囲気としてはオゾン(O3)またはオゾン(O3)を含む酸
素ガス(O3/O2)を用い、上記雰囲気の圧力を1Pa以
下の低圧に設定する。なお、第2のシリコン酸化膜14
の膜厚は、酸窒化により増大した正孔トラップを低減す
るのに適切であり、酸化温度はこの膜厚範囲で良好な膜
質が得られる温度範囲となっている。
膜厚バラツキを小さくし、第1の酸窒化膜13の膜厚バ
ラツキおよび窒素濃度バラツキを小さくしているので、
第2のシリコン酸化膜14の膜厚バラツキを小さくする
ことができ、第2のシリコン酸化膜14と下地のシリコ
ン11との界面11aも平坦に仕上げることができる。
単原子状酸素は、酸素分子に比して酸窒化膜中の窒素原
子の存在の影響をあまり受けることなく、酸窒化膜中を
容易に拡散し、かつシリコンと容易に反応する。したが
って、既に形成されている酸窒化膜13の窒素濃度バラ
ツキの影響をあまり受けることなく、第2のシリコン酸
化膜14を均一な膜厚に形成することができる。なお、
上記雰囲気の圧力を1Pa以下の低圧に設定する理由
は、酸化種の拡散係数を低下させずに酸化速度を低下さ
せて膜厚制御性を向上させるためである。
酸素や水分を極力低減した窒素ガス(N2)あるいはアル
ゴン・ガス(Ar)等の不活性ガスで置換し、シリコン基
板11を空冷して降温する(図6のV4)。十分に降温し
た後、反応管115から通路117Cを通して処理後・
カセット室116にシリコン基板11を転送し、バルブ
118Cを閉じて処理後・カセット室116を常圧にし
た状態でシリコン基板11を外に取り出す。これで、ゲ
ート絶縁膜の形成が完了する。
酸化膜12,14の膜厚バラツキを小さくし、第1の酸
窒化膜13の膜厚バラツキや窒素濃度バラツキを小さく
し、かつ第2のシリコン酸化膜14と下地のシリコン1
1との界面11aを平坦にしているので、従来に比して
ゲート絶縁膜全体としての膜厚バラツキを小さくするこ
とができ、ゲート絶縁膜の絶縁破壊耐圧を向上させるこ
とができる。また、ゲート絶縁膜全体の膜厚均一性や界
面平坦性を損なう事なく、第2のシリコン酸化膜4の膜
厚を1nm以上に設定できるので、Si/SiO2界面の歪
みの変化やSi2=NHなどの窒素が関与する化学種に起
因する正孔トラップの増加、あるいはMOS界面に垂直
な方向の電界が低い領域でのキャリア移動度の低下など
の酸窒化に伴う種々の問題を解決することができる。
携帯でゲート絶縁膜を形成する場合の工程途中のウェー
ハ断面を示し、図7はその加熱サイクルを示している。
この実施形態では、酸化・酸窒化用チャンバ115とし
て抵抗加熱型酸化炉(反応管)を用いており、加熱サイ
クルは縦軸に炉内温度、横軸に処理時間をとって示して
いる。ウェーハとしては単結晶シリコン基板21を用い
ている。以下、図3(a)〜(c)、図7および図9を適宜参
照しながら、この実施形態のゲート絶縁膜形成方法を説
明する。
ット室113から洗浄室114に転送する。洗浄室11
4内で、予め窒素ガス(N2)あるいはアルゴン・ガス(A
r)等の不活性ガスで置換するか、または10-4〜10-6
Paの高真空にすることにより、酸素や水分を極力低減
した雰囲気中において、図3(a)に示すシリコン基板2
1の表面21aを洗浄する。これにより、シリコン基板
21の表面21aを清浄かつ自然酸化膜の無い状態にす
る。続いて、洗浄室114から通路117Aを通して、
予め洗浄室114と同じ雰囲気にしておいた酸化・酸窒
化用の反応管115内にシリコン基板21を転送して設
置する。
にシリコン基板21を保持した状態で、炉内温度を上昇
させる(図7のV1)。これにより、昇温時の酸化による
膜質の良くない酸化膜の形成が抑制され、清浄かつ自然
酸化膜のないシリコン表面を維持できる。なお、炉内温
度は700℃以下なので、窒素ガス雰囲気であっても、
シリコン基板21の表面は窒化しない。引き続き、30
0〜700℃の温度で、反応管115内の雰囲気を窒素
を含まない酸化性ガスに置換して、図3(a)に示すよう
に、シリコン基板21の表面21aに第1のシリコン酸
化膜22を形成する(図7のH1)。自然酸化膜のないシ
リコン表面21aに第1のシリコン酸化膜22を形成す
るので、第1のシリコン酸化膜22の膜厚を均一にする
ことができ、第1のシリコン酸化膜22と下地のシリコ
ン21との界面21aを平坦にすることができる。ま
た、加熱温度を700℃以下に設定することにより、シ
リコン表面21aの酸化を緩やかに行うことができる。
特に、雰囲気の圧力を1Pa以下の低圧に設定すること
により、1原子層毎に層状に酸化することができる。さ
らに、上記雰囲気を水蒸気(H2O)、オゾン(O3)、また
はこれらを含む酸素ガス(H2O/O2,O3/O2)とする
ことにより、酸素分子のみで酸化を行う場合に比して、
小粒径の酸化種の存在により第1のシリコン酸化膜22
を緻密に形成できる。これとともに、第1のシリコン酸
化膜22と下地のシリコン21との界面21aの平坦性
をさらに良くすることができる。なお、これらの雰囲気
では、酸化速度が大きいので、層状に酸化するために
は、1Pa以下の低圧に設定する必要がある。
2の膜厚バラツキを小さくし、かつ第1のシリコン酸化
膜22と下地のシリコン21との界面21aを平坦にす
ることができる。なお、第1のシリコン酸化膜22の膜
厚が0.3〜1.0nmとなるように、圧力、時間を調節
する。
素や水分を極力低減した窒素ガス(N2)あるいはアルゴ
ン・ガス(Ar)等の不活性ガスに置換し、炉内温度を上
昇させる(図7のV2)。引き続いて、900〜1100
℃の温度で、反応管115内の雰囲気を窒素を含む酸化
性ガスに置換して、図3(b)に示すように、第1のシリ
コン酸化膜22と下地のシリコン21との間に第1の酸
窒化膜23(膜厚1〜5nm)を形成する(図7のH2)。
上記雰囲気としては一酸化窒素(NO)、一酸化二窒素
(N2O)、二酸化窒素(NO2)などを用いる。雰囲気の圧
力は、常圧でも低圧でも良い。なお、第1の酸窒化膜2
3の膜厚は、高い窒素濃度を実現する上で適切である。
膜厚バラツキを小さくし、かつ第1のシリコン酸化膜2
2と下地のシリコン21との界面21aを平坦にしてい
るので、第1の酸窒化膜23の膜厚バラツキや窒素濃度
バラツキを小さくすることができる。
る第2の酸窒化膜25よりも最終的にシリコン表面21
aから遠い側に位置するので、上記雰囲気としてアンモ
ニア(NH3)を用いたとしても、アンモニアの水素基(-
H)に起因するキャリア捕獲は素子特性に影響を及ぼし
にくい。したがって、上記雰囲気としてアンモニア(N
H3)を用いても良い。特に、雰囲気をアンモニアからな
る単体ガスとして、第1の酸窒化膜23ではなくシリコ
ン窒化膜を形成するようにしても良い。
素や水分を極力低減した窒素ガス(N2)あるいはアルゴ
ン・ガス(Ar)等の不活性ガスに置換し、炉内温度を下
降させる(図7のV3)。引き続いて、700〜850℃
の温度で、反応管115内の雰囲気を窒素を含まない酸
化性ガスに置換して、図3(c)に示すように、第1の酸
窒化膜23と下地のシリコン21との間に第2のシリコ
ン酸化膜24を形成する(図7のH3)。上記雰囲気とし
てはオゾン(O3)またはオゾン(O3)を含む酸素ガス(O3
/O2)を用い、上記雰囲気の圧力を1Pa以下の低圧に
設定する。
膜厚バラツキを小さくし、第1の酸窒化膜23の膜厚バ
ラツキおよび窒素濃度バラツキを小さくしているので、
第2のシリコン酸化膜24の膜厚バラツキを小さくする
ことができ、第2のシリコン酸化膜24と下地のシリコ
ン21との界面21aも平坦に仕上げることができる。
単原子状酸素は、酸素分子に比して酸窒化膜中の窒素原
子の存在の影響をあまり受けることなく、酸窒化膜中を
容易に拡散し、かつシリコンと容易に反応する。したが
って、既に形成されている酸窒化膜23の窒素濃度バラ
ツキの影響をあまり受けることなく、第2のシリコン酸
化膜24を均一な膜厚に形成することができる。なお、
上記雰囲気の圧力を1Pa以下の低圧に設定する理由
は、酸化種の拡散係数を低下させずに酸化速度を低下さ
せて膜厚制御性を向上させるためである。この場合、比
較的低温で酸化を行っているので、窒素濃度プロファイ
ルの再分布は起こりにくい。なお、所望の全絶縁膜厚を
得るには、主にこの酸化での圧力、時間を調節する。
内の雰囲気を、酸素や水分を極力低減した窒素ガス
(N2)あるいはアルゴン・ガス(Ar)等の不活性ガスに置
換し、炉内温度を上昇させる(図7のV4)。引き続い
て、900〜1100℃の温度で、反応管115内の雰
囲気を窒素を含む酸化性ガスに置換して、図3(d)に示
すように、第2のシリコン酸化膜24と下地のシリコン
21との間に第2の酸窒化膜25(膜厚1〜5nm)を形
成する(図7のH4)。上記雰囲気としては一酸化窒素
(NO)、一酸化二窒素(N2O)、二酸化窒素(NO2)など
を用いる。雰囲気の圧力は、常圧でも低圧でも良いが、
ここでは第1の酸窒化膜23の窒素濃度よりも第2の酸
窒化膜25の窒素濃度を低くするように、第1の酸窒化
膜23形成時よりも、圧力あるいは温度を低く設定す
る。なお、第2の酸窒化膜25の膜厚は、0.5〜3原
子%の窒素濃度を実現するのに適切である。
膜厚バラツキを小さくし、第1の酸窒化膜23の膜厚バ
ラツキや窒素濃度バラツキを小さくしているのに加え
て、第2のシリコン酸化膜24の膜厚バラツキを小さく
し、かつ第2のシリコン酸化膜24と下地のシリコン2
1との界面21aを平坦にしているので、第2の酸窒化
膜25の膜厚バラツキや窒素濃度バラツキを小さくする
ことができる。
内の雰囲気を、酸素や水分を極力低減した窒素ガス
(N2)あるいはアルゴン・ガス(Ar)等の不活性ガスに置
換し、炉内温度を下降させる(図7のV5)。引き続い
て、700〜850℃の温度で、反応管115内の雰囲
気を窒素を含まない酸化性ガスに置換して、図3(e)に
示すように、第2の酸窒化膜25と下地のシリコン21
との間に第3のシリコン酸化膜26(膜厚1〜5nm)を
形成する(図7のH5)。上記雰囲気としてはオゾン
(O3)またはオゾン(O3)を含む酸素ガス(O3/O2)を用
い、上記雰囲気の圧力を1Pa以下の低圧に設定する。
なお、第3のシリコン酸化膜26の膜厚は、酸窒化によ
り増大した正孔トラップを低減するのに適切であり、酸
化温度はこの膜厚範囲で良好な膜質が得られる温度範囲
となっている。
膜22,24の膜厚バラツキを小さくし、第1及び第2
の酸窒化膜23,25の膜厚バラツキや窒素濃度バラツ
キを小さくし、かつ第2の酸窒化膜25と下地のシリコ
ン21との界面21aを平坦にしているので、第3のシ
リコン酸化膜26の膜厚バラツキや窒素濃度バラツキを
小さくすることができ、第3のシリコン酸化膜26と下
地のシリコン21との界面21aも平坦に仕上げること
ができる。
単原子状酸素は、酸素分子に比して酸窒化膜中の窒素原
子の存在の影響をあまり受けることなく、酸窒化膜中を
容易に拡散し、かつシリコンと容易に反応する。したが
って、既に形成されている酸窒化膜23,25の窒素濃
度バラツキの影響をあまり受けることなく、第3のシリ
コン酸化膜26を均一な膜厚に形成することができる。
なお、上記雰囲気の圧力を1Pa以下の低圧に設定する
理由は、酸化種の拡散係数を低下させずに酸化速度を低
下させて膜厚制御性を向上させるためである。この場
合、通常の乾燥酸化に比べて、比較的低温で酸化を行っ
ているので、窒素濃度プロファイルの再分布は起こりに
くい。
酸素や水分を極力低減した窒素ガス(N2)あるいはアル
ゴン・ガス(Ar)等の不活性ガスで置換し、炉内温度を
下降させる(図7のV6)。十分に降温した後、反応管1
15から通路117Cを通して処理後・カセット室11
6にシリコン基板21を転送し、バルブ118Cを閉じ
て処理後・カセット室116を常圧にした状態でシリコ
ン基板21を外に取り出す。これで、ゲート絶縁膜の形
成が完了する。
リコン酸化膜22,24,26の膜厚バラツキを小さく
し、第1及び第2の酸窒化膜23,25の膜厚バラツキ
や窒素濃度バラツキを小さくし、かつ第3のシリコン酸
化膜26と下地のシリコン21との界面21aを平坦に
しているので、従来に比してゲート絶縁膜全体としての
膜厚バラツキを小さくすることができ、ゲート絶縁膜の
絶縁破壊耐圧を向上させることができる。また、ゲート
絶縁膜全体の膜厚均一性や界面平坦性を損なう事なく、
第2及び第3のシリコン酸化膜24,26の膜厚を1nm
以上に設定できるので、Si/SiO2界面の歪みの変化
や、Si2=NHなどの窒素が関与する化学種に起因する
正孔トラップの増加、あるいはMOS界面に垂直な方向
の電界が低い領域でのキャリア移動度の低下などの酸窒
化に伴う種々の問題を解決することができる。
のうちシリコン表面21aから遠い側の第1の酸窒化膜
23の窒素濃度を比較的大きくしているので、いわゆる
ボロンの突き抜けや層間絶縁膜からの水素の拡散が関連
したホットキャリアによる素子劣化の増大を効果的に防
止することができる。また、第2の酸窒化膜25の窒素
濃度を比較的小さくしているので、酸窒化に伴う上述の
問題、すなわちSi/SiO2界面の歪みの変化や、Si2
=NHなどの窒素が関与する化学種に起因する正孔トラ
ップの増加、あるいはMOS界面に垂直な方向の電界が
低い領域でのキャリア移動度の低下などを効果的に抑え
ることができる。
施形態でゲート絶縁膜を形成する場合の工程途中のウェ
ーハ断面を示し、図8はその加熱サイクルを示してい
る。この実施形態では、酸化・酸窒化用チャンバ115
としてランプ加熱型酸化炉(反応管)を用いており、加
熱サイクルは縦軸にウェーハ温度(オプティカル・パイ
ロメータ等で測定する)、横軸に処理時間をとって示し
ている。ウェーハとしては単結晶シリコン基板31を用
いている。以下、図4(a)〜(e)、図8および図9を適
宜参照しながら、この実施形態のゲート絶縁膜形成方法
を説明する。
ット室113から洗浄室114に転送する。洗浄室11
4内で、予め窒素ガス(N2)あるいはアルゴン・ガス(A
r)等の不活性ガスで置換するか、または10-4〜10-6
Paの高真空にすることにより、酸素や水分を極力低減
した雰囲気中において、図4(a)に示すシリコン基板3
1の表面31aを洗浄する。これにより、シリコン基板
31の表面31aを清浄かつ自然酸化膜の無い状態にす
る。続いて、洗浄室114から通路117Aを通して、
予め洗浄室114と同じ雰囲気にしておいた酸化・酸窒
化用の反応管115内にシリコン基板31を転送して設
置する。
にシリコン基板31を保持した状態で、シリコン基板3
1をランプ加熱して昇温させる(図8のV1)。これによ
り、昇温時の酸化が抑制され、清浄かつ自然酸化膜のな
いシリコン表面を維持できる。なお、炉内温度は700
℃以下なので、窒素ガス雰囲気であっても、シリコン基
板1の表面は窒化しない。また、ランプ加熱型酸化炉に
よれば、抵抗加熱型酸化炉に比して短時間で昇温(およ
び降温)ができるので、さらに酸化を抑制することがで
きる。引き続き、300〜700℃の温度で、反応管1
15内の雰囲気を窒素を含まない酸化性ガスに置換し
て、図4(a)に示すように、シリコン基板31の表面3
1aに第1のシリコン酸化膜32を形成する(図8のH
1)。自然酸化膜のないシリコン表面31aに第1のシ
リコン酸化膜32を形成するので、第1のシリコン酸化
膜32の膜厚を均一にすることができ、第1のシリコン
酸化膜32と下地のシリコン31との界面31aを平坦
にすることができる。また、加熱温度を700℃以下に
設定することにより、シリコン表面31aの酸化を緩や
かに行うことができる。特に、雰囲気の圧力を1Pa以
下の低圧に設定することにより、1原子層毎に層状に酸
化することができる。さらに、上記雰囲気を水蒸気(H2
O)、オゾン(O3)、またはこれらを含む酸素ガス(H2O
/O2,O3/O2)とすることにより、酸素分子のみで酸
化を行う場合に比して、小粒径の酸化種の存在により第
1のシリコン酸化膜32を緻密に形成できる。これとと
もに、第1のシリコン酸化膜32と下地のシリコン31
との界面31aの平坦性をさらに良くすることができ
る。なお、これらの雰囲気では、酸化速度が大きいの
で、層状に酸化するためには、1Pa以下の低圧に設定
する必要がある。
2の膜厚バラツキを小さくし、かつ第1のシリコン酸化
膜32と下地のシリコン31との界面31aを平坦にす
ることができる。なお、第1のシリコン酸化膜32の膜
厚が0.3〜1.0nmとなるように、圧力、時間を調節
する。
素や水分を極力低減した窒素ガス(N2)あるいはアルゴ
ン・ガス(Ar)等の不活性ガスに置換し、シリコン基板
31を空冷で降温した後、再度ランプ加熱して昇温する
(図8のV2)。これにより、工程移行期間中のわずかな
酸化を抑制できる。したがって、次に形成する酸窒化膜
の膜厚バラツキや窒素濃度バラツキを小さくできるだけ
でなく、既に形成された第1のシリコン酸化膜32中に
混入する水素原子も少なくなるので、界面準位の生成や
電子捕獲等の水素に起因した素子劣化も抑制できる。ま
た、ランプ加熱型酸化炉によれば、抵抗加熱型酸化炉に
比して短時間で昇温および降温ができるので、さらに酸
化を抑制でき、水素原子の混入を少なくすることができ
る。
で、反応管115内の雰囲気を窒素を含む酸化性ガスに
置換して、図4(b)に示すように、第1のシリコン酸化
膜32と下地のシリコン31との間に第1の酸窒化膜3
3(膜厚1〜5nm)を形成する(図8のH2)。上記雰囲
気としては一酸化窒素(NO)、一酸化二窒素(N2O)、
二酸化窒素(NO2)などを用いる。雰囲気の圧力は、常
圧でも低圧でも良い。なお、第1の酸窒化膜33の膜厚
は、高い窒素濃度を実現する上で適切である。
膜厚バラツキを小さくし、かつ第1のシリコン酸化膜3
2と下地のシリコン31との界面31aを平坦にしてい
るので、第1の酸窒化膜33の膜厚バラツキや窒素濃度
バラツキを小さくすることができる。
る第2の酸窒化膜35よりも最終的にシリコン表面31
aから遠い側に位置するので、上記雰囲気としてアンモ
ニア(NH3)を用いたとしても、アンモニアの水素基(-
H)に起因するキャリア捕獲は素子特性に影響を及ぼし
にくい。したがって、上記雰囲気としてアンモニア(N
H3)を用いても良い。特に、雰囲気をアンモニアからな
る単体ガスとして、第1の酸窒化膜33ではなくシリコ
ン窒化膜を形成するようにしても良い。
素や水分を極力低減した窒素ガス(N2)あるいはアルゴ
ン・ガス(Ar)等の不活性ガスに置換し、シリコン基板
31を空冷で降温した後、再度ランプ加熱して昇温する
(図6のV3)。これにより、工程移行期間中のわずかな
酸化を抑制できる。引き続いて、700〜1000℃の
温度で、反応管115内の雰囲気を窒素を含まない酸化
性ガスに置換して、図4(c)に示すように、第1の酸窒
化膜33と下地のシリコン31との間に第2のシリコン
酸化膜34を形成する(図8のH3)。上記雰囲気として
はオゾン(O3)またはオゾン(O3)を含む酸素ガス(O3/
O2)を用い、上記雰囲気の圧力を1Pa以下の低圧に設
定する。
膜厚バラツキを小さくし、第1の酸窒化膜33の膜厚バ
ラツキおよび窒素濃度バラツキを小さくしているので、
第2のシリコン酸化膜34の膜厚バラツキを小さくする
ことができ、第2のシリコン酸化膜34と下地のシリコ
ン31との界面31aも平坦に仕上げることができる。
単原子状酸素は、酸素分子に比して酸窒化膜中の窒素原
子の存在の影響をあまり受けることなく、酸窒化膜中を
容易に拡散し、かつシリコンと容易に反応する。したが
って、既に形成されている酸窒化膜33の窒素濃度バラ
ツキの影響をあまり受けることなく、第2のシリコン酸
化膜34を均一な膜厚に形成することができる。また、
ランプ加熱型酸化炉によれば、抵抗加熱型酸化炉に比し
て高温短時間の酸化を行えるので、酸化種の拡散係数を
さらに大きくできる。したがって、既に形成されている
酸窒化膜33の窒素濃度バラツキの影響をさらに少なく
することができ、第2のシリコン酸化膜34をさらに均
一な膜厚に形成することができる。なお、上記雰囲気の
圧力を1Pa以下の低圧に設定する理由は、酸化種の拡
散係数を低下させずに酸化速度を低下させて膜厚制御性
を向上させるためである。この場合、通常の乾燥酸化に
比べて、比較的低温で酸化を行っているので、窒素濃度
プロファイルの再分布は起こりにくい。なお、所望の全
絶縁膜厚を得るには、主にこの酸化での圧力、時間を調
節する。
内の雰囲気を、酸素や水分を極力低減した窒素ガス
(N2)あるいはアルゴン・ガス(Ar)等の不活性ガスに置
換し、シリコン基板31を空冷で降温した後、再度ラン
プ加熱して昇温する(図8のV4)。引き続いて、900
〜1100℃の温度で、反応管115内の雰囲気を窒素
を含む酸化性ガスに置換して、図4(d)に示すように、
第2のシリコン酸化膜34と下地のシリコン31との間
に第2の酸窒化膜35(膜厚1〜5nm)を形成する(図
8のH4)。上記雰囲気としては一酸化窒素(NO)、一
酸化二窒素(N2O)、二酸化窒素(NO2)などを用いる。
雰囲気の圧力は、常圧でも低圧でも良いが、ここでは第
1の酸窒化膜33の窒素濃度よりも第2の酸窒化膜35
の窒素濃度を低くするように、第1の酸窒化膜33形成
時よりも圧力あるいは温度を低く設定する。なお、第2
の酸窒化膜35の膜厚は、0.5〜3原子%の窒素濃度
を実現するのに適切である。
膜厚バラツキを小さくし、第1の酸窒化膜33の膜厚バ
ラツキや窒素濃度バラツキを小さくしているのに加え
て、第2のシリコン酸化膜34の膜厚バラツキを小さく
し、かつ第2のシリコン酸化膜34と下地のシリコン3
1との界面31aを平坦にしているので、第2の酸窒化
膜35の膜厚バラツキや窒素濃度バラツキを小さくする
ことができる。
内の雰囲気を、酸素や水分を極力低減した窒素ガス
(N2)あるいはアルゴン・ガス(Ar)等の不活性ガスに置
換し、シリコン基板31を空冷で降温した後、再度ラン
プ加熱して昇温する(図8のV5)。引き続いて、700
〜850℃の温度で、反応管115内の雰囲気を窒素を
含まない酸化性ガスに置換して、図4(e)に示すよう
に、第2の酸窒化膜35と下地のシリコン31との間に
第3のシリコン酸化膜36(膜厚1〜5nm)を形成する
(図8のH5)。上記雰囲気としてはオゾン(O3)または
オゾン(O3)を含む酸素ガス(O3/O2)を用い、上記雰
囲気の圧力を1Pa以下の低圧に設定する。なお、第3
のシリコン酸化膜36の膜厚は、酸窒化により増大した
正孔トラップを低減するのに適切であり、酸化温度はこ
の膜厚範囲で良好な膜質が得られる温度範囲となってい
る。
膜32,34の膜厚バラツキを小さくし、第1及び第2
の酸窒化膜33,35の膜厚バラツキや窒素濃度バラツ
キを小さくし、かつ第2の酸窒化膜35と下地のシリコ
ン31との界面31aを平坦にしているので、第3のシ
リコン酸化膜36の膜厚バラツキや窒素濃度バラツキを
小さくすることができ、第3のシリコン酸化膜36と下
地のシリコン31との界面31aも平坦に仕上げること
ができる。
単原子状酸素は、酸素分子に比して酸窒化膜中の窒素原
子の存在の影響をあまり受けることなく、酸窒化膜中を
容易に拡散し、かつシリコンと容易に反応する。したが
って、既に形成されている酸窒化膜33,35の窒素濃
度バラツキの影響をあまり受けることなく、第3のシリ
コン酸化膜36を均一な膜厚に形成することができる。
また、ランプ加熱型酸化炉によれば、抵抗加熱型酸化炉
に比して高温短時間の酸化を行えるので、酸化種の拡散
係数をさらに大きくできる。したがって、既に形成され
ている酸窒化膜33,35の窒素濃度バラツキの影響を
さらに少なくすることができ、第3のシリコン酸化膜3
6をさらに均一な膜厚に形成することができる。なお、
上記雰囲気の圧力を1Pa以下の低圧に設定する理由
は、酸化種の拡散係数を低下させずに酸化速度を低下さ
せて膜厚制御性を向上させるためである。この場合、通
常の乾燥酸化に比べて、比較的低温で酸化を行っている
ので、窒素濃度プロファイルの再分布は起こりにくい。
酸素や水分を極力低減した窒素ガス(N2)あるいはアル
ゴン・ガス(Ar)等の不活性ガスで置換し、シリコン基
板31を空冷して降温する(図8のV6)。十分に降温し
た後、反応管115から通路117Cを通して処理後・
カセット室116にシリコン基板31を転送し、バルブ
118Cを閉じて処理後・カセット室116を常圧にし
た状態でシリコン基板31を外に取り出す。これで、ゲ
ート絶縁膜の形成が完了する。
リコン酸化膜32,34,36の膜厚バラツキを小さく
し、第1及び第2の酸窒化膜33,35の膜厚バラツキ
や窒素濃度バラツキを小さくし、かつ第3のシリコン酸
化膜6と下地のシリコン31との界面31aを平坦にし
ているので、従来に比してゲート絶縁膜全体としての膜
厚バラツキを小さくすることができ、ゲート絶縁膜の絶
縁破壊耐圧を向上させることができる。また、ゲート絶
縁膜全体の膜厚均一性や界面平坦性を損なう事なく、第
2及び第3のシリコン酸化膜34,36の膜厚を1nm以
上に設定できるので、Si/SiO2界面の歪みの変化
や、Si2=NHなどの窒素が関与する化学種に起因する
正孔トラップの増加、あるいはMOS界面に垂直な方向
の電界が低い領域でのキャリア移動度の低下などの酸窒
化に伴う種々の問題を解決することができる。
のうちシリコン表面31aから遠い側の第1の酸窒化膜
3の窒素濃度を比較的大きくしているので、いわゆるボ
ロンの突き抜けや層間絶縁膜からの水素の拡散に関連し
たホットキャリアによる素子劣化の増大を効果的に防止
することができる。また、第2の酸窒化膜35の窒素濃
度を比較的小さくしているので、酸窒化に伴う上述の問
題、すなわちSi/SiO2界面の歪みの変化や、Si2=
NHなどの窒素が関与する化学種に起因する正孔トラッ
プの増加、あるいはMOS界面に垂直な方向の電界が低
い領域でのキャリア移動度の低下などを効果的に抑える
ことができる。
構造のゲート絶縁膜を形成したが、当然ながらこれに限
られるものではない。この発明は7層構造以上のゲート
絶縁膜を形成する場合にも適用することができる。
を用いたが、SOI(シリコン・オン・インシュレー
タ)のように、絶縁基板の片面にシリコン層が形成され
ているようなものを用いることもできる。
ート絶縁膜形成方法では、第1及び第2のシリコン酸化
膜の膜厚バラツキを小さくでき、第1の酸窒化膜の膜厚
バラツキおよび窒素濃度バラツキを小さくでき、しかも
第2のシリコン酸化膜と下地のシリコンとの界面も平坦
に仕上げることができる。したがって、従来に比してゲ
ート絶縁膜全体としての膜厚バラツキを小さくでき、ゲ
ート絶縁膜の絶縁破壊耐圧を向上させることができる。
また、この結果、第2のシリコン酸化膜の膜厚を十分に
設定できるので、Si/SiO2界面の歪みの変化やSi2
=NHなどの窒素が関与する化学種に起因する正孔トラ
ップの増加、あるいはMOS界面に垂直な方向の電界が
低い領域でのキャリア移動度の低下などの酸窒化に伴う
種々の問題を解決することができる。
ば、請求項1と同じ作用効果を奏することができる。し
かも、形成したゲート絶縁膜上にP+多結晶シリコンか
らなるゲート電極(不純物としてボロンがイオン注入さ
れている)を形成して表面チャネル型PMOSFETを
作製する場合に、下地のシリコンから遠い側にある第1
の酸窒化膜によって、いわゆるボロンの突き抜け(ゲー
ト電極中のボロンが熱処理によってゲート絶縁膜を通り
シリコン基板まで達してフラット・バンド電圧を変動さ
せる現象)を防止することができる。また、ゲート電極
上の層間絶縁膜から水素が拡散するのを上記第1の酸窒
化膜によって遮断して、上記第3のシリコン酸化膜とシ
リコン基板との界面での界面準位の生成を抑えることが
できる。したがってホットキャリアによる素子劣化の増
大を防止することができる。
記各膜を形成する工程を移行する期間中、上記雰囲気が
不活性ガスに切り替えられるので、その期間中のわずか
な酸化を抑制することができる。したがって、各膜の膜
厚バラツキを小さくでき、酸窒化膜の窒素濃度のバラツ
キも低減することができる。また、上記期間中、上記雰
囲気から既に形成された膜中に混入する水素原子も少な
くなるので、界面準位の生成や電子捕獲等の水素に起因
した素子劣化を抑制することができる。
ば、上記第1のシリコン酸化膜を形成する工程で、上記
ウェーハを加熱する温度が700℃以下に設定されるの
で、シリコン表面の酸化を緩やかに行うことができる。
したがって、上記第1のシリコン酸化膜と下地のシリコ
ンとの界面をさらに平坦にでき、上記第1のシリコン酸
化膜の膜厚をさらに均一にすることができる。
ば、上記各シリコン酸化膜を1原子層毎に層状に形成す
ることができる。
記第1のシリコン酸化膜を形成する工程で、上記雰囲気
として水蒸気(H2O)、オゾン(O3)、または水蒸気若し
くはオゾン含む酸素(H2O/O2,O3/O2)を用いるの
で、酸素分子のみで酸化を行う場合に比して、小粒径の
酸化種の存在により第1のシリコン酸化膜を緻密に形成
することができる。これとともに、第1のシリコン酸化
膜と下地のシリコンとの界面の平坦性を良くすることが
できる。したがって、後工程で形成する酸窒化膜の膜厚
バラツキや窒素濃度バラツキを低減することができる。
記第1の酸窒化膜を形成する工程で、上記雰囲気とし
て、一酸化窒素(NO)、一酸化二窒素(N2O)、二酸化
窒素(NO2)、及びアンモニア(NH3)の中から選ばれた
単体ガスまたは混合ガスを用いるので、第1の酸窒化膜
を容易に形成することができる。
記各酸窒化膜を形成する工程で、上記雰囲気として、一
酸化窒素(NO)、一酸化二窒素(N2O)、及び二酸化窒
素(NO2)の中から選ばれた単体ガスまたは混合ガスを
用いるので、各酸窒化膜を容易に形成することができ
る。
記第2のシリコン酸化膜または上記第2及び第3のシリ
コン酸化膜を形成する工程で、上記雰囲気としてオゾン
(O3)またはオゾン(O3)を含む酸素ガス(O3/O2)を用
いる。オゾンから解離した単原子状酸素は、酸素分子に
比して酸窒化膜中の窒素原子の存在の影響をあまり受け
ることなく、酸窒化膜中を容易に拡散し、かつシリコン
と容易に反応する。したがって、既に形成されている酸
窒化膜の窒素濃度バラツキの影響をあまり受けることな
く、上記第2のシリコン酸化膜または上記第2及び第3
のシリコン酸化膜を均一な膜厚に形成することができ
る。
上記第2のシリコン酸化膜または上記第2及び第3のシ
リコン酸化膜を形成する工程で、上記ウェーハを加熱す
る温度を700℃以上に設定しているので、酸化種の酸
窒化膜中における拡散係数がさらに大きくなる。したが
って、既に形成されている酸窒化膜の窒素濃度バラツキ
の影響をあまり受けることなく、上記第2のシリコン酸
化膜または上記第2及び第3のシリコン酸化膜を均一な
膜厚に形成することができる。
第1の酸窒化膜の窒素濃度が第2の酸窒化膜の窒素濃度
よりも大きくなる。シリコンの表面から遠い側の第1の
酸窒化膜の窒素濃度が比較的大きくなるので、いわゆる
ボロンの突き抜けや層間絶縁膜からの水素の拡散に起因
したホットキャリアによる素子劣化の増大を効果的に防
止することができる。また、第2の酸窒化膜の窒素濃度
が比較的低くなるので、酸窒化に伴う上述の問題、すな
わちSi/SiO2界面の歪みの変化や、Si2=NHなど
の窒素が関与する化学種に起因する正孔トラップの増
加、あるいはMOS界面に垂直な方向の電界が低い領域
でのキャリア移動度の低下などを抑えることができる。
請求項2における第1の酸窒化膜に代えてシリコン窒化
膜を形成しているが、請求項2と同じ作用効果を奏する
ことができる。上記シリコン窒化膜は、アンモニアから
なる単体ガスを用いているので容易に形成することがで
きる。なお、上記シリコン窒化膜は第2の酸窒化膜より
もシリコン表面から遠い側にあるので、上記シリコン窒
化膜においてアンモニアを用いた窒化に起因する電子捕
獲が起こったとしても、素子特性に殆ど影響を及ぼすこ
とがない。
りゲート絶縁膜を形成する場合の工程途中のウェーハ断
面を示す図である。
りゲート絶縁膜を形成する場合の工程途中のウェーハ断
面を示す図である。
りゲート絶縁膜を形成する場合の工程途中のウェーハ断
面を示す図である。
りゲート絶縁膜を形成する場合の工程途中のウェーハ断
面を示す図である。
りゲート絶縁膜を形成する場合の加熱サイクルを示す図
である。
りゲート絶縁膜を形成する場合の加熱サイクルを示す図
である。
りゲート絶縁膜を形成する場合の加熱サイクルを示す図
である。
りゲート絶縁膜を形成する場合の加熱サイクルを示す図
である。
のに適した装置を示す図である。
絶縁膜を形成する場合の膜厚バラツキの増加メカニズム
を説明する図である。
Claims (12)
- 【請求項1】 不活性ガスからなる雰囲気中で、ウェー
ハのシリコンからなる表面を洗浄して清浄かつ自然酸化
膜の無い状態にする工程(a)と、 上記ウェーハを大気に曝すことなく上記雰囲気を窒素を
含まない酸化性ガスに置換し、この雰囲気中で上記ウェ
ーハを加熱して、上記シリコンからなる表面に第1のシ
リコン酸化膜を形成する工程(b)と、 上記雰囲気を窒素を含む酸化性ガスに置換し、この雰囲
気中で上記ウェーハを加熱して、上記第1のシリコン酸
化膜と下地のシリコンとの間に第1の酸窒化膜を形成す
る工程(c)と、 上記雰囲気を窒素を含まない酸化性ガスに置換し、この
雰囲気中で上記ウェーハを加熱して、上記第1の酸窒化
膜と下地のシリコンとの間に第2のシリコン酸化膜を形
成する工程(d)とを有することを特徴とするゲート絶縁
膜形成方法。 - 【請求項2】 請求項1に記載のゲート絶縁膜形成方法
において、 上記第2のシリコン酸化膜を形成する工程(d)の後、 上記雰囲気を窒素を含む酸化性ガスに置換し、この雰囲
気中で上記ウェーハを加熱して、上記第2のシリコン酸
化膜と下地のシリコンとの間に第2の酸窒化膜を形成す
る工程(e)と、 上記雰囲気を窒素を含まない酸化性ガスに置換し、この
雰囲気中で上記ウェーハを加熱して、上記第2の酸窒化
膜と下地のシリコンとの間に第3のシリコン酸化膜を形
成する工程(g)とを有することを特徴とするゲート絶縁
膜形成方法。 - 【請求項3】 請求項1又は2に記載のゲート絶縁膜形
成方法において、 上記各膜を形成する工程を移行する期間中、上記雰囲気
を不活性ガスに切り替えることを特徴とする絶縁膜形成
方法。 - 【請求項4】 請求項1又は2に記載のゲート絶縁膜形
成方法において、 上記第1のシリコン酸化膜を形成する工程で、上記ウェ
ーハを加熱する温度を300℃以上700℃以下に設定
することを特徴とするゲート絶縁膜形成方法。 - 【請求項5】 請求項1又は2に記載のゲート絶縁膜形
成方法において、 上記各シリコン酸化膜を形成する工程で、上記雰囲気の
圧力を大気圧よりも低く設定することを特徴とするゲー
ト絶縁膜形成方法。 - 【請求項6】 請求項1又は2に記載のゲート絶縁膜形
成方法において、 上記第1のシリコン酸化膜を形成する工程で、上記雰囲
気として水蒸気、オゾン、または水蒸気若しくはオゾン
含む酸素を用いることを特徴とするゲート絶縁膜形成方
法。 - 【請求項7】 請求項2に記載のゲート絶縁膜形成方法
において、 上記第1の酸窒化膜を形成する工程で、上記雰囲気とし
て、一酸化窒素、一酸化二窒素、二酸化窒素、及びアン
モニアの中から選ばれた単体ガスまたは混合ガスを用い
ることを特徴とするゲート絶縁膜形成方法。 - 【請求項8】 請求項1又は2に記載のゲート絶縁膜形
成方法において、 上記各酸窒化膜を形成する工程で、上記雰囲気として、
一酸化窒素、一酸化二窒素、及び二酸化窒素の中から選
ばれた単体ガスまたは混合ガスを用いることを特徴とす
るゲート絶縁膜形成方法。 - 【請求項9】 請求項1又は2に記載のゲート絶縁膜形
成方法において、 上記第2のシリコン酸化膜または上記第2及び第3のシ
リコン酸化膜を形成する工程で、上記雰囲気としてオゾ
ンまたはオゾンを含む酸素を用いることを特徴とするゲ
ート絶縁膜形成方法。 - 【請求項10】 請求項1又は2に記載のゲート絶縁膜
形成方法において、上記第2のシリコン酸化膜または上
記第2及び第3のシリコン酸化膜を形成する工程で、上
記雰囲気の圧力を大気圧よりも低く設定するとともに、
上記ウェーハを加熱する温度を700℃以上1200℃
以下に設定することを特徴とするゲート絶縁膜形成方
法。 - 【請求項11】 請求項2に記載のゲート絶縁膜形成方
法において、 上記第1の酸窒化膜を形成する工程と上記第2の酸窒化
膜を形成する工程とで、形成される第1の酸窒化膜の窒
素濃度が第2の酸窒化膜の窒素濃度よりも大きくなるよ
うに、上記雰囲気の圧力、または上記ウェーハを加熱す
る温度若しくは時間を変えることを特徴とするゲート絶
縁膜形成方法。 - 【請求項12】 不活性ガスからなる雰囲気中で、ウェ
ーハのシリコンからなる表面を洗浄して清浄かつ自然酸
化膜の無い状態にする工程(a)と、 上記ウェーハを大気に曝すことなく上記雰囲気を窒素を
含まない酸化性ガスに置換し、この雰囲気中で上記ウェ
ーハを加熱して、上記シリコンからなる表面に第1のシ
リコン酸化膜を形成する工程(b)と、 上記雰囲気をアンモニアからなる単体ガスに置換し、こ
の雰囲気中で上記ウェーハを加熱して、上記第1のシリ
コン酸化膜と下地のシリコンとの間にシリコン窒化膜を
形成する工程(c)と、 上記雰囲気を窒素を含まない酸化性ガスに置換し、この
雰囲気中で上記ウェーハを加熱して、上記シリコン窒化
膜と下地のシリコンとの間に第2のシリコン酸化膜を形
成する工程(d)と、 上記雰囲気を窒素を含む酸化性ガスに置換し、この雰囲
気中で上記ウェーハを加熱して、上記第2のシリコン酸
化膜と下地のシリコンとの間に第2の酸窒化膜を形成す
る工程(e)と、 上記雰囲気を窒素を含まない酸化性ガスに置換し、この
雰囲気中で上記ウェーハを加熱して、上記第2の酸窒化
膜と下地のシリコンとの間に第3のシリコン酸化膜を形
成する工程(g)とを有することを特徴とするゲート絶縁
膜形成方法。
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JP18373896A JP3981426B2 (ja) | 1996-07-12 | 1996-07-12 | ゲート絶縁膜形成方法 |
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JP18373896A JP3981426B2 (ja) | 1996-07-12 | 1996-07-12 | ゲート絶縁膜形成方法 |
Publications (2)
Publication Number | Publication Date |
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JPH1032328A true JPH1032328A (ja) | 1998-02-03 |
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US (1) | US5926741A (ja) |
JP (1) | JP3981426B2 (ja) |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100380278B1 (ko) * | 2000-09-29 | 2003-04-16 | 주식회사 하이닉스반도체 | 반도체장치 및 그 제조방법 |
KR20040025187A (ko) * | 2002-09-18 | 2004-03-24 | 삼성전자주식회사 | 반도체 장치의 게이트 절연막 구조체 및 그 형성 방법 |
US6984267B2 (en) | 1998-06-30 | 2006-01-10 | Fujitsu Limited | Manufacture system for semiconductor device with thin gate insulating film |
US7303946B1 (en) | 1999-04-28 | 2007-12-04 | Kabushiki Kaisha Toshiba | Method of manufacturing a semiconductor device using an oxidation process |
JP2010056558A (ja) * | 1999-06-24 | 2010-03-11 | Alcatel-Lucent Usa Inc | 半導体デバイス |
US7709403B2 (en) | 2003-10-09 | 2010-05-04 | Panasonic Corporation | Silicon carbide-oxide layered structure, production method thereof, and semiconductor device |
JP2012004275A (ja) * | 2010-06-16 | 2012-01-05 | Sumitomo Electric Ind Ltd | 炭化珪素半導体装置の製造方法 |
JP2020145366A (ja) * | 2019-03-08 | 2020-09-10 | 株式会社Screenホールディングス | 熱処理方法および熱処理装置 |
Families Citing this family (29)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6319857B1 (en) * | 1996-09-16 | 2001-11-20 | Advanced Micro Devices, Inc. | Method of fabricating stacked N-O-N ultrathin gate dielectric structures |
US6177312B1 (en) * | 1998-03-26 | 2001-01-23 | Advanced Micro Devices, Inc. | Method for removing contaminate nitrogen from the peripheral gate region of a non-volatile memory device during production of such device |
US6509283B1 (en) * | 1998-05-13 | 2003-01-21 | National Semiconductor Corporation | Thermal oxidation method utilizing atomic oxygen to reduce dangling bonds in silicon dioxide grown on silicon |
US6541394B1 (en) * | 1999-01-12 | 2003-04-01 | Agere Systems Guardian Corp. | Method of making a graded grown, high quality oxide layer for a semiconductor device |
JP2000232222A (ja) * | 1999-02-10 | 2000-08-22 | Nec Corp | 半導体装置の製造方法 |
US7022623B2 (en) * | 1999-04-22 | 2006-04-04 | Micron Technology, Inc. | Method of fabricating a semiconductor device with a dielectric film using a wet oxidation with steam process |
US6395610B1 (en) | 1999-06-24 | 2002-05-28 | Lucent Technologies Inc. | Method of making bipolar transistor semiconductor device including graded, grown, high quality oxide layer |
US6521496B1 (en) | 1999-06-24 | 2003-02-18 | Lucent Technologies Inc. | Non-volatile memory semiconductor device including a graded, grown, high quality control gate oxide layer and associated methods |
US6509230B1 (en) | 1999-06-24 | 2003-01-21 | Lucent Technologies Inc. | Non-volatile memory semiconductor device including a graded, grown, high quality oxide layer and associated methods |
US6670242B1 (en) | 1999-06-24 | 2003-12-30 | Agere Systems Inc. | Method for making an integrated circuit device including a graded, grown, high quality gate oxide layer and a nitride layer |
US6551946B1 (en) | 1999-06-24 | 2003-04-22 | Agere Systems Inc. | Two-step oxidation process for oxidizing a silicon substrate wherein the first step is carried out at a temperature below the viscoelastic temperature of silicon dioxide and the second step is carried out at a temperature above the viscoelastic temperature |
US6433383B1 (en) * | 1999-07-20 | 2002-08-13 | Advanced Micro Devices, Inc. | Methods and arrangements for forming a single interpoly dielectric layer in a semiconductor device |
GB9929614D0 (en) * | 1999-12-15 | 2000-02-09 | Koninkl Philips Electronics Nv | Method of manufacturing a transistor |
US20030235957A1 (en) * | 2002-06-25 | 2003-12-25 | Samir Chaudhry | Method and structure for graded gate oxides on vertical and non-planar surfaces |
US6281140B1 (en) * | 2000-06-12 | 2001-08-28 | Taiwan Semiconductor Manufacturing Company | Method of reducing the roughness of a gate insulator layer after exposure of the gate insulator layer to a threshold voltage implantation procedure |
US6511887B1 (en) | 2000-06-19 | 2003-01-28 | Taiwan Semiconductor Manufacturing Computer | Method for making FET gate oxides with different thicknesses using a thin silicon nitride layer and a single oxidation step |
US7148153B2 (en) * | 2000-06-20 | 2006-12-12 | Agere Systems Inc. | Process for oxide fabrication using oxidation steps below and above a threshold temperature |
US6890831B2 (en) * | 2002-06-03 | 2005-05-10 | Sanyo Electric Co., Ltd. | Method of fabricating semiconductor device |
US7022193B2 (en) * | 2002-10-29 | 2006-04-04 | In Kwon Jeong | Apparatus and method for treating surfaces of semiconductor wafers using ozone |
US6949804B2 (en) * | 2003-02-14 | 2005-09-27 | Seiko Epson Corporation | Semiconductor device with gate dielectric film having an oxide film and an oxynitride film |
KR100885910B1 (ko) * | 2003-04-30 | 2009-02-26 | 삼성전자주식회사 | 게이트 적층물에 oha막을 구비하는 비 휘발성 반도체메모리 장치 및 그 제조방법 |
US7972441B2 (en) * | 2005-04-05 | 2011-07-05 | Applied Materials, Inc. | Thermal oxidation of silicon using ozone |
KR100678473B1 (ko) * | 2005-11-28 | 2007-02-02 | 삼성전자주식회사 | 다중 게이트 절연막을 갖는 반도체 소자의 제조방법 |
KR100850138B1 (ko) * | 2006-12-26 | 2008-08-04 | 동부일렉트로닉스 주식회사 | 반도체 소자의 게이트 절연막 및 그 형성방법 |
KR101291485B1 (ko) * | 2009-12-04 | 2013-07-30 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치의 제작 방법 |
KR20210043743A (ko) | 2009-12-04 | 2021-04-21 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 그 제조 방법 |
JP5479304B2 (ja) * | 2010-11-10 | 2014-04-23 | 信越半導体株式会社 | シリコン単結晶ウェーハの熱酸化膜形成方法 |
US9153658B2 (en) * | 2011-11-17 | 2015-10-06 | Tohoku University | Semiconductor device and method of manufacturing the same |
CN108630605B (zh) * | 2017-03-22 | 2020-12-18 | 中芯国际集成电路制造(上海)有限公司 | 半导体装置及其制造方法 |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5198392A (en) * | 1989-11-20 | 1993-03-30 | Oki Electric Industry Co., Ltd. | Method of forming a nitrided silicon dioxide (SiOx Ny) film |
US5252515A (en) * | 1991-08-12 | 1993-10-12 | Taiwan Semiconductor Manufacturing Company | Method for field inversion free multiple layer metallurgy VLSI processing |
US5455204A (en) * | 1994-12-12 | 1995-10-03 | International Business Machines Corporation | Thin capacitor dielectric by rapid thermal processing |
-
1996
- 1996-07-12 JP JP18373896A patent/JP3981426B2/ja not_active Expired - Fee Related
-
1997
- 1997-07-07 US US08/888,470 patent/US5926741A/en not_active Expired - Lifetime
Cited By (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6984267B2 (en) | 1998-06-30 | 2006-01-10 | Fujitsu Limited | Manufacture system for semiconductor device with thin gate insulating film |
US7312138B2 (en) | 1999-04-28 | 2007-12-25 | Kabushiki Kaisha Toshiba | Semiconductor device and method of manufacture thereof |
US7425480B2 (en) | 1999-04-28 | 2008-09-16 | Kabushiki Kaisha Tohisba | Semiconductor device and method of manufacture thereof |
US7303946B1 (en) | 1999-04-28 | 2007-12-04 | Kabushiki Kaisha Toshiba | Method of manufacturing a semiconductor device using an oxidation process |
JP2010056558A (ja) * | 1999-06-24 | 2010-03-11 | Alcatel-Lucent Usa Inc | 半導体デバイス |
KR100380278B1 (ko) * | 2000-09-29 | 2003-04-16 | 주식회사 하이닉스반도체 | 반도체장치 및 그 제조방법 |
KR20040025187A (ko) * | 2002-09-18 | 2004-03-24 | 삼성전자주식회사 | 반도체 장치의 게이트 절연막 구조체 및 그 형성 방법 |
US7709403B2 (en) | 2003-10-09 | 2010-05-04 | Panasonic Corporation | Silicon carbide-oxide layered structure, production method thereof, and semiconductor device |
JP2012004275A (ja) * | 2010-06-16 | 2012-01-05 | Sumitomo Electric Ind Ltd | 炭化珪素半導体装置の製造方法 |
JP2020145366A (ja) * | 2019-03-08 | 2020-09-10 | 株式会社Screenホールディングス | 熱処理方法および熱処理装置 |
KR20210124945A (ko) * | 2019-03-08 | 2021-10-15 | 가부시키가이샤 스크린 홀딩스 | 열처리 방법 및 열처리 장치 |
US11322375B2 (en) | 2019-03-08 | 2022-05-03 | SCREEN Holdings Co., Ltd. | Light irradiation type heat treatment method and heat treatment apparatus |
US11901200B2 (en) | 2019-03-08 | 2024-02-13 | SCREEN Holdings Co., Ltd. | Light irradiation type heat treatment method and heat treatment apparatus |
Also Published As
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