JPH0799240A - スマート・パワー・チップ用基板内に絶縁トレンチを形成する方法 - Google Patents
スマート・パワー・チップ用基板内に絶縁トレンチを形成する方法Info
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Abstract
(57)【要約】
【目的】 論理回路及び高圧パワーデバイスを集積して
いるSOI基板に絶縁トレンチを形成し、トレンチの側
壁内に拡散領域を所定の大きさに形成することができ、
またトレンチをSOI基板の絶縁層をエッチングした場
合にも空洞を生じることなく満たすことのできる方法を
提供する。 【構成】 論理回路及び高圧パワーデバイスが集積され
ているSOI基板内に絶縁トレンチを形成するために、
SOI基板の絶縁層2まで達するトレンチ6をエッチン
グする。トレンチ6の側壁61がドーパントを含有する
被覆層7を備えることによりまたこの被覆層7からの拡
散によりトレンチ6に隣接して拡散領域8を形成する。
被覆層7を完全に除去した後シリコン層10を形成し、
熱酸化によりトレンチ内に絶縁構造物11を形成する。
いるSOI基板に絶縁トレンチを形成し、トレンチの側
壁内に拡散領域を所定の大きさに形成することができ、
またトレンチをSOI基板の絶縁層をエッチングした場
合にも空洞を生じることなく満たすことのできる方法を
提供する。 【構成】 論理回路及び高圧パワーデバイスが集積され
ているSOI基板内に絶縁トレンチを形成するために、
SOI基板の絶縁層2まで達するトレンチ6をエッチン
グする。トレンチ6の側壁61がドーパントを含有する
被覆層7を備えることによりまたこの被覆層7からの拡
散によりトレンチ6に隣接して拡散領域8を形成する。
被覆層7を完全に除去した後シリコン層10を形成し、
熱酸化によりトレンチ内に絶縁構造物11を形成する。
Description
【0001】
【産業上の利用分野】本発明はスマート・パワー・チッ
プ用の基板内に絶縁トレンチを形成する方法に関する。
プ用の基板内に絶縁トレンチを形成する方法に関する。
【0002】
【従来の技術】スマート・パワー・チップとは基板内に
論理回路と高圧パワーデバイスをモノリシックに集積し
た複合デバイスである。論理回路は約5Vの電圧レベル
で作動されるが、しかし高圧パワーデバイスでは500
Vまでの電圧が生じるため、論理回路と高圧パワーデバ
イスを電気的に絶縁する必要がある。
論理回路と高圧パワーデバイスをモノリシックに集積し
た複合デバイスである。論理回路は約5Vの電圧レベル
で作動されるが、しかし高圧パワーデバイスでは500
Vまでの電圧が生じるため、論理回路と高圧パワーデバ
イスを電気的に絶縁する必要がある。
【0003】高圧及び低圧デバイスを絶縁層分離により
電気的に相互に完全に絶縁することは公知である(例え
ばオハタ(Yu Ohata)その他による「IEEE
1987CICC」第443〜446頁参照)。その際
デバイスはSOI基板内に形成される。SOI基板は単
結晶シリコン基板上にSiO2からなる絶縁層及びこの
絶縁層上にありSOI基板の表面を囲む単結晶シリコン
層を含んでいる。SOI基板の絶縁層は垂直方向の絶縁
を保証し、一方デバイスの横方向の絶縁は絶縁材で満た
されたトレンチにより実現される。多くの用途において
デバイスの電圧挙動は、トレンチを酸化物で満たす前に
トレンチの側壁をその深さ全体を通してSOI基板の絶
縁層までn+又はp+ドープすることにより改善される
(ヤスハラ(N.Yasuhara)その他による「I
EDM1991」第141〜144頁参照)。
電気的に相互に完全に絶縁することは公知である(例え
ばオハタ(Yu Ohata)その他による「IEEE
1987CICC」第443〜446頁参照)。その際
デバイスはSOI基板内に形成される。SOI基板は単
結晶シリコン基板上にSiO2からなる絶縁層及びこの
絶縁層上にありSOI基板の表面を囲む単結晶シリコン
層を含んでいる。SOI基板の絶縁層は垂直方向の絶縁
を保証し、一方デバイスの横方向の絶縁は絶縁材で満た
されたトレンチにより実現される。多くの用途において
デバイスの電圧挙動は、トレンチを酸化物で満たす前に
トレンチの側壁をその深さ全体を通してSOI基板の絶
縁層までn+又はp+ドープすることにより改善される
(ヤスハラ(N.Yasuhara)その他による「I
EDM1991」第141〜144頁参照)。
【0004】横方向を絶縁するのにトレンチをエッチン
グした後まず側壁をドーピングすることが公知である。
このドーピングは例えばBSG又はPSGのようなドー
プされたガラス層からの拡散、気相からの被覆又はイオ
ン注入により行われる。引続きトレンチはSiO2で満
たされる。これは例えばSiO2の熱酸化又はCVD析
出により行われる。
グした後まず側壁をドーピングすることが公知である。
このドーピングは例えばBSG又はPSGのようなドー
プされたガラス層からの拡散、気相からの被覆又はイオ
ン注入により行われる。引続きトレンチはSiO2で満
たされる。これは例えばSiO2の熱酸化又はCVD析
出により行われる。
【0005】スマート・パワー・チップで5〜10のア
スペクト比(トレンチの幅と深さの割合)を有する約2
0μmの深さのトレンチが生じるので、イオン注入によ
り側壁をドーピングする際に一様な所定の大きさの拡散
領域を形成するには問題がある。イオン注入は角度をつ
けて行わなければならないが、その際ある程度均一なド
ーパント濃度を全ての壁面に保証するには基板を4回転
しなければならない。また少なくとも5×1015原子/
cm2の線量を必要とするため、この方法は極めて時間
を要する。
スペクト比(トレンチの幅と深さの割合)を有する約2
0μmの深さのトレンチが生じるので、イオン注入によ
り側壁をドーピングする際に一様な所定の大きさの拡散
領域を形成するには問題がある。イオン注入は角度をつ
けて行わなければならないが、その際ある程度均一なド
ーパント濃度を全ての壁面に保証するには基板を4回転
しなければならない。また少なくとも5×1015原子/
cm2の線量を必要とするため、この方法は極めて時間
を要する。
【0006】ガラス層からの拡散又は気相からの被覆に
よるドーピングの場合、拡散領域を形成後ドープされた
ガラスからなる層又は被覆層は、以後の工程中にこれら
の層からの制御不能の拡散又は設備の汚染を回避するた
め再び除去する必要がある。従ってドーパント源として
使用される層は完全に除去されなければならない。これ
らの層はSiO2に類するものであり、トレンチの底面
がSOI基板の絶縁層上に直接配設されているため、ト
レンチの底面にはエッチングストップが生じない。従っ
てこれらの層を完全に除去する際にSOI基板の絶縁層
に腐食が起こる。引続きトレンチを熱酸化によりSiO
2で満たすと、絶縁層の表面的又は内部までのエッチン
グによりもはや充填することのできない空洞が形成され
ることになる。CVDによるSiO2の使用下にトレン
チを満たすときには、常圧で一様性の十分でない析出を
生じるか又は低圧析出では析出率が極めて低くなること
を甘受しなければならない。
よるドーピングの場合、拡散領域を形成後ドープされた
ガラスからなる層又は被覆層は、以後の工程中にこれら
の層からの制御不能の拡散又は設備の汚染を回避するた
め再び除去する必要がある。従ってドーパント源として
使用される層は完全に除去されなければならない。これ
らの層はSiO2に類するものであり、トレンチの底面
がSOI基板の絶縁層上に直接配設されているため、ト
レンチの底面にはエッチングストップが生じない。従っ
てこれらの層を完全に除去する際にSOI基板の絶縁層
に腐食が起こる。引続きトレンチを熱酸化によりSiO
2で満たすと、絶縁層の表面的又は内部までのエッチン
グによりもはや充填することのできない空洞が形成され
ることになる。CVDによるSiO2の使用下にトレン
チを満たすときには、常圧で一様性の十分でない析出を
生じるか又は低圧析出では析出率が極めて低くなること
を甘受しなければならない。
【0007】
【発明が解決しようとする課題】本発明は、論理回路及
び高圧パワーデバイスを集積しているSOI基板に絶縁
トレンチを形成し、トレンチの側壁内に拡散領域を所定
の大きさに形成することができ、またトレンチをSOI
基板の絶縁層をエッチングした場合にも空洞を生じるこ
となく満たすことのできる方法を提供することを課題と
する。
び高圧パワーデバイスを集積しているSOI基板に絶縁
トレンチを形成し、トレンチの側壁内に拡散領域を所定
の大きさに形成することができ、またトレンチをSOI
基板の絶縁層をエッチングした場合にも空洞を生じるこ
となく満たすことのできる方法を提供することを課題と
する。
【0008】
【課題を解決するための手段】この課題は本発明によ
り、SOI基板が単結晶シリコン基板、その上に配設さ
れたSiO2からなる絶縁層及び更にその上に配設され
た単結晶シリコン層を含んでおり、単結晶シリコン層内
に絶縁層上にまで達するトレンチをエッチングし、トレ
ンチの側壁がドーパントを含んでいる被覆層を備えてお
り、被覆層からの拡散により単結晶シリコン層内にトレ
ンチに隣接して拡散領域を形成し、被覆層を完全に除去
し、ほぼ一様なエッジ被覆を有するシリコン層を形成
し、熱酸化により絶縁構造物をトレンチ内に形成するこ
とにより解決される。本発明方法ではシリコンを酸化す
る際約2倍の容量増大が生じるので、シリコン層の厚さ
は最大でトレンチの幅に対して1/4あればよい。シリ
コン層は特に非晶質にLPCVD法で析出される。シリ
コン層は多結晶に形成してもよい。しかし非晶質シリコ
ンは多結晶シリコンよりも微細な構造を示し、従ってそ
のエッジ被覆に一層良好な一様性もたらす。
り、SOI基板が単結晶シリコン基板、その上に配設さ
れたSiO2からなる絶縁層及び更にその上に配設され
た単結晶シリコン層を含んでおり、単結晶シリコン層内
に絶縁層上にまで達するトレンチをエッチングし、トレ
ンチの側壁がドーパントを含んでいる被覆層を備えてお
り、被覆層からの拡散により単結晶シリコン層内にトレ
ンチに隣接して拡散領域を形成し、被覆層を完全に除去
し、ほぼ一様なエッジ被覆を有するシリコン層を形成
し、熱酸化により絶縁構造物をトレンチ内に形成するこ
とにより解決される。本発明方法ではシリコンを酸化す
る際約2倍の容量増大が生じるので、シリコン層の厚さ
は最大でトレンチの幅に対して1/4あればよい。シリ
コン層は特に非晶質にLPCVD法で析出される。シリ
コン層は多結晶に形成してもよい。しかし非晶質シリコ
ンは多結晶シリコンよりも微細な構造を示し、従ってそ
のエッジ被覆に一層良好な一様性もたらす。
【0009】本発明による製造方法では、ドープされた
ガラス層を完全に除去するためSOI基板の絶縁層を完
全にエッチングすること自体は何ら問題とはならない。
それというのもエッチング除去された絶縁酸化物はシリ
コン層の表面酸化により大部分補われるからである。従
って本発明方法では常圧で析出された例えばBPSGの
ようなドープされたガラスを被覆層として使用すること
ができる。これらのドープされたガラス層はCMOSの
製造において平坦化のために標準的に使用されている。
これらのガラス層はBSG又はPSGの形で拡散源とし
て適している。スマート・パワー・チップにおける絶縁
トレンチに生じるようなアスペクト比ではこれらの常圧
CVD法によるガラスは好ましくない一様性を示す。従
ってこれらのガラスを被覆層として使用する場合被覆層
を完全に除去する際にSOI基板の絶縁層がエッチング
されることになる。
ガラス層を完全に除去するためSOI基板の絶縁層を完
全にエッチングすること自体は何ら問題とはならない。
それというのもエッチング除去された絶縁酸化物はシリ
コン層の表面酸化により大部分補われるからである。従
って本発明方法では常圧で析出された例えばBPSGの
ようなドープされたガラスを被覆層として使用すること
ができる。これらのドープされたガラス層はCMOSの
製造において平坦化のために標準的に使用されている。
これらのガラス層はBSG又はPSGの形で拡散源とし
て適している。スマート・パワー・チップにおける絶縁
トレンチに生じるようなアスペクト比ではこれらの常圧
CVD法によるガラスは好ましくない一様性を示す。従
ってこれらのガラスを被覆層として使用する場合被覆層
を完全に除去する際にSOI基板の絶縁層がエッチング
されることになる。
【0010】被覆層の除去後ほぼ一様なエッジ被覆を有
するSiO2 層及び/又はSi3N4層を形成し、それら
の表面にシリコン層を施すことは本発明の枠内にある。
引続きシリコン層を異方性エッチング処理でSiO2 又
はSi3N4 に対して選択的にエッチングするが、その
際SiO2 又はSi3N4 層の水平面が露出される。そ
の際SOI基板の単結晶シリコン層の垂直側面にシリコ
ンスペーサが生じる。熱酸化の際にこれらのシリコンス
ペーサは酸化され、容量増大により膨らむ。同時にトレ
ンチの底面に配置されているSiO2 層の部分が厚くな
る。
するSiO2 層及び/又はSi3N4層を形成し、それら
の表面にシリコン層を施すことは本発明の枠内にある。
引続きシリコン層を異方性エッチング処理でSiO2 又
はSi3N4 に対して選択的にエッチングするが、その
際SiO2 又はSi3N4 層の水平面が露出される。そ
の際SOI基板の単結晶シリコン層の垂直側面にシリコ
ンスペーサが生じる。熱酸化の際にこれらのシリコンス
ペーサは酸化され、容量増大により膨らむ。同時にトレ
ンチの底面に配置されているSiO2 層の部分が厚くな
る。
【0011】シリコンスペーサの酸化の際に絶縁構造物
が形成されるが、その対向側面間には自由空間が残る。
が形成されるが、その対向側面間には自由空間が残る。
【0012】この自由空間をもう1つのシリコン層の析
出及び逆エッチングによりシリコン充填材で満たすこと
は本発明の枠内にある。
出及び逆エッチングによりシリコン充填材で満たすこと
は本発明の枠内にある。
【0013】またCVD法で少なくともO3及びSi
(OC2H5)4 を含有する処理ガスの使用下に析出され
るSiO2で自由空間を満たしてもよい。CVD法でO3
及びSi(OC2H5)4 を含有する処理ガスを使用した
場合アスペクト比の高い狭いトレンチを空洞を生じるこ
となく満たすことができる。
(OC2H5)4 を含有する処理ガスの使用下に析出され
るSiO2で自由空間を満たしてもよい。CVD法でO3
及びSi(OC2H5)4 を含有する処理ガスを使用した
場合アスペクト比の高い狭いトレンチを空洞を生じるこ
となく満たすことができる。
【0014】
【実施例】本発明を実施例及び図面に基づき以下に詳述
する。
する。
【0015】SOI基板は単結晶シリコン基板1、絶縁
層2及び単結晶シリコン層3を含んでいる(図1参
照)。単結晶シリコン基板1は例えば5×1019ホウ素
/cm3のドーパント濃度で例えばp+ドープされてい
る。絶縁層2はSiO2からなり、例えば2μmの厚さ
を有する。単結晶シリコン層3は例えば4×1014燐/
cm3のドーパント濃度で弱くnドープされており、例
えば20μmの厚さを有する。このSOI基板は有利に
は直接ウェハボンディング(DWB)法又はシリコン直
接ボンディング(SDB)法により形成される(例えば
オハタ(Yu Ohata)その他による「IEEE1
987CICC」第443〜446頁参照)。
層2及び単結晶シリコン層3を含んでいる(図1参
照)。単結晶シリコン基板1は例えば5×1019ホウ素
/cm3のドーパント濃度で例えばp+ドープされてい
る。絶縁層2はSiO2からなり、例えば2μmの厚さ
を有する。単結晶シリコン層3は例えば4×1014燐/
cm3のドーパント濃度で弱くnドープされており、例
えば20μmの厚さを有する。このSOI基板は有利に
は直接ウェハボンディング(DWB)法又はシリコン直
接ボンディング(SDB)法により形成される(例えば
オハタ(Yu Ohata)その他による「IEEE1
987CICC」第443〜446頁参照)。
【0016】単結晶シリコン層3の表面にトレンチ用マ
スク4を形成する。それには単結晶シリコン層3の表面
をまず熱酸化するが、その際例えば50nmの厚さの熱
酸化によるSiO2からなる下部層41が生じる。その
上に例えば150nmの厚さのCVDによるSi3N4か
らなる中間層42を形成する。この中間層42上に例え
ば1000〜1600nmの厚さのCVDによるSiO
2からなる上部層43を析出する。この下部層41、中
間層42及び上部層43からなる成層をフォトレジスト
マスク5の使用下に例えばCHF3/O2によるドライエ
ッチングプロセスで構造化する。
スク4を形成する。それには単結晶シリコン層3の表面
をまず熱酸化するが、その際例えば50nmの厚さの熱
酸化によるSiO2からなる下部層41が生じる。その
上に例えば150nmの厚さのCVDによるSi3N4か
らなる中間層42を形成する。この中間層42上に例え
ば1000〜1600nmの厚さのCVDによるSiO
2からなる上部層43を析出する。この下部層41、中
間層42及び上部層43からなる成層をフォトレジスト
マスク5の使用下に例えばCHF3/O2によるドライエ
ッチングプロセスで構造化する。
【0017】フォトレジストマスク5を除去した後トレ
ンチ6を単結晶シリコン層3内にエッチングする(図2
参照)。トレンチ6のエッチングは例えばCl2/O2で
の異方性ドライエッチングプロセスで行われる。HFに
浸漬してエッチング生成物を除去した後にはSOI基板
上にきれいな側壁61が形成される。
ンチ6を単結晶シリコン層3内にエッチングする(図2
参照)。トレンチ6のエッチングは例えばCl2/O2で
の異方性ドライエッチングプロセスで行われる。HFに
浸漬してエッチング生成物を除去した後にはSOI基板
上にきれいな側壁61が形成される。
【0018】トレンチ6を有する単結晶シリコン層3の
表面上に常圧CVD(APCVD)法でドープされたガ
ラスからなる被覆層7を施す。この被覆層7は例えばホ
ウ素4重量%を含有するホウ珪酸ガラス(BSG)から
なる。この被覆層7をトレンチ用マスク4の上方に例え
ば800〜1600nm、有利には1600nmの厚さ
に析出する。析出が一様でないため被覆層7の厚さはト
レンチ6の側壁61と底面では100〜200nmとな
る(図3参照)。トレンチ6の側壁61上に配置されて
いる被覆層7の部分は拡散源に用いられる。
表面上に常圧CVD(APCVD)法でドープされたガ
ラスからなる被覆層7を施す。この被覆層7は例えばホ
ウ素4重量%を含有するホウ珪酸ガラス(BSG)から
なる。この被覆層7をトレンチ用マスク4の上方に例え
ば800〜1600nm、有利には1600nmの厚さ
に析出する。析出が一様でないため被覆層7の厚さはト
レンチ6の側壁61と底面では100〜200nmとな
る(図3参照)。トレンチ6の側壁61上に配置されて
いる被覆層7の部分は拡散源に用いられる。
【0019】例えば1000℃での熱処理工程で30分
間被覆層7からドーパントをトレンチ6の側壁61を介
して単結晶シリコン層3内に打ち込むが、その際トレン
チ6に隣接して拡散領域8が生じる。この熱処理工程時
に被覆層は融解し、その結果析出後トレンチ用マスク4
の範囲内に生じたオーバーハングは消滅し、トレンチ6
の範囲内に被覆層7の垂直な側面が形成される。
間被覆層7からドーパントをトレンチ6の側壁61を介
して単結晶シリコン層3内に打ち込むが、その際トレン
チ6に隣接して拡散領域8が生じる。この熱処理工程時
に被覆層は融解し、その結果析出後トレンチ用マスク4
の範囲内に生じたオーバーハングは消滅し、トレンチ6
の範囲内に被覆層7の垂直な側面が形成される。
【0020】例えばフッ化水素酸浸漬による等方性湿式
化学エッチングでトレンチ6の側壁61及び底面に施さ
れた被覆層7の部分を除去する(図4参照)。このエッ
チング工程でSOI基板の絶縁層2の表面は腐食され
る。単結晶シリコン層3の下にある絶縁層2に数ナノメ
ータの横方向のアンダーエッチングが起こる。この等方
性湿式化学エッチングはトレンチ6の側壁61及び底面
に施された被覆層7の部分が除去されるまで続けられ
る。
化学エッチングでトレンチ6の側壁61及び底面に施さ
れた被覆層7の部分を除去する(図4参照)。このエッ
チング工程でSOI基板の絶縁層2の表面は腐食され
る。単結晶シリコン層3の下にある絶縁層2に数ナノメ
ータの横方向のアンダーエッチングが起こる。この等方
性湿式化学エッチングはトレンチ6の側壁61及び底面
に施された被覆層7の部分が除去されるまで続けられ
る。
【0021】トレンチ用マスク4の表面に施された被覆
層7の部分を異方性ドライエッチングにより除去する。
この異方性ドライエッチングは例えばCHF3/O2で行
われる。異方性ドライエッチングの際に同時にSOI基
板の絶縁層2及びトレンチ用マスク4の上部層43がエ
ッチング除去される(図5参照)。異方性ドライエッチ
ングはシリコンに対して選択的に行われる。それにより
SOI基板の単結晶シリコン基板1の表面がエッチング
されることがほぼ回避される。
層7の部分を異方性ドライエッチングにより除去する。
この異方性ドライエッチングは例えばCHF3/O2で行
われる。異方性ドライエッチングの際に同時にSOI基
板の絶縁層2及びトレンチ用マスク4の上部層43がエ
ッチング除去される(図5参照)。異方性ドライエッチ
ングはシリコンに対して選択的に行われる。それにより
SOI基板の単結晶シリコン基板1の表面がエッチング
されることがほぼ回避される。
【0022】次に例えばSiO2層9を例えば厚さ20
0nmに施す。このSiO2層9は一様なエッジ被覆と
なるように、例えば低圧CVD(LPCVD)法でSi
(OC2H5)4(TEOS)の分解により形成する。S
iO2層9上にシリコン層10が析出される。このシリ
コン層はLPCVD法で例えば400nmの厚さを有す
るほぼ一様なエッジ被覆となるように形成される(図6
参照)。シリコン層10はドープせずに非晶質に析出さ
れる。SiO2層9及びシリコン層10の層厚はトレン
チの直径に適合させられ、所定のトレンチの形状が得ら
れるように最適化されなければならない。トレンチの幅
はこの実施例では例えば2μmである。
0nmに施す。このSiO2層9は一様なエッジ被覆と
なるように、例えば低圧CVD(LPCVD)法でSi
(OC2H5)4(TEOS)の分解により形成する。S
iO2層9上にシリコン層10が析出される。このシリ
コン層はLPCVD法で例えば400nmの厚さを有す
るほぼ一様なエッジ被覆となるように形成される(図6
参照)。シリコン層10はドープせずに非晶質に析出さ
れる。SiO2層9及びシリコン層10の層厚はトレン
チの直径に適合させられ、所定のトレンチの形状が得ら
れるように最適化されなければならない。トレンチの幅
はこの実施例では例えば2μmである。
【0023】引続きSiO2に対しての選択的異方性エ
ッチングでシリコン層10をSiO2層9の水平方向の
表面が露出するまでエッチングする。その際トレンチ6
の側壁にシリコンスペーサ101が形成される(図7参
照)。異方性エッチングは例えばHBr/Cl2で行わ
れる。
ッチングでシリコン層10をSiO2層9の水平方向の
表面が露出するまでエッチングする。その際トレンチ6
の側壁にシリコンスペーサ101が形成される(図7参
照)。異方性エッチングは例えばHBr/Cl2で行わ
れる。
【0024】引続き熱酸化を行う。これは湿気雰囲気下
に例えば1000℃で行われる。その際シリコンスペー
サ101はSiO2に酸化され、絶縁構造物11を形成
する。酸化の際に容量の増大が起こる(図8参照)。同
時にトレンチ6の底面範囲のSiO2層9が厚くされ
る。トレンチ用マスク4の下部層41のエッジ範囲に表
面酸化によりバーズ・ビーク(鳥のくちばし状部分)1
2が形成される。
に例えば1000℃で行われる。その際シリコンスペー
サ101はSiO2に酸化され、絶縁構造物11を形成
する。酸化の際に容量の増大が起こる(図8参照)。同
時にトレンチ6の底面範囲のSiO2層9が厚くされ
る。トレンチ用マスク4の下部層41のエッジ範囲に表
面酸化によりバーズ・ビーク(鳥のくちばし状部分)1
2が形成される。
【0025】トレンチの底面範囲のSiO2層9が厚く
なることとトレンチの上側エッジにバーズ・ビーク12
が形成されることを回避しなければならない場合には、
SiO2層9の代わりにSi3N4層又はSiO2及びSi
3N4からなる二重層をその表面に形成してもよい。
なることとトレンチの上側エッジにバーズ・ビーク12
が形成されることを回避しなければならない場合には、
SiO2層9の代わりにSi3N4層又はSiO2及びSi
3N4からなる二重層をその表面に形成してもよい。
【0026】絶縁構造物11の対向側面間に残留する自
由空間をもう1つのシリコン層を析出及び逆エッチング
することによりシリコン充填材13で満たす(図9参
照)。このもう1つのシリコン層の逆エッチングはシリ
コン充填材13がほぼトレンチ用マスク4の下部層41
の高さまで達するように行われる。引続きSi3N4に対
する選択的エッチングでSiO2層9の露出部分を除去
する。エッチングはトレンチ用マスク4の中間層42の
表面が露出するまで進められる(図9参照)。
由空間をもう1つのシリコン層を析出及び逆エッチング
することによりシリコン充填材13で満たす(図9参
照)。このもう1つのシリコン層の逆エッチングはシリ
コン充填材13がほぼトレンチ用マスク4の下部層41
の高さまで達するように行われる。引続きSi3N4に対
する選択的エッチングでSiO2層9の露出部分を除去
する。エッチングはトレンチ用マスク4の中間層42の
表面が露出するまで進められる(図9参照)。
【0027】湿気雰囲気下で例えば1000℃の熱酸化
でシリコン充填材13の表面が酸化される。その際シリ
コン充填材13を完全に覆う絶縁カバー14が形成され
る(図10参照)。同時にバーズ・ビーク12が拡大さ
れる。このバーズ・ビーク12はエッジを丸めることに
より破壊電圧を高めるのに寄与する。
でシリコン充填材13の表面が酸化される。その際シリ
コン充填材13を完全に覆う絶縁カバー14が形成され
る(図10参照)。同時にバーズ・ビーク12が拡大さ
れる。このバーズ・ビーク12はエッジを丸めることに
より破壊電圧を高めるのに寄与する。
【0028】引続き平坦化処理の枠内でデバイスを単結
晶シリコン層3内に形成する。
晶シリコン層3内に形成する。
【0029】図8に示されている絶縁構造物11の対向
側面間の自由空間は場合によってはSiO2の一様な析
出により、有利にはO3及びSi(OC2H5)4を出発プ
ロセスガスとして使用してCVD法により満たしてもよ
い。
側面間の自由空間は場合によってはSiO2の一様な析
出により、有利にはO3及びSi(OC2H5)4を出発プ
ロセスガスとして使用してCVD法により満たしてもよ
い。
【0030】本発明方法ではCMOSの製造に際してト
レンチをドーピング及び充填する従来の方法のみが使用
される。その際CMOSの製造は論理回路の形成にいず
れにせよ必要であるため相乗的効果が期待される。
レンチをドーピング及び充填する従来の方法のみが使用
される。その際CMOSの製造は論理回路の形成にいず
れにせよ必要であるため相乗的効果が期待される。
【0031】本発明方法はSOI基板の絶縁層のエッチ
ングに対して抵抗性を有することから、比較的大きなプ
ロセスウインドウが可能となる。
ングに対して抵抗性を有することから、比較的大きなプ
ロセスウインドウが可能となる。
【0032】丸味のあるエッジとバーズ・ビークを同時
に有するトレンチ表面の自己整合された絶縁カバーによ
り改善された電気的特性が得られる。
に有するトレンチ表面の自己整合された絶縁カバーによ
り改善された電気的特性が得られる。
【図1】トレンチ用マスクを有するSOI基板の断面
図。
図。
【図2】トレンチをエッチングした後のSOI基板の断
面図。
面図。
【図3】被覆層の析出及びトレンチに隣接して拡散領域
を形成した後のSOI基板の断面図。
を形成した後のSOI基板の断面図。
【図4】トレンチの側壁及び底面被覆層を除去した後の
SOI基板の断面図。
SOI基板の断面図。
【図5】被覆層を完全に除去した後のSOI基板の断面
図。
図。
【図6】SiO2及びシリコン層を析出した後のSOI
基板の断面図。
基板の断面図。
【図7】シリコンスペーサを形成した後のSOI基板の
断面図。
断面図。
【図8】シリコンスペーサを熱酸化した後のSOI基板
の断面図。
の断面図。
【図9】絶縁構造物間の自由空間をシリコン充填材で満
たした後のSOI基板の断面図。
たした後のSOI基板の断面図。
【図10】シリコン充填材を表面酸化した後のSOI基
板の断面図。
板の断面図。
1 単結晶シリコン基板 2 SiO2絶縁層 3 単結晶シリコン層 4 トレンチ用マスク 41 下部層 42 中間層 43 上部層 5 フォトレジストマスク 6 トレンチ 61 トレンチの側壁 7 被覆層 8 拡散領域 9 SiO2 層(絶縁層) 10 シリコン層 101 シリコンスペーサ 11 絶縁構造物 12 バーズ・ビーク 13 充填材 14 絶縁カバー
Claims (9)
- 【請求項1】 論理回路及び高圧パワーデバイスが集積
されているSOI基板内に絶縁トレンチを形成する方法
において、 a)SOI基板が単結晶シリコン基板(1)、その上に
配設されたSiO2からなる絶縁層(2)及び更にその
上に配設された単結晶シリコン層(3)を含んでおり、 b)単結晶シリコン層(3)内に絶縁層(2)まで達す
るトレンチ(6)をエッチングし、 c)トレンチ(6)の側壁がドーパントを含む被覆層
(7)を備えており、 d)被覆層(7)からの拡散により単結晶シリコン層
(3)内にトレンチ(6)に隣接して拡散領域(8)を
形成し、 e)被覆層(7)を完全に除去し、 f)ほぼ同形のエッジ被覆を有するシリコン層(10)
を形成し、 g)熱酸化により絶縁構造物(11)をトレンチ(6)
内に形成することを特徴とするスマート・パワー・チッ
プ用基板内に絶縁トレンチを形成する方法。 - 【請求項2】 熱酸化を湿気雰囲気下に900〜120
0℃の温度範囲で行うことを特徴とする請求項1記載の
方法。 - 【請求項3】 ドープされたガラスからなる被覆層
(7)を常圧CVD法で形成することを特徴とする請求
項1又は2記載の方法。 - 【請求項4】 シリコン層(10)を非晶質に析出する
ことを特徴とする請求項1ないし3の1つに記載の方
法。 - 【請求項5】 被覆層(7)の除去後少なくともSiO
2 又はSi3N4 化合物の1つを含有するほぼ一様なエ
ッジ被覆を有する絶縁層(9)を形成し、その表面上に
シリコン層(10)を施し、このシリコン層(10)の
異方性エッチング処理で絶縁層(9)の水平面を露出
し、単結晶シリコン層(3)の垂直側面にはシリコンス
ペーサ(101)が残留するように絶縁層(9)に対し
て選択的にエッチングすることを特徴とする請求項1な
いし4の1つに記載の方法。 - 【請求項6】 もう1つのシリコン層を析出及び逆エッ
チングすることによりトレンチ(6)内の絶縁構造物
(11)内に残留する自由空間にシリコン充填材(1
3)を満たすことを特徴とする請求項5記載の方法。 - 【請求項7】 熱酸化によるSiO2 からなる下部層
(41)、CVDによるSi3N4 からなる中間層(4
2)及びCVDによるSiO2 からなる上部層(43)
からなる成層として形成されたトレンチ用マスク(4)
の使用下にトレンチ(6)をエッチングし、被覆層を除
去する際にトレンチ用マスク(4)の上部層(43)を
同時に除去し、シリコン充填材(13)がトレンチ用マ
スク(4)の下部層(41)に達するようにもう1つの
シリコン層を逆エッチングし、シリコン充填材(13)
を完全に覆う絶縁カバー(14)が生じるようにシリコ
ン充填材(13)の表面を酸化することを特徴とする請
求項6記載の方法。 - 【請求項8】 シリコン充填材(13)の表面酸化を湿
気雰囲気下に900〜1200℃の温度範囲で行うこと
を特徴とする請求項7記載の方法。 - 【請求項9】 少なくともO3及びSi(OC2H5)4を
含む処理ガスの使用下にCVD法によりトレンチ(6)
内の絶縁構造物(11)の内側に残留する自由空間をS
iO2充填材で満たすことを特徴とする請求項5記載の
方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE4320884.3 | 1993-06-23 | ||
DE4320884 | 1993-06-23 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0799240A true JPH0799240A (ja) | 1995-04-11 |
Family
ID=6491040
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6160624A Pending JPH0799240A (ja) | 1993-06-23 | 1994-06-20 | スマート・パワー・チップ用基板内に絶縁トレンチを形成する方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US5496765A (ja) |
EP (1) | EP0631305B1 (ja) |
JP (1) | JPH0799240A (ja) |
DE (1) | DE59405680D1 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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Families Citing this family (28)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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DE19528746C1 (de) * | 1995-08-04 | 1996-10-31 | Siemens Ag | Verfahren zum Erzeugen einer Siliziumdioxidschicht auf Oberflächenabschnitten einer Struktur |
JPH09172061A (ja) * | 1995-12-18 | 1997-06-30 | Fuji Electric Co Ltd | 半導体装置の製造方法 |
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